JP4542138B2 - 垂直色フィルタピクセルセンサに対する簡易化された配線計画 - Google Patents
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- Transforming Light Signals Into Electric Signals (AREA)
Description
16 p型ウェル
18 n型LDD注入物
Claims (17)
- 半導体基板上に形成された活性化垂直色フィルタピクセルセンサであって、
第1極のフォト生成キャリアを収集するよう設定され、
対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって各々が分離され、互いに垂直な配列で実質的に各々が配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層と、
リセット信号線と、
行有効線と、
ソースフォロアドレイン電圧線と、
複数の列出力/参照電圧線と、
前記複数の検出層の1つと前記複数の列出力/参照電圧線の1つとの間で各々が接続され、前記リセット信号線に接続されたゲートを各々が有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記複数の列出力/参照電圧線の1つに接続されたソースとを各々が有する複数の出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成され、そのような活性化ピクセルセンサの複数の行及び列を有するアレーの行(m)及び列(n)に関連付けられた活性化垂直色フィルタピクセルセンサであって、
第1極のフォト生成キャリアを収集するよう設定され、複数の第1及び複数の第2検出層が対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離され、互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層と、
前記アレーの行(m)に関連付けられたリセット信号/行有効線と、
前記アレーの行(m+1)に関連付けられたリセット信号/行有効線と、
ソースフォロアドレイン電圧線と、
前記アレーの列(n)に各々が関連付けられた複数の列出力/参照電圧線と、
前記複数の検出層の1つと前記複数の列出力/参照電圧線の1つとの間で各々が接続され、前記アレーの前記行(m+1)に関連付けられた前記リセット信号/行有効線に接続されたゲートを各々が有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、 前記アレーの前記行(m)に関連付けられた前記リセット信号/行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記複数の列出力/参照電圧線に接続されたソースとを各々が有する複数の出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、複数の列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効線と、
ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離された複数の検出層と、
前記複数の検出層の1つと前記複数の列出力/参照電圧線の1つとの間に各々が接続され、前記リセット信号/行有効線に接続されたゲートを各々が有する複数のリセットトランジスタと、
ゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記リセット信号/行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの各々の前記ソースに接続されたドレインと、前記複数の列出力/参照電圧線の各々に接続されたソースとを各々が有する複数の出力有効トランジスタとを含み、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記複数のソースフォロアトランジスタの各々の前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサの複数の検出層の1つに接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、複数の列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効線と、
ソースフォロアドレイン電圧/参照電圧線と、
複数のピクセルセンサとを具備し、各々は、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離された複数の検出層と、
前記複数の検出層の1つと前記ソースフォロアドレイン電圧/参照電圧線との間に各々が接続され、ゲートを有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記ソースフォロアドレイン電圧/参照電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記リセット信号/行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記列出力/参照電圧線に接続されたソースとを各々が有する複数の出力有効トランジスタとを含み、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記複数のリセットトランジスタの前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効線に接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサであって、
第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって第1及び第2検出層が分離され、互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層と、
リセット信号線と、
ソースフォロアドレイン電圧/参照電圧/行有効線と、
複数の列出力線と、
前記複数の検出層の1つと前記ソースフォロアドレイン電圧/参照電圧/行有効線との間に各々が接続され、前記リセット信号線に接続されたゲートを各々が有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記ソースフォロアドレイン電圧/参照電圧/行有効線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記ソースフォロアドレイン電圧/参照電圧/行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記複数の列出力線の1つに接続されたソースとを各々が有する複数の出力有効トランジスタと を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、複数の列出力/参照電圧線を含み、列(n)は、複数の行を含み、各行は、
リセット信号/行有効/ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離された複数の検出層と、
前記複数の検出層の1つと前記列出力/参照電圧線との間で各々が接続され、ゲートを各々が有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記複数の列出力/参照電圧線の1つに接続されたソースとを各々が有する複数の出力有効トランジスタとを含み、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記複数のリセットトランジスタの前記ゲートの各々は、前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効/ソースフォロアドレイン電圧線に接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効/ソースフォロアドレイン電圧線と、
複数の色有効線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離された複数の検出層と、
フォト充電出力信号ノードと、
前記複数の検出層の1つと前記フォト充電出力信号ノードとの間で各々が接続され、前記複数の色有効線の1つに接続されたゲートを各々が有する複数の色有効トランジスタと、
前記フォト充電出力信号ノードと前記列出力/参照電圧線との間で接続され、ゲートを有するリセットトランジスタと、
前記フォト充電出力信号ノードに接続されたゲートと、前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線に接続されたソースとを有する出力有効トランジスタとを含み、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記リセットトランジスタの前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効/ソースフォロアドレイン電圧線に接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、列出力線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号線と、
参照電圧/ソースフォロアドレイン電圧線と、
複数の色有効線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって分離された複数の検出層と、
フォト充電出力信号ノードと、
前記複数の検出層の1つと前記フォト充電出力信号ノードとの間で各々が接続され、前記複数の色有効線の1つに接続されたゲートを各々が有する複数の色有効トランジスタと、
前記フォト充電出力信号ノードと前記参照電圧/ソースフォロアドレイン電圧線との間で接続され、前記リセット信号線に接続されたゲートを有するリセットトランジスタと、 前記フォト充電出力信号ノードに接続されたゲートと、前記参照電圧/ソースフォロアドレイン電圧線に接続されたドレインと、列出力線に接続されたソースとを有するソースフォロアトランジスタとを含むことを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサであって、
リセット信号線と、
行有効線と、
ソースフォロアドレイン電圧線と、
第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離され、互いに垂直な配列で実質的に各々が配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層とを具備し、各検出層は、
列出力/参照電圧線と、
前記検出層と前記列出力/参照電圧線との間で接続され、前記リセット信号線に接続されたゲートを有するリセットトランジスタと、
前記検出層に接続されたゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記行有効線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線に接続されたソースとを含む出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成され、そのような活性化ピクセルセンサの複数の行及び列を有するアレーの行(m)及び列(n)に関連付けられた活性化垂直色フィルタピクセルセンサであって、
前記アレーの行(m)に関連付けられたリセット信号/行有効線と、
前記アレーの行(m+1)に関連付けられたリセット信号/行有効線と、
ソースフォロアドレイン電圧線と、
第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離され、互いに垂直な配列で実質的に各々が配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層とを具備し、各検出層は、
前記アレーの列(n)に関連付けられた列出力/参照電圧線と、
前記検出層と前記列出力/参照電圧線との間で接続され、前記アレーの前記行(m+1)に関連付けられた前記リセット信号/行有効線に接続されたゲートを有するリセットトランジスタと、
前記検出層に接続されたゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記アレーの前記行(m)に関連付けられた前記リセット信号/行有効線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線に接続されたソースとを有する出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、複数の列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効線と、
ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離された複数の検出層を含み、各検出層は、
前記検出層と前記列出力/参照電圧線の1つとの間で接続され、前記リセット信号/行有効線に接続されたゲートを有するリセットトランジスタと、
ゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記リセット信号/行有効線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線の1つに接続されたソースとを有する出力有効トランジスタとを具備し、
前記アレーの最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記ソースフォロアトランジスタの前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサの前記検出層に接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、複数の列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効線と、
ソースフォロアドレイン電圧/参照電圧線と、
複数のピクセルセンサとを具備し、各々は、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって各々が分離された複数の検出層を含み、各検出層は、
前記検出層と前記ソースフォロアドレイン電圧/参照電圧線との間で接続され、前記リセット信号/行有効線に接続されたゲートを有するリセットトランジスタと、
前記検出層に接続されたゲートと、前記ソースフォロアドレイン電圧/参照電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記リセット信号/行有効線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線の1つに接続されたソースとを有する出力有効トランジスタとを具備し、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記リセットトランジスタの前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効線に接続されることを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサであって、
リセット信号線と、
ソースフォロアドレイン電圧/参照電圧/行有効線と、
第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離され、互いに垂直な配列で実質的に各々が配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層とを具備し、各検出層は、
列出力線と、
前記検出層と前記ソースフォロアドレイン電圧/参照電圧/行有効線との間で接続され、前記リセット信号線に接続されたゲートを有するリセットトランジスタと、
前記検出層に接続されたゲートと、前記ソースフォロアドレイン電圧/参照電圧/行有効線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記ソースフォロアドレイン電圧/参照電圧/行有効線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記第1列出力線に接続されたソースとを有する出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、列出力/参照電圧線を含み、列(n)は、複数の行を含み、各行は、
リセット信号/行有効/ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離された複数の検出層を含み、各検出層は、
前記検出層と前記列出力/参照電圧線との間で接続され、ゲートを有するリセットトランジスタと、
前記検出層に接続されたゲートと、前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたゲートと、前記第1ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記第1列出力/参照電圧線に接続されたソースとを有する出力有効トランジスタとを具備し、
前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記リセットトランジスタの前記ゲートは、前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効/ソースフォロアドレイン電圧線に接続されることを特徴とするアレー。 - 半導体基板上に形成される活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、列出力/参照電圧線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号/行有効/ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
フォト充電出力信号ノードと、
前記フォト充電出力信号ノードと前記列出力/参照電圧線との間で接続され、前記アレーにおける最後の行以外の列(n)の各行(m)における各ピクセルセンサの前記リセットトランジスタのゲートが前記列(n)の行(m+1)におけるピクセルセンサのリセット信号/行有効/ソースフォロアドレイン電圧線に接続されている前記ゲートを有するリセットトランジスタと、
前記フォト充電出力信号ノードに接続されたゲートと、前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを有するソースフォロアトランジスタと、
前記リセット信号/行有効/ソースフォロアドレイン電圧線に接続されたゲートと、前記ソースフォロアトランジスタの前記ソースに接続されたドレインと、前記列出力/参照電圧線に接続されたソースとを有する出力有効トランジスタと、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離された検出層とを含み、各検出層は、
色有効線と、
前記検出層と前記フォト充電出力信号ノードとの間で接続され、前記色有効線に接続されたゲートを有する色有効トランジスタとを具備することを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサの複数の行及び列を含むアレーにおいて、アレー列(n)は、列出力線を含み、列(n)は、複数の行を具備し、各行は、
リセット信号線と、
参照電圧/ソースフォロアドレイン電圧線と、
複数のピクセルセンサとを具備し、各ピクセルセンサは、
フォト充電出力信号ノードと、
前記フォト充電出力信号ノードと前記参照電圧/ソースフォロアドレイン電圧線との間で接続され、前記リセット信号線に接続されたゲートを有するリセットトランジスタと、
前記フォト充電出力信号ノードに接続されたゲートと、前記参照電圧/ソースフォロアドレイン電圧線に接続されたドレインと、列出力線に接続されたソースとを有するソースフォロアトランジスタと、
互いに垂直な配列で実質的に配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有し、第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって互いに各々が分離された複数の検出層とを含み、各検出層は、
色有効線と、
前記検出層と前記フォト充電出力信号ノードとの間で接続され、前記色有効線に接続されたゲートを有する色有効トランジスタとを具備することを特徴とするアレー。 - 半導体基板上に形成された活性化垂直色フィルタピクセルセンサであって、
第1極のフォト生成キャリアを収集するよう設定され、対極のフォト生成キャリアを収集及び追い出すよう設定された追加の介在層によって各々が分離され、互いに垂直な配列で実質的に各々が配設され、半導体基板におけるそれらの異なる深さの関数として異なるスペクトル感度を有する複数の検出層と、
リセット信号線と、
行有効線と、
ソースフォロアドレイン電圧線と、
複数の列出力/参照電圧線と、
前記複数の検出層の1つと前記複数の列出力/参照電圧線の1つとの間で各々が接続され、前記リセット信号線に接続されたゲートを各々が有する複数のリセットトランジスタと、
前記複数の検出層の1つに接続されたゲートと、前記ソースフォロアドレイン電圧線に接続されたドレインと、ソースとを各々が有する複数のソースフォロアトランジスタと、
前記行有効線に接続されたゲートと、前記複数のソースフォロアトランジスタの1つの前記ソースに接続されたドレインと、前記複数の列出力/参照電圧線の1つに接続されたソースとを各々が有する複数の出力有効トランジスタと
を具備することを特徴とする活性化垂直色フィルタピクセルセンサ。
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