JP4210244B2 - エレクトロルミネセンス表示装置 - Google Patents
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Description
また、ゲートライン及びデータラインの交差部にマトリックス状に配置されたエレクトロルミネセンスセルと、前記エレクトロルミネセンスセルに駆動電圧を供給するための電圧供給ラインと、ビデオ信号に応答して前記電圧供給ラインの駆動電圧から前記エレクトロルミネセンスセルに供給される電流を制御するための駆動回路と、前記ビデオ信号を前記駆動回路に供給するための制御回路と、i(iは自然数)番目のゲートラインに供給されるゲート信号は、i+1番目のゲートラインに供給されるゲート信号と1水平期間の間重畳されるように、前記ゲートラインに2水平期間の間ターンオン電位を有するゲート信号を供給するゲートドライバとを具備し、前記駆動回路のそれぞれは、i番目の水平ラインに形成されて、i−1番目のゲートラインにゲート信号が供給される際に、i番目のゲートラインにより制御される制御回路からのビデオ信号に応答して前記i番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第1駆動回路と、i+1番目の水平ラインに形成されて、i+1番目のゲートラインに前記ゲート信号が供給される際に、前記i番目のゲートラインにより制御される制御回路からのビデオ信号に応答してi+1番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第2駆動回路とを備え、前記第1駆動回路は、前記電圧供給ラインにソース端子が接続されると共に前記i番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i−1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されたストレージキャパシターとを有し、前記第2駆動回路は、前記電圧供給ラインにソース端子が接続されると共に前記i+1番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i+1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されるストレージキャパシターとを有し、前記制御回路は、前記電圧供給ラインにソース端子が接続され、前記第2駆動薄膜トランジスタのソース端子にドレーン端子及びゲート端子が接続された第1制御薄膜トランジスタと、前記第1制御薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記データラインにソース端子が接続され、前記i番目のゲートラインにゲート端子が接続された第2制御薄膜トランジスタとを備える。
さらに、マトリックス状に配置された複数の画素セルと、ビデオ信号を前記画素セルに供給するための複数のデータ電極と、上下に隣接する前記画素セルに位置して前記データ電極と交差する複数のゲート電極と、前記画素セル毎に設置されたエレクトロルミネセンスセルと、前記エレクトロルミネセンスセルに駆動電圧を供給するための電圧供給ラインと、ビデオ信号に応答して前記エレクトロルミネセンスセルのそれぞれに前記ビデオ信号に対応する電流を供給するための駆動回路と、前記データ電極と接続されて前記データ電極に供給される前記ビデオ信号を前記駆動回路に供給するための制御回路と、i(iは自然数)番目のゲートラインに供給されるゲート信号は、i+1番目のゲートラインに供給されるゲート信号と1水平期間の間重畳されるように、ゲートラインに2水平期間の間ターンオン電位を有するゲート信号を供給するためのゲートドライバとを具備し、前記駆動回路のそれぞれは、i番目の水平ラインに形成されて、i−1番目のゲートラインにゲート信号が供給される際に、i番目のゲートラインにより制御される制御回路からのビデオ信号に応答して前記i番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第1駆動回路と、i+1番目の水平ラインに形成されて、i+1番目のゲートラインに前記ゲート信号が供給される際に、前記i番目のゲートラインにより制御される制御回路からのビデオ信号に応答してi+1番目の水平ラインに位置された前記エレクトロルミネセンスセルに前記電流を供給する第2駆動回路とを備え、前記第1駆動回路は、前記電圧供給ラインにソース端子が接続されると共に前記i番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i−1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されたストレージキャパシターとを有し、前記第2駆動回路は、前記電圧供給ラインにソース端子が接続されると共に前記i+1番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i+1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されるストレージキャパシターとを有し、前記制御回路は、前記電圧供給ラインにソース端子が接続され、前記第2駆動薄膜トランジスタのソース端子にドレーン端子及びゲート端子が接続された第1制御薄膜トランジスタと、前記第1制御薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記データラインにソース端子が接続され、前記i番目のゲートラインにゲート端子が接続された第2制御薄膜トランジスタとを備える。
Claims (12)
- マトリックス状に配置された複数の画素セルと、
ビデオ信号を前記画素セルに供給するための複数のデータ電極と、
上下に隣接する前記画素セルに接続されて前記データ電極と交差する複数のゲートラインと、
i(iは自然数)番目のゲートラインに供給されるゲート信号は、i+1番目のゲートラインに供給されるゲート信号と1水平期間の間重畳されるように、(請求項2及び3を限定)前記ゲートラインに2水平期間の間ターンオン電位を有するゲート信号を供給するゲートドライバと、
を具備し、
前記駆動回路のそれぞれは、
i番目の水平ラインに形成されて、i−1番目のゲートラインにゲート信号が供給される際に、i番目のゲートラインにより制御される制御回路からのビデオ信号に応答して前記i番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第1駆動回路と、
i+1番目の水平ラインに形成されて、i+1番目のゲートラインに前記ゲート信号が供給される際に、前記i番目のゲートラインにより制御される制御回路からのビデオ信号に応答してi+1番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第2駆動回路と
を備え、
前記第1駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i−1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されたストレージキャパシターと
を有し、
前記第2駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i+1番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i+1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されるストレージキャパシターと
を有し、
前記制御回路は、
前記電圧供給ラインにソース端子が接続され、前記第2駆動薄膜トランジスタのソース端子にドレーン端子及びゲート端子が接続された第1制御薄膜トランジスタと、
前記第1制御薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記データラインにソース端子が接続され、前記i番目のゲートラインにゲート端子が接続された第2制御薄膜トランジスタと
を備える
ことを特徴とするエレクトロルミネセンス表示装置。 - ゲートライン及びデータラインの交差部にマトリックス状に配置されたエレクトロルミネセンスセルと、
前記エレクトロルミネセンスセルに駆動電圧を供給するための電圧供給ラインと、
ビデオ信号に応答して前記電圧供給ラインの駆動電圧から前記エレクトロルミネセンスセルに供給される電流を制御するための駆動回路と、
前記ビデオ信号を前記駆動回路に供給するための制御回路と、
i(iは自然数)番目のゲートラインに供給されるゲート信号は、i+1番目のゲートラインに供給されるゲート信号と1水平期間の間重畳されるように、前記ゲートラインに2水平期間の間ターンオン電位を有するゲート信号を供給するゲートドライバと(請求項4を請求項1と同様に補正:請求項13および14、図5及び図6)
を具備し、
前記駆動回路のそれぞれは、
i番目の水平ラインに形成されて、i−1番目のゲートラインにゲート信号が供給される際に、i番目のゲートラインにより制御される制御回路からのビデオ信号に応答して前記i番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第1駆動回路と、
i+1番目の水平ラインに形成されて、i+1番目のゲートラインに前記ゲート信号が供給される際に、前記i番目のゲートラインにより制御される制御回路からのビデオ信号に応答してi+1番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第2駆動回路と
を備え、
前記第1駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i−1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されたストレージキャパシターと
を有し、
前記第2駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i+1番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i+1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されるストレージキャパシターと
を有し、
前記制御回路は、
前記電圧供給ラインにソース端子が接続され、前記第2駆動薄膜トランジスタのソース端子にドレーン端子及びゲート端子が接続された第1制御薄膜トランジスタと、
前記第1制御薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記データラインにソース端子が接続され、前記i番目のゲートラインにゲート端子が接続された第2制御薄膜トランジスタと
を備える
ことを特徴とするエレクトロルミネセンス表示装置。 - 前記制御回路は、前記第1駆動回路と第2駆動回路との間に位置する
ことを特徴とする請求項2記載のエレクトロルミネセンス表示装置。 - 前記第2駆動回路は、i−1番目の水平ラインに形成され、前記i−1番目のゲートラインと接続される
ことを特徴とする請求項2記載のエレクトロルミネセンス表示装置。 - 前記第1駆動回路は、i+2番目の水平ラインに形成され、前記i+1番目のゲートラインと接続される
ことを特徴とする請求項2記載のエレクトロルミネセンス表示装置。 - 前記第1制御薄膜トランジスタ及び第2制御薄膜トランジスタの中のいずれか一つは、前記i番目の水平ラインに形成され、残りの一つは前記i+1番目の水平ラインに形成される
ことを特徴とする請求項2記載のエレクトロルミネセンス表示装置。 - 前記i−1番目のゲートライン及びi番目のゲートラインにゲート信号が供給されると、前記i−1番目のゲートラインと接続される第2駆動薄膜トランジスタ及びi番目のゲートラインに接続される第2制御薄膜トランジスタがターンオンされ、前記第2制御薄膜トランジスタがターンオンされると、前記データラインからのビデオ信号が前記i番目の水平ラインに位置した第1駆動薄膜トランジスタ及び第1制御薄膜トランジスタに供給される
ことを特徴とする請求項2記載のエレクトロルミネセンス表示装置。 - 前記i番目の水平ラインに位置した第1駆動薄膜トランジスタは、前記ビデオ信号に対応する前記電流を前記i番目の水平ラインのエレクトロルミネセンスセルに供給する
ことを特徴とする請求項7記載のエレクトロルミネセンス表示装置。 - 前記第1制御薄膜トランジスタは、前記ビデオ信号に対応する電流を前記電圧供給ラインから前記データラインに供給する
ことを特徴とする請求項7記載のエレクトロルミネセンス表示装置。 - 前記第1制御薄膜トランジスタに流れる前記電流に対応する電圧が前記ストレージキャパシターに貯蔵される
ことを特徴とする請求項9記載のエレクトロルミネセンス表示装置。 - マトリックス状に配置された複数の画素セルと、
ビデオ信号を前記画素セルに供給するための複数のデータ電極と、
上下に隣接する前記画素セルに位置して前記データ電極と交差する複数のゲート電極と、
前記画素セル毎に設置されたエレクトロルミネセンスセルと、
前記エレクトロルミネセンスセルに駆動電圧を供給するための電圧供給ラインと、
ビデオ信号に応答して前記エレクトロルミネセンスセルのそれぞれに前記ビデオ信号に対応する電流を供給するための駆動回路と、
前記データ電極と接続されて前記データ電極に供給される前記ビデオ信号を前記駆動回路に供給するための制御回路と、
i(iは自然数)番目のゲートラインに供給されるゲート信号は、i+1番目のゲートラインに供給されるゲート信号と1水平期間の間重畳されるように、ゲートラインに2水平期間の間ターンオン電位を有するゲート信号を供給するためのゲートドライバと
を具備し、
前記駆動回路のそれぞれは、
i番目の水平ラインに形成されて、i−1番目のゲートラインにゲート信号が供給される際に、i番目のゲートラインにより制御される制御回路からのビデオ信号に応答して前記i番目の水平ラインに位置した前記エレクトロルミネセンスセルに前記電流を供給する第1駆動回路と、
i+1番目の水平ラインに形成されて、i+1番目のゲートラインに前記ゲート信号が供給される際に、前記i番目のゲートラインにより制御される制御回路からのビデオ信号に応答してi+1番目の水平ラインに位置された前記エレクトロルミネセンスセルに前記電流を供給する第2駆動回路と
を備え、
前記第1駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i−1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されたストレージキャパシターと
を有し、
前記第2駆動回路は、
前記電圧供給ラインにソース端子が接続されると共に前記i+1番目の水平ラインに位置したエレクトロルミネセンスセルにドレーン端子が接続された第1駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記制御回路にソース端子が接続され、前記i+1番目のゲートラインにゲート端子が接続された第2駆動薄膜トランジスタと、
前記第1駆動薄膜トランジスタのソース端子とゲート端子との間に接続されるストレージキャパシターと
を有し、
前記制御回路は、
前記電圧供給ラインにソース端子が接続され、前記第2駆動薄膜トランジスタのソース端子にドレーン端子及びゲート端子が接続された第1制御薄膜トランジスタと、
前記第1制御薄膜トランジスタのゲート端子にドレーン端子が接続されると共に前記データラインにソース端子が接続され、前記i番目のゲートラインにゲート端子が接続された第2制御薄膜トランジスタと
を備える
ことを特徴とするエレクトロルミネセンス表示装置。 - 前記制御回路は、前記第1駆動回路と第2駆動回路との間に位置する
ことを特徴とする請求項11記載のエレクトロルミネセンス表示装置。
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