JP4148105B2 - Method for manufacturing SiC substrate - Google Patents
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Description
本発明は、SiC基板およびその製造方法に関し、特に、少なくとも片面が研磨されたSiC基板の製造方法に関する。 The present invention relates to a SiC substrate and a method for manufacturing the same, and more particularly to a method for manufacturing a SiC substrate having at least one surface polished.
近年、光ディスクに高記録密度で情報を記録・再生するための光源として、また、画像をフルカラーで表示したり、照明として用いるための光源として、GaN系半導体を発光層とし、紫外領域や青色などの短波長の光を出射し得るレーザおよび発光ダイオードが求められている。GaN系半導体は、一般に結晶欠陥の少ない大きな単結晶インゴットの形状に成長させることが難しい。このため、サファイア単結晶基板やSiC単結晶基板上に、GaN系半導体層をエピタキシャル成長させる技術が注目されており、GaN系半導体層を形成するための、サファイア単結晶基板やSiC単結晶基板が求められている。 In recent years, as a light source for recording / reproducing information with high recording density on an optical disc, and as a light source for displaying an image in full color or for use as illumination, a GaN-based semiconductor is used as a light emitting layer, and ultraviolet region, blue, etc. There is a need for a laser and a light emitting diode that can emit light having a short wavelength. GaN-based semiconductors are generally difficult to grow into a large single crystal ingot shape with few crystal defects. For this reason, a technique for epitaxially growing a GaN-based semiconductor layer on a sapphire single-crystal substrate or a SiC single-crystal substrate has attracted attention, and a sapphire single-crystal substrate or a SiC single-crystal substrate for forming a GaN-based semiconductor layer is required. It has been.
また、SiC単結晶基板は、高い品質のSiC半導体層を形成するための基板としても求められている。SiC半導体はGaAs半導体に比べてバンドギャップが広く、絶縁破壊電界および熱伝導率が大きいため、SiC単結晶基板上高品質のSiC半導体層を形成し、高温で動作する半導体素子や高耐圧のパワー半導体素子を実現する研究・開発がなされている。このほか、半導体プロセスにおいて、耐熱性、高熱伝導性、高温強度、低熱膨張、耐摩耗性等に優れているという理由からも、SiCからなるダミーウエハが求められている。 Further, the SiC single crystal substrate is also demanded as a substrate for forming a high-quality SiC semiconductor layer. SiC semiconductors have a wider band gap, larger dielectric breakdown electric field, and higher thermal conductivity than GaAs semiconductors. Therefore, high-quality SiC semiconductor layers are formed on SiC single crystal substrates, and semiconductor devices that operate at high temperatures and high breakdown voltage power. Research and development to realize semiconductor devices has been conducted. In addition, dummy wafers made of SiC are also required for semiconductor processes because of their excellent heat resistance, high thermal conductivity, high temperature strength, low thermal expansion, wear resistance, and the like.
こうした用途のためのサファイア単結晶基板やSiC基板には、基板の平坦性、基板表面の平滑性等において高い加工精度が要求される。しかし、サファイア単結晶やSiCは一般に硬度が高く、かつ、耐腐食性に優れるため、こうした基板を作製する場合の加工性は悪く、加工精度の高いサファイア単結晶基板やSiC基板を得ることは難しい。 Sapphire single crystal substrates and SiC substrates for such applications are required to have high processing accuracy in terms of substrate flatness, substrate surface smoothness, and the like. However, since sapphire single crystal and SiC are generally high in hardness and excellent in corrosion resistance, the workability in producing such a substrate is poor, and it is difficult to obtain a sapphire single crystal substrate or SiC substrate with high processing accuracy. .
特に、特許文献1に記載されているように、サファイア単結晶の塊体を切断・ラッピング後、表面に鏡面仕上げを施した場合、加工歪が生じている加工変質層が裏面に残るため、基板が反ってしまうという問題が生じる。このため、このような基板を用いてフォトリソグラフィを行う場合、露光装置などにおいて基板を真空吸着できなかったり、基板の平面度が悪いために露光の精度が悪くなるという不具合が生じる。また、このような加工変質層が残っている基板に金属やセラミックス等の薄膜を積層した場合、基板の残留応力に薄膜の持つ応力が加わることによって、基板が割れてしまうという問題が生じる。
In particular, as described in
このため、特許文献1は、サファイア単結晶基板を加熱したリン酸または苛性カリ中に浸漬し、基板に残存する加工変質層を溶解することによって除去し、基板の反りを解消する技術を開示している。
For this reason,
しかしながら、SiC基板の場合、SiCを加熱したリン酸または苛性カリで溶解することはできない。SiCを溶解する溶液として、300℃以上に過熱された溶融アルカリが知られているが、高温の溶融アルカリを安全に取り扱うためには大掛かりな設備が必要となる。 However, in the case of a SiC substrate, SiC cannot be dissolved with heated phosphoric acid or caustic potash. As a solution for dissolving SiC, molten alkali heated to 300 ° C. or higher is known, but large-scale equipment is required to safely handle high-temperature molten alkali.
特許文献1は、サファイア単結晶基板の加工変質層を除去する他の方法として、イオンスパッタリングおよびイオンエッチングを用いてもよいことを開示している。しかし、これらの方法は加速されたアルゴンなどのイオンを基板の表面に衝突させることにより、イオンの物理的エネルギを利用して基板表面のエッチングを行うものであり、エッチング速度が遅いという問題がある。
また、SiCの融点は2000℃以上であるため、アニール処理によって加工歪を除去するためには、SiC基板を1600℃以上にまで加熱する必要がある。このような高温での熱処理をSiC基板に施すためには、大掛かりな設備を必要とする。
本発明は上記課題に鑑みてなされたものであって、その目的とするところは、実用的な条件によって加工変質層が除去されたSiC基板およびSiC基板の製造方法を提供することにある。 The present invention has been made in view of the above problems, and an object of the present invention is to provide a SiC substrate from which a work-affected layer has been removed under practical conditions and a method for manufacturing the SiC substrate.
本発明のSiC基板の製造方法は、第1および第2の主面を備え、機械的平面加工あるいは切削加工により生じた加工変質層を前記第1の主面に有するSiC基板から、前記加工変質層の少なくとも一部を気相エッチング法により除去する工程(a)を包含する。 The SiC substrate manufacturing method of the present invention includes the first and second main surfaces, the SiC substrate having a work-affected layer generated by mechanical plane machining or cutting on the first main surface, and the work-affected alteration. A step (a) of removing at least a part of the layer by a vapor-phase etching method;
ある好ましい実施形態において、前記気相エッチング法は反応性イオンエッチング法である。 In a preferred embodiment, the gas phase etching method is a reactive ion etching method.
ある好ましい実施形態において、前記第2の主面は前記SiC基板において素子を形成する面である。 In a preferred embodiment, the second main surface is a surface on which an element is formed on the SiC substrate.
ある好ましい実施形態において、SiC基板の製造方法は、前記第2の主面を鏡面研磨する工程(b)をさらに包含する。 In a preferred embodiment, the method for manufacturing an SiC substrate further includes a step (b) of mirror-polishing the second main surface.
ある好ましい実施形態において、前記SiC基板は機械的平面加工あるいは切削加工による加工変質層を前記第2の主面を有し、SiC基板の製造方法は、前記第2の主面の加工変質層の少なくとも一部を気相エッチング法により除去する工程(c)と、前記工程(a)および(c)の後、前記第1の主面および第2の主面のうち、少なくとも前記第2の主面を鏡面研磨する工程(d)とをさらに包含する。 In a preferred embodiment, the SiC substrate has the second main surface with a work-affected layer by mechanical flattening or cutting, and the method of manufacturing the SiC substrate includes the work-affected layer of the second main surface. After the step (c) of removing at least a part by a vapor phase etching method and the steps (a) and (c), at least the second main surface of the first main surface and the second main surface A step (d) of mirror-polishing the surface.
ある好ましい実施形態において、前記SiC基板は、前記機械的平面加工あるいは切削加工による加工変質層を第2の主面に有し、SiC基板の製造方法は、前記第2の主面の加工変質層を機械的研磨および化学的機械研磨によって除去し、前記第2の主面を鏡面に仕上げる工程(e)をさらに包含する。 In a preferred embodiment, the SiC substrate has a work-affected layer formed by the mechanical flattening or cutting on the second main surface, and the SiC substrate manufacturing method includes a work-affected layer on the second main surface. Is further removed by mechanical polishing and chemical mechanical polishing, and further includes a step (e) of finishing the second main surface into a mirror surface.
ある好ましい実施形態において、前記工程(a)により得られる前記第1の主面は10nm〜1μmの面粗度Raを有している。 In a preferred embodiment, the first main surface obtained by the step (a) has a surface roughness Ra of 10 nm to 1 μm.
ある好ましい実施形態において、SiC基板の製造方法は、SiCの塊体から前記SiC基板を切断する工程をさらに包含し、前記第1の主面および第2の主面は前記切断工程により形成されたものである。 In a preferred embodiment, the method of manufacturing an SiC substrate further includes a step of cutting the SiC substrate from a SiC lump, wherein the first main surface and the second main surface are formed by the cutting step. Is.
ある好ましい実施形態において、前記SiC基板の反りの変化を許容するように、前記工程(a)において、前記SiC基板を保持する。 In a preferred embodiment, the SiC substrate is held in the step (a) so as to allow a change in warpage of the SiC substrate.
ある好ましい実施形態において、前記気相エッチング法はフッ素を含むガスを用いる。 In a preferred embodiment, the gas phase etching method uses a gas containing fluorine.
ある好ましい実施形態において、前記フッ素を含むガスは、CF4またはSF6である。 In a preferred embodiment, the fluorine-containing gas is CF 4 or SF 6 .
ある好ましい実施形態において、前記気相エッチング法により、前記加工変質層を0.5〜20μm/Hrの範囲のエッチング速度で除去する。 In a preferred embodiment, the work-affected layer is removed at an etching rate in the range of 0.5 to 20 μm / Hr by the vapor phase etching method.
ある好ましい実施形態において、前記SiC基板は非晶質、多結晶または単結晶である。 In a preferred embodiment, the SiC substrate is amorphous, polycrystalline or single crystal.
本発明のSiC基板は、上記いずれかの方法により製造される。 The SiC substrate of the present invention is manufactured by any one of the above methods.
本発明のSiC基板は、実質的に並行な2つの主面を備え、前記2つの主面の一方のみが鏡面仕上げされており、反りが±50μm以下である。 The SiC substrate of the present invention comprises two substantially parallel principal surfaces, and only one of the two principal surfaces is mirror-finished, and the warpage is ± 50 μm or less.
本発明によれば、SiC基板に形成された加工変質層を実用的なエッチング速度で容易に除去することができる。したがって、平坦なSiC基板を容易に製造することができる。また、加工面の面粗度をほとんど変えることなく、加工変質層を除去できるため、片面のみに鏡面仕上げが施された基板を製造することもできる。 According to the present invention, the work-affected layer formed on the SiC substrate can be easily removed at a practical etching rate. Therefore, a flat SiC substrate can be easily manufactured. Further, since the work-affected layer can be removed with almost no change in the surface roughness of the processed surface, a substrate having a mirror finish on only one surface can be produced.
本願発明では、機械的平面加工あるいは切削加工によりSiC基板に生じた加工変質層を気相エッチング法により除去する。特に、気相エッチング法には反応性ガスを用いることが好ましい。たとえば、反応性ガスを用いたイオンビームエッチング法や反応性イオンエッチング(RIE)を本発明に用いることができ、化学的反応性が高い反応性イオンエッチングを用いることがより好ましい。 In the present invention, the work-affected layer generated on the SiC substrate by mechanical planar processing or cutting is removed by a vapor phase etching method. In particular, it is preferable to use a reactive gas in the vapor phase etching method. For example, an ion beam etching method using reactive gas or reactive ion etching (RIE) can be used in the present invention, and it is more preferable to use reactive ion etching with high chemical reactivity.
半導体装置の製造分野では、半導体層や絶縁層などの薄膜を反応性イオンエッチングによって除去する方法が従来より知られている。しかし、この分野では、薄膜形成装置で形成した薄膜のパターニングやエッチング、あるいは半導体基板表面の酸化層の除去などに反応性イオンエッチングが用いられ、エッチング量も典型的には数百nm以下である。また、反応性イオンエッチング法を用いた場合、プラズマによるダメージが半導体層に生じ易いことが知られている。このため、半導体層に生じるダメージが問題となる場合には、エッチング液を用いたウエットエッチング法により半導体層や絶縁層を除去したり、反応性イオンエッチング法によるエッチングのあと、反応性イオンエッチングによるダメージが生じた半導体領域をウエットエッチングにより除去することが行われていた。つまり、ウエットエッチングを用いることが好ましい工程では反応性イオンエッチングによるエッチングは適切な方法ではない場合が多い。 In the field of manufacturing semiconductor devices, a method of removing thin films such as a semiconductor layer and an insulating layer by reactive ion etching is conventionally known. However, in this field, reactive ion etching is used for patterning and etching of a thin film formed by a thin film forming apparatus or removal of an oxide layer on the surface of a semiconductor substrate, and the etching amount is typically several hundred nm or less. . Further, it is known that plasma damage is likely to occur in the semiconductor layer when the reactive ion etching method is used. For this reason, when the damage generated in the semiconductor layer becomes a problem, the semiconductor layer or the insulating layer is removed by a wet etching method using an etchant, or the reactive ion etching is performed after the reactive ion etching method. The damaged semiconductor region has been removed by wet etching. That is, in a process where it is preferable to use wet etching, etching by reactive ion etching is often not an appropriate method.
このような背景にもかかわらず、本願発明者は、気相エッチング、好ましくはフッ素を含むガスを用いた反応性イオンエッチングにより、実用的なエッチング速度でSiC基板を削ることができることを見出した。薄膜ではないSiC基板を気相エッチングを用い、数ミクロンのオーダーで削るという発想は半導体装置の製造分野ではこれまでになかった。特に、本発明では、気相エッチングにより、半導体素子を形成する面とは反対の面に生じた加工変質層を除去することを特徴とする。以下において詳細に説明するように、このとき、SiC基板に反りが生じていても、表面からほぼ均一に加工変質層をエッチングでき、加工変質層の除去にともなってSiC基板の反りが解消する。このため、基板の平行度やTTV(Total Thickness Variation)に優れたSiC基板を製造することができる。本発明によれば、直径4インチ以下のSiC基板の反りを±50μm以内にすることができる。このような反りの小さいSiC基板は従来の製造方法では得られなかった。 In spite of such a background, the present inventor has found that SiC substrates can be scraped at a practical etching rate by gas phase etching, preferably reactive ion etching using a gas containing fluorine. The idea of cutting a SiC substrate that is not a thin film on the order of several microns using vapor phase etching has never been present in the field of semiconductor device manufacturing. In particular, the present invention is characterized in that a work-affected layer generated on a surface opposite to a surface on which a semiconductor element is formed is removed by vapor phase etching. As will be described in detail below, at this time, even if the SiC substrate is warped, the work-affected layer can be etched almost uniformly from the surface, and the warpage of the SiC substrate is eliminated as the work-affected layer is removed. For this reason, it is possible to manufacture a SiC substrate having excellent substrate parallelism and TTV (Total Thickness Variation). According to the present invention, the warp of a SiC substrate having a diameter of 4 inches or less can be made within ± 50 μm. Such a SiC substrate with a small warpage could not be obtained by a conventional manufacturing method.
また、SiC基板に生じた加工変質層を除去するのに反応性イオンエッチングを用いても、SiC基板に生じる反応性イオンエッチングによるダメージは問題とならない。加工変質層を除去すべき主面は、鏡面研磨が施され半導体素子が形成される面とは反対の面であったり、加工変質層を反応性イオンエッチングにより除去したのち、鏡面研磨をさらに施すことが可能だからである。 Further, even if reactive ion etching is used to remove the work-affected layer generated in the SiC substrate, damage caused by reactive ion etching generated in the SiC substrate is not a problem. The main surface on which the work-affected layer is to be removed is the surface opposite to the surface on which the semiconductor element is formed by mirror polishing, or after the work-affected layer is removed by reactive ion etching, mirror polishing is further performed. Because it is possible.
以下本発明によるSiC基板の製造方法を具体的に説明する。図1に示すように、本発明で用いるSiC基板1は、SiCの塊体2から切り出される切片である。SiCの塊体2は、単結晶、多結晶および非晶質のいずれであってもよい。また、SiCの塊体2は、SiおよびC以外のAl、Zr、Y、Oなどの添加元素、あるいは、置換元素を含んでいてもよい。本願明細書においてSiC基板とは、添加元素あるいは置換元素を含有するSiCからなるSiC基板を含むものとする。
Hereinafter, a method for producing an SiC substrate according to the present invention will be described in detail. As shown in FIG. 1, the
SiC基板1の外形に特に制限はなく、種々の大きさ、厚さおよび平面形状のものを本発明に用いることができる。たとえば、GaN系半導体層のエピタキシャル成長用基板として単結晶からなるSiC基板1を用いる場合には、2インチの直径および500μm程度の厚さを備えた円板状のSiC基板1を用意する。
There is no particular limitation on the outer shape of
SiCの塊体2の切断には、外周刃または内周刃のカッティングブレードや、ワイヤーソーなどを用いることができる。このような切削加工により切り出されたSiC基板1は、図2に示すように、切削加工により形成される第1の主面1aおよび第2の主面1bの表面近傍に加工変質層3a、3bを含む。本願明細書において切削加工とは、上述した外周刃または内周刃のカッティングブレードによる切断およびワイヤーソーによる切断などをいう。
For cutting the
加工変質層3a、3bには機械的切断による加工歪が生じている。このため、第1の主面1aおよび第2の主面2bがそれぞれ凸状となるような圧縮応力が加工変質層3a、3bに働く。圧縮応力の大きさは加工変質層3a、3bの厚さに依存する。図1および図2から明らかなように、SiC基板1の第1の主面1aおよび第2の主面2bは、機械的切断により同じ条件で形成されるため、加工変質層3aおよび加工変質層3bの厚さは実質的に等しい。このため、加工変質層3aおよび加工変質層3bに働く圧縮応力が等しくなり、SiCの塊体2から切断されたSiC基板1全体としてはほとんど反りが生じない。加工変質層3a、3bの厚さは切断方法等の切断条件や基板の材質に依存するが、一般に切断により形成された面の最大面粗度Rmaxの約3〜10倍程度であると言われている。
In the work-affected
図1および図2では、SiCの塊体2から切り出されたSiC基板1を説明したが、本発明で用いるSiC基板は、焼結によって形成されたSiC板を研磨により薄板化したものでもよい。図3(a)に示すように、焼結により形成したSiC板4を用意し、第1の主面4aおよび第2の主面4bの少なくとも一方をラッピング装置などを用いて研磨することにより、機械的平面加工を施す。SiC板4の厚さが所望の値になるまで機械的平面加工を施すことにより、図3(b)に示すSiC基板4’が得られる。SiC基板4’は、その第2の主面4’bのみが機械的研磨により形成されており、機械的研磨により加工変質層3bが第2の主面4’bの表面近傍に形成されている。第1の主面4aは焼結により形成されたSiC板4であるため、第1の主面4aに加工変質層3bは形成されていない。このため、SiC基板4’は、加工変質層3bによる圧縮応力で、第2の主面4’bが凸状になるように反っている。
1 and 2, the
本願明細書において機械的平面加工とは、研磨剤を用いたラッピング装置による研磨およびバーティカルグラインダーによる研磨などを言う。基板主面の表面近傍に加工変質層が存在する場合、機械的平面加工によって基板を研磨することにより、その加工変質層は、除去される。しかし、機械的平面加工により、基板の主面の表面近傍領域に常に加工歪が発生し、新たな加工変質層が形成される。その結果、機械的平面加工が施された基板の主面は常に加工変質層が存在する。上述したように、この加工変質層の厚さは、表面の最大面粗度Rmaxに依存する。機械的平面加工により研磨された面は、おおよそ10nm〜1μm程度の面粗度Raを有する。 In the specification of the present application, the mechanical plane processing means polishing by a lapping apparatus using an abrasive, polishing by a vertical grinder, and the like. When a work-affected layer exists in the vicinity of the surface of the substrate main surface, the work-affected layer is removed by polishing the substrate by mechanical planar processing. However, due to mechanical plane processing, processing strain always occurs in the vicinity of the surface of the main surface of the substrate, and a new work-affected layer is formed. As a result, a work-affected layer is always present on the main surface of the substrate that has been subjected to mechanical planarization. As described above, the thickness of the work-affected layer depends on the maximum surface roughness Rmax. The surface polished by mechanical planarization has a surface roughness Ra of approximately 10 nm to 1 μm.
図3(c)に示すように、SiC板4の第1の主面4aおよび第2の主面4bを機械的研磨した場合には、第1の主面4’aおよび第2の主面4’bに加工変質層3a、3bが形成されたSiC基板4’が得られる。上述したように加工変質層3bの厚さは、第1の主面4’aおよび第2の主面4’b最大面粗度Rmaxに依存する。このため、第1の主面4aおよび第2の主面4bの研磨量にかかわらず、加工変質層3aおよび加工変質層3bの厚さはほぼ等しくなる。生じる圧縮応力も第1の主面4’a側および第2の主面4’b側で等しく、図3(c)に示すSiC基板4’には反りがほとんど生じない。
As shown in FIG. 3C, when the first main surface 4a and the second
次に、加工変質層3を反応性イオンエッチング法により除去する工程について説明する。反応性イオンエッチング法に用いる装置としては、平行平板型反応性イオンエッチング装置、ECR(Electron Cyclotron Resonance)反応性イオンエッチング装置、ICP(Inductively Coupled Plasma)エッチング装置など、半導体製造プロセスに用いられる種々の反応性イオンエッチング装置を用いることができる。エッチングには、Fを含むガスを用いることがこのましい。F2、CF4、CHF3、CH2F2、CH3F、SF6などを用いることができるが、CF4またはSF6を用いることがより好ましい。Fを含むガスに加えて、Ar、H2、O2、N2などの他のガスを混合して用いてもよい。
Next, the process of removing the work-affected
SiC基板1は、除去すべき加工変質層3が反応性イオンエッチング装置のチャンバ内で露出するように基板ホルダに保持される。このとき、基板ホルダはSiC基板1の反りがエッチング中に変化しても、反りの変化を許容してSiC基板1を保持できるよう、SiC基板1の全体を基板ホルダに貼り付けて固定しないことが好ましい。
The
投入する電力の大きさ、反応中のガス圧、および反応ガスのガス流量は、用いる装置の種類およびエッチング行うSiC基板の結晶状態、装置内に一度に導入するSiC基板の数に依存する。加工変質層を除去するエッチング速度が、0.5〜20μm/Hrになるよう、これらのパラメータを調整することが好ましい。0.5μm/Hrよりもエッチング速度が小さい場合、エッチング効率が悪く工程能力に問題があり、一般的な反応性エッチング装置では20μm/Hrよりもエッチング速度を大きくすることは難しい。実用的には1〜5μm/Hrのエッチング速度で加工変質層を削ることがより好ましい。 The magnitude of the electric power to be input, the gas pressure during the reaction, and the gas flow rate of the reaction gas depend on the type of apparatus used, the crystal state of the SiC substrate to be etched, and the number of SiC substrates introduced into the apparatus at one time. It is preferable to adjust these parameters so that the etching rate for removing the work-affected layer is 0.5 to 20 μm / Hr. When the etching rate is lower than 0.5 μm / Hr, the etching efficiency is poor and there is a problem in the process capability, and it is difficult to increase the etching rate beyond 20 μm / Hr with a general reactive etching apparatus. Practically, it is more preferable to cut the work-affected layer at an etching rate of 1 to 5 μm / Hr.
反応性イオンエッチング法により、SiC基板1の加工変質層は、エッチングガス中の化学種と化学反応し、気体となって除去される。反応性イオンエッチングによれば、エッチング前の表面状態を維持しながら加工変質層が除去される。したがって、反応性イオンエッチングの前後において基板表面の面粗度は、おおよそ維持される。
By the reactive ion etching method, the work-affected layer of
反応性イオンエッチング法による加工変質層の除去は、加工変質層表面とエッチングガスとの接触により進行するので、SiC基板1が反っていても加工変質層の表面からほぼ均一に進み、加工変質層の厚さが全体として均一に小さくなる。加工変質層が薄くなるのにともなって、加工変質層による応力が減少し、SiC基板1の反りが解消される。応力の釣り合いによって、加工変質層を除去する前にSiC基板1が平坦である場合には、加工変質層の除去によって応力のつり合いが崩れるため、逆に反りが生じる。このとき、SiC基板1は、反応性イオンエッチング装置の基板ホルダに貼り付けられていないので、反りの変化に応じてSiC基板1を保持することができる。
The removal of the work-affected layer by the reactive ion etching method proceeds by contact between the work-affected layer surface and the etching gas. Therefore, even if the
つまり、反応性イオンエッチング法による加工変質層の除去によれば、SiC基板1が反っていても、表面からほぼ均一加工変質層を除去することが可能であり、また、加工変質層の除去にともなって生じるSiC基板1の反りの変化を許容してSiC基板を保持できる。これにより、基板の反りの解消するとともに、高い平行度および小さな厚さばらつきを同時に達成することができる。
That is, according to the removal of the work-affected layer by the reactive ion etching method, it is possible to remove the substantially uniform work-affected layer from the surface even if the
なお、反応性イオンエッチング中、プラズマ状態になっているエッチングガスの化学種がSiC基板1と衝突し、SiC基板1の表面にダメージを与える可能性がある。上述したように、このようなプラズマによる基板表面のダメージは好ましくないものとされていた。しかし、本発明では、このダメージは問題とならない。なぜなら、以下において説明するように、反応性イオンエッチング法により除去される加工変質層が存在する主面は、基板としてエピタキシャル層を成長させる表面ではなかったり、ダメージが生じているSiC基板の表面領域がその後鏡面研磨工程により除去されるからである。
During reactive ion etching, the chemical species of the etching gas in the plasma state may collide with the
このように、本発明は加工変質層を反応性イオンエッチングによって除去することに1つの特徴を有する。そして、反応性イオンエッチングによる加工変質層の除去工程をSiC基板の研磨工程と組みあわせることにより従来得られなかった特徴を備えるSiC基板を作製することができる。 As described above, the present invention has one feature in removing the work-affected layer by reactive ion etching. And the SiC substrate provided with the characteristic which was not obtained conventionally is producible by combining the removal process of the process deterioration layer by reactive ion etching with the grinding | polishing process of a SiC substrate.
本発明において加工変質層の除去工程と組み合わせて用いられる工程としては、上述した機械的平面加工および鏡面研磨加工がある。鏡面研磨加工には、化学的エッチングをともなう化学的機械研磨(CMP)を用いることができる。化学的機械研磨は、研磨中に新たな加工歪を基板にほとんど発生させることなく、基板の表面領域を除去し、かつ、表面の面粗度を小さくすることができる。このため、機械的平面加工とは異なり、化学的機械研磨中新たな加工変質層が形成されることはなく、形成されているとしてもその厚さは非常に小さく、加工変質層による圧縮応力の影響はほとんど無視することができる。また、化学的機械研磨が施された表面は鏡面となる。鏡面状に仕上げられた面は、おおよそ1nm以下の面粗度Raを有する。化学的機械研磨には、コロイダルシリカを用いるものが一般的であるが、化学的機械研磨用の他の材料を用いてもよい。 Examples of the process used in combination with the process-affected layer removal process in the present invention include the above-described mechanical plane processing and mirror polishing. For the mirror polishing process, chemical mechanical polishing (CMP) with chemical etching can be used. The chemical mechanical polishing can remove the surface region of the substrate and reduce the surface roughness of the substrate with almost no new processing strain being generated on the substrate during polishing. For this reason, unlike mechanical planar processing, a new work-affected layer is not formed during chemical mechanical polishing, and even if it is formed, its thickness is very small. The impact can be almost ignored. The surface subjected to chemical mechanical polishing is a mirror surface. The mirror finished surface has a surface roughness Ra of approximately 1 nm or less. The chemical mechanical polishing is generally performed using colloidal silica, but other materials for chemical mechanical polishing may be used.
以下、本発明によるSiC基板の製造方法をより詳細に説明する。なお、図4、6および7の各図において、基板表面の粗さを示すため、基板の主面に仕上げ記号を付している。 Hereinafter, the manufacturing method of the SiC substrate by this invention is demonstrated in detail. 4, 6 and 7, a finishing symbol is attached to the main surface of the substrate in order to indicate the roughness of the substrate surface.
(第1の実施形態)
図4(a)に示すように、SiC基板1を用意する。図1および図2を参照して説明したように、SiC基板1は、SiCの塊体1からワイヤーソーなどによって切削加工されて切り出される。SiC基板1の第1の主面1aおよび第2の主面1bには切削加工による加工変質層3aおよび3bがそれぞれ形成されている。
(First embodiment)
As shown in FIG. 4A, an
まず、SiC基板1の第1の主面1aおよび第2の主面1bを、切削加工による面粗度よりも小さな面粗度となるよう、適切な研磨剤およびラッピング装置を用いて研磨する。これにより、図4(b)に示すように、第1の主面1aおよび第2の主面1bの加工変質層3a、3bの一部が除去される。
First, the 1st
次に加工変質層3bの残った第2の主面1bに化学的物理的研磨を施し、加工変質層3bを完全に除去する。第2の主面1bは後に半導体層などが形成され、半導体素子が形成される面である。これにより、図4(c)に示すように、鏡面状に仕上げられた第2の主面11bが形成される。第1の主面1a側には加工変質層3aがそのまま残っているので、SiC基板1は第1の主面1aが凸状になるよう全体が反る。
Next, chemical physical polishing is performed on the second
次に半導体素子を形成する面とは反対の面に残っている加工変質層3aを反応性エッチングにより除去する。反応性エッチング装置内の基板ホルダに第2の主面11bが下になるようSiC基板1を保持し、反応性エッチングを行うことにより、加工変質層3aを完全に除去する。このとき、第2の主面11bは基板ホルダに接しているため、実質的に全くエッチングされない。
Next, the work-affected
上述したように加工変質層3aが全体として均一に除去されるにつれてSiC基板1の反りは解消されてゆき、加工変質層3aを完全に除去されると、図4(d)に示すように、ほとんど反りのない実質的に平坦なSiC基板11が得られる。エッチングの前後において第1の主面の面粗度は維持される。このため、加工変質層3aが除去されて形成される第1の主面11aは機械的平坦加工による面粗度と同程度の面粗度を有する。最後にSiC基板11を洗浄することにより、片面のみが鏡面状に仕上げられた平坦なSiC基板11が得られる。
As described above, the warpage of the
上述したようにSiC基板11の第1の主面は機械的平坦加工によって得られる程度の面粗度を備えている。具体的には、第1の主面11aの面粗度Raは10nm〜1μm程度である。一方第2の主面11bは鏡面に仕上げられており、その面粗度Raは1nm以下である。また、SiC基板全体の平面度は直径2インチ程度の基板の場合、おおよそ±20μm以内である。なお、本実施形態では、第1の主面に機械的平面加工を施したが、基板の用途によっては、第1の主面を切削加工上がりの状態のままにしておいてもよい。
As described above, the first main surface of
このように本実施形態による片面のみに鏡面仕上げが施された基板は、たとえば半導体製造装置において、基板の表面と裏面との識別を容易に行うことができるという利点や、鏡面仕上げが施されていない面において光が散乱し、光を透過させないので、基板材料が光源に対して透明であっても露光装置を用いた露光を行うことができるという利点を備える。 As described above, the substrate having a mirror finish only on one side according to the present embodiment has an advantage that, for example, in a semiconductor manufacturing apparatus, the front surface and the back surface of the substrate can be easily distinguished, and the mirror finish is applied. Since light is scattered on a non-exposed surface and light is not transmitted, there is an advantage that exposure using an exposure apparatus can be performed even if the substrate material is transparent to the light source.
従来の技術によれば、片面のみが鏡面に仕上げられた平坦なSiC基板を製造することは非常に困難である。加工変質層を除去するには化学的物理的研磨を行う必要があり、これにより、面粗度は小さくなってしまうからである。このため、従来の片面のみが鏡面に仕上げられたSiC基板では、鏡面と逆の面に生じた加工変質層3aが残されたままになっており、加工変質層3aによる応力のため、基板の反りは60μm以上になっている。
According to the prior art, it is very difficult to manufacture a flat SiC substrate in which only one side is finished as a mirror surface. This is because chemical physical polishing is required to remove the work-affected layer, and the surface roughness is thereby reduced. For this reason, in the conventional SiC substrate in which only one surface is finished to be a mirror surface, the work-affected
なお、本実施形態の反応性エッチングの工程では、図5に示すように、半導体素子を形成する面である第2の主面11bを反応性エッチング装置の基板ホルダ20に対向させてSiC基板1を保持し、加工変質層3aのエッチングを行う。このとき、基板ホルダ20もエッチングガスに曝されるため、基板ホルダ20を構成するガスとエッチングガスとの組み合わせによっては、基板ホルダ20がエッチングされ、エッチングされた基板ホルダ20を構成する物質などの異物20’が、SiC基板1の第2の主面11bの外周11e近傍に付着する可能性がある。第2の主面11bは半導体素子を形成する面であるため、このような異物20’が第2の主面11bの外周11e近傍に付着するのは好ましくない。
In the reactive etching process of the present embodiment, as shown in FIG. 5, the
したがって、異物20’が付着した場合には、反応性エッチング後に異物20’を除去することが好ましい。SiC基板1をエッチングしたり、SiC基板1にダメージを与えないように、SiC基板1は実質的に溶解しないが、異物20’を溶解するような溶液を用い、ウエットエッチングにより異物20’を除去することが好ましい。つまり、SiC基板1を実質的に溶解しないエッチング液および、そのエッチング液により容易に溶解される材料で基板ホルダ20を構成することが好ましい。
Therefore, when the foreign matter 20 'adheres, it is preferable to remove the foreign matter 20' after reactive etching. The
本実施形態では、第1の主面11aを機械的平坦加工によって得られる程度の面粗度にしているが、更に化学的物理的研磨を施して第1の主面11aも鏡面に仕上げても良い。この場合、第1の主面11aの表面に加工変質層は存在しないため、従来の技術を用いて研磨を施す場合に比べて研磨時間を短くすることができる。SiC基板11に反りも生じていないため、鏡面仕上げにより、SiC基板11の平行度や反りを悪化させることはない。
In the present embodiment, the first main surface 11a has a surface roughness that can be obtained by mechanical flattening. However, the first main surface 11a may be mirror-finished by further chemical physical polishing. good. In this case, since the work-affected layer does not exist on the surface of the first main surface 11a, the polishing time can be shortened compared to the case where polishing is performed using the conventional technique. Since the
また、本実施形態において反応性エッチングを行う工程は、第2の主面11bを鏡面に仕上げた後である必要はない。たとえば、SiC基板1を切削加工により切り出した後、まず初めに加工変質層3aを反応性エッチングにより除去してもよい。
Further, the step of performing reactive etching in the present embodiment does not need to be performed after finishing the second
(第2の実施形態)
第1の実施形態と同様、図6(a)に示すように、SiC基板1を用意する。SiC基板1の第1の主面1aおよび第2の主面1bには切削加工または機械的平坦加工による加工変質層3aおよび3bがそれぞれ形成されている。
(Second Embodiment)
Similar to the first embodiment, an
まず、第1の主面1aおよび第2の主面1bに存在する加工変質層3aおよび3bを反応性エッチングにより完全に除去する。たとえば、反応性エッチング装置内の基板ホルダに第2の主面1bが基板ホルダに対向し、基板の反りの変化を許容するようにSiC基板1を保持し、反応性エッチングを行うことにより、加工変質層3aを完全に除去する。第1の実施形態で説明したように、反応性エッチングにより、加工変質層3aは全体として均一にエッチングされる。加工変質層3aの厚さが小さくなるにつれて、加工変質層3aおよび3bの厚さに差異が生じるため、応力差が発生し、SiC基板1には第2の主面1bが凸となるように反りが生じる。次にSiC基板1を裏返し、加工変質層3bを除去する。加工変質層3bの厚さが小さくなるにつれて応力差が小さくなり、基板の反りは解消される。これにより、図6(b)に示すように、第1の主面1’aおよび第2の主面1’bに加工変質層が存在しないSiC基板1’を得る。SiC基板1’にはその両主面に加工変質層が存在しないため、SiC基板1’にほとんど反りは生じていない。
First, the work-affected
次に第2の主面1’bに化学的機械研磨を施し、第2の主面1’bを鏡面状に仕上げる。これにより、図6(c)に示すように、鏡面状の第2の主面11bを有するSiC基板11が得られる。加工変質層が残存していないため、SiC基板11に反りは発生せず、直径2インチ程度の基板の場合、平面度はおよそ±20μm以内になっている。
Next, chemical mechanical polishing is applied to the second main surface 1'b to finish the second main surface 1'b into a mirror surface. Thereby, as shown in FIG.6 (c), the
なお、必要に応じて、第1の主面1’aに化学的機械研磨を施し、第1の主面1’aの面粗度を小さくしても良い。本実施形態によれば、第1の主面1’aは切削加工または機械的平面加工により得られる程度の大きな面粗度を有しているが、加工変質層は存在していない。このため、新たな加工変質層を形成しない化学的機械研磨を任意の時間だけ施して、第1の主面1’aの面粗度を調節することができる。 If necessary, the first main surface 1'a may be subjected to chemical mechanical polishing to reduce the surface roughness of the first main surface 1'a. According to the present embodiment, the first main surface 1'a has a surface roughness that is large enough to be obtained by cutting or mechanical planarization, but there is no work-affected layer. For this reason, it is possible to adjust the surface roughness of the first main surface 1'a by applying chemical mechanical polishing without forming a new work-affected layer for an arbitrary time.
(第3の実施形態)
第2の実施形態と同様の手順により、SiC基板1を用意し(図7(a))、加工変質層3aおよび3bを反応性エッチングにより除去する。これにより、図7(b)に示すように、実質的に平坦で、加工変質層のないSiC基板1’を用意する。SiC基板1’の第1の主面1’aおよび第2の主面1’bは、切削可能により得られる程度の面粗度を有している。
(Third embodiment)
The
次に、下定盤が凹状の曲面および上定盤が凸状の曲面を有するラッピング装置を用い、第2の主面1’bが下定盤に接するようにSiC基板1’を保持し、第1の主面1’aおよび第2の主面1’bに対して、化学的機械研磨を同時に施す。これにより、凸状の第2の主面12bおよび凹状の第1の主面12aを有する。つまり、鏡面に仕上げられた第2の主面12bが凸状となるよう湾曲したSiC基板12が得られる。
Next, using a lapping apparatus in which the lower surface plate has a concave curved surface and the upper surface plate has a convex curved surface, the
このように、加工変質層は通常、機械的平面加工あるいは切削加工により形成された面に対して均一には形成されない。したがって、加工変質層が存在したまま次の加工を行うと加工変質層による圧縮応力が存在するために、基板の形状を制御することは困難となる。しかし、本発明の方法によれば、あらかじめ加工変質層を除去するため、ラッピング装置の定盤の形状や加工方法を選択することによって、平面度や平行度、形状などを自在に制御することができる。たとえば、鏡面仕上げされた凸面を有し、その裏面が梨地状の平坦な面になっている基板や、表面と裏面とが実質的に平行に湾曲した形状の基板や、両面が凹面となっている基板などを作成することができる。 As described above, the work-affected layer is usually not uniformly formed on the surface formed by mechanical flattening or cutting. Therefore, if the next processing is performed while the work-affected layer is present, it becomes difficult to control the shape of the substrate because the compressive stress due to the work-affected layer exists. However, according to the method of the present invention, in order to remove the work-affected layer in advance, the flatness, parallelism, shape, etc. can be freely controlled by selecting the shape and processing method of the surface plate of the wrapping apparatus. it can. For example, a substrate having a mirror-finished convex surface, the back surface of which is a satin-like flat surface, a substrate having a curved surface substantially parallel to the front surface and the back surface, and both surfaces being concave. Can be created.
(実験例)
第1の実施形態において図4(c)に示すように、鏡面に仕上げられた第2の主面11bを有するSiCの単結晶基板1に対して第1の主面1a側から反応性イオンエッチングにより加工変質層3aをエッチングしてゆき、そのエッチング量とSiC基板1の平面度との関係を調べた。
(Experimental example)
As shown in FIG. 4 (c) in the first embodiment, reactive ion etching is performed from the first
直径2インチのSiCの単結晶基板1の第2の主面11bは鏡面に加工されており、その面粗度Raは0.3nm以下である。また、第1の主面11aは梨地に加工されており、その面粗度Raは0.3μm以下である。
The second
エッチングには、並行平板型反応性エッチング装置を用い、エッチング時の投入パワーは1.0W/cm2である。反応性ガスとしてCF4を100sccmの流量でチャンバに導入し、チャンバの真空度を2.0×10-3Torrに保って、エッチングを行った。平面度は、第2の主面11b側を測定した。
For etching, a parallel plate type reactive etching apparatus is used, and the input power during the etching is 1.0 W / cm 2 . Etching was performed by introducing CF 4 as a reactive gas into the chamber at a flow rate of 100 sccm and maintaining the degree of vacuum in the chamber at 2.0 × 10 −3 Torr. The flatness was measured on the second
図8は、エッチング量と基板の平面度の関係を示すグラフである。図8に示すように、エッチング前(エッチング量が0μm)では、SiC基板の平坦度は−100μmである。これは、図4(c)に示すように第2の主面11bが凹状になるようSiC基板1が反っていることを示している。
FIG. 8 is a graph showing the relationship between the etching amount and the flatness of the substrate. As shown in FIG. 8, before the etching (the etching amount is 0 μm), the flatness of the SiC substrate is −100 μm. This indicates that the
図8に示すように、加工変質層がエッチングされ始めると、平坦度は急激に小さくなる。およそ1μmエッチングすると、平面度は1/3以下になる。約2.8μmエッチングすると、平面度の改善はそれ以上見られなくなる。この実験例の場合、約2.5μm以上SiC基板をエッチングすることによって、加工改質層がほぼ完全に除去できることがわかる。 As shown in FIG. 8, when the work-affected layer begins to be etched, the flatness decreases rapidly. When etching is about 1 μm, the flatness becomes 1/3 or less. After etching about 2.8 μm, no further improvement in flatness is seen. In the case of this experimental example, it can be seen that the work-modified layer can be almost completely removed by etching the SiC substrate of about 2.5 μm or more.
なお、上記実施形態および上記実施例では反応性イオンエッチング法によって、加工変質層を完全に除去していたが、一部のみを反応性イオンエッチング法により除去し、残りを化学的機械研磨により除去してもよい。 In the above embodiment and the above examples, the work-affected layer was completely removed by the reactive ion etching method, but only a part was removed by the reactive ion etching method, and the rest was removed by chemical mechanical polishing. May be.
また、反応性イオンエッチングによる加工変質層の除去工程、機械的平面加工の工程、および鏡面研磨の工程を上記実施例で示した例以外の順序でSiC基板の片面あるいは両面に施してもよい。加工表面の面粗度を変化させることなく加工変質を除去することによって、研磨によりSiC基板を製造する方法において、さまざまな加工のコントロールをすることができる。 Further, the process-affected layer removal process by reactive ion etching, the mechanical planarization process, and the mirror polishing process may be performed on one side or both sides of the SiC substrate in the order other than the example shown in the above embodiment. By removing the process alteration without changing the surface roughness of the processed surface, various processes can be controlled in the method of manufacturing the SiC substrate by polishing.
本発明によれば、平坦なSiC基板を容易に製造することが可能となる。得られたSiC基板は好適に、本品質なGaN系半導体層、SiC半導体層などの半導体層を形成するための基板や、半導体製造プロセスに用いるダミーウエハとして用いることができる。 According to the present invention, a flat SiC substrate can be easily manufactured. The obtained SiC substrate can be suitably used as a substrate for forming a semiconductor layer such as a GaN-based semiconductor layer or SiC semiconductor layer of this quality, or as a dummy wafer used in a semiconductor manufacturing process.
1、1’、4’11、12 SiC基板
2 SiCの塊体
3a、3b 加工変質層
1a、4a、11a、12a 第1の主面
1b、4b、11b、12b 第2の主面
1, 1 ', 4'11, 12
Claims (11)
第1の主面に機械的平面加工あるいは切削加工により生じた加工変質層を有し、前記第1の主面の表面粗度Raが10nm以上1μm以下であるSiC基板を用意する工程と、
前記表面粗度Raが10nm以上1μm以下である第1の主面に気相エッチングを施し、前記加工変質層の少なくとも一部を除去する工程と、
を包含するSiC基板の製造方法。 A method of manufacturing a SiC substrate having a first main surface having a surface roughness Ra of 10 nm or more and 1 μm or less, and a second main surface having a surface roughness Ra of 1 nm or less and on a side on which an element is formed. There,
Providing a SiC substrate having a work-affected layer generated by mechanical planar processing or cutting on the first main surface, and having a surface roughness Ra of 10 nm to 1 μm of the first main surface;
Performing a gas phase etching on the first main surface having the surface roughness Ra of 10 nm or more and 1 μm or less to remove at least a part of the work-affected layer;
SiC substrate manufacturing method including
前記第2の主面の加工変質層を化学的機械研磨によって除去し、前記第2の主面を鏡面に仕上げる工程をさらに包含する請求項1に記載のSiC基板の製造方法。 In the step of preparing the SiC substrate, the first main surface and the second main surface each have a work-affected layer generated by the mechanical planar processing or cutting, and the first and second main surfaces are provided. The SiC substrate having a surface roughness Ra of the main surface of 10 nm to 1 μm is prepared,
The method for manufacturing an SiC substrate according to claim 1, further comprising a step of removing the work-affected layer on the second main surface by chemical mechanical polishing and finishing the second main surface into a mirror surface.
前記第2の主面に気相エッチングを施し、前記第2の主面の加工変質層の少なくとも一部を除去する工程と、
前記第2の主面の加工変質層の少なくとも一部を除去する工程の後、前記第2の主面を鏡面研磨する工程と
をさらに包含する請求項1に記載のSiC基板の製造方法。 In the step of preparing the SiC substrate, the first main surface and the second main surface each have a work-affected layer generated by the mechanical planar processing or cutting, and the first and second main surfaces are provided. The SiC substrate having a surface roughness Ra of the main surface of 10 nm to 1 μm is prepared,
Performing gas phase etching on the second main surface to remove at least a part of the work-affected layer on the second main surface;
The method for manufacturing an SiC substrate according to claim 1, further comprising a step of mirror polishing the second main surface after the step of removing at least a part of the work-affected layer on the second main surface.
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