JP4103740B2 - 画像表示装置、画像表示方法及び画像表示プログラム - Google Patents
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Description
図1に、本発明の実施形態に係る携帯端末装置の概略構成を示す。図1において、携帯端末装置210は、例えば携帯電話やPDAなどの端末装置である。携帯端末装置210は、表示装置212と、送受信部214と、CPU216と、入力部218と、プログラムROM220と、RAM224とを備える。また、表示装置212は、ドライバ226と表示パネル227などから構成されている。
以下では、本実施例に係るディザ処理について説明する。上述したように、ディザ処理は、CPU216内のディザ処理部232にて実行される。このディザ処理部232には、ビットスライス処理部231にてビットスライスされた画像データS1と、ビットスライスしたデータS2が入力される。本実施例では、ビットスライス処理部231にRGB各8ビットのフルカラーの画像データが入力され、ディザ処理部232には、そのデータの上位6ビットが画像データS1として、下位2ビットがデータS2として入力される例について説明していく。
以下で、上記の問題を解決することができる第1実施例に係る手法について説明する。上記のように64階調の各間隔を一様に3階調分ずつ補間していくと最終的には256階調には3階調分不足してしまう。そこで、第1実地例においては、この不足する3階調分を補間する処理を行う。具体的には、256階調のうち所定の領域には、他よりも大きなサイズのディザ行列を用いてディザ処理を行う。これにより、64階調の色のみで256階調分の色数を完全に表現することができる。なお、第1実施例に係る処理は、前述のディザ処理部232などを含んだCPU216で行うことができる。
まず、実施例1aについて、図5を用いて説明する。図5の上段には、64階調のステップが四角形内の数字で示されており、その下には、256階調のステップが三角形内の数字で示されている。そして最下段には、ディザ処理を行うことによって、64階調の色で256階調を擬似的に表現したパターンを示してある。この図において、ブロック内に描かれた「斜線」などが64階調表現の色を表しているものとする。
次に、実施例1bに係る処理方法について説明する。実施例1aにおいては最下位の領域(即ち、0階調から1階調)に3×3のディザ行列を用いた補間を行ったが、実施例1bでは、最上位の領域の階調に対して3×3のディザ処理を行う。図8に実施例1bに係る処理の例を示す。図8に示すように、256階調にて0から247まで(64階調表現では0階調から62階調)は2×2のディザ行列にてディザ処理を行う。一方、248から255まで(64階調表現では、62階調から63階調)は、先に述べたように3×3のディザ行列を用いてディザ処理を行う。これにより、実施例1aと同様に、256階調の色全てを64階調の色のみで擬似的に表現することができる。
実施例1cも、上述の実施例1aとbと同様に3×3のディザ行列を用いて、不足する3階調分を補間するための処理を行う。実施例1cでは、3×3のディザ行列を用いた処理を、上記のように最下位の階調領域(0階調から1階調)又は最上位の階調領域(62階調から63階調)に限定せず、中間の階調の所定領域に行うことができる。つまり、任意の中間の7階調分の領域に3×3のディザ処理を行う。それ以外の領域には2×2のディザ行列を用いて変換を行う。
以下では、第2実施例に係る処理について説明する。前述の第1実施例においては、3×3のディザ行列を所定の階調値に対して用いることにより、不足する3階調を補間したが、第2実施例では2×2のディザ行列のみを用いて処理を行う。その概要を説明すると、第2実施例ではディザ処理にて、3値のディザ行列(3ステップ分の階調値を含む)ディザ行列にて擬似的に中間の階調を表現する処理を行う。
次に、上述の方法を具体的に行うことができる実施例2aに係る処理ついて、図10のフローチャートを用いて説明する。ここでの処理は、CPU216内のディザ処理部232が行う。前述の3階調分の階調を用いる処理は所定の階調値のデータのみに行うので、入力階調値が所定階調値であるかを判別する。この領域内において所定階調値を有するデータに対しては、上記の特殊なディザ行列でディザ処理を行う。
次に、上述のものとは異なる他の実施例について説明する。実施例2aでは、所定の階調値である場合のみに特殊な処理を行ったが、実施例2bの方法では新たなディザ行列を用いて、一括にディザ処理が行うことができる。この新たなディザ行列を用いる場合も、所定領域内のデータに対してのみ行う。なお、実施例2aも実施例2bもディザ処理によって得られる結果は同じであり、図9に示したもののようになる。
Claims (7)
- nビットの階調表示能力を有する画像表示部と、
表示すべきmビットの画像データを取得する画像データ取得手段と、
前記画像データのビット数をmビットからnビットに減少させるビット数減少処理手段と、
前記mビットの画像データの階調値が所定領域外にあるときは、2×2画素構成の第1のディザマトリクスを用い、前記所定領域内にあるときは、3×3画素構成の第2のディザマトリクスを用いて、前記nビットの画像データの階調数をディザ処理により補間し、前記mビットに相当する階調数を有する補間画像データを生成する補間処理手段と、
前記補間画像データを前記画像表示部に表示する表示制御手段と、
を備えることを特徴とする画像表示装置。 - 前記補間処理手段は、前記mビットの画像データのうち、所定の階調値を有するものについてのみ前記第2のディザマトリクスを用いてディザ処理を行うことを特徴とする請求項1に記載の画像表示装置。
- 前記ビット数減少処理手段は、前記mビットの画像データの上位nビットを前記nビットの画像データとして使用することを特徴とする請求項1又は2に記載の画像表示装置。
- 前記mビットは8ビットであり、前記nビットは6ビットであり、前記mビットに相当する階調数は256階調であることを特徴とする請求項1乃至3のいずれか一項に記載の画像表示装置。
- 前記補間処理手段は、前記第1のディザマトリクスを用いたディザ処理により前記画像データを186階調増加させ、前記第2のディザマトリクスを用いたディザ処理により6階調増加させることを特徴とする請求項4に記載の画像表示装置。
- nビットの階調表示能力を有する画像表示部を備える画像表示装置において実行される画像表示方法において、
表示すべきmビットの画像データを取得する画像データ取得工程と、
前記画像データのビット数をmビットからnビットに減少させるビット数減少処理工程と、
前記mビットの画像データの階調値が所定領域外にあるときは、2×2画素構成の第1のディザマトリクスを用い、前記所定領域内にあるときは、3×3画素構成の第2のディザマトリクスを用いて、前記nビットの画像データの階調数をディザ処理により補間し、前記mビットに相当する階調数を有する補間画像データを生成する補間処理工程と、
前記補間画像データを前記画像表示部に表示する表示制御工程と、
を備えることを特徴とする画像表示方法。 - nビットの階調表示能力を有する画像処理部及び画像表示部を備える画像表示装置において実行されることにより、
表示すべきmビットの画像データを取得する画像データの取得と、
前記画像データのビット数をmビットからnビットに減少させるビット数減少処理手段と、
前記mビットの画像データの階調値が所定領域外にあるときは、2×2画素構成の第1のディザマトリクスを用い、前記所定領域内にあるときは、3×3画素構成の第2のディザマトリクスを用いて、前記nビットの画像データの階調数をディザ処理により補間し、前記mビットに相当する階調数を有する補間画像データを生成する補間処理と、
前記補間画像データを前記画像表示部に表示する表示制御と、
を行わせることを特徴とする画像表示プログラム。
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