JP4076497B2 - 内容アドレス・メモリ内の異なるテーブルの同時サーチ - Google Patents
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- 複数の内容アドレス・メモリ・ブロックと、
複数のフィルタ回路とを備え、複数のフィルタ回路はそれぞれ、複数の内容アドレス・メモリ・ブロックのうちの対応する1つに結合され、複数のフィルタ回路はそれぞれ、共通入力ストリングを受信し、フィルタ処理されたコンパランド・ストリングを複数の内容アドレス・メモリ・ブロックのうちの対応する1つに送信するように構成されており、その複数のフィルタ回路はそれぞれ、共通入力ストリングを受信するように構成されているクロスバ・スイッチを備え、さらに、複数のフィルタ回路はそれぞれクロスバ・スイッチに結合されたプログラミング回路を備え、プログラミング回路は、フィルタ・データを受信して、共通入力ストリングからフィルタ処理されたコンパランド・ストリングを生成するようにクロスバ・スイッチをプログラムする構成とされている装置。 - 複数の内容アドレス・メモリ・ブロックは、同時ルックアップを実行するように構成されている請求項1に記載の装置。
- プログラミング回路は、
クロスバ・スイッチに結合されたデータ・ジェネレータと、
データ・ジェネレータに結合され、フィルタ・データを格納するブロック・フィルタ・レジスタと、
クロスバ・スイッチに結合されたアドレス・ジェネレータとを備える請求項1に記載の装置。 - データ・ジェネレータは、
ブロック・フィルタ・レジスタに結合されたシフト・レジスタと、
シフト・レジスタに結合された論理回路とを備える請求項3に記載の装置。 - シフト・レジスタは複数のビット位置を持ち、シフト・レジスタは、フィルタとクロック信号に基づき複数のビット位置を通じて所定のビット値をシフトするように構成されている請求項4に記載の装置。
- 論理回路は、シフト・レジスタの複数のビット位置からビット値を受け取り、クロック信号に基づきビット値を出力するように構成されている請求項5に記載の装置。
- データ・ジェネレータは、
第1のシフト・レジスタと、
複数のビット位置を持つ第2のシフト・レジスタと、
第1のシフト・レジスタに結合され、フィルタ・データを受け取るためブロック・フィルタ・レジスタに結合され、第2のシフト・レジスタを通じて所定のビット値のシフト動作を制御するため第2のシフト・レジスタに結合され、その第2のシフト・レジスタがフィルタ・データとクロック信号に基づき複数のビット位置を通じて所定のビット値をシフトするように構成されているワイヤード論理ゲートと、
第2のシフト・レジスタの出力を受け取り、その出力をバッファ書き込み回路に送るように結合されている論理回路とを備える請求項3に記載の装置。 - ブロック・フィルタ・レジスタは、複数行、単一列のランダム・アクセス・メモリである請求項3に記載の装置。
- アドレス・ジェネレータが、
制御入力とカウンタ出力を備えるカウンタと、
カウンタの出力とクロスバ・スイッチに結合されたデコーダとを備える請求項3に記載の装置。 - さらに、出力がカウンタの制御入力に結合され、複数の入力がデータ・ジェネレータに結合されているOR回路を備える請求項9に記載の装置。
- アドレス・ジェネレータはシフト・レジスタを備える請求項3に記載の装置。
- さらに、アドレス・ジェネレータは、出力がシフト・レジスタに結合され、複数の入力がデータ・ジェネレータに結合されているOR回路を備える請求項11に記載の装置。
- 複数の内容アドレス・メモリ・ブロックと、
複数のフィルタ回路とを備え、複数のフィルタ回路はそれぞれ、複数の内容アドレス・メモリ・ブロックのうちの対応する1つに結合され、複数のフィルタ回路はそれぞれ、共通入力ストリングを受信し、フィルタ処理されたコンパランド・ストリングを複数の内容アドレス・メモリ・ブロックのうちの対応する1つに送信するように構成されており、複数のフィルタ回路はそれぞれ、
共通入力ストリングを受け取るように構成されているクロスバ・スイッチと、
クロスバ・スイッチに結合されたプログラミング回路とを備え、そのプログラミング回路は、フィルタ・データを受け取って、共通入力ストリングからフィルタ処理されたコンパランド・ストリングを生成するようにクロスバ・スイッチをプログラムする構成であり、プログラミング回路は、
クロスバ・スイッチに結合されたバッファ書き込み回路と、
バッファ書き込み回路に結合されたデータ・ジェネレータと、
データ・ジェネレータに結合され、クロスバ・スイッチ内の接続を確立するためにビット・データ・パターンを格納するブロック・フィルタ・レジスタと、
クロスバ・スイッチに結合されたアドレス・ジェネレータとを備え、アドレス・ジェネレータは、
制御入力とカウンタ出力を備えるカウンタと、
カウンタの出力とクロスバ・スイッチに結合されたデコーダと、
出力がカウンタの制御入力に結合され、複数の入力がデータ・ジェネレータに結合されているOR回路とを備える装置。 - 複数のフィルタ回路がプログラム可能である請求項13に記載の装置。
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