JP4034086B2 - 発光装置及び電子機器 - Google Patents
発光装置及び電子機器 Download PDFInfo
- Publication number
- JP4034086B2 JP4034086B2 JP2002056555A JP2002056555A JP4034086B2 JP 4034086 B2 JP4034086 B2 JP 4034086B2 JP 2002056555 A JP2002056555 A JP 2002056555A JP 2002056555 A JP2002056555 A JP 2002056555A JP 4034086 B2 JP4034086 B2 JP 4034086B2
- Authority
- JP
- Japan
- Prior art keywords
- transistors
- switch
- pixel
- transistor
- self
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Expired - Fee Related
Links
- 239000003990 capacitor Substances 0.000 claims description 20
- 239000000758 substrate Substances 0.000 claims description 6
- 238000000034 method Methods 0.000 description 35
- 230000003071 parasitic effect Effects 0.000 description 10
- 238000010586 diagram Methods 0.000 description 7
- 230000000694 effects Effects 0.000 description 6
- 229910021420 polycrystalline silicon Inorganic materials 0.000 description 6
- 229920005591 polysilicon Polymers 0.000 description 6
- 239000004973 liquid crystal related substance Substances 0.000 description 5
- 239000004065 semiconductor Substances 0.000 description 5
- 230000007547 defect Effects 0.000 description 4
- 239000011159 matrix material Substances 0.000 description 4
- 238000006243 chemical reaction Methods 0.000 description 3
- 230000005669 field effect Effects 0.000 description 3
- 239000010408 film Substances 0.000 description 3
- 238000004519 manufacturing process Methods 0.000 description 3
- 239000000463 material Substances 0.000 description 3
- 239000013078 crystal Substances 0.000 description 2
- 229910010272 inorganic material Inorganic materials 0.000 description 2
- 239000011147 inorganic material Substances 0.000 description 2
- 239000007787 solid Substances 0.000 description 2
- 239000010409 thin film Substances 0.000 description 2
- XUIMIQQOPSSXEZ-UHFFFAOYSA-N Silicon Chemical compound [Si] XUIMIQQOPSSXEZ-UHFFFAOYSA-N 0.000 description 1
- 229910021417 amorphous silicon Inorganic materials 0.000 description 1
- 239000004020 conductor Substances 0.000 description 1
- 238000013461 design Methods 0.000 description 1
- 238000011161 development Methods 0.000 description 1
- 238000011835 investigation Methods 0.000 description 1
- 239000002184 metal Substances 0.000 description 1
- 230000003287 optical effect Effects 0.000 description 1
- 150000002894 organic compounds Chemical class 0.000 description 1
- 239000011368 organic material Substances 0.000 description 1
- 238000012545 processing Methods 0.000 description 1
- 238000005070 sampling Methods 0.000 description 1
- 229910052710 silicon Inorganic materials 0.000 description 1
- 239000010703 silicon Substances 0.000 description 1
Images
Landscapes
- Electroluminescent Light Sources (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Control Of El Displays (AREA)
Description
【０００１】
【発明の属する技術分野】
本発明は、発光装置及び表示装置の技術に関する。さらには、前記発光装置または表示装置を搭載した電子機器に関する。本明細書における発光装置とは、自発光素子から放出される光を利用した装置を指す。自発光素子の例としては、有機発光ダイオード（ＯＬＥＤ）素子、無機材料系の発光ダイオード素子、電界放出発光素子（ＦＥＤ素子）などがある。本明細書における表示装置とは、複数の画素をマトリクス状に配置し画像情報を視覚的に伝達する装置、いわゆるディスプレイを指す。
【０００２】
【従来の技術】
近年、画像の表示を行う表示装置の重要性が増している。表示装置としては、液晶素子を用いて画像の表示を行う液晶表示装置が、高画質、薄型、軽量などの利点を活かして、携帯電話やパソコンをはじめとする種々の用途の表示装置として幅広く用いられている。
【０００３】
他方で、自発光素子を用いた表示装置、発光装置の開発も進められている。この自発光素子には、有機材料、無機材料、薄膜材料、バルク材料、分散材料、広汎にわたり様々な種類の素子が存在する。
【０００４】
なかでも表示装置向けに将来有望視されている代表的な自発光素子は、有機発光ダイオード（ＯＬＥＤ）素子である。ＯＬＥＤ素子を自発光素子として用いたＯＬＥＤ表示装置は、既存の液晶表示装置以上に薄型、軽量である特長に加え、動画表示に適した高応答速度、高視野角、低電圧駆動などの特長を有しているため、携帯電話や携帯情報端末（ＰＤＡ）をはじめテレビ、モニターなど、幅広い用途が見込まれ、次世代ディスプレイとして注目されている。
【０００５】
特にアクティブマトリクス（ＡＭ）型のＯＬＥＤ表示装置は、パッシブマトリクス（ＰＭ）型では困難な、高精細、大画面の表示も可能であるうえ、ＰＭ型を上回る低消費電力動作で高信頼性を有し、実用化への期待は大変強い。
【０００６】
ＯＬＥＤ素子は、陽極と、陰極と、該陽極と該陰極との間に挟まれた有機化合物の層とを有する構造をしている。ＯＬＥＤ素子に流れる電流量と、ＯＬＥＤ素子の発光輝度は概ね比例する関係にある。ＡＭ型ＯＬＥＤ表示装置の画素では、該画素のＯＬＥＤ素子の発光輝度を制御する駆動用トランジスタを、ＯＬＥＤ素子に直列に接続している。
【０００７】
ＡＭ型ＯＬＥＤ表示装置において画像を表示する駆動方式には、電圧入力方式と電流入力方式がある。前者の電圧入力方式は、画素に入力するビデオ信号として、電圧値形式データのビデオ信号を入力する。他方、後者の電流入力方式は、画素に入力するビデオ信号として、電流値形式データのビデオ信号を入力する。
【０００８】
電圧入力方式では通常、画素の駆動用トランジスタのゲート電極にビデオ信号の電圧が直接印加される。そのためＯＬＥＤ素子を定電流発光させる場合、駆動用トランジスタの電気的特性が各々の画素間で均一でなくバラつきを有していると、各画素のＯＬＥＤ素子駆動電流にバラつきが生じる。ＯＬＥＤ素子駆動電流のバラつきは、ＯＬＥＤ素子の発光輝度のバラつきとなる。ＯＬＥＤ素子の発光輝度のバラつきは、画面全体でみると砂嵐状あるいは絨毯模様のムラとして、表示画像の品位を低下させる。
【０００９】
特に、駆動用トランジスタとして非晶質（アモルファス）シリコン薄膜トランジスタ（ＴＦＴ）を用いると、高輝度の発光に十分な電流が得られない。そこで、駆動用トランジスタとして、多結晶（ポリ）シリコンＴＦＴが用いられる。しかし、ポリシリコンでは結晶粒界における欠陥等に起因して、ＴＦＴの電気的特性にバラつきが生じやすい問題がある。
【００１０】
このような電圧入力方式における、ＯＬＥＤ素子駆動電流のバラつきを防ぐための有効な手段の一つとして、電流入力方式がある。電流入力方式では通常、ビデオ信号のデータ電流値を記憶し、記憶した電流値と同一もしくは数倍（１未満を含む正の実数倍）の電流を、ＯＬＥＤ素子駆動電流として供給する。
【００１１】
電流入力方式のＡＭ型ＯＬＥＤ表示装置の画素回路で、代表的な一例を図１０（Ａ）に示す（A. Yumoto et al., Proc. Asia Display / IDW '01 p.p.1395-1398 (2001) 等を参照）。５１６がＯＬＥＤ素子である。この画素回路は、カレントミラー回路を用いている。そこでカレントミラーを構成する二つのトランジスタが同一の電気的特性さえ備えていれば、ビデオ信号のデータ電流値を正確に記憶することができる。相異なる画素の駆動用トランジスタの電気的特性間にバラつきがあっても、同一画素内の前記二つのトランジスタが各々同一の電気的特性を備えてさえいれば、ＯＬＥＤ素子の発光輝度のバラつきは防がれることになる。
【００１２】
電流入力方式のＡＭ型ＯＬＥＤ表示装置の画素回路で、代表的な他の一例を図１０（Ｂ）に示す（I. M. Hunter et al., Proc. AM-LCD 2000 p.p.249-252 (2000) 等を参照）。６１１がＯＬＥＤ素子である。この画素回路は、駆動用トランジスタのゲート電極にビデオ信号に対応する電圧を書込むときに、駆動用トランジスタ自身のドレイン電極とゲート電極を短絡する。その状態でビデオ信号のデータ電流を流し、その後ゲート電極を電気的に絶縁させる。するとＯＬＥＤ素子を発光させるときに、駆動用トランジスタを飽和領域にて動作させるようにすれば、書込み時のデータ電流と同一値の電流を、駆動用トランジスタはＯＬＥＤ素子に供給する。従って、各画素の駆動用トランジスタに電気的特性のバラつきが存在しても、ＯＬＥＤ素子の発光輝度のバラつきは防がれることになる。
【００１３】
【発明が解決しようとする課題】
図１０（Ａ）（Ｂ）は、上記のように正確にデータ電流値を記憶できるはずであるが、以下の深刻な問題がある。
【００１４】
まず、図１０（Ａ）の画素回路における問題点は、カレントミラーを構成する二つのトランジスタが同一の電気的特性もつことが、前提条件とされていることである。設計時に工夫すれば、両トランジスタを基板上に隣り合わせに作製することも可能であるので、ある程度はバラつきを減少させることができる。とはいえ現在のポリシリコンでは、結晶粒界における欠陥等に起因して、ＴＦＴのしきい値電圧、電界効果移動度等の電気的特性に、なお許容限度を超えるバラつきが残存してしまうのが普通である。
【００１５】
具体的には、例えば６４階調の画像を表示する場合には、輝度バラつきは１％以内程度に抑える必要が生じる。しかし図１０（Ａ）の画素回路では、データ電流値を１％の精度で記憶することは、現在普通に使用されるポリシリコンでは困難である。すなわち、図１０（Ａ）の画素回路を使うのみでは、画面全体でムラがない十分に均一の、高品位表示画像を得ることはできない。
【００１６】
次に、図１０（Ｂ）の画素回路における問題点は、画素に書込むビデオ信号データ電流と、ＯＬＥＤ素子を発光させるときのＯＬＥＤ素子駆動電流とが、同一値になってしまう点である。ＡＭ型ＯＬＥＤ表示装置を作製する場合、両電流を同一値としなくてはならないという点は、事実上はかなり厳しい制約となる。
【００１７】
具体的には、実際のＡＭ型ＯＬＥＤ表示装置においては、信号線等に多量の寄生容量、寄生抵抗がついてしまう。その結果、ビデオ信号データ電流はＯＬＥＤ素子駆動電流よりも大きくする措置をとることが必要な場合が、少なからず生じる。特に、ビデオ信号データ電流をアナログ値にして階調表現する場合には、暗部のビデオ信号データ電流の書込みが非常に困難となる。
【００１８】
本発明は上記問題点の存在に鑑みてなされたものである。まず本発明は、図１０（Ｂ）の画素回路とは異なり、画素に書込むビデオ信号データ電流と、ＯＬＥＤ素子を発光させるときのＯＬＥＤ素子駆動電流との比が「１」に固定されない、ＡＭ型ＯＬＥＤ表示装置を提供することを課題とする。次に本発明は、図１０（Ａ）の画素回路とは異なり、同一画素内の隣接設置されたトランジスタ間においても、なお電気的特性のバラつきがある程度残存することを前提とする。その上で本発明は、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合と比較して、ＯＬＥＤ素子駆動電流のバラつきが十分に抑制されたＡＭ型ＯＬＥＤ表示装置を提供することを課題とする。
【００１９】
【課題を解決するための手段】
上記課題を解決するために、本発明はＡＭ型表示装置または発光装置において、各画素に設置される駆動用素子を複数のトランジスタにより構成し、画素にデータ電流を読込むときには該複数のトランジスタを並列接続状態にし、自発光素子を発光させるときには該複数のトランジスタを直列接続状態にすることを特徴としている。
【００２０】
なおＯＬＥＤ素子以外の素子を用いた表示装置、発光装置であっても、電流駆動型の素子を用いる場合には、本発明の構成が利用できる。
【００２１】
このような、本発明の表示装置または発光装置の画素構成の概略について、図１（Ａ）（Ｂ）を用いて説明する。図１（Ａ）には、複数の画素を有する画素部において、j行i列目に配置された画素１１を示す。画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、スイッチング機能を有する第１スイッチ１２〜第３スイッチ１４、駆動用素子１５、容量素子１６、自発光素子１７を有する。なお、図１（Ａ）（Ｂ）で容量素子１６が設置されているノードの寄生容量が大きい場合などには、容量素子１６は必ずしも設けなくてよい。
【００２２】
自発光素子としては、典型的にはＯＬＥＤ素子が該当するため、本明細書では、自発光素子を表す記号としてダイオードの記号を用いる。しかし自発光素子にダイオード特性は必須ではなく、本発明はダイオード特性をもつ自発光素子の場合に限定されない。さらに断ると、本明細書での自発光素子は、電流駆動型の表示用素子であればよく、自発光により表示機能を担う必要もない。例えば、液晶のような光シャッターだが、電圧値でなく電流値により制御されるものも、本明細書での自発光素子に含まれる。
【００２３】
第１スイッチ１２〜第３スイッチ１４には、トランジスタなどのスイッチング機能を有する半導体素子を１個又は複数個用いることができる。同様に駆動用素子１５にも、トランジスタなどの半導体素子を複数個用いることができる。第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号により、オン又はオフが決定される。第１スイッチ１２及び第２スイッチ１３はスイッチとして機能すればよいので、用いられる半導体素子の導電型に特に限定はない。
【００２４】
なお第１スイッチ１２は、信号線(Si)と駆動用素子１５の間に設置されており、画素１１に対する信号の書込みを制御する役割を果たす。また第２スイッチ１３は、電源線(Vi)と駆動用素子１５の間に設置されており、電源線から画素１１への電流の供給を制御する。
【００２５】
図１（Ｂ）には、図１（Ａ）に示した画素１１に、第４スイッチ１８と第２走査線(Gbj)を追加して配置した場合を示す。第４スイッチ１８には、トランジスタなどのスイッチング機能を有する半導体素子を１個又は複数個用いることができる。第４スイッチ１８は、第２走査線(Gbj)から与えられる信号により、オン又はオフが決定される。第１スイッチ１２及び第２スイッチ１３はスイッチとして機能すればよいので、用いられる半導体素子の導電型に特に限定はない。
【００２６】
なお第４スイッチ１８は画素１１の初期化用素子としての役割を担う。
第４スイッチ１８がオンになると、容量素子１６に保持されている電荷が放出されて、駆動用素子１５はオフになり、さらに自発光素子１７の発光は終了する。
【００２７】
本発明では、駆動用素子１５を複数のトランジスタで構成し、画素１１にビデオ信号のデータ電流を書込む場合と、自発光素子１７に電流を流し発光させる場合とにおいて、該複数のトランジスタの接続を並列と直列とに切替えて用いる点に特徴がある。図１（Ａ）（Ｂ）では、第１スイッチ１２及び第２スイッチ１３を、走査線(Gaj)からの信号によりオン・オフ制御をすることが、駆動用素子１５の複数のトランジスタを、並列接続状態と直列接続状態とを切替える手段となっている。
【００２８】
ここで、一例として駆動用素子１５が４つのトランジスタ２０ａ〜２０ｄで構成された場合の画素１１を図１（Ｃ）（Ｄ）に示し、画素１１における電流の経路について以下に説明する。
【００２９】
図１（Ｃ）は画素１１にデータ電流を書込む場合を示し、図１（Ｄ）は自発光素子を発光させる場合を示している。なお図１（Ｃ）（Ｄ）において、第１スイッチ１２、第２スイッチ１３、駆動用素子１５、自発光素子１７、信号線(Si)及び電源線(Vi)以外の素子、配線は図示を省略する。
【００３０】
最初に、画素１１にデータ電流を書込む場合について説明する。図１（Ｃ）において、第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号によりオンになる。すると駆動用素子１５は、各トランジスタがダイオード接続状態となり、かつ相互に並列接続状態になる。電流経路は、電源線(Vi)から第２スイッチ１３、駆動用素子１５、第１スイッチ１２を通って、信号線(Si)である。このときの電流値ＩWは、ビデオ信号のデータ電流値であり、信号線駆動回路が信号線(Si)に出力する所定の電流値である。
【００３１】
次いで、自発光素子１７を発光させる場合について説明する。図１（Ｄ）において、第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号によりオフになる。すると駆動用素子１５は、各トランジスタが相互に直列接続状態になる。電流経路は、電源線(Vi)からトランジスタ２０ａ、２０ｂ、２０ｃ、２０ｄを通って自発光素子１７である。このときの電流値ＩEにより、自発光素子１７の発光輝度が決まる。
【００３２】
上述したように本発明では、画素にデータ電流を書込むときには、駆動用素子１５を構成するトランジスタ２０ａ〜２０ｄを並列に使用する（図１（Ｃ））。他方、画素１１が有する自発光素子１７に電流を流すとき、すなわち自発光素子駆動時には、駆動用素子１５を構成するトランジスタ２０ａ〜２０ｄを直列に使用する（図１（Ｄ））。従って、もしトランジスタ２０ａ〜２０ｄの電気的特性が同一であると仮定すれば、書込み時の電流値ＩWは、自発光素子駆動時の電流値ＩEの１６倍（４2倍）となる。より一般的に、駆動用素子１５を構成するトランジスタの数がｎ個の場合を考えると、該トランジスタの全てが同一の電気的特性をもつとの条件の下では、ビデオ信号書込み時の電流値ＩWと自発光素子駆動時の電流値ＩEとの間に次式（１）の関係が成立する。
【００３３】
【数１】
ＩW＝ｎ2×ＩE・・・（１）
【００３４】
なお式（１）が厳密に成立するためには、駆動用素子１５を構成するトランジスタの全てが同一の電気的特性をもつことが条件となる。しかし該トランジスタの電気的特性が、相互に若干のバラつきを伴っている場合であっても、近似的に式（１）が成立するとして扱うことが現実的には可能である。
【００３５】
よって本発明では、駆動用素子１５を複数のトランジスタで構成し、画素１１にビデオ信号電流を書込む場合と、自発光素子を発光させる場合とにおいて、該複数のトランジスタの接続を並列と直列とに切替えて用いることで、書込み時の電流値ＩWと自発光素子駆動時の電流値ＩEとを任意に設定することができる特長を有する。
【００３６】
また本発明の別の特長として、駆動用素子１５を構成する各トランジスタの電気的特性が、相互に若干のバラつきを伴っていたとしても、その影響が自発光素子駆動電流ＩEに反映されてしまうのを大きく軽減できる点がある。これに関しては具体的な例をとりあげ、実施の形態５において説明する。
【００３７】
図１０（Ａ）のようなカレントミラーを用いる画素回路においても、画素内の二つのトランジスタに関する限り、同一の電気的特性もつことが要求されてしまう問題があった。しかし本発明では同一画素内におけるトランジスタでさえ、相互に電気的特性が若干異なることを既に前提としている。すなわち本発明は、トランジスタの特性バラつきに対する耐性の点において、電流入力方式のカレントミラーを用いる画素回路と比較して、優れている。その結果本発明では、結晶粒界における欠陥等に起因するポリシリコンＴＦＴの電気的特性バラつきが存在しても、自発光素子駆動電流ＩEを実用レベルにまで均一化することが可能となる。
【００３８】
【発明の実施の形態】
（実施の形態１）
以上、本発明の表示装置、発光装置の画素の概略を図１を用いて述べた。実施の形態１では、本発明の表示装置、発光装置の画素の具体的例について、図２〜４を用いて説明する。簡単にするため、駆動用素子１５を構成するトランジスタ数ｎが、２〜４の場合の例を挙げる。
【００３９】
まず最初の例を、図２（Ａ）を用いて説明する。
【００４０】
図２（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、走査線(Gaj)、トランジスタ２１〜２６、容量素子２７、自発光素子２８を有する。図２（Ａ）に示す画素１１は、図１（Ａ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ２１、２２は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ２３は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ２４は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ２５、２６は駆動用素子１５に相当する。
【００４１】
トランジスタ２１〜２４の各ゲート電極は、走査線(Gaj)に接続されている。容量素子２７は、トランジスタ２５のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ２５、２６のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子２７は必ずしも設けなくてもよい。
【００４２】
図２（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、走査線(Gaj)に低電位信号を送り、トランジスタ２１〜２３をオン、トランジスタ２４をオフにする。このとき、トランジスタ２５、２６は電流経路上、互いに並列接続の関係になる。一方、自発光素子２８に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ２１〜２３をオフ、トランジスタ２４をオンにする。このとき、トランジスタ２５、２６は電流経路上、互いに直列接続の関係になる。
【００４３】
図２（Ａ）の例では、駆動用素子１５のトランジスタ２５、２６の接続関係の切替えを、走査線(Gaj)のみで制御する。また、第１スイッチを２個、第２スイッチを１個のトランジスタのみという、最少個数のトランジスタで構成する。このように図２（Ａ）の例は、走査線数及びトランジスタ数を少なく抑えているため、開口率確保や製造不良発生率低減を重視する場合に、適した構成である。
【００４４】
次いで図２（Ａ）とは別の例を、図２（Ｂ）を用いて説明する。
【００４５】
図２（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ３１〜３９、４２、容量素子４０、自発光素子４１を有する。図２（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ３１〜３４は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ３５、３６は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ３７は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ３８、３９は駆動用素子１５に相当する。ｎチャネル型のトランジスタ４２は第４スイッチ１８に相当する。
【００４６】
トランジスタ３１〜３４の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ３５〜３７、４２の各ゲート電極は、第２走査線(Gbj)に接続されている。容量素子４０は、トランジスタ３８のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ３８、３９のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子４０は必ずしも設けなくてもよい。
【００４７】
図２（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ３１〜３６をオン、トランジスタ３７、４２をオフにする。このとき、トランジスタ３８、３９は電流経路上、互いに並列接続の関係になる。一方、自発光素子４１に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ３１〜３６をオフ、トランジスタ３７、４２をオンにする。このとき、トランジスタ３８、３９は電流経路上、互いに直列接続の関係になる。
【００４８】
図２（Ｂ）の例では、駆動用素子１５のトランジスタ３８、３９の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子４１に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子４１の発光時間を任意に制御できる。
【００４９】
これは、中間階調表現を時間階調方式により表現する場合に、非常に重要な特長である。時間階調方式をポリシリコンＴＦＴ駆動回路を有するＡＭ型ＯＬＥＤ表示装置に適用する場合、列走査期間中に発光を停止させる手段なしには、十分な多階調表示が困難なためである。また、中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である（ホールド型ディスプレイ特有の動画ボケについては、例えばT. Kurita, Proc. AM-LCD 2000 p.p.1-4 (2000) 等を参照）。
【００５０】
また図２（Ｂ）の例の、別の特長として、ビデオ信号データ電流の記憶がより正確に行える点がある。図２（Ａ）の例では、データ電流の書込み時に、トランジスタ２５は電源線(Vi)に直接接続するのに対し、トランジスタ２６はトランジスタ２３を介して接続する。よって、トランジスタ２３による電圧降下分だけ、データ電流の書込み時が不正確となる。他方図２（Ｂ）の例では、トランジスタ３８はトランジスタ３５を介して、トランジスタ３９はトランジスタ３６を介して、電源線(Vi)に接続する。トランジスタ３５とトランジスタ３６による電圧降下を、同程度となるようにすれは、ビデオ信号データ電流の記憶をより正確に行うことができる。
【００５１】
続いて３つ目の例を、図３（Ａ）を用いて説明する。
【００５２】
図３（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ５１〜５７、６０、容量素子５８、自発光素子５９を有する。図３（Ａ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｎチャネル型のトランジスタ５１〜５３は第１スイッチ１２に相当する。ｎチャネル型のトランジスタ５４は第２スイッチ１３に相当し、ｐチャネル型のトランジスタ５５は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ５６、５７は駆動用素子１５に相当する。ｎチャネル型のトランジスタ６０は第４スイッチ１８に相当する。
【００５３】
トランジスタ５１〜５５の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ６０のゲート電極は、第２走査線(Gbj)に接続されている。容量素子５８は、トランジスタ５６のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ５６、５７のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子５８は必ずしも設けなくてもよい。
【００５４】
図３（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)に高電位信号を送り、トランジスタ５１〜５４をオン、トランジスタ５５をオフにする。このとき、トランジスタ５６、５７は電流経路上、互いに並列接続の関係になる。一方、自発光素子５９に電流を流すときには、走査線(Gaj)に低電位信号を送り、トランジスタ５１〜５４をオフ、トランジスタ５５をオンにする。このとき、トランジスタ５６、５７は電流経路上、互いに直列接続の関係になる。
【００５５】
なお上記の間、第２走査線(Gbj)には低電位信号を送り、トランジスタ６０をオフしておく。
【００５６】
図３（Ａ）に示す画素１１においても、図２（Ｂ）の例の場合と同様に、第２走査線(Gbj)に送る信号により、自発光素子５９の発光時間を任意に制御できる。すなわち自発光素子５９発光中に、第２走査線(Gbj)に高電位信号をおくり、トランジスタ６０をオンにすると、トランジスタ５６がオフとなり自発光素子５９は消光する。ただし自発光素子５９を一度消光させると、再度ビデオ信号データ電流を書込まなくては、自発光素子５９を発光させられない点は、図２（Ｂ）の例と異なる。
【００５７】
図３（Ａ）に示す画素１１において、自発光素子５９の発光時間を任意に制御できることの特長は、図２（Ｂ）の例の場合と同様である。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００５８】
図３（Ａ）に示す画素１１においては、第１スイッチ１２又は第２スイッチ１３のトランジスタ５１〜５４、第４スイッチ１８のトランジスタ６０はｎチャネル型であり、第３スイッチ１４のトランジスタ５５はｐチャネル型である。これは、図２（Ａ）（Ｂ）の例の場合と異なっている。しかしこれは、スイッチのトランジスタのチャネル型に関して、特に制限がないことを例示したものにすぎない。
【００５９】
続いて４つ目の例を、図３（Ｂ）を用いて説明する。
【００６０】
図３（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ７１〜８２、８５、容量素子８３、自発光素子８４を有する。図３（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ７１〜７５は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ７６〜７８は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ７９は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ８０〜８２は駆動用素子１５に相当する。ｎチャネル型のトランジスタ８５は第４スイッチ１８に相当する。
【００６１】
トランジスタ７１〜７５、８５の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ７６〜７９のゲート電極は、第２走査線(Gbj)に接続されている。容量素子８３は、トランジスタ８０のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ８０〜８２のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子８３は必ずしも設けなくてもよい。
【００６２】
図３（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ７１〜７８をオン、トランジスタ７９、８５をオフにする。このとき、トランジスタ８０〜８２は電流経路上、互いに並列接続の関係になる。一方、自発光素子８４に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ７１〜７８をオフ、トランジスタ７９、８５をオンにする。このとき、トランジスタ８０〜８２は電流経路上、互いに直列接続の関係になる。
【００６３】
図３（Ｂ）の例では、駆動用素子１５のトランジスタ８０〜８２の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子８４に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子８４の発光時間を任意に制御できる。この事情は図２（Ｂ）の例と同様である。
【００６４】
よって、図３（Ｂ）に示す画素１１においても、自発光素子８４の発光時間を任意に制御できることに起因する、以下の特長がある。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００６５】
５つ目の例を、図４（Ａ）を用いて説明する。
【００６６】
図４（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ９１〜１０３、１０６、容量素子１０４、自発光素子１０５を有する。図４（Ａ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ９１〜９４は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ９５〜９８は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ９９は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ１００〜１０３は駆動用素子１５に相当する。ｎチャネル型のトランジスタ１０６は第４スイッチ１８に相当する。
【００６７】
トランジスタ９１〜９４の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ９５〜９９、１０６のゲート電極は、第２走査線(Gbj)に接続されている。容量素子１０４は、トランジスタ１００のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ１００〜１０３のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子１０４は必ずしも設けなくてもよい。
【００６８】
図４（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ９１〜９８をオン、トランジスタ９９、１０６をオフにする。このとき、トランジスタ１００〜１０３は電流経路上、互いに並列接続の関係になる。一方、自発光素子１０５に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ９１〜９８をオフ、トランジスタ９９、１０６をオンにする。このとき、トランジスタ１００〜１０３は電流経路上、互いに直列接続の関係になる。
【００６９】
図４（Ａ）の例では、駆動用素子１５のトランジスタ１００〜１０３の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子１０５に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子８４の発光時間を任意に制御できる。この事情は図２（Ｂ）の例と同様である。
【００７０】
よって、図４（Ａ）に示す画素１１においても、自発光素子８４の発光時間を任意に制御できることに起因する、以下の特長がある。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００７１】
６つ目の例を、図４（Ｂ）を用いて説明する。
【００７２】
図４（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ１１１〜１２０、１２２、容量素子１２３、自発光素子１２１を有する。図４（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ１１１〜１１３は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ１１４、１１５は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ１１６は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ１１７〜１２０は駆動用素子１５に相当する。ｐチャネル型のトランジスタ１２２は第４スイッチ１８に相当する。
【００７３】
トランジスタ１１１〜１１６の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ１２２のゲート電極は、第２走査線(Gbj)に接続されている。容量素子１２３は、トランジスタ１１７のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ１１７〜１２０のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子１２３は必ずしも設けなくてもよい。
【００７４】
図４（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)に高電位信号を送り、トランジスタ１１１〜１１５をオン、トランジスタ１１６をオフにする。このとき、トランジスタ１１７〜１２０は電流経路上、互いに並列接続の関係になる。一方、自発光素子１２１に電流を流すときには、第１走査線(Gaj)に低電位信号を送り、トランジスタ１１１〜１１５をオフ、トランジスタ１１６をオンにする。このとき、トランジスタ１１７〜１２０は電流経路上、互いに直列接続の関係になる。
【００７５】
なお上記の間、第２走査線(Gbj)には低電位信号を送り、トランジスタ１２２をオフしておく。
【００７６】
図４（Ｂ）に示す画素１１においても、図２（Ｂ）の例の場合と同様に、第２走査線(Gbj)に送る信号により、自発光素子１２１の発光時間を任意に制御できる。すなわち自発光素子１２１発光中に、第２走査線(Gbj)に高電位信号をおくり、トランジスタ１２２をオンにすると、トランジスタ１１７がオフとなり自発光素子１２１は消光する。ただし自発光素子１２１を一度消光させると、再度ビデオ信号データ電流を書込まなくては、自発光素子５９を発光させられない点は、図２（Ｂ）の例と異なる。
【００７７】
図４（Ｂ）に示す画素１１において、自発光素子１２１の発光時間を任意に制御できることの特長は、図２（Ｂ）の例の場合と同様である。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００７８】
以上、本発明の表示装置、発光装置の画素１１の例として、それぞれ異なる構成の６種類の画素１１を図２〜４を用いて説明した。しかし本発明の表示装置、発光装置の画素構成は、これら６種に限定されるわけではない。
【００７９】
（実施の形態２）
実施の形態２では、画素１１の駆動方法を説明する。例として図４（Ｂ）に示した画素１１の場合を取り上げ、図５を用いて説明する。
【００８０】
最初に、ビデオ信号書込み動作と発光動作について説明する。
【００８１】
まず画素１１の周囲に設けられた走査線駆動回路（図示せず）から出力される信号によって、j行目の第1走査線(Gaj)が選択される。すなわち、第1走査線(Gaj)に低電位（Ｌレベル）信号が出力され、トランジスタ１１１〜１１６のゲート電極が低電位（Ｌレベル）となる。このとき、ｐチャネル型のトランジスタ１１１〜１１５がオンとなり、ｎチャネル型のトランジスタ１１６がオフとなる。そして画素１１の周囲に設けられた信号線駆動回路（図示せず）から、i列目の信号線(Si)を介して画素１１にビデオ信号データ電流ＩWが入力される。
【００８２】
トランジスタ１１１〜１１３がオンすると、トランジスタ１１７〜１２０は、ドレインとゲートが短絡されたダイオード接続状態となる。すなわち画素１１は、並列な４つのダイオードと回路的に等価となる。この状態で画素１１の電源線(Vi)と信号線(Si)の間に、電流ＩWを流す（図５（Ａ）を参照）。
【００８３】
並列な４つのダイオードを流れる電流ＩWが定常状態になった後、第1走査線(Gaj)を高電位（Ｈレベル）にする。するとトランジスタ１１１〜１１３はオフとなり、ビデオ信号データ電流ＩWが画素に記憶される。
【００８４】
続いて第1走査線(Gaj)が高電位（Ｈレベル）となると、ｐチャネル型のトランジスタ１１１〜１１５がオフとなり、ｎチャネル型のトランジスタ１１６がオンとなる。トランジスタ１１７〜１２０は直列状態に接続が組みかえられる。このときトランジスタ１２０が飽和領域で動作するように予め電圧条件を設定しておくと、駆動用素子は自発光素子に定電流ＩEを供給する。
【００８５】
定電流ＩEの値は、ビデオ信号データ電流ＩWの約１６分の１の大きさである。本実施の形態では、駆動用素子は４つトランジスタにより構成されているためである。より一般的に、駆動用素子がｎ個のトランジスタにより構成されている場合には、電流ＩEは、ビデオ信号データ電流ＩWの約ｎ2分の１の大きさとなる。
【００８６】
このように本実施の形態では、書込みデータ電流ＩWを自発光素子駆動電流ＩEの約１６倍と、大きな値にすることができる。そのため寄生容量等のために、自発光素子駆動電流ＩE程度の微小電流を、直接速やかに画素に書込むことが難しい場合であっても、ビデオ信号データ電流ＩWを画素に書込むことが可能となる。
【００８７】
なお本実施の形態は、中間階調表現の方法として、アナログビデオ方式を採っていてもよいし、ディジタルビデオ方式を採っていてもよい。アナログビデオ方式の場合、ビデオ信号データ電流として、アナログ的に変化するデータ電流ＩWを用いる。ディジタルビデオ方式の場合は、一つのデータ電流ＩWのみを基準のオン電流として単位輝度を用意する。そして、単位輝度を時間的に足し合わせて階調表現する、時間階調法を用いるのが便利である（ディジタル時間階調法）。あるいは、単位輝度を面積的に足し合わせて階調表現する面積階調法や、時間階調法と面積階調法を組み合わせる方法で、ディジタルビデオ方式を行うこともできる。
【００８８】
また本実施の形態において、アナログビデオ方式、ディジタルビデオ方式いずれを採用したとしても、ビデオ信号データ電流ＩWを０とする場合が必要となることがある。しかしビデオ信号データ電流ＩWを０とする場合は、自発光素子の発光輝度を０とするということであるから、ＩWを画素に正確に書込み記憶させる必要はない。したがって、この場合には駆動用素子のトランジスタ１１７〜１２０がオフとなるようなゲート電圧を、直接信号線(Si)に出力してもよい。すなわち例外的に、ビデオ信号を電流値でなく、電圧値で出力してもよい。
【００８９】
次に、発光停止動作について説明する。
【００９０】
まず画素１１の周囲に設けられた別の走査線駆動回路（図示せず）から出力される信号によって、j行目の第２走査線(Gbj)が選択される。すなわち、第２走査線(Gbj)に低電位（Ｌレベル）信号が出力される。ｐチャネル型のトランジスタ１２２は、ゲート電極が低電位（Ｌレベル）となるためにオン状態となる。
【００９１】
するとトランジスタ１１７のソースとゲートが短絡され、オフとなる。その結果、自発光素子１２１への電流供給は遮断され、発光は停止する。
【００９２】
このような発光停止動作を利用することによって、自発光素子１２１の発光時間を、１列走査時間の制約を受けずに、任意に制御できるが可能となる。その大きな利点として、まず中間階調表現を時間階調方式により表現することが容易となることがある。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行うこと等に利点がある。
【００９３】
（実施の形態３）
実施の形態３では、本発明の表示装置、発光装置における画素の平面レイアウト（上面図）例を提示する。本例の画素回路は、図３（Ｂ）に示した画素回路である。
【００９４】
図６には、j行i列目の画素１１を示す。図６において、二点破線で囲んだ領域が画素１１に相当する。点模様の領域は、ポリシリコン膜である。右上り斜線と右下り二重斜線は、それぞれ別の層の導電体膜（金属膜等）である。バツ印は層間の接触点を示す。そして、チェック模様の領域８６は自発光素子８４の陽極に相当する。
【００９５】
第1走査線(Gaj)下には、トランジスタ７１〜７５、８５が形成されている。第２走査線(Gbj)下には、トランジスタ７６〜７９が形成されている。電源線(Vi)の下に容量素子８３が形成されている。
【００９６】
駆動用素子を構成する３つのトランジスタ８０〜８２は同サイズに揃えて互いに隣接させて形成されている。これにより最初から、同一画素内におけるトランジスタ８０〜８２間のバラつきが、大きくなりにくくすることはできる。本発明の構成である「並列書込み直列駆動」は、駆動用素子を構成する複数のトランジスタ間に元々存在するバラつきの影響を、さらに小さくする手法である。したがって、当初からバラつきが抑えられた複数のトランジスタを駆動用素子に用いるのであれば、本発明の効果を非常に大きく生かすことができ好ましい。自発光素子の発光輝度のバラつきは、さらに僅少となる。
【００９７】
なお本発明の表示装置、発光装置を作製する工程については、例えば、特開２００１−３４３９３３等を参照できる。駆動用素子を構成する複数のトランジスタは、ソースとドレインについては対称的である方が好ましいが、対称的であることが必須というわけではない。
【００９８】
（実施の形態４）
実施の形態４では、本発明の表示装置、発光装置の構成の例について図７を用いて説明する。画素内ではなく、装置の全体的な構成の例を説明する。
【００９９】
本発明の表示装置、発光装置は、基板１８０１上に、複数の画素がマトリクス状に配置された画素部１８０２を有する。画素部１８０２の周辺部には、信号線駆動回路１８０３、第１の走査線駆動回路１８０４及び第２の走査線駆動回路１８０５が配置されている。信号線駆動回路１８０３と、走査線駆動回路１８０４及び１８０５には、ＦＰＣ１８０６を介して、外部より電源、信号が供給される。
【０１００】
図７（Ａ）の例においては、信号線駆動回路１８０３と、走査線駆動回路１８０４及び１８０５が集積されているが、本発明はこれに限定されるものではない。例えば、第２の走査線駆動回路１８０５を欠いていてもよい。あるいは、信号線駆動回路１８０３、走査線駆動回路１８０４及び１８０５を欠いていてもよい。
【０１０１】
第１の走査線駆動回路１８０４及び第２の走査線駆動回路１８０５の例を、図７（Ｂ）を用いて説明する。図７（Ｂ）では、走査線駆動回路１８０４及び１８０５はそれぞれ、シフトレジスタ１８２１、バッファ回路１８２２を有している。
【０１０２】
図７（Ｂ）の回路の動作を説明する。シフトレジスタ１８２１は、クロック信号（Ｇ−ＣＬＫ）、クロック反転信号（Ｇ−ＣＬＫｂ）、スタートパルス信号（Ｇ−ＳＰ）に基づき、順次パルスを出力する。該パルスは、バッファ回路１８２２で電流増幅された後、走査線に入力される。こうして走査線は、１行ずつ順次選択状態となる。
【０１０３】
なお必要に応じ、バッファ回路１８２２内にレベルシフタを設置してもよい。レベルシフタにより、電圧振幅を変更することができる。
【０１０４】
次いで、信号線駆動回路１８０３の例を、図７（Ｃ）を用いて説明する。図７（Ｃ）に示す信号線駆動回路１８０３は、シフトレジスタ１８３１、第１のラッチ回路１８３２、第２のラッチ回路１８３３、電圧電流変換回路１８３４を有している。
【０１０５】
図７（Ｃ）の回路の動作を説明する。図７（Ｃ）の回路は、中間階調表示方式として、ディジタル時間階調法を採用した場合の回路である。
【０１０６】
シフトレジスタ１８３１は、クロック信号（Ｓ−ＣＬＫ）、クロック反転信号（Ｓ−ＣＬＫｂ）、スタートパルス信号（Ｓ−ＳＰ）に基づき、順次サンプリングパルスを第１のラッチ回路１８３２に出力する。各列の第１のラッチ回路１８３２は、該パルスのタイミングに従って、ディジタルビデオ信号を順次読込む。第１のラッチ回路１８３２において、最終列までビデオ信号の読込みが完了すると、第２のラッチ回路１８３３にラッチパルスが入力される。ラッチパルスにより、各列の第１のラッチ回路１８３２に読込まれていたビデオ信号は、一斉に各列の第２のラッチ回路１８３３に転送される。第２のラッチ回路１８３３に転送されたビデオ信号は、電圧電流変換回路１８３４において、適宜形式変換処理され、画素へ転送される。ビデオ信号のうち、オンデータは電流形式に変換され、オフデータは電圧形式のまま電流増幅される。ラッチパルス後、シフトレジスタ１８３１、第１のラッチ回路１８３２は、次行のビデオ信号読込み動作として、上記動作を繰り返す。
【０１０７】
図７（Ｃ）の信号線駆動回路１８０３の構成は１例であり、アナログ階調法を採用した場合には、別の構成にする。またディジタル時間階調法を採用した場合であっても、他の構成にすることはできる。
【０１０８】
（実施の形態５）
実施の形態５では、トランジスタの特性曲線（図８）を用いて、本発明の効果について説明する。説明を簡単にするため、駆動用素子を構成するトランジスタに個数が、２個の場合を例に説明する。画素回路構成としては、図２（Ｂ）のとおりであるとする。またここで用いるトランジスタの特性曲線は、簡単にするため理想的なものとしてあり、実際のトランジスタとは若干の差異がある。例えば、チャネル長変調はゼロとしてある。
【０１０９】
トランジスタのソースの電位を基準として、ゲートの電位をＶg、ドレインの電位をＶd、ソースドレイン間に流れる電流をＩdとする。ただし、正負の向きは適宜設定してある（トランジスタがｐチャネル型のときは、正負を入替える等）。図８（Ａ）（Ｂ）において、曲線８０１〜８０４は、ある一定のゲート電位Ｖg下におけるＩd-Ｖd特性曲線である。一点鎖太曲線８０５は、駆動用素子を構成する２個のトランジスタの一方について、ゲートとドレインを短絡することにより、ＶgとＶdとを等しくした条件下でのＩd-Ｖd変化を示したものである。すなわち、一点鎖太曲線８０５には、該トランジスタ固有の電気的特性（電界効果移動度、しきい電圧値）が反映されている。同様に、二点鎖太曲線８０６は、駆動用素子を構成する他の一方のトランジスタについて、ゲートとドレインを短絡することにより、ＶgとＶdとを等しくした条件下でのＩd-Ｖd変化を示したものである。
【０１１０】
図８（Ａ）（Ｂ）は、駆動用素子を構成する２個のトランジスタが各々異なった電気的特性をもっている場合に、本発明の構成である「並列書込み直列駆動」により、自発光素子駆動電流がどうなるかを、図的に調べたものである。図８（Ａ）は、２個のトランジスタ間において特に、電界効果移動度の違いが大きい場合の例である。図８（Ｂ）は、２個のトランジスタ間において特に、しきい電圧値の違いが大きい場合の例である。結論としては、各場合で自発光素子駆動電流は、８０７の三角矢印の長さで示されるとおりとなる。これについて、以下に簡単に説明する。
【０１１１】
まず、トランジスタ３８、３９の特性曲線として、いずれも等しく、一点鎖太曲線８０５が対応する場合を考える。
【０１１２】
データ電流書込み時には、図２（Ｂ）のトランジスタ３１〜３６がオンとなる。トランジスタ３１〜３４がオンとなることから、駆動用素子を構成する２個のトランジスタ３８、３９では、ゲートとドレインが短絡される。よってトランジスタ３８、３９の動作点は、一点鎖太曲線８０５上の点であり、データ電流値ＩWにより決まるある一点である。いま、該動作点が８０５と８０１の交点としておく。つまり８０５と８０１の交点の縦軸値Ｉdの２倍が、データ電流値ＩWであるとしておく。
【０１１３】
自発光素子発光時には、図２（Ｂ）のトランジスタ３１〜３６がオフとなり、トランジスタ３７、４２がオンとなる。トランジスタ３１〜３４がオフとなることから、トランジスタ３８、３９のゲート電位は、データ電流書込み時のままで保持される。そして自発光素子発光時には、トランジスタ３９が飽和領域で動作し、トランジスタ３８が非飽和領域で動作する。自発光素子発光時における、トランジスタ３８のＩd-Ｖd曲線は８０１で表され、トランジスタ３９のＩd-Ｖd曲線は８０３で表される。
【０１１４】
図８（Ａ）上で、各一点鎖線矢印は、長さと縦軸座標は等しい。自発光素子発光時における、トランジスタ３８の動作点は、左側の一点鎖線矢印の右端と８０１との接点である。そして求めるべき自発光素子駆動電流ＩEは、一点鎖線矢印の縦軸座標、すなわち、８０７の実線三角矢印の長さである。なお図８（Ｂ）上でも同様の事情が成立し、求めるべき自発光素子駆動電流ＩEは８０７の実線三角矢印の長さである。トランジスタ３８の特性曲線とトランジスタ３９の特性曲線が、いずれも等しい場合には、結果的には求めるべき自発光素子駆動電流ＩEは、データ電流値ＩWの４分の１の大きさとなる。
【０１１５】
次に、トランジスタ３８の特性曲線として二点鎖太曲線８０６が対応し、トランジスタ３９の特性曲線として一点鎖太曲線８０５が対応する場合を考える。データ電流値ＩWは、上で述べたトランジスタ３８、３９の特性曲線としていずれも８０５が対応する場合と、同一とする。
【０１１６】
データ電流書込み時には、図２（Ｂ）の駆動用素子を構成する２個のトランジスタ３８、３９では、ゲートとドレインが短絡される。よってトランジスタ３８の動作点は二点鎖太曲線８０６上の点であり、トランジスタ３９の動作点は一点鎖太曲線８０５上の点である。そして、トランジスタ３８の動作点の縦軸座標と、トランジスタ３９の動作点の縦軸座標との和は、データ電流値ＩWである。よってトランジスタ３８の動作点は、８０６と８０２の交点となる。トランジスタ３９の動作点は、トランジスタ３８の動作点と横軸座標が等しい、曲線８０５上の点となる。
【０１１７】
自発光素子発光時には、図２（Ｂ）のトランジスタ３１〜３４がオフとなることから、トランジスタ３８、３９のゲート電位は、データ電流書込み時のままで保持される。そして自発光素子発光時には、トランジスタ３９が飽和領域で動作し、トランジスタ３８が非飽和領域で動作する。自発光素子発光時における、トランジスタ３８のＩd-Ｖd曲線は８０２で表される。
【０１１８】
図８（Ａ）上で、同縦軸座標値にある各二点鎖線矢印は、長さが等しい。上の二点鎖線矢印の組が、いま検討している、トランジスタ３８の特性曲線として二点鎖太曲線８０６が対応し、トランジスタ３９の特性曲線として一点鎖太曲線８０５が対応する場合である。自発光素子発光時における、トランジスタ３８の動作点は、左側の該二点鎖線矢印の右端と８０２との接点である。そして求めるべき自発光素子駆動電流ＩEは、該二点鎖線矢印の縦軸座標、すなわち、８０７の長点線三角矢印（左側）の長さである。なお図８（Ｂ）上でも同様の事情が成立し、求めるべき自発光素子駆動電流ＩEは、８０７の長点線三角矢印（左側）の長さである。
【０１１９】
また別の場合として、トランジスタ３８の特性曲線として一点鎖太曲線８０５が対応し、トランジスタ３９の特性曲線として二点鎖太曲線８０６が対応する場合の検討も、同様にして行うことができる。詳しく述べないが、結果的には図８（Ａ）（Ｂ）とも、求めるべき自発光素子駆動電流ＩEは、８０７の長点線三角矢印（右側）の長さとなる。
【０１２０】
さらに別の場合として、トランジスタ３８、３９の特性曲線として、いずれも二点鎖太曲線８０５が対応する場合の検討も、同様に行うことができる。結果的には図８（Ａ）（Ｂ）とも、求めるべき自発光素子駆動電流ＩEは、８０７の短点線三角矢印の長さとなる。
【０１２１】
図８（Ａ）（Ｂ）における、８０７の三角矢印の長さから、駆動用素子を構成するトランジスタ３８、３９の特性がバラつきが、自発光素子駆動電流ＩEにどのように反映されるかの概略をみることができる。
【０１２２】
比較のために、図８（Ａ）（Ｂ）には８０８の狭角矢印、８０９の広角矢印も掲載してある。８０８の狭角矢印は、電流入力方式でカレントミラー型を用いる画素回路の場合において、上記と同様の検討を行った結果である。すなわち、カレントミラーの二つのトランジスタ間に、上記と同様の特性バラつきが存在したとき、自発光素子駆動電流ＩEがどうなるかを示している。８０９の広角矢印は、電圧入力方式の画素回路の場合において、同様の検討を行った結果である。すなわち、異なる画素の自発光素子駆動トランジスタ間に、上記と同様の特性バラつきが存在したとき、自発光素子駆動電流ＩEがどうなるかを示している。
【０１２３】
図８（Ａ）（Ｂ）の８０７の三角矢印、８０８の狭角矢印、８０９の広角矢印を比較から、次の点がわかる。
【０１２４】
まず、８０７の三角矢印、８０８の狭角矢印では、同一画素内の二つのトランジスタ間にさえ特性バラつきがない限りは、トランジスタの特性曲線が８０５でも８０６でも、自発光素子駆動電流ＩEは一定となる。すなわち、電流入力方式でカレントミラー型を用いる画素回路でも、本発明の「並列書込み直列駆動」の画素回路でも、基板全体でトランジスタの特性を一定に揃える必要はなく、同一画素内の二つのトランジスタ間の特性バラつきさえ、抑制すれば十分である。この点は、電圧入力方式の画素回路に対して非常に優位である。
【０１２５】
しかし、同一画素内の二つのトランジスタ間の特性バラつきが存在すると、８０８の狭角矢印では、自発光素子駆動電流ＩEのバラつきが大きくなる。すなわち、電流入力方式でカレントミラー型を用いる画素回路では、同一画素内の二つのトランジスタ間の特性バラつきの影響が激しく現れてしまう。極端な場合では、電圧入力方式の画素回路よりも、自発光素子駆動電流ＩEのバラつきが大きくなる危険がある。この点、本発明の「並列書込み直列駆動」の画素回路では、同一画素内の二つのトランジスタ間の特性バラつきの影響が、かなり抑制されている。現実の表示装置、発光装置では、トランジスタの特性バラつきは、同一画素内よりも基板全体にわたるものの方が深刻である。したがって同一画素内の二つのトランジスタ間の特性バラつきは、本発明の「並列書込み直列駆動」の画素回路なみに抑制されれば、実用上はほとんど問題がなくなる。
【０１２６】
この実施の形態５では、駆動用素子を構成するトランジスタに個数が、２個の場合を例に、本発明の効果について説明した。しかし、駆動用素子を構成するトランジスタに個数が、３個以上の場合においても同様の事情が成立する。
【０１２７】
（実施の形態６）
実施の形態６では、本発明の表示装置、発光装置を搭載した電子機器等を、いくつか例示する。
【０１２８】
本発明の表示装置、発光装置を搭載した電子機器として、モニター、ビデオカメラ、ディジタルカメラ、ゴーグル型ディスプレイ（ヘッドマウントディスプレイ）、ナビゲーションシステム、音響再生装置（オーディオコンポ、カーオーディオ等）、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末（モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等）、記録媒体を備えた画像再生装置（具体的にはDigital Versatile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置）などが挙げられる。特に、斜め方向から画面を見る機会が多い電子機器については、視野角の広さが重要視されるため、発光装置を用いることが望ましい。それら電子機器の具体例を図９に示す。
【０１２９】
図９（Ａ）はモニターである。この例は筐体２００１、支持台２００２、表示部２００３、スピーカー部２００４、ビデオ入力端子２００５等を含んでいる。本発明の表示装置、発光装置は表示部２００３に用いることができる。発光装置は自発光型であるためバックライトが不要であり、液晶ディスプレイよりも表示部を薄くすることができる。なおモニターには、パソコン用、ＴＶ放送受信用、広告表示用などのすべての情報表示装置が含まれる。
【０１３０】
図９（Ｂ）はディジタルスチルカメラである。この例は本体２１０１、表示部２１０２、受像部２１０３、操作キー２１０４、外部接続ポート２１０５、シャッター２１０６等を含んでいる。本発明の表示装置、発光装置は表示部２１０２に用いることができる。
【０１３１】
図９（Ｃ）はノート型パーソナルコンピュータである。この例は本体２２０１、筐体２２０２、表示部２２０３、キーボード２２０４、外部接続ポート２２０５、ポインティングマウス２２０６等を含んでいる。本発明の表示装置、発光装置は表示部２２０３に用いることができる。
【０１３２】
図９（Ｄ）はモバイルコンピュータである。この例は本体２３０１、表示部２３０２、スイッチ２３０３、操作キー２３０４、赤外線ポート２３０５等を含んでいる。本発明の表示装置、発光装置は表示部２３０２に用いることができる。
【０１３３】
図９（Ｅ）は記録媒体を備えた携帯型の画像再生装置（具体的にはＤＶＤ再生装置）である。この例は本体２４０１、筐体２４０２、表示部Ａ２４０３、表示部Ｂ２４０４、記録媒体（ＤＶＤ等）読込み部２４０５、操作キー２４０６、スピーカー部２４０７等を含んでいる。本発明の表示装置、発光装置は、表示部Ａ２４０３、表示部Ｂ２４０４に用いることができる。なお、記録媒体を備えた画像再生装置には家庭用ゲーム機器なども含まれる。
【０１３４】
図９（Ｆ）はゴーグル型ディスプレイ（ヘッドマウントディスプレイ）である。この例は本体２５０１、表示部２５０２、アーム部２５０３等を含んでいる。本発明の表示装置、発光装置は表示部２５０２に用いることができる。
【０１３５】
図９（Ｇ）はビデオカメラである。この例は本体２６０１、表示部２６０２、筐体２６０３、外部接続ポート２６０４、リモコン受信部２６０５、受像部２６０６、バッテリー２６０７、音声入力部２６０８、操作キー２６０９等を含んでいる。本発明の表示装置、発光装置は表示部２６０２に用いることができる。
【０１３６】
図９（Ｈ）は携帯電話である。この例は本体２７０１、筐体２７０２、表示部２７０３、音声入力部２７０４、音声出力部２７０５、操作キー２７０６、外部接続ポート２７０７、アンテナ２７０８等を含んでいる。本発明の表示装置、発光装置は表示部２７０３に用いることができる。なお、表示部２７０３は黒色背景に白色文字を表示することで、携帯電話の消費電力を抑制することができる。
【０１３７】
将来に自発光素子の発光輝度を安定的に高くすることが可能となれば、本発明の表示装置、発光装置から出力した画像情報を含む光をレンズ等で拡大投影して、フロント型又はリア型のプロジェクターに用いることもできる。
【０１３８】
このように、本発明の適用範囲は極めて広く、あらゆる分野の電子機器等に使用することが可能である。
【０１３９】
【発明の効果】
本発明はＡＭ型表示装置、発光装置において、各画素に設置される駆動用素子を複数のトランジスタにより構成する。その上で、画素にデータ電流を読込むときには該複数のトランジスタを並列接続状態にし、自発光素子を発光させるときには該複数のトランジスタを直列接続状態にする。このように、駆動用素子を構成する複数のトランジスタの接続状態を、並列または直列と適宜切替えることを特徴とする。その結果、次のような効果が生じる。
【０１４０】
まず、同一画素内の駆動用素子を構成する複数のトランジスタさえ、バラつきがなければ、表示画面全体で発光輝度のムラが現れてしまうという、表示品位上の重大な欠陥を回避することができる。すなわち、各画素に設置されるトランジスタの電気的特性は、基板全体にわたって観察すると、かなりのバラつきをもつ。このバラつきが自発光素子駆動電流ＩEに反映されて、表示画面全体で発光輝度のムラとなってしまうのを防止することができる。ただし、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合においても、同一画素内のカレントミラーの二つのトランジスタさえバラつきがなければ、表示画面全体で発光輝度のムラとなるのを防止することができる。この点で本発明は、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合と同様の効果を有する。
【０１４１】
しかし、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合、同一画素内のカレントミラーの二つのトランジスタ間にバラつきが存在してしまうと、結局発光輝度が画素間で異なってしまうのを防止することができなくなる。その点、本発明の場合では、同一画素内の駆動用素子を構成する複数のトランジスタ間にバラつきが存在しても、その影響は小さく抑制されるため、実用上問題となるほど画素間で発光輝度がバラついてしまうことは防止することができる。
【０１４２】
また、図１０（Ｂ）の画素回路の場合、画素間で発光輝度がバラついてしまうのは防止することができる。しかし、図１０（Ｂ）の画素回路の場合には、画素に書込むデータ電流ＩWと、自発光素子を発光させるときの自発光素子駆動電流ＩEとの比が、同一値でなくてはならない。これは実用上、非常に厳しい制限である。本発明の場合では、駆動用素子を構成するトランジスタを複数に分割するため、画素に書込むデータ電流ＩWを自発光素子駆動電流ＩEよりも大きくすることが可能である。
【０１４３】
本発明は以上のような利点を有することから、実用的なＡＭ型表示装置、発光装置を製造する上で、重要な技術である。
【図面の簡単な説明】
【図１】 本発明の表示装置、発光装置の画素を示す図。
【図２】 本発明の表示装置、発光装置の画素を示す図。
【図３】 本発明の表示装置、発光装置の画素を示す図。
【図４】 本発明の表示装置、発光装置の画素を示す図。
【図５】 本発明の表示装置、発光装置の画素における電流の経路を示す図。
【図６】 本発明の表示装置、発光装置の画素の平面レイアウトを示す図。
【図７】 本発明の表示装置、発光装置を示す図。
【図８】 駆動用素子を構成するトランジスタの特性を示す図。
【図９】 本発明の表示装置、発光装置を適用した電子機器を示す図。
【図１０】 公知の表示装置、発光装置の画素を示す図。
【発明の属する技術分野】
本発明は、発光装置及び表示装置の技術に関する。さらには、前記発光装置または表示装置を搭載した電子機器に関する。本明細書における発光装置とは、自発光素子から放出される光を利用した装置を指す。自発光素子の例としては、有機発光ダイオード（ＯＬＥＤ）素子、無機材料系の発光ダイオード素子、電界放出発光素子（ＦＥＤ素子）などがある。本明細書における表示装置とは、複数の画素をマトリクス状に配置し画像情報を視覚的に伝達する装置、いわゆるディスプレイを指す。
【０００２】
【従来の技術】
近年、画像の表示を行う表示装置の重要性が増している。表示装置としては、液晶素子を用いて画像の表示を行う液晶表示装置が、高画質、薄型、軽量などの利点を活かして、携帯電話やパソコンをはじめとする種々の用途の表示装置として幅広く用いられている。
【０００３】
他方で、自発光素子を用いた表示装置、発光装置の開発も進められている。この自発光素子には、有機材料、無機材料、薄膜材料、バルク材料、分散材料、広汎にわたり様々な種類の素子が存在する。
【０００４】
なかでも表示装置向けに将来有望視されている代表的な自発光素子は、有機発光ダイオード（ＯＬＥＤ）素子である。ＯＬＥＤ素子を自発光素子として用いたＯＬＥＤ表示装置は、既存の液晶表示装置以上に薄型、軽量である特長に加え、動画表示に適した高応答速度、高視野角、低電圧駆動などの特長を有しているため、携帯電話や携帯情報端末（ＰＤＡ）をはじめテレビ、モニターなど、幅広い用途が見込まれ、次世代ディスプレイとして注目されている。
【０００５】
特にアクティブマトリクス（ＡＭ）型のＯＬＥＤ表示装置は、パッシブマトリクス（ＰＭ）型では困難な、高精細、大画面の表示も可能であるうえ、ＰＭ型を上回る低消費電力動作で高信頼性を有し、実用化への期待は大変強い。
【０００６】
ＯＬＥＤ素子は、陽極と、陰極と、該陽極と該陰極との間に挟まれた有機化合物の層とを有する構造をしている。ＯＬＥＤ素子に流れる電流量と、ＯＬＥＤ素子の発光輝度は概ね比例する関係にある。ＡＭ型ＯＬＥＤ表示装置の画素では、該画素のＯＬＥＤ素子の発光輝度を制御する駆動用トランジスタを、ＯＬＥＤ素子に直列に接続している。
【０００７】
ＡＭ型ＯＬＥＤ表示装置において画像を表示する駆動方式には、電圧入力方式と電流入力方式がある。前者の電圧入力方式は、画素に入力するビデオ信号として、電圧値形式データのビデオ信号を入力する。他方、後者の電流入力方式は、画素に入力するビデオ信号として、電流値形式データのビデオ信号を入力する。
【０００８】
電圧入力方式では通常、画素の駆動用トランジスタのゲート電極にビデオ信号の電圧が直接印加される。そのためＯＬＥＤ素子を定電流発光させる場合、駆動用トランジスタの電気的特性が各々の画素間で均一でなくバラつきを有していると、各画素のＯＬＥＤ素子駆動電流にバラつきが生じる。ＯＬＥＤ素子駆動電流のバラつきは、ＯＬＥＤ素子の発光輝度のバラつきとなる。ＯＬＥＤ素子の発光輝度のバラつきは、画面全体でみると砂嵐状あるいは絨毯模様のムラとして、表示画像の品位を低下させる。
【０００９】
特に、駆動用トランジスタとして非晶質（アモルファス）シリコン薄膜トランジスタ（ＴＦＴ）を用いると、高輝度の発光に十分な電流が得られない。そこで、駆動用トランジスタとして、多結晶（ポリ）シリコンＴＦＴが用いられる。しかし、ポリシリコンでは結晶粒界における欠陥等に起因して、ＴＦＴの電気的特性にバラつきが生じやすい問題がある。
【００１０】
このような電圧入力方式における、ＯＬＥＤ素子駆動電流のバラつきを防ぐための有効な手段の一つとして、電流入力方式がある。電流入力方式では通常、ビデオ信号のデータ電流値を記憶し、記憶した電流値と同一もしくは数倍（１未満を含む正の実数倍）の電流を、ＯＬＥＤ素子駆動電流として供給する。
【００１１】
電流入力方式のＡＭ型ＯＬＥＤ表示装置の画素回路で、代表的な一例を図１０（Ａ）に示す（A. Yumoto et al., Proc. Asia Display / IDW '01 p.p.1395-1398 (2001) 等を参照）。５１６がＯＬＥＤ素子である。この画素回路は、カレントミラー回路を用いている。そこでカレントミラーを構成する二つのトランジスタが同一の電気的特性さえ備えていれば、ビデオ信号のデータ電流値を正確に記憶することができる。相異なる画素の駆動用トランジスタの電気的特性間にバラつきがあっても、同一画素内の前記二つのトランジスタが各々同一の電気的特性を備えてさえいれば、ＯＬＥＤ素子の発光輝度のバラつきは防がれることになる。
【００１２】
電流入力方式のＡＭ型ＯＬＥＤ表示装置の画素回路で、代表的な他の一例を図１０（Ｂ）に示す（I. M. Hunter et al., Proc. AM-LCD 2000 p.p.249-252 (2000) 等を参照）。６１１がＯＬＥＤ素子である。この画素回路は、駆動用トランジスタのゲート電極にビデオ信号に対応する電圧を書込むときに、駆動用トランジスタ自身のドレイン電極とゲート電極を短絡する。その状態でビデオ信号のデータ電流を流し、その後ゲート電極を電気的に絶縁させる。するとＯＬＥＤ素子を発光させるときに、駆動用トランジスタを飽和領域にて動作させるようにすれば、書込み時のデータ電流と同一値の電流を、駆動用トランジスタはＯＬＥＤ素子に供給する。従って、各画素の駆動用トランジスタに電気的特性のバラつきが存在しても、ＯＬＥＤ素子の発光輝度のバラつきは防がれることになる。
【００１３】
【発明が解決しようとする課題】
図１０（Ａ）（Ｂ）は、上記のように正確にデータ電流値を記憶できるはずであるが、以下の深刻な問題がある。
【００１４】
まず、図１０（Ａ）の画素回路における問題点は、カレントミラーを構成する二つのトランジスタが同一の電気的特性もつことが、前提条件とされていることである。設計時に工夫すれば、両トランジスタを基板上に隣り合わせに作製することも可能であるので、ある程度はバラつきを減少させることができる。とはいえ現在のポリシリコンでは、結晶粒界における欠陥等に起因して、ＴＦＴのしきい値電圧、電界効果移動度等の電気的特性に、なお許容限度を超えるバラつきが残存してしまうのが普通である。
【００１５】
具体的には、例えば６４階調の画像を表示する場合には、輝度バラつきは１％以内程度に抑える必要が生じる。しかし図１０（Ａ）の画素回路では、データ電流値を１％の精度で記憶することは、現在普通に使用されるポリシリコンでは困難である。すなわち、図１０（Ａ）の画素回路を使うのみでは、画面全体でムラがない十分に均一の、高品位表示画像を得ることはできない。
【００１６】
次に、図１０（Ｂ）の画素回路における問題点は、画素に書込むビデオ信号データ電流と、ＯＬＥＤ素子を発光させるときのＯＬＥＤ素子駆動電流とが、同一値になってしまう点である。ＡＭ型ＯＬＥＤ表示装置を作製する場合、両電流を同一値としなくてはならないという点は、事実上はかなり厳しい制約となる。
【００１７】
具体的には、実際のＡＭ型ＯＬＥＤ表示装置においては、信号線等に多量の寄生容量、寄生抵抗がついてしまう。その結果、ビデオ信号データ電流はＯＬＥＤ素子駆動電流よりも大きくする措置をとることが必要な場合が、少なからず生じる。特に、ビデオ信号データ電流をアナログ値にして階調表現する場合には、暗部のビデオ信号データ電流の書込みが非常に困難となる。
【００１８】
本発明は上記問題点の存在に鑑みてなされたものである。まず本発明は、図１０（Ｂ）の画素回路とは異なり、画素に書込むビデオ信号データ電流と、ＯＬＥＤ素子を発光させるときのＯＬＥＤ素子駆動電流との比が「１」に固定されない、ＡＭ型ＯＬＥＤ表示装置を提供することを課題とする。次に本発明は、図１０（Ａ）の画素回路とは異なり、同一画素内の隣接設置されたトランジスタ間においても、なお電気的特性のバラつきがある程度残存することを前提とする。その上で本発明は、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合と比較して、ＯＬＥＤ素子駆動電流のバラつきが十分に抑制されたＡＭ型ＯＬＥＤ表示装置を提供することを課題とする。
【００１９】
【課題を解決するための手段】
上記課題を解決するために、本発明はＡＭ型表示装置または発光装置において、各画素に設置される駆動用素子を複数のトランジスタにより構成し、画素にデータ電流を読込むときには該複数のトランジスタを並列接続状態にし、自発光素子を発光させるときには該複数のトランジスタを直列接続状態にすることを特徴としている。
【００２０】
なおＯＬＥＤ素子以外の素子を用いた表示装置、発光装置であっても、電流駆動型の素子を用いる場合には、本発明の構成が利用できる。
【００２１】
このような、本発明の表示装置または発光装置の画素構成の概略について、図１（Ａ）（Ｂ）を用いて説明する。図１（Ａ）には、複数の画素を有する画素部において、j行i列目に配置された画素１１を示す。画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、スイッチング機能を有する第１スイッチ１２〜第３スイッチ１４、駆動用素子１５、容量素子１６、自発光素子１７を有する。なお、図１（Ａ）（Ｂ）で容量素子１６が設置されているノードの寄生容量が大きい場合などには、容量素子１６は必ずしも設けなくてよい。
【００２２】
自発光素子としては、典型的にはＯＬＥＤ素子が該当するため、本明細書では、自発光素子を表す記号としてダイオードの記号を用いる。しかし自発光素子にダイオード特性は必須ではなく、本発明はダイオード特性をもつ自発光素子の場合に限定されない。さらに断ると、本明細書での自発光素子は、電流駆動型の表示用素子であればよく、自発光により表示機能を担う必要もない。例えば、液晶のような光シャッターだが、電圧値でなく電流値により制御されるものも、本明細書での自発光素子に含まれる。
【００２３】
第１スイッチ１２〜第３スイッチ１４には、トランジスタなどのスイッチング機能を有する半導体素子を１個又は複数個用いることができる。同様に駆動用素子１５にも、トランジスタなどの半導体素子を複数個用いることができる。第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号により、オン又はオフが決定される。第１スイッチ１２及び第２スイッチ１３はスイッチとして機能すればよいので、用いられる半導体素子の導電型に特に限定はない。
【００２４】
なお第１スイッチ１２は、信号線(Si)と駆動用素子１５の間に設置されており、画素１１に対する信号の書込みを制御する役割を果たす。また第２スイッチ１３は、電源線(Vi)と駆動用素子１５の間に設置されており、電源線から画素１１への電流の供給を制御する。
【００２５】
図１（Ｂ）には、図１（Ａ）に示した画素１１に、第４スイッチ１８と第２走査線(Gbj)を追加して配置した場合を示す。第４スイッチ１８には、トランジスタなどのスイッチング機能を有する半導体素子を１個又は複数個用いることができる。第４スイッチ１８は、第２走査線(Gbj)から与えられる信号により、オン又はオフが決定される。第１スイッチ１２及び第２スイッチ１３はスイッチとして機能すればよいので、用いられる半導体素子の導電型に特に限定はない。
【００２６】
なお第４スイッチ１８は画素１１の初期化用素子としての役割を担う。
第４スイッチ１８がオンになると、容量素子１６に保持されている電荷が放出されて、駆動用素子１５はオフになり、さらに自発光素子１７の発光は終了する。
【００２７】
本発明では、駆動用素子１５を複数のトランジスタで構成し、画素１１にビデオ信号のデータ電流を書込む場合と、自発光素子１７に電流を流し発光させる場合とにおいて、該複数のトランジスタの接続を並列と直列とに切替えて用いる点に特徴がある。図１（Ａ）（Ｂ）では、第１スイッチ１２及び第２スイッチ１３を、走査線(Gaj)からの信号によりオン・オフ制御をすることが、駆動用素子１５の複数のトランジスタを、並列接続状態と直列接続状態とを切替える手段となっている。
【００２８】
ここで、一例として駆動用素子１５が４つのトランジスタ２０ａ〜２０ｄで構成された場合の画素１１を図１（Ｃ）（Ｄ）に示し、画素１１における電流の経路について以下に説明する。
【００２９】
図１（Ｃ）は画素１１にデータ電流を書込む場合を示し、図１（Ｄ）は自発光素子を発光させる場合を示している。なお図１（Ｃ）（Ｄ）において、第１スイッチ１２、第２スイッチ１３、駆動用素子１５、自発光素子１７、信号線(Si)及び電源線(Vi)以外の素子、配線は図示を省略する。
【００３０】
最初に、画素１１にデータ電流を書込む場合について説明する。図１（Ｃ）において、第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号によりオンになる。すると駆動用素子１５は、各トランジスタがダイオード接続状態となり、かつ相互に並列接続状態になる。電流経路は、電源線(Vi)から第２スイッチ１３、駆動用素子１５、第１スイッチ１２を通って、信号線(Si)である。このときの電流値ＩWは、ビデオ信号のデータ電流値であり、信号線駆動回路が信号線(Si)に出力する所定の電流値である。
【００３１】
次いで、自発光素子１７を発光させる場合について説明する。図１（Ｄ）において、第１スイッチ１２及び第２スイッチ１３は、第１走査線(Gaj)から与えられる信号によりオフになる。すると駆動用素子１５は、各トランジスタが相互に直列接続状態になる。電流経路は、電源線(Vi)からトランジスタ２０ａ、２０ｂ、２０ｃ、２０ｄを通って自発光素子１７である。このときの電流値ＩEにより、自発光素子１７の発光輝度が決まる。
【００３２】
上述したように本発明では、画素にデータ電流を書込むときには、駆動用素子１５を構成するトランジスタ２０ａ〜２０ｄを並列に使用する（図１（Ｃ））。他方、画素１１が有する自発光素子１７に電流を流すとき、すなわち自発光素子駆動時には、駆動用素子１５を構成するトランジスタ２０ａ〜２０ｄを直列に使用する（図１（Ｄ））。従って、もしトランジスタ２０ａ〜２０ｄの電気的特性が同一であると仮定すれば、書込み時の電流値ＩWは、自発光素子駆動時の電流値ＩEの１６倍（４2倍）となる。より一般的に、駆動用素子１５を構成するトランジスタの数がｎ個の場合を考えると、該トランジスタの全てが同一の電気的特性をもつとの条件の下では、ビデオ信号書込み時の電流値ＩWと自発光素子駆動時の電流値ＩEとの間に次式（１）の関係が成立する。
【００３３】
【数１】
ＩW＝ｎ2×ＩE・・・（１）
【００３４】
なお式（１）が厳密に成立するためには、駆動用素子１５を構成するトランジスタの全てが同一の電気的特性をもつことが条件となる。しかし該トランジスタの電気的特性が、相互に若干のバラつきを伴っている場合であっても、近似的に式（１）が成立するとして扱うことが現実的には可能である。
【００３５】
よって本発明では、駆動用素子１５を複数のトランジスタで構成し、画素１１にビデオ信号電流を書込む場合と、自発光素子を発光させる場合とにおいて、該複数のトランジスタの接続を並列と直列とに切替えて用いることで、書込み時の電流値ＩWと自発光素子駆動時の電流値ＩEとを任意に設定することができる特長を有する。
【００３６】
また本発明の別の特長として、駆動用素子１５を構成する各トランジスタの電気的特性が、相互に若干のバラつきを伴っていたとしても、その影響が自発光素子駆動電流ＩEに反映されてしまうのを大きく軽減できる点がある。これに関しては具体的な例をとりあげ、実施の形態５において説明する。
【００３７】
図１０（Ａ）のようなカレントミラーを用いる画素回路においても、画素内の二つのトランジスタに関する限り、同一の電気的特性もつことが要求されてしまう問題があった。しかし本発明では同一画素内におけるトランジスタでさえ、相互に電気的特性が若干異なることを既に前提としている。すなわち本発明は、トランジスタの特性バラつきに対する耐性の点において、電流入力方式のカレントミラーを用いる画素回路と比較して、優れている。その結果本発明では、結晶粒界における欠陥等に起因するポリシリコンＴＦＴの電気的特性バラつきが存在しても、自発光素子駆動電流ＩEを実用レベルにまで均一化することが可能となる。
【００３８】
【発明の実施の形態】
（実施の形態１）
以上、本発明の表示装置、発光装置の画素の概略を図１を用いて述べた。実施の形態１では、本発明の表示装置、発光装置の画素の具体的例について、図２〜４を用いて説明する。簡単にするため、駆動用素子１５を構成するトランジスタ数ｎが、２〜４の場合の例を挙げる。
【００３９】
まず最初の例を、図２（Ａ）を用いて説明する。
【００４０】
図２（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、走査線(Gaj)、トランジスタ２１〜２６、容量素子２７、自発光素子２８を有する。図２（Ａ）に示す画素１１は、図１（Ａ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ２１、２２は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ２３は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ２４は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ２５、２６は駆動用素子１５に相当する。
【００４１】
トランジスタ２１〜２４の各ゲート電極は、走査線(Gaj)に接続されている。容量素子２７は、トランジスタ２５のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ２５、２６のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子２７は必ずしも設けなくてもよい。
【００４２】
図２（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、走査線(Gaj)に低電位信号を送り、トランジスタ２１〜２３をオン、トランジスタ２４をオフにする。このとき、トランジスタ２５、２６は電流経路上、互いに並列接続の関係になる。一方、自発光素子２８に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ２１〜２３をオフ、トランジスタ２４をオンにする。このとき、トランジスタ２５、２６は電流経路上、互いに直列接続の関係になる。
【００４３】
図２（Ａ）の例では、駆動用素子１５のトランジスタ２５、２６の接続関係の切替えを、走査線(Gaj)のみで制御する。また、第１スイッチを２個、第２スイッチを１個のトランジスタのみという、最少個数のトランジスタで構成する。このように図２（Ａ）の例は、走査線数及びトランジスタ数を少なく抑えているため、開口率確保や製造不良発生率低減を重視する場合に、適した構成である。
【００４４】
次いで図２（Ａ）とは別の例を、図２（Ｂ）を用いて説明する。
【００４５】
図２（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ３１〜３９、４２、容量素子４０、自発光素子４１を有する。図２（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ３１〜３４は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ３５、３６は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ３７は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ３８、３９は駆動用素子１５に相当する。ｎチャネル型のトランジスタ４２は第４スイッチ１８に相当する。
【００４６】
トランジスタ３１〜３４の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ３５〜３７、４２の各ゲート電極は、第２走査線(Gbj)に接続されている。容量素子４０は、トランジスタ３８のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ３８、３９のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子４０は必ずしも設けなくてもよい。
【００４７】
図２（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ３１〜３６をオン、トランジスタ３７、４２をオフにする。このとき、トランジスタ３８、３９は電流経路上、互いに並列接続の関係になる。一方、自発光素子４１に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ３１〜３６をオフ、トランジスタ３７、４２をオンにする。このとき、トランジスタ３８、３９は電流経路上、互いに直列接続の関係になる。
【００４８】
図２（Ｂ）の例では、駆動用素子１５のトランジスタ３８、３９の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子４１に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子４１の発光時間を任意に制御できる。
【００４９】
これは、中間階調表現を時間階調方式により表現する場合に、非常に重要な特長である。時間階調方式をポリシリコンＴＦＴ駆動回路を有するＡＭ型ＯＬＥＤ表示装置に適用する場合、列走査期間中に発光を停止させる手段なしには、十分な多階調表示が困難なためである。また、中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である（ホールド型ディスプレイ特有の動画ボケについては、例えばT. Kurita, Proc. AM-LCD 2000 p.p.1-4 (2000) 等を参照）。
【００５０】
また図２（Ｂ）の例の、別の特長として、ビデオ信号データ電流の記憶がより正確に行える点がある。図２（Ａ）の例では、データ電流の書込み時に、トランジスタ２５は電源線(Vi)に直接接続するのに対し、トランジスタ２６はトランジスタ２３を介して接続する。よって、トランジスタ２３による電圧降下分だけ、データ電流の書込み時が不正確となる。他方図２（Ｂ）の例では、トランジスタ３８はトランジスタ３５を介して、トランジスタ３９はトランジスタ３６を介して、電源線(Vi)に接続する。トランジスタ３５とトランジスタ３６による電圧降下を、同程度となるようにすれは、ビデオ信号データ電流の記憶をより正確に行うことができる。
【００５１】
続いて３つ目の例を、図３（Ａ）を用いて説明する。
【００５２】
図３（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ５１〜５７、６０、容量素子５８、自発光素子５９を有する。図３（Ａ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｎチャネル型のトランジスタ５１〜５３は第１スイッチ１２に相当する。ｎチャネル型のトランジスタ５４は第２スイッチ１３に相当し、ｐチャネル型のトランジスタ５５は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ５６、５７は駆動用素子１５に相当する。ｎチャネル型のトランジスタ６０は第４スイッチ１８に相当する。
【００５３】
トランジスタ５１〜５５の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ６０のゲート電極は、第２走査線(Gbj)に接続されている。容量素子５８は、トランジスタ５６のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ５６、５７のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子５８は必ずしも設けなくてもよい。
【００５４】
図３（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)に高電位信号を送り、トランジスタ５１〜５４をオン、トランジスタ５５をオフにする。このとき、トランジスタ５６、５７は電流経路上、互いに並列接続の関係になる。一方、自発光素子５９に電流を流すときには、走査線(Gaj)に低電位信号を送り、トランジスタ５１〜５４をオフ、トランジスタ５５をオンにする。このとき、トランジスタ５６、５７は電流経路上、互いに直列接続の関係になる。
【００５５】
なお上記の間、第２走査線(Gbj)には低電位信号を送り、トランジスタ６０をオフしておく。
【００５６】
図３（Ａ）に示す画素１１においても、図２（Ｂ）の例の場合と同様に、第２走査線(Gbj)に送る信号により、自発光素子５９の発光時間を任意に制御できる。すなわち自発光素子５９発光中に、第２走査線(Gbj)に高電位信号をおくり、トランジスタ６０をオンにすると、トランジスタ５６がオフとなり自発光素子５９は消光する。ただし自発光素子５９を一度消光させると、再度ビデオ信号データ電流を書込まなくては、自発光素子５９を発光させられない点は、図２（Ｂ）の例と異なる。
【００５７】
図３（Ａ）に示す画素１１において、自発光素子５９の発光時間を任意に制御できることの特長は、図２（Ｂ）の例の場合と同様である。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００５８】
図３（Ａ）に示す画素１１においては、第１スイッチ１２又は第２スイッチ１３のトランジスタ５１〜５４、第４スイッチ１８のトランジスタ６０はｎチャネル型であり、第３スイッチ１４のトランジスタ５５はｐチャネル型である。これは、図２（Ａ）（Ｂ）の例の場合と異なっている。しかしこれは、スイッチのトランジスタのチャネル型に関して、特に制限がないことを例示したものにすぎない。
【００５９】
続いて４つ目の例を、図３（Ｂ）を用いて説明する。
【００６０】
図３（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ７１〜８２、８５、容量素子８３、自発光素子８４を有する。図３（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ７１〜７５は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ７６〜７８は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ７９は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ８０〜８２は駆動用素子１５に相当する。ｎチャネル型のトランジスタ８５は第４スイッチ１８に相当する。
【００６１】
トランジスタ７１〜７５、８５の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ７６〜７９のゲート電極は、第２走査線(Gbj)に接続されている。容量素子８３は、トランジスタ８０のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ８０〜８２のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子８３は必ずしも設けなくてもよい。
【００６２】
図３（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ７１〜７８をオン、トランジスタ７９、８５をオフにする。このとき、トランジスタ８０〜８２は電流経路上、互いに並列接続の関係になる。一方、自発光素子８４に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ７１〜７８をオフ、トランジスタ７９、８５をオンにする。このとき、トランジスタ８０〜８２は電流経路上、互いに直列接続の関係になる。
【００６３】
図３（Ｂ）の例では、駆動用素子１５のトランジスタ８０〜８２の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子８４に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子８４の発光時間を任意に制御できる。この事情は図２（Ｂ）の例と同様である。
【００６４】
よって、図３（Ｂ）に示す画素１１においても、自発光素子８４の発光時間を任意に制御できることに起因する、以下の特長がある。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００６５】
５つ目の例を、図４（Ａ）を用いて説明する。
【００６６】
図４（Ａ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ９１〜１０３、１０６、容量素子１０４、自発光素子１０５を有する。図４（Ａ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ９１〜９４は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ９５〜９８は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ９９は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ１００〜１０３は駆動用素子１５に相当する。ｎチャネル型のトランジスタ１０６は第４スイッチ１８に相当する。
【００６７】
トランジスタ９１〜９４の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ９５〜９９、１０６のゲート電極は、第２走査線(Gbj)に接続されている。容量素子１０４は、トランジスタ１００のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ１００〜１０３のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子１０４は必ずしも設けなくてもよい。
【００６８】
図４（Ａ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)及び第２走査線(Gbj)に低電位信号を送り、トランジスタ９１〜９８をオン、トランジスタ９９、１０６をオフにする。このとき、トランジスタ１００〜１０３は電流経路上、互いに並列接続の関係になる。一方、自発光素子１０５に電流を流すときには、走査線(Gaj)に高電位信号を送り、トランジスタ９１〜９８をオフ、トランジスタ９９、１０６をオンにする。このとき、トランジスタ１００〜１０３は電流経路上、互いに直列接続の関係になる。
【００６９】
図４（Ａ）の例では、駆動用素子１５のトランジスタ１００〜１０３の接続関係の切替えを、第１走査線(Gaj)及び第２走査線(Gbj)を用いて制御する。しかし第２走査線(Gbj)により制御されるトランジスタは、いずれも信号線(Si)とは接続していない。また自発光素子１０５に電流を流し発光させるか否かは、第１走査線(Gaj)の電位に関わりなく、第２走査線(Gbj)の電位のみにより制御できる特徴がある。従って、データ電流を書込むとき以外で、第２走査線(Gbj)に第１走査線(Gaj)とは独立の信号を送ることで、自発光素子８４の発光時間を任意に制御できる。この事情は図２（Ｂ）の例と同様である。
【００７０】
よって、図４（Ａ）に示す画素１１においても、自発光素子８４の発光時間を任意に制御できることに起因する、以下の特長がある。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００７１】
６つ目の例を、図４（Ｂ）を用いて説明する。
【００７２】
図４（Ｂ）には、j行i列目に配置された画素１１を示す。そして画素１１は、信号線(Si)、電源線(Vi)、第１走査線(Gaj)、第２走査線(Gbj)、トランジスタ１１１〜１２０、１２２、容量素子１２３、自発光素子１２１を有する。図４（Ｂ）に示す画素１１は、図１（Ｂ）に示す画素１１を具体的にトランジスタで図示したものであり、ｐチャネル型のトランジスタ１１１〜１１３は第１スイッチ１２に相当する。ｐチャネル型のトランジスタ１１４、１１５は第２スイッチ１３に相当し、ｎチャネル型のトランジスタ１１６は第３スイッチ１４に相当する。ｐチャネル型のトランジスタ１１７〜１２０は駆動用素子１５に相当する。ｐチャネル型のトランジスタ１２２は第４スイッチ１８に相当する。
【００７３】
トランジスタ１１１〜１１６の各ゲート電極は、第１走査線(Gaj)に接続されている。トランジスタ１２２のゲート電極は、第２走査線(Gbj)に接続されている。容量素子１２３は、トランジスタ１１７のゲート・ソース間電圧を保持する役割を担う。なお、トランジスタ１１７〜１２０のゲート容量が大きい場合や、該ノードの寄生容量が大きい場合などでは、容量素子１２３は必ずしも設けなくてもよい。
【００７４】
図４（Ｂ）に示す画素１１に、ビデオ信号データ電流を書込むときには、第１走査線(Gaj)に高電位信号を送り、トランジスタ１１１〜１１５をオン、トランジスタ１１６をオフにする。このとき、トランジスタ１１７〜１２０は電流経路上、互いに並列接続の関係になる。一方、自発光素子１２１に電流を流すときには、第１走査線(Gaj)に低電位信号を送り、トランジスタ１１１〜１１５をオフ、トランジスタ１１６をオンにする。このとき、トランジスタ１１７〜１２０は電流経路上、互いに直列接続の関係になる。
【００７５】
なお上記の間、第２走査線(Gbj)には低電位信号を送り、トランジスタ１２２をオフしておく。
【００７６】
図４（Ｂ）に示す画素１１においても、図２（Ｂ）の例の場合と同様に、第２走査線(Gbj)に送る信号により、自発光素子１２１の発光時間を任意に制御できる。すなわち自発光素子１２１発光中に、第２走査線(Gbj)に高電位信号をおくり、トランジスタ１２２をオンにすると、トランジスタ１１７がオフとなり自発光素子１２１は消光する。ただし自発光素子１２１を一度消光させると、再度ビデオ信号データ電流を書込まなくては、自発光素子５９を発光させられない点は、図２（Ｂ）の例と異なる。
【００７７】
図４（Ｂ）に示す画素１１において、自発光素子１２１の発光時間を任意に制御できることの特長は、図２（Ｂ）の例の場合と同様である。すなわち、まず中間階調表現を時間階調方式により表現することが可能となる。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行う等の用途に有用である。
【００７８】
以上、本発明の表示装置、発光装置の画素１１の例として、それぞれ異なる構成の６種類の画素１１を図２〜４を用いて説明した。しかし本発明の表示装置、発光装置の画素構成は、これら６種に限定されるわけではない。
【００７９】
（実施の形態２）
実施の形態２では、画素１１の駆動方法を説明する。例として図４（Ｂ）に示した画素１１の場合を取り上げ、図５を用いて説明する。
【００８０】
最初に、ビデオ信号書込み動作と発光動作について説明する。
【００８１】
まず画素１１の周囲に設けられた走査線駆動回路（図示せず）から出力される信号によって、j行目の第1走査線(Gaj)が選択される。すなわち、第1走査線(Gaj)に低電位（Ｌレベル）信号が出力され、トランジスタ１１１〜１１６のゲート電極が低電位（Ｌレベル）となる。このとき、ｐチャネル型のトランジスタ１１１〜１１５がオンとなり、ｎチャネル型のトランジスタ１１６がオフとなる。そして画素１１の周囲に設けられた信号線駆動回路（図示せず）から、i列目の信号線(Si)を介して画素１１にビデオ信号データ電流ＩWが入力される。
【００８２】
トランジスタ１１１〜１１３がオンすると、トランジスタ１１７〜１２０は、ドレインとゲートが短絡されたダイオード接続状態となる。すなわち画素１１は、並列な４つのダイオードと回路的に等価となる。この状態で画素１１の電源線(Vi)と信号線(Si)の間に、電流ＩWを流す（図５（Ａ）を参照）。
【００８３】
並列な４つのダイオードを流れる電流ＩWが定常状態になった後、第1走査線(Gaj)を高電位（Ｈレベル）にする。するとトランジスタ１１１〜１１３はオフとなり、ビデオ信号データ電流ＩWが画素に記憶される。
【００８４】
続いて第1走査線(Gaj)が高電位（Ｈレベル）となると、ｐチャネル型のトランジスタ１１１〜１１５がオフとなり、ｎチャネル型のトランジスタ１１６がオンとなる。トランジスタ１１７〜１２０は直列状態に接続が組みかえられる。このときトランジスタ１２０が飽和領域で動作するように予め電圧条件を設定しておくと、駆動用素子は自発光素子に定電流ＩEを供給する。
【００８５】
定電流ＩEの値は、ビデオ信号データ電流ＩWの約１６分の１の大きさである。本実施の形態では、駆動用素子は４つトランジスタにより構成されているためである。より一般的に、駆動用素子がｎ個のトランジスタにより構成されている場合には、電流ＩEは、ビデオ信号データ電流ＩWの約ｎ2分の１の大きさとなる。
【００８６】
このように本実施の形態では、書込みデータ電流ＩWを自発光素子駆動電流ＩEの約１６倍と、大きな値にすることができる。そのため寄生容量等のために、自発光素子駆動電流ＩE程度の微小電流を、直接速やかに画素に書込むことが難しい場合であっても、ビデオ信号データ電流ＩWを画素に書込むことが可能となる。
【００８７】
なお本実施の形態は、中間階調表現の方法として、アナログビデオ方式を採っていてもよいし、ディジタルビデオ方式を採っていてもよい。アナログビデオ方式の場合、ビデオ信号データ電流として、アナログ的に変化するデータ電流ＩWを用いる。ディジタルビデオ方式の場合は、一つのデータ電流ＩWのみを基準のオン電流として単位輝度を用意する。そして、単位輝度を時間的に足し合わせて階調表現する、時間階調法を用いるのが便利である（ディジタル時間階調法）。あるいは、単位輝度を面積的に足し合わせて階調表現する面積階調法や、時間階調法と面積階調法を組み合わせる方法で、ディジタルビデオ方式を行うこともできる。
【００８８】
また本実施の形態において、アナログビデオ方式、ディジタルビデオ方式いずれを採用したとしても、ビデオ信号データ電流ＩWを０とする場合が必要となることがある。しかしビデオ信号データ電流ＩWを０とする場合は、自発光素子の発光輝度を０とするということであるから、ＩWを画素に正確に書込み記憶させる必要はない。したがって、この場合には駆動用素子のトランジスタ１１７〜１２０がオフとなるようなゲート電圧を、直接信号線(Si)に出力してもよい。すなわち例外的に、ビデオ信号を電流値でなく、電圧値で出力してもよい。
【００８９】
次に、発光停止動作について説明する。
【００９０】
まず画素１１の周囲に設けられた別の走査線駆動回路（図示せず）から出力される信号によって、j行目の第２走査線(Gbj)が選択される。すなわち、第２走査線(Gbj)に低電位（Ｌレベル）信号が出力される。ｐチャネル型のトランジスタ１２２は、ゲート電極が低電位（Ｌレベル）となるためにオン状態となる。
【００９１】
するとトランジスタ１１７のソースとゲートが短絡され、オフとなる。その結果、自発光素子１２１への電流供給は遮断され、発光は停止する。
【００９２】
このような発光停止動作を利用することによって、自発光素子１２１の発光時間を、１列走査時間の制約を受けずに、任意に制御できるが可能となる。その大きな利点として、まず中間階調表現を時間階調方式により表現することが容易となることがある。また中間階調表現をアナログ的なビデオ信号データ電流を用いることで表現する場合であっても、ホールド型ディスプレイ特有の動画ボケを防止するために、インパルス型の発光を行うこと等に利点がある。
【００９３】
（実施の形態３）
実施の形態３では、本発明の表示装置、発光装置における画素の平面レイアウト（上面図）例を提示する。本例の画素回路は、図３（Ｂ）に示した画素回路である。
【００９４】
図６には、j行i列目の画素１１を示す。図６において、二点破線で囲んだ領域が画素１１に相当する。点模様の領域は、ポリシリコン膜である。右上り斜線と右下り二重斜線は、それぞれ別の層の導電体膜（金属膜等）である。バツ印は層間の接触点を示す。そして、チェック模様の領域８６は自発光素子８４の陽極に相当する。
【００９５】
第1走査線(Gaj)下には、トランジスタ７１〜７５、８５が形成されている。第２走査線(Gbj)下には、トランジスタ７６〜７９が形成されている。電源線(Vi)の下に容量素子８３が形成されている。
【００９６】
駆動用素子を構成する３つのトランジスタ８０〜８２は同サイズに揃えて互いに隣接させて形成されている。これにより最初から、同一画素内におけるトランジスタ８０〜８２間のバラつきが、大きくなりにくくすることはできる。本発明の構成である「並列書込み直列駆動」は、駆動用素子を構成する複数のトランジスタ間に元々存在するバラつきの影響を、さらに小さくする手法である。したがって、当初からバラつきが抑えられた複数のトランジスタを駆動用素子に用いるのであれば、本発明の効果を非常に大きく生かすことができ好ましい。自発光素子の発光輝度のバラつきは、さらに僅少となる。
【００９７】
なお本発明の表示装置、発光装置を作製する工程については、例えば、特開２００１−３４３９３３等を参照できる。駆動用素子を構成する複数のトランジスタは、ソースとドレインについては対称的である方が好ましいが、対称的であることが必須というわけではない。
【００９８】
（実施の形態４）
実施の形態４では、本発明の表示装置、発光装置の構成の例について図７を用いて説明する。画素内ではなく、装置の全体的な構成の例を説明する。
【００９９】
本発明の表示装置、発光装置は、基板１８０１上に、複数の画素がマトリクス状に配置された画素部１８０２を有する。画素部１８０２の周辺部には、信号線駆動回路１８０３、第１の走査線駆動回路１８０４及び第２の走査線駆動回路１８０５が配置されている。信号線駆動回路１８０３と、走査線駆動回路１８０４及び１８０５には、ＦＰＣ１８０６を介して、外部より電源、信号が供給される。
【０１００】
図７（Ａ）の例においては、信号線駆動回路１８０３と、走査線駆動回路１８０４及び１８０５が集積されているが、本発明はこれに限定されるものではない。例えば、第２の走査線駆動回路１８０５を欠いていてもよい。あるいは、信号線駆動回路１８０３、走査線駆動回路１８０４及び１８０５を欠いていてもよい。
【０１０１】
第１の走査線駆動回路１８０４及び第２の走査線駆動回路１８０５の例を、図７（Ｂ）を用いて説明する。図７（Ｂ）では、走査線駆動回路１８０４及び１８０５はそれぞれ、シフトレジスタ１８２１、バッファ回路１８２２を有している。
【０１０２】
図７（Ｂ）の回路の動作を説明する。シフトレジスタ１８２１は、クロック信号（Ｇ−ＣＬＫ）、クロック反転信号（Ｇ−ＣＬＫｂ）、スタートパルス信号（Ｇ−ＳＰ）に基づき、順次パルスを出力する。該パルスは、バッファ回路１８２２で電流増幅された後、走査線に入力される。こうして走査線は、１行ずつ順次選択状態となる。
【０１０３】
なお必要に応じ、バッファ回路１８２２内にレベルシフタを設置してもよい。レベルシフタにより、電圧振幅を変更することができる。
【０１０４】
次いで、信号線駆動回路１８０３の例を、図７（Ｃ）を用いて説明する。図７（Ｃ）に示す信号線駆動回路１８０３は、シフトレジスタ１８３１、第１のラッチ回路１８３２、第２のラッチ回路１８３３、電圧電流変換回路１８３４を有している。
【０１０５】
図７（Ｃ）の回路の動作を説明する。図７（Ｃ）の回路は、中間階調表示方式として、ディジタル時間階調法を採用した場合の回路である。
【０１０６】
シフトレジスタ１８３１は、クロック信号（Ｓ−ＣＬＫ）、クロック反転信号（Ｓ−ＣＬＫｂ）、スタートパルス信号（Ｓ−ＳＰ）に基づき、順次サンプリングパルスを第１のラッチ回路１８３２に出力する。各列の第１のラッチ回路１８３２は、該パルスのタイミングに従って、ディジタルビデオ信号を順次読込む。第１のラッチ回路１８３２において、最終列までビデオ信号の読込みが完了すると、第２のラッチ回路１８３３にラッチパルスが入力される。ラッチパルスにより、各列の第１のラッチ回路１８３２に読込まれていたビデオ信号は、一斉に各列の第２のラッチ回路１８３３に転送される。第２のラッチ回路１８３３に転送されたビデオ信号は、電圧電流変換回路１８３４において、適宜形式変換処理され、画素へ転送される。ビデオ信号のうち、オンデータは電流形式に変換され、オフデータは電圧形式のまま電流増幅される。ラッチパルス後、シフトレジスタ１８３１、第１のラッチ回路１８３２は、次行のビデオ信号読込み動作として、上記動作を繰り返す。
【０１０７】
図７（Ｃ）の信号線駆動回路１８０３の構成は１例であり、アナログ階調法を採用した場合には、別の構成にする。またディジタル時間階調法を採用した場合であっても、他の構成にすることはできる。
【０１０８】
（実施の形態５）
実施の形態５では、トランジスタの特性曲線（図８）を用いて、本発明の効果について説明する。説明を簡単にするため、駆動用素子を構成するトランジスタに個数が、２個の場合を例に説明する。画素回路構成としては、図２（Ｂ）のとおりであるとする。またここで用いるトランジスタの特性曲線は、簡単にするため理想的なものとしてあり、実際のトランジスタとは若干の差異がある。例えば、チャネル長変調はゼロとしてある。
【０１０９】
トランジスタのソースの電位を基準として、ゲートの電位をＶg、ドレインの電位をＶd、ソースドレイン間に流れる電流をＩdとする。ただし、正負の向きは適宜設定してある（トランジスタがｐチャネル型のときは、正負を入替える等）。図８（Ａ）（Ｂ）において、曲線８０１〜８０４は、ある一定のゲート電位Ｖg下におけるＩd-Ｖd特性曲線である。一点鎖太曲線８０５は、駆動用素子を構成する２個のトランジスタの一方について、ゲートとドレインを短絡することにより、ＶgとＶdとを等しくした条件下でのＩd-Ｖd変化を示したものである。すなわち、一点鎖太曲線８０５には、該トランジスタ固有の電気的特性（電界効果移動度、しきい電圧値）が反映されている。同様に、二点鎖太曲線８０６は、駆動用素子を構成する他の一方のトランジスタについて、ゲートとドレインを短絡することにより、ＶgとＶdとを等しくした条件下でのＩd-Ｖd変化を示したものである。
【０１１０】
図８（Ａ）（Ｂ）は、駆動用素子を構成する２個のトランジスタが各々異なった電気的特性をもっている場合に、本発明の構成である「並列書込み直列駆動」により、自発光素子駆動電流がどうなるかを、図的に調べたものである。図８（Ａ）は、２個のトランジスタ間において特に、電界効果移動度の違いが大きい場合の例である。図８（Ｂ）は、２個のトランジスタ間において特に、しきい電圧値の違いが大きい場合の例である。結論としては、各場合で自発光素子駆動電流は、８０７の三角矢印の長さで示されるとおりとなる。これについて、以下に簡単に説明する。
【０１１１】
まず、トランジスタ３８、３９の特性曲線として、いずれも等しく、一点鎖太曲線８０５が対応する場合を考える。
【０１１２】
データ電流書込み時には、図２（Ｂ）のトランジスタ３１〜３６がオンとなる。トランジスタ３１〜３４がオンとなることから、駆動用素子を構成する２個のトランジスタ３８、３９では、ゲートとドレインが短絡される。よってトランジスタ３８、３９の動作点は、一点鎖太曲線８０５上の点であり、データ電流値ＩWにより決まるある一点である。いま、該動作点が８０５と８０１の交点としておく。つまり８０５と８０１の交点の縦軸値Ｉdの２倍が、データ電流値ＩWであるとしておく。
【０１１３】
自発光素子発光時には、図２（Ｂ）のトランジスタ３１〜３６がオフとなり、トランジスタ３７、４２がオンとなる。トランジスタ３１〜３４がオフとなることから、トランジスタ３８、３９のゲート電位は、データ電流書込み時のままで保持される。そして自発光素子発光時には、トランジスタ３９が飽和領域で動作し、トランジスタ３８が非飽和領域で動作する。自発光素子発光時における、トランジスタ３８のＩd-Ｖd曲線は８０１で表され、トランジスタ３９のＩd-Ｖd曲線は８０３で表される。
【０１１４】
図８（Ａ）上で、各一点鎖線矢印は、長さと縦軸座標は等しい。自発光素子発光時における、トランジスタ３８の動作点は、左側の一点鎖線矢印の右端と８０１との接点である。そして求めるべき自発光素子駆動電流ＩEは、一点鎖線矢印の縦軸座標、すなわち、８０７の実線三角矢印の長さである。なお図８（Ｂ）上でも同様の事情が成立し、求めるべき自発光素子駆動電流ＩEは８０７の実線三角矢印の長さである。トランジスタ３８の特性曲線とトランジスタ３９の特性曲線が、いずれも等しい場合には、結果的には求めるべき自発光素子駆動電流ＩEは、データ電流値ＩWの４分の１の大きさとなる。
【０１１５】
次に、トランジスタ３８の特性曲線として二点鎖太曲線８０６が対応し、トランジスタ３９の特性曲線として一点鎖太曲線８０５が対応する場合を考える。データ電流値ＩWは、上で述べたトランジスタ３８、３９の特性曲線としていずれも８０５が対応する場合と、同一とする。
【０１１６】
データ電流書込み時には、図２（Ｂ）の駆動用素子を構成する２個のトランジスタ３８、３９では、ゲートとドレインが短絡される。よってトランジスタ３８の動作点は二点鎖太曲線８０６上の点であり、トランジスタ３９の動作点は一点鎖太曲線８０５上の点である。そして、トランジスタ３８の動作点の縦軸座標と、トランジスタ３９の動作点の縦軸座標との和は、データ電流値ＩWである。よってトランジスタ３８の動作点は、８０６と８０２の交点となる。トランジスタ３９の動作点は、トランジスタ３８の動作点と横軸座標が等しい、曲線８０５上の点となる。
【０１１７】
自発光素子発光時には、図２（Ｂ）のトランジスタ３１〜３４がオフとなることから、トランジスタ３８、３９のゲート電位は、データ電流書込み時のままで保持される。そして自発光素子発光時には、トランジスタ３９が飽和領域で動作し、トランジスタ３８が非飽和領域で動作する。自発光素子発光時における、トランジスタ３８のＩd-Ｖd曲線は８０２で表される。
【０１１８】
図８（Ａ）上で、同縦軸座標値にある各二点鎖線矢印は、長さが等しい。上の二点鎖線矢印の組が、いま検討している、トランジスタ３８の特性曲線として二点鎖太曲線８０６が対応し、トランジスタ３９の特性曲線として一点鎖太曲線８０５が対応する場合である。自発光素子発光時における、トランジスタ３８の動作点は、左側の該二点鎖線矢印の右端と８０２との接点である。そして求めるべき自発光素子駆動電流ＩEは、該二点鎖線矢印の縦軸座標、すなわち、８０７の長点線三角矢印（左側）の長さである。なお図８（Ｂ）上でも同様の事情が成立し、求めるべき自発光素子駆動電流ＩEは、８０７の長点線三角矢印（左側）の長さである。
【０１１９】
また別の場合として、トランジスタ３８の特性曲線として一点鎖太曲線８０５が対応し、トランジスタ３９の特性曲線として二点鎖太曲線８０６が対応する場合の検討も、同様にして行うことができる。詳しく述べないが、結果的には図８（Ａ）（Ｂ）とも、求めるべき自発光素子駆動電流ＩEは、８０７の長点線三角矢印（右側）の長さとなる。
【０１２０】
さらに別の場合として、トランジスタ３８、３９の特性曲線として、いずれも二点鎖太曲線８０５が対応する場合の検討も、同様に行うことができる。結果的には図８（Ａ）（Ｂ）とも、求めるべき自発光素子駆動電流ＩEは、８０７の短点線三角矢印の長さとなる。
【０１２１】
図８（Ａ）（Ｂ）における、８０７の三角矢印の長さから、駆動用素子を構成するトランジスタ３８、３９の特性がバラつきが、自発光素子駆動電流ＩEにどのように反映されるかの概略をみることができる。
【０１２２】
比較のために、図８（Ａ）（Ｂ）には８０８の狭角矢印、８０９の広角矢印も掲載してある。８０８の狭角矢印は、電流入力方式でカレントミラー型を用いる画素回路の場合において、上記と同様の検討を行った結果である。すなわち、カレントミラーの二つのトランジスタ間に、上記と同様の特性バラつきが存在したとき、自発光素子駆動電流ＩEがどうなるかを示している。８０９の広角矢印は、電圧入力方式の画素回路の場合において、同様の検討を行った結果である。すなわち、異なる画素の自発光素子駆動トランジスタ間に、上記と同様の特性バラつきが存在したとき、自発光素子駆動電流ＩEがどうなるかを示している。
【０１２３】
図８（Ａ）（Ｂ）の８０７の三角矢印、８０８の狭角矢印、８０９の広角矢印を比較から、次の点がわかる。
【０１２４】
まず、８０７の三角矢印、８０８の狭角矢印では、同一画素内の二つのトランジスタ間にさえ特性バラつきがない限りは、トランジスタの特性曲線が８０５でも８０６でも、自発光素子駆動電流ＩEは一定となる。すなわち、電流入力方式でカレントミラー型を用いる画素回路でも、本発明の「並列書込み直列駆動」の画素回路でも、基板全体でトランジスタの特性を一定に揃える必要はなく、同一画素内の二つのトランジスタ間の特性バラつきさえ、抑制すれば十分である。この点は、電圧入力方式の画素回路に対して非常に優位である。
【０１２５】
しかし、同一画素内の二つのトランジスタ間の特性バラつきが存在すると、８０８の狭角矢印では、自発光素子駆動電流ＩEのバラつきが大きくなる。すなわち、電流入力方式でカレントミラー型を用いる画素回路では、同一画素内の二つのトランジスタ間の特性バラつきの影響が激しく現れてしまう。極端な場合では、電圧入力方式の画素回路よりも、自発光素子駆動電流ＩEのバラつきが大きくなる危険がある。この点、本発明の「並列書込み直列駆動」の画素回路では、同一画素内の二つのトランジスタ間の特性バラつきの影響が、かなり抑制されている。現実の表示装置、発光装置では、トランジスタの特性バラつきは、同一画素内よりも基板全体にわたるものの方が深刻である。したがって同一画素内の二つのトランジスタ間の特性バラつきは、本発明の「並列書込み直列駆動」の画素回路なみに抑制されれば、実用上はほとんど問題がなくなる。
【０１２６】
この実施の形態５では、駆動用素子を構成するトランジスタに個数が、２個の場合を例に、本発明の効果について説明した。しかし、駆動用素子を構成するトランジスタに個数が、３個以上の場合においても同様の事情が成立する。
【０１２７】
（実施の形態６）
実施の形態６では、本発明の表示装置、発光装置を搭載した電子機器等を、いくつか例示する。
【０１２８】
本発明の表示装置、発光装置を搭載した電子機器として、モニター、ビデオカメラ、ディジタルカメラ、ゴーグル型ディスプレイ（ヘッドマウントディスプレイ）、ナビゲーションシステム、音響再生装置（オーディオコンポ、カーオーディオ等）、ノート型パーソナルコンピュータ、ゲーム機器、携帯情報端末（モバイルコンピュータ、携帯電話、携帯型ゲーム機または電子書籍等）、記録媒体を備えた画像再生装置（具体的にはDigital Versatile Disc(DVD)等の記録媒体を再生し、その画像を表示しうるディスプレイを備えた装置）などが挙げられる。特に、斜め方向から画面を見る機会が多い電子機器については、視野角の広さが重要視されるため、発光装置を用いることが望ましい。それら電子機器の具体例を図９に示す。
【０１２９】
図９（Ａ）はモニターである。この例は筐体２００１、支持台２００２、表示部２００３、スピーカー部２００４、ビデオ入力端子２００５等を含んでいる。本発明の表示装置、発光装置は表示部２００３に用いることができる。発光装置は自発光型であるためバックライトが不要であり、液晶ディスプレイよりも表示部を薄くすることができる。なおモニターには、パソコン用、ＴＶ放送受信用、広告表示用などのすべての情報表示装置が含まれる。
【０１３０】
図９（Ｂ）はディジタルスチルカメラである。この例は本体２１０１、表示部２１０２、受像部２１０３、操作キー２１０４、外部接続ポート２１０５、シャッター２１０６等を含んでいる。本発明の表示装置、発光装置は表示部２１０２に用いることができる。
【０１３１】
図９（Ｃ）はノート型パーソナルコンピュータである。この例は本体２２０１、筐体２２０２、表示部２２０３、キーボード２２０４、外部接続ポート２２０５、ポインティングマウス２２０６等を含んでいる。本発明の表示装置、発光装置は表示部２２０３に用いることができる。
【０１３２】
図９（Ｄ）はモバイルコンピュータである。この例は本体２３０１、表示部２３０２、スイッチ２３０３、操作キー２３０４、赤外線ポート２３０５等を含んでいる。本発明の表示装置、発光装置は表示部２３０２に用いることができる。
【０１３３】
図９（Ｅ）は記録媒体を備えた携帯型の画像再生装置（具体的にはＤＶＤ再生装置）である。この例は本体２４０１、筐体２４０２、表示部Ａ２４０３、表示部Ｂ２４０４、記録媒体（ＤＶＤ等）読込み部２４０５、操作キー２４０６、スピーカー部２４０７等を含んでいる。本発明の表示装置、発光装置は、表示部Ａ２４０３、表示部Ｂ２４０４に用いることができる。なお、記録媒体を備えた画像再生装置には家庭用ゲーム機器なども含まれる。
【０１３４】
図９（Ｆ）はゴーグル型ディスプレイ（ヘッドマウントディスプレイ）である。この例は本体２５０１、表示部２５０２、アーム部２５０３等を含んでいる。本発明の表示装置、発光装置は表示部２５０２に用いることができる。
【０１３５】
図９（Ｇ）はビデオカメラである。この例は本体２６０１、表示部２６０２、筐体２６０３、外部接続ポート２６０４、リモコン受信部２６０５、受像部２６０６、バッテリー２６０７、音声入力部２６０８、操作キー２６０９等を含んでいる。本発明の表示装置、発光装置は表示部２６０２に用いることができる。
【０１３６】
図９（Ｈ）は携帯電話である。この例は本体２７０１、筐体２７０２、表示部２７０３、音声入力部２７０４、音声出力部２７０５、操作キー２７０６、外部接続ポート２７０７、アンテナ２７０８等を含んでいる。本発明の表示装置、発光装置は表示部２７０３に用いることができる。なお、表示部２７０３は黒色背景に白色文字を表示することで、携帯電話の消費電力を抑制することができる。
【０１３７】
将来に自発光素子の発光輝度を安定的に高くすることが可能となれば、本発明の表示装置、発光装置から出力した画像情報を含む光をレンズ等で拡大投影して、フロント型又はリア型のプロジェクターに用いることもできる。
【０１３８】
このように、本発明の適用範囲は極めて広く、あらゆる分野の電子機器等に使用することが可能である。
【０１３９】
【発明の効果】
本発明はＡＭ型表示装置、発光装置において、各画素に設置される駆動用素子を複数のトランジスタにより構成する。その上で、画素にデータ電流を読込むときには該複数のトランジスタを並列接続状態にし、自発光素子を発光させるときには該複数のトランジスタを直列接続状態にする。このように、駆動用素子を構成する複数のトランジスタの接続状態を、並列または直列と適宜切替えることを特徴とする。その結果、次のような効果が生じる。
【０１４０】
まず、同一画素内の駆動用素子を構成する複数のトランジスタさえ、バラつきがなければ、表示画面全体で発光輝度のムラが現れてしまうという、表示品位上の重大な欠陥を回避することができる。すなわち、各画素に設置されるトランジスタの電気的特性は、基板全体にわたって観察すると、かなりのバラつきをもつ。このバラつきが自発光素子駆動電流ＩEに反映されて、表示画面全体で発光輝度のムラとなってしまうのを防止することができる。ただし、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合においても、同一画素内のカレントミラーの二つのトランジスタさえバラつきがなければ、表示画面全体で発光輝度のムラとなるのを防止することができる。この点で本発明は、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合と同様の効果を有する。
【０１４１】
しかし、図１０（Ａ）のようなカレントミラーを用いた画素回路の場合、同一画素内のカレントミラーの二つのトランジスタ間にバラつきが存在してしまうと、結局発光輝度が画素間で異なってしまうのを防止することができなくなる。その点、本発明の場合では、同一画素内の駆動用素子を構成する複数のトランジスタ間にバラつきが存在しても、その影響は小さく抑制されるため、実用上問題となるほど画素間で発光輝度がバラついてしまうことは防止することができる。
【０１４２】
また、図１０（Ｂ）の画素回路の場合、画素間で発光輝度がバラついてしまうのは防止することができる。しかし、図１０（Ｂ）の画素回路の場合には、画素に書込むデータ電流ＩWと、自発光素子を発光させるときの自発光素子駆動電流ＩEとの比が、同一値でなくてはならない。これは実用上、非常に厳しい制限である。本発明の場合では、駆動用素子を構成するトランジスタを複数に分割するため、画素に書込むデータ電流ＩWを自発光素子駆動電流ＩEよりも大きくすることが可能である。
【０１４３】
本発明は以上のような利点を有することから、実用的なＡＭ型表示装置、発光装置を製造する上で、重要な技術である。
【図面の簡単な説明】
【図１】 本発明の表示装置、発光装置の画素を示す図。
【図２】 本発明の表示装置、発光装置の画素を示す図。
【図３】 本発明の表示装置、発光装置の画素を示す図。
【図４】 本発明の表示装置、発光装置の画素を示す図。
【図５】 本発明の表示装置、発光装置の画素における電流の経路を示す図。
【図６】 本発明の表示装置、発光装置の画素の平面レイアウトを示す図。
【図７】 本発明の表示装置、発光装置を示す図。
【図８】 駆動用素子を構成するトランジスタの特性を示す図。
【図９】 本発明の表示装置、発光装置を適用した電子機器を示す図。
【図１０】 公知の表示装置、発光装置の画素を示す図。
Claims (11)
- 第１のスイッチ、第２のスイッチ、第３のスイッチ、第４のスイッチ、電源線と前記第４のスイッチの間に直列に電気的に接続された複数のトランジスタを含む駆動用素子、及び自発光素子を含む画素が設けられ、
前記複数のトランジスタの各々のゲート電極は、互いに電気的に接続され、
前記複数のトランジスタから選択された二つのトランジスタの各々のソース又はドレインの一方は、互いに電気的に接続され、
前記第１のスイッチは、前記複数のトランジスタの各々のゲート電極と信号線の間に設けられ、
前記第２のスイッチは、前記複数のトランジスタの各々のソース又はドレインの一方と前記信号線の間に設けられ、
前記第３のスイッチは、前記複数のトランジスタの各々のソース又はドレインの他方と前記電源線の間に設けられ、
前記第４のスイッチは、前記複数のトランジスタから選択された一つのトランジスタのソース又はドレインの他方と前記自発光素子の間に設けられ、
前記第１、前記第２、前記第３及び前記第４のスイッチのオンとオフは、第１の走査線から供給される信号により制御されることを特徴とする発光装置。 - 第１のスイッチ、第２のスイッチ、第３のスイッチ、第４のスイッチ、第５のスイッチ、電源線と前記第４のスイッチの間に直列に電気的に接続された複数のトランジスタを含む駆動用素子、及び自発光素子を含む画素が設けられ、
前記複数のトランジスタの各々のゲート電極は、互いに電気的に接続され、
前記複数のトランジスタから選択された二つのトランジスタの各々のソース又はドレインの一方は、互いに電気的に接続され、
前記第１のスイッチは、前記複数のトランジスタの各々のゲート電極と信号線の間に設けられ、
前記第２のスイッチは、前記複数のトランジスタの各々のソース又はドレインの一方と前記信号線の間に設けられ、
前記第３のスイッチは、前記複数のトランジスタの各々のソース又はドレインの他方と前記電源線の間に設けられ、
前記第４のスイッチは、前記複数のトランジスタから選択された一つのトランジスタのソース又はドレインの他方と前記自発光素子の間に設けられ、
前記第５のスイッチは、前記複数のトランジスタから選択された一つのトランジスタのソース又はドレインの他方またはゲート電極と、前記電源線との間に設けられ、
前記第１のスイッチと前記第２のスイッチのオンとオフは、第１の走査線から供給される信号により制御され、
前記第３のスイッチ、前記第４のスイッチ及び前記第５のスイッチのオンとオフは、それぞれ、前記第１の走査線又は第２の走査線から供給される信号により制御されることを特徴とする発光装置。 - 請求項１または請求項２において、
前記第１のスイッチは、少なくとも１つのトランジスタを含むことを特徴とする発光装置。 - 請求項１または請求項２において、
前記第２のスイッチは、少なくとも１つのトランジスタを含むことを特徴とする発光装置。 - 請求項１または請求項２において、
前記第３のスイッチは、少なくとも１つのトランジスタを含むことを特徴とする発光装置。 - 請求項１または請求項２において、
前記第４のスイッチは、少なくとも１つのトランジスタを含むことを特徴とする発光装置。 - 請求項２において、
前記第５のスイッチは、少なくとも１つのトランジスタを含むことを特徴とする発光装置。 - 請求項１乃至請求項７のいずれか１項において、
前記画素には容量素子が設けられており、
前記容量素子の一方の電極は、前記複数のトランジスタの各々のゲート電極に電気的に接続され、
前記容量素子の他方の電極は、前記電源線に電気的に接続され、
前記容量素子は、前記複数のトランジスタの各々のゲート電極の電位を保持することを特徴とする発光装置。 - 請求項１乃至請求項８のいずれか一項において、
前記画素を駆動する駆動回路が設けられており、
前記画素と前記駆動回路は、同じ基板上に設けられていることを特徴とする発光装置。 - 請求項１乃至請求項９のいずれか一項において、
前記自発光素子は、有機発光ダイオードであることを特徴とする発光装置。 - 請求項１乃至請求項１０のいずれか一項に記載の前記発光装置を用いた電子機器。
Priority Applications (9)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002056555A JP4034086B2 (ja) | 2002-03-01 | 2002-03-01 | 発光装置及び電子機器 |
| TW092103794A TWI276031B (en) | 2002-03-01 | 2003-02-24 | Display device, light emitting device, and electronic equipment |
| SG200300771A SG110023A1 (en) | 2002-03-01 | 2003-02-24 | Display device, light emitting device, and electronic eqipment |
| KR1020030012237A KR100952318B1 (ko) | 2002-03-01 | 2003-02-27 | 디스플레이 장치, 발광 장치, 및 전자 장비 |
| EP03004551A EP1341148B1 (en) | 2002-03-01 | 2003-02-28 | Display device, light emitting device, and electronic equipment |
| DE60336871T DE60336871D1 (de) | 2002-03-01 | 2003-02-28 | Anzeigegerät, lichtemittierende Vorrichtung und elektronisches Gerät |
| US10/375,015 US6798148B2 (en) | 2002-03-01 | 2003-02-28 | Display device, light emitting device, and electronic equipment |
| CNB031068103A CN100361183C (zh) | 2002-03-01 | 2003-03-03 | 显示装置、发光装置和电子设备 |
| US10/939,360 US7528799B2 (en) | 2002-03-01 | 2004-09-14 | Display device, light emitting device, and electronic equipment |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2002056555A JP4034086B2 (ja) | 2002-03-01 | 2002-03-01 | 発光装置及び電子機器 |
Publications (3)
| Publication Number | Publication Date |
|---|---|
| JP2003255896A JP2003255896A (ja) | 2003-09-10 |
| JP2003255896A5 JP2003255896A5 (ja) | 2005-09-02 |
| JP4034086B2 true JP4034086B2 (ja) | 2008-01-16 |
Family
ID=28667087
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2002056555A Expired - Fee Related JP4034086B2 (ja) | 2002-03-01 | 2002-03-01 | 発光装置及び電子機器 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP4034086B2 (ja) |
Families Citing this family (11)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| TWI318490B (en) * | 2002-08-30 | 2009-12-11 | Semiconductor Energy Lab | Current source circuit, display device using the same and driving method thereof |
| JP2004117820A (ja) | 2002-09-26 | 2004-04-15 | Seiko Epson Corp | 電子回路、電子装置及び電子機器 |
| JP4350370B2 (ja) | 2002-12-27 | 2009-10-21 | 株式会社半導体エネルギー研究所 | 電子回路及び電子機器 |
| US7333099B2 (en) | 2003-01-06 | 2008-02-19 | Semiconductor Energy Laboratory Co., Ltd. | Electronic circuit, display device, and electronic apparatus |
| JP4790070B2 (ja) * | 2003-03-19 | 2011-10-12 | 株式会社半導体エネルギー研究所 | 発光装置及び発光装置の駆動方法 |
| JP2004361424A (ja) | 2003-03-19 | 2004-12-24 | Semiconductor Energy Lab Co Ltd | 素子基板、発光装置及び発光装置の駆動方法 |
| US8552933B2 (en) | 2003-06-30 | 2013-10-08 | Semiconductor Energy Laboratory Co., Ltd. | Light emitting device and driving method of the same |
| KR101142994B1 (ko) | 2004-05-20 | 2012-05-08 | 삼성전자주식회사 | 표시 장치 및 그 구동 방법 |
| US20050258867A1 (en) | 2004-05-21 | 2005-11-24 | Seiko Epson Corporation | Electronic circuit, electro-optical device, electronic device and electronic apparatus |
| CN100363967C (zh) * | 2004-07-14 | 2008-01-23 | 友达光电股份有限公司 | 主动式有机发光显示器的象素驱动电路 |
| JP5207885B2 (ja) * | 2008-09-03 | 2013-06-12 | キヤノン株式会社 | 画素回路、発光表示装置及びそれらの駆動方法 |
-
2002
- 2002-03-01 JP JP2002056555A patent/JP4034086B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JP2003255896A (ja) | 2003-09-10 |
Similar Documents
| Publication | Publication Date | Title |
|---|---|---|
| KR100952318B1 (ko) | 디스플레이 장치, 발광 장치, 및 전자 장비 | |
| US6909243B2 (en) | Light-emitting device and method of driving the same | |
| US9620060B2 (en) | Semiconductor device including transistors, switches and capacitor, and electronic device utilizing the same | |
| JP4628447B2 (ja) | 半導体装置 | |
| JP2020016905A (ja) | 表示装置 | |
| US8593381B2 (en) | Method of driving light-emitting device | |
| JP3923341B2 (ja) | 半導体集積回路およびその駆動方法 | |
| US7961160B2 (en) | Display device, a driving method of a display device, and a semiconductor integrated circuit incorporated in a display device | |
| JP4034086B2 (ja) | 発光装置及び電子機器 | |
| JP2006091923A (ja) | 電気光学装置および電子機器 | |
| JP2004361935A (ja) | 半導体装置およびその駆動方法 | |
| JP4112248B2 (ja) | 発光装置、電子機器 | |
| JP2002049354A (ja) | 自発光装置およびそれを用いた電気器具 | |
| JP4170050B2 (ja) | 発光装置及びそれを用いた電子機器 | |
| JP4467900B2 (ja) | 発光装置の駆動方法 | |
| JP2004198683A (ja) | 表示装置 | |
| JP4658016B2 (ja) | 半導体装置 | |
| JP4574128B2 (ja) | 発光装置 | |
| JP5604270B2 (ja) | 半導体装置 | |
| JP4688899B2 (ja) | 表示装置 |
Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050301 |
|
| A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20050301 |
|
| A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20070725 |
|
| A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20070807 |
|
| A521 | Request for written amendment filed |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20070927 |
|
| TRDD | Decision of grant or rejection written | ||
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20071023 |
|
| A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20071024 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101102 Year of fee payment: 3 |
|
| R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101102 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20101102 Year of fee payment: 3 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111102 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20111102 Year of fee payment: 4 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121102 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20121102 Year of fee payment: 5 |
|
| FPAY | Renewal fee payment (event date is renewal date of database) |
Free format text: PAYMENT UNTIL: 20131102 Year of fee payment: 6 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |