JP3671771B2 - 平型半導体装置のパッケージ - Google Patents
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Description
【発明の属する技術分野】
本発明は、パワートランジスタ,サイリスタなどのパワー半導体素子を両面冷却型の平型パッケージに封入した高耐電圧,大電流容量の平型半導体装置のパッケージ構造に関する。
【0002】
【従来の技術】
車輌駆動,電動機制御用インバータなどの電力変換用装置に適用する高耐電圧,大電流容量のパワー半導体素子として、ゲートターンオフサイリスタ(GTOサイリスク)などのサイリスタ,絶縁ゲート型バイポーラトランジスタ(IGBT)などが広く使われている。
【0003】
これらのパワー半導体素子は、高耐電圧を保持するために、通常はセラミック製の絶縁体を外囲枠としてその上下に銅電極を配して密閉した平型パッケージに組み込まれいる。
【0004】
この場合に、サイリスタを用いたデバイスでは、素子エレメントが円板状であるため、そのエレメントを収容するパッケージの外形形状も丸形である。一方、IGBTモジュールは、大容量化のためにチップ形状が角形になる複数個のIGBTチップを同一のパッケージ内に集積して収容した角型のパッケージが採用されるおり、昨今での半導体素子の高耐電圧化、大容量化に伴ってそのパッケージの外形も大きくなっている。
【0005】
次に、IGBTの平型半導体装置を例に、従来における平型パッケージの構造を図4(a),(b) に示す。図において、1,2は上下に対峙して並ぶ平角形の上部,および下部銅電極、3,4は各銅電極1,2にろう付けしてその周縁から外周に張り出した段付き絞り構造になる銅製の上部フランジ板,および下部フランジ板、5は上下の銅電極1と2の間のスペース(このスペースには後記する半導体素子組立体(エレメント)が収容される)を囲繞してフランジ板3と4の間に介装し、かつ溶接板(コバール,あるいはFe-42Ni 合金)6,7、および金属板(コバール,あるいはFe-42Ni 合金)8を介して銀ろう付けしたセラミックス製( 純度90〜96%のアルミナ)の角型絶縁環であり、これらを組み合わせて平型パッケージを構成している。
【0006】
また、前記パッケージに組み込まれる半導体エレメント9は、格子状になる樹脂製の集合枠10と、上下のコンタクト板11と12の間に挟持して集合枠10の各枡目に配列したIGBTチップ(IGBT)13,およびダイオードチップ(Di)14とからなる。なお、15はゲートリード線,16はゲート端子、17は補助端子、18は排気パイプである。
【0007】
ここで、前記した平型パッケージの組立方法を説明する。まず、前記したアルミナセラミックス製の角形絶縁環5の上下両端面にMo−Mnのペーストをスクリーン印刷により塗布し、それらを加湿水素中1400〜1500℃で焼き付け、その後、その面にニッケルメッキを行って絶縁環5の両端面にメタライズ層を形成しておく。
【0008】
次に、グラファイトのろう付け治具内に、前記の溶接板7を置き、銀ろうを挟んで絶縁環5を載せ、また絶縁環5の他端面には銀ろうを挟んで前記した金属板8,および銀ろうを載せ、さらにその上にフランジ板4,および下部銅電極2を載せ、800〜850℃の水素雰囲気中に約10分間保持して各部材間のろう付けを行う。なお、銀ろうとしては、例えばJISのBAg−8(融点:873℃)を用いることができる。また、上部銅電極1についても、前記と同様な組立法で銅電極1の周縁から外周に張り出した段付き絞り構造のフランジ板3に先記した溶接板6を銀ろうでろう付する。
【0009】
その後に、下部銅電極2の上に別途組立てた半導体エレメント9を載置し、さらに上方から上部銅電極2を重ね合わせた上で、溶接板6と7の間の周縁を溶接し、さらに排気パイプ15を通じてパッケージ内をガス置換した上で、最後に排気パイプ15を封じて密封する。
【0010】
この場合に、前記の絶縁環5はその材料として熱膨張係数α=6〜8×10-6/℃であるアルミナセラミックスが使われており、銅電極1,2の熱膨張係数α=18×10-6/℃との間の熱膨張係数の差が大である。
【0011】
そこで、この熱膨張係数の差に起因するパッケージの熱的な歪みを緩和するため、および銅電極1,2と半導体エレメント9との密着性を確保するために、前記した上下フランジ板3,4に絞り加工を施してフランジの周域に図示のような絞り段付き部3a,4aを形成し、この絞り段付き部3a,4aで銅電極1,2の熱膨張,収縮によるパッケージの歪みを吸収し、溶接,ろう付け部の剥離などによるパッケージの気密不良を防ぐようにし、併せて寸法,組立誤差を吸収して銅電極1,2と半導体エレメント9との間に良好な導電性を確保するようにしている。
【0012】
なお、前記した熱的歪みの発生要因には、パッケージ組立時のろう付け(ろう付け温度:約800℃)工程,および製品組立後に行うヒートショック試験(周囲温度:−40〜+125℃),および半導体装置の実使用時における半導体素子の通電,停止の繰り返しに伴うヒートサイクルなどがあり、上下銅電極1,2と絶縁環5との間の熱膨張係数の差による発生する歪みをフランジ板3,4に形成した絞り段付き部3a,4aで吸収させるようにしている。
【0013】
【発明が解決しようとする課題】
先記のように電力変換装置はますます大容量化する傾向にあることから、半導体チップの大形化に併せて、複数個の半導体チップを図4で述べたようになパッケージに集積して組み込んだモジュール構造が多く採用されている。なお、現在でのIGBチップのサイズは10〜25mm角、チップ1個当たりの定格電流は50〜150Aである。
【0014】
そこで、チップサイズが20mm角,定格電流150AのIGBTチップを使って例えば定格電流1800Aの半導体装置を製作するには、パッケージに12個のIGBTチップと、これに付属するフリーホイーリングダイオードを収容する必要があり、これに相応して上下の銅電極も大形となり、その寸法は100mm角,厚さ7mmとなる。
【0015】
ところで、図4に示した平型パッケージの構造では、銅電極1,2が平角形であることら、その周囲の四辺の部分と四隅のコーナー部分とでは電極中心からの距離(長さ)が異なり、特にパッケージの四隅を通る対角距離は周囲四辺間の距離に比べて大きい。このために、先述のようなヒートサイクルが加わった場合の銅電極1,2の膨張,収縮量はその周囲四辺部よりも四隅コーナー部が大きく発生し、その膨張,収縮量の差からコーナーの角部に大きな熱応力が集中的に加わってこの部分に大きな歪みが発生する。
【0016】
また、前記したIGBTモジュールについて、発明者等が長期間の稼働テストから得た知見によれば、ヒートサイクルの繰り返しにより、特にフランジ板3,4の四隅コーナー部分でその絞り段付き部にクラック(亀裂)が生じ気密不良となる事故が多く発生することが判明した。これは、パッケージの組立工程でろう付けする際にフランジ板部の四隅コーナー部分に銅電極と絶縁環の熱膨張係数の差に起因する大きな歪みが加わり、さらにIGBT素子の試験,実使用時の発生熱によるヒートサイクルの繰り返しにより、フランジ板の四隅コーナー部分に材料の疲労が進行することに起因するものと推定される。
【0017】
本発明は上記の点に鑑みなされたものであり、先記したIGBTモジュールなどの平型半導体装置を対象に、ヒートサイクルに起因するパッケージの歪み発生を抑え、長期に亘り安定した気密性が維持できるよう改良した平型半導体装置のパッケージ構造を提供することを目的とする。
【0018】
【課題を解決するための手段】
上記の目的を達成するために、本発明によれば、上下に対峙する一対の平角形銅電極と、各銅電極の周縁から外周に張り出し周域に絞り段付き部を有する銅製のフランジ板と、上下銅電極の間のスペースを囲繞して前記フランジ板の間に介装した角形絶縁環との組立体としてなり、半導体素子組立体を前記一対の銅電極の間に挟持し、かつ絶縁環の端面とフランジ板との間をろう付けして封止した平形半導体装置のパッケージにおいて、前記フランジ板の四隅コーナー部に、前記絞り段付き部の角部に沿って歪み吸収用の凹部をさらに形成する(請求項1)ものとし、その凹部は具体的には次記のような態様で構成する。
【0019】
(1) 前記凹部を、円弧状スリットの凹溝(窪み)で形成する(請求項2)。
(2) 前記凹部を、角部に沿って並ぶ複数の丸穴状凹溝(窪み)で形成する(請求項3)。
(3) 前記凹部の長さをフランジ板の四隅コーナーにおける角部曲率半径の0.5〜1倍、幅,および深さを少なくともフランジ板の板厚の1.5倍に設定する(請求項4)。
【0020】
上記のように銅電極のフランジ板の四隅コーナー部分に、その角部に沿って凹部を形成することにより撓み性が増し、これによりパッケージの対角方向でフランジ板の絞り段付き部に生じる歪みを凹部が吸収する。その結果として、フランジ板に対してろう付け,およびその後のヒートショック試験などによるヒートサイクルの繰り返しによる角部の歪みが小さく抑えられることから、疲労破壊が起こりに難くなって製品の信頼性が向上する。
【0021】
【発明の実施の形態】
以下、本発明の実施の形態を図1〜図3に示す実施例に基づいて説明する。なお、実施例の図中で図4に対応する部材には同じ符号を付してその詳細な説明は省略する。
【0022】
〔実施例1〕
図1(a),(b) および図2(a),(b) において、パッケージの全体構造は基本的に図4で述べた従来構造と同じであるが、特に上部銅電極1,下部銅電極2の周縁から外周に張り出した段付き絞り構造のフランジ板3,4については、その四隅コーナー部分の絞り段付き部3a,4aに、その角部(R部)に沿って円弧状のスリットになる凹溝3b,4bが形成されている。
【0023】
この場合に、前記した円弧状スリットの凹溝3b,4bは、その長さ寸法Aを角部の曲率半径の0.5〜1倍(銅電極1,2のサイズが100mm角である場合には凹溝の長さ寸法Aを5mm以上とする)、溝幅,および溝深さを少なくともフランジ板3,4の板厚の1.5倍に設定するのがよい。
【0024】
かかる構成により、図4に示した従来構造と比べてフランジ板3,4のコーナー部分における撓み性が増し、これによりヒートサイクルに起因してフランジ板3,4の四隅コーナー部分における絞り段付き部3a,4aに生じる曲げ,歪みが小さくなり、その結果としてろう付による熱歪み,その後のヒートショック試験などのヒートサイクルによる繰り返し歪みの発生が小さくなってフランジ板3,4に疲労破壊が起こりに難くなる。
【0025】
なお、この点について発明者等が行った評価テストの結果によれば、周囲温度を−40℃〜+125℃に変化させて行うヒートショック試験において、従来構造では300サイクル前後で銅製フランジ板3,4の四隅コーナー部分が疲労破壊してクラック割れが生じていたが、図示実施例の構成によれば、1000サイクル以上でもクラック割れの発生が無いことが確かめられている。
【0026】
これは、ろう付け工程,ヒートショック試験などで加わるヒートサイクルに対し、絶縁環5と銅電極1,2との熱膨張係数差,銅電極1,2の平形形状に起因して平型パッケージの対角線(図中にX−Y線で表す)に沿って生じる伸び,縮みをフランジ板3,4の絞り段付き部3a,4aと円弧状スリットの凹溝3b,4bとが共同して吸収する効果によるものであり、ヒートサイクルの繰り返しによりフランジ板3,4の四隅コーナー部分でその絞り段付き部3a,4aに加わる歪みが軽減されて疲労破壊が生じなくなるものと推定される。これにより、平型パッケージの熱的,機械的特性が向上し、かつ良好な気密性を確保して高信頼性が得られる。
【0027】
〔実施例2〕
図3は本発明の請求項3に対応する応用実施例を示すものである。この実施例においては、フランジ板3の四隅コーナー部に形成した凹部として、図示のように角部(R部)に沿って並ぶ複数の丸穴状凹溝3cとして形成されている。また、下部フランジ板4についても前記と同様に四隅コーナー部に複数の丸穴状凹溝を形成するものとする。なお、この実施例で凹部の長さとは、複数の丸孔状溝3cが並んでいる区間をいう。
【0028】
この実施例でも、先記実施例1と同様な効果の得られることが試験結果から確認されている。
【0029】
【発明の効果】
以上述べたように、本発明によれば、上下に対峙する一対の平角形銅電極と、各銅電極の周縁から外周に張り出した段付き絞り構造になる銅製のフランジ板と、上下銅電極の間のスペースを囲繞して前記フランジ板の間に介装した角形絶縁環との組立体としてなり、半導体素子組立体を前記一対の銅電極で挟持し、かつ絶縁環の端面とフランジ板との間をろう付けして封止した平形半導体装置のパッケージにおいて、前記フランジ板の四隅コーナー部に、その角部に沿って熱的な歪みを吸収する円弧状スリットの凹溝,もしくは角部(R部)に沿って並ぶ複数の丸穴状凹溝としての凹部を形成したことにより、次の効果を奏する。
【0030】
(1) ろう付工程での加熱,冷却の温度差,絶縁環と銅電極との熱膨張係数の差,および平角形銅電極の膨張,収縮により、パッケージの四隅コーナー部でフランジ板の絞り段付き部に生じる変形,歪みが軽減される。
【0031】
(2) ヒートサイクルの繰り返しに伴う銅電極の伸び,縮みに起因してフランジ板の角部に作用する材料の疲労が軽減され、これによりフランジ板のクラック割れの発生が無くなり、さらにパッケージの熱的,機械的特性が改善されてパッケージの気密性が向上する。
【0032】
(3) これにより、電力用半導体装置の大容量化に対応して信頼性の高い平型パッケージを提供することができる。
【図面の簡単な説明】
【図1】本発明の実施例による平型半導体装置のパッケージ全体の構成図であり、(a) は平面図、(b) は側面図
【図2】図1における四隅コーナー部分の要部拡大図であり、(a) は平面図、(b) は断面図
【図3】図2と異なる実施例の凹部パターンを示す四隅コーナ部分の要部拡大平面図
【図4】平型IGBTモジュールを例にした従来のパッケージ構造を表す図であり、(a) は側視断面図、(b) は横断平面図
【符号の説明】
1 上部銅電極
2 下部銅電極
3,4 フランジ板
3a,4a 絞り段付き部
3b,4b 円弧状スリットの凹溝
3c,4c 丸穴状の凹溝
5 絶縁環
9 半導体エレメント(半導体素子の組立体)
13 IGBT
14 ダイオード
Claims (4)
- 上下に対峙する一対の平角形銅電極と、各銅電極の周縁から外周に張り出し周域に絞り段付き部を有する銅製のフランジ板と、上下銅電極の間のスペースを囲繞して前記フランジ板の間に介装した角形絶縁環との組立体としてなり、半導体素子組立体を前記一対の銅電極の間に挟持し、かつ絶縁環の端面とフランジ板との間をろう付けして封止した平形半導体装置のパッケージにおいて、前記フランジ板の四隅コーナー部に、前記絞り段付き部の角部に沿って歪み吸収用の凹部をさらに形成したことを特徴とする平型半導体装置のパッケージ。
- 請求項1記載のパッケージにおいて、凹部が円弧状スリットの凹溝であることを特徴とする平型半導体装置のパッケージ。
- 請求項1記載のパッケージにおいて、凹部が角部に沿って並ぶ複数の丸穴状凹溝であることを特徴とする平型半導体装置のパッケージ。
- 請求項2,または3記載のパッケージにおいて、凹部の長さを角部の曲率半径の0.5〜1倍、幅,および深さを少なくともフランジ板の板厚の1.5倍に設定したことを特徴とする平型半導体装置のパッケージ。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28758999A JP3671771B2 (ja) | 1999-10-08 | 1999-10-08 | 平型半導体装置のパッケージ |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP28758999A JP3671771B2 (ja) | 1999-10-08 | 1999-10-08 | 平型半導体装置のパッケージ |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2001110923A JP2001110923A (ja) | 2001-04-20 |
JP3671771B2 true JP3671771B2 (ja) | 2005-07-13 |
Family
ID=17719264
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP28758999A Expired - Fee Related JP3671771B2 (ja) | 1999-10-08 | 1999-10-08 | 平型半導体装置のパッケージ |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP3671771B2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
CN105957861B (zh) * | 2016-06-24 | 2019-02-15 | 中国南方电网有限责任公司电网技术研究中心 | 一种芯片模块封装结构 |
-
1999
- 1999-10-08 JP JP28758999A patent/JP3671771B2/ja not_active Expired - Fee Related
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Publication number | Publication date |
---|---|
JP2001110923A (ja) | 2001-04-20 |
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Legal Events
Date | Code | Title | Description |
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A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20040921 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20050104 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20050302 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20050329 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20050411 |
|
R150 | Certificate of patent (=grant) or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
FPAY | Renewal fee payment (prs date is renewal date of database) |
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