JP3565090B2 - 半導体装置の製造方法 - Google Patents
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Description
【発明の属する技術分野】
本発明は、半導体装置の製造方法に関する。
【0002】
【発明の背景】
半導体装置の小型化を追求するとベアチップ実装が理想的であるが、品質の保証及び取り扱いが難しいため、パッケージ形態に加工することで対応してきた。特に多端子化の要求に応じたパッケージ形態として、近年、BGA(Ball Grid
Array)型パッケージが開発されてきた。BGA型パッケージは、基板に外部端子であるバンプをエリアアレイ状に配置し、面実装できるようにしたものである。
【0003】
BGA型パッケージの一つとして、TAB(Tape Automated Bonding)技術に用いられるテープキャリアが適用されて、このテープキャリアがベースになるT−BGA(Tape Ball Grid Array)型パッケージがある。これによれば、テープキャリアの特徴を活かして、狭ピッチ化及び多端子化の半導体装置が提供できる。
【0004】
ただし、テープキャリアは、剛性がなく反りやすいことから、保持板(スティフナ)の貼り付けが必要であった。この点、テープキャリア以外のフレキシブル基板であっても同様であった。従来、スティフナは接着剤によって貼り付けられていたので、その貼り付け工程が煩雑になっていた。
【0005】
本発明は、この問題点を解決するものであり、その目的は、製造工程が簡略化された半導体装置の製造方法を提供することにある。
【0027】
(1)本発明に係る半導体装置の製造方法は、配線パターンが形成されたフレキシブル基板上に接着剤を設ける工程と、
前記フレキシブル基板上の第1領域において、半導体素子に形成されてなる複数の電極と前記配線パターンとを前記接着剤によって接着する工程と、
前記第1の領域とは異なる前記フレキシブル基板上の第2領域において、前記フレキシブル基板と保持材を前記接着剤により貼り付ける工程と、
前記半導体素子の前記複数の電極及び前記保持材と前記フレキシブル基板との間に、一括して圧力を加える工程と、
を含む。
【0028】
本発明によれば、半導体素子をフレキシブル基板に接着するときの接着剤を利用して保持材を貼り付けることができる。すなわち、接着剤を半導体素子よりも外側まで設けておくだけで、保持材をフレキシブル基板に貼り付けることができ、接着剤の塗布を省略することができる。こうして、保持材を容易に接着することができる。
【0029】
なお、ここで保持材とは、フレキシブル基板の平坦性を確保するためのもので、パッケージの補強にも寄与する。保持材として、例えば、金属板などの剛性のあるものが使用されることが多い。
【0031】
(2)この半導体装置の製造方法において、
前記接着剤には導電粒子が分散されてなり、加えられた圧力により前記半導体素子の電極と前記配線パターンとを前記導電粒子により電気的に接続してもよい。
【0034】
本発明とは異なり、先に半導体素子がフレキシブル基板にフェースダウンボンディングされた場合には、接着剤が劣化する前に、電極と配線パターンとが接合され、両者間の良好な電気的接続を確保することができる。
【0035】
(3)この半導体装置の製造方法において、
前記保持材を、前記半導体素子を囲むように載置してもよい。
【0037】
本発明に係る方法によれば、半導体素子の電気的接続及び保持材の接着を同時に行うことができる。
【0038】
(4)この半導体装置の製造方法において、
前記接着剤は熱硬化性を有する材料から形成されてなり、
前記半導体素子及び前記保持材を、前記接着剤を介して前記フレキシブル基板に貼り付けてから、前記接着剤を加熱する工程を含んでもよい。
【0039】
このように、接着剤が熱硬化性を有する材料からなる場合には、半導体素子及び保持材の両方を貼り付けてから加熱することで、一度に両方をフレキシブル基板に固定することができる。
(5)この半導体装置の製造方法は、
前記配線パターンに電気的に導通する外部電極を形成する工程をさらに含み、
前記外部電極を形成する工程は、加熱のためのリフロー工程を含み、
前記リフロー工程で、前記外部電極の形成と同時に前記接着剤を加熱してもよい。
【0040】
【発明の実施の形態】
以下、本発明の実施の形態を、図面を参照して説明する。図1〜図5は、実施の形態に係る半導体装置の製造方法を示す図である。本実施の形態に係る製造方法では、BGAパッケージが適用される半導体装置を製造するが、CSP(ChipSize/Scale Package) が適用される半導体装置の製造に本発明を適用してもよい。
【0041】
本実施の形態では、図1に示す個片のフレキシブル基板10が使用される。あるいは、フレキシブル基板10として、例えば、TAB技術で使用される長尺のテープキャリアを使用してもよい。その場合、テープキャリアは別の工程で個片に打ち抜かれる。
【0042】
フレキシブル基板10は、ポリイミド樹脂などから形成され絶縁性を有するが、材料は限定されない。このフレキシブル基板10には、図1に示すように、複数のスルーホール12が形成されている。これらのスルーホール12の上をまたいで、配線パターン14が形成されている。なお、スルーホール12の上を含む領域は、広い領域のランドとなっている。この構成により、スルーホール12を介して、フレキシブル基板10における配線パターン14の形成面とは反対側の面に、外部電極50(図5参照)を形成することができる。また、配線パターン14には、スルーホール12以外の領域に、半導体素子30の電極32との接合用のランド(図示せず)が形成されている。
【0043】
スルーホール12は、図5に示すように半導体素子30の搭載領域内及びその外の両方に形成されている。こうすることで、半導体素子30の搭載領域内及びその外の両方に外部電極50を有する FAN−IN/FAN−OUT 型の半導体装置1を得ることができる。なお、本発明の適用において、半導体素子30の搭載領域内に外部電極50を形成することは必須ではなく、半導体素子30の搭載領域の外側のみに外部電極50を形成するようにスルーホール12を形成してもよい。
【0044】
フレキシブル基板10には、保護層16が形成されている。保護層16は、少なくとも配線パターン14における半導体素子30との接合部を除いて、この配線パターン14を覆って保護している。保護層16として、ソルダレジスト等の絶縁性を有する材料が使用されることが好ましい。
【0045】
本実施の形態で述べた片面のフレキシブル基板10以外に、両面フレキシブル基板を用いても良い。この場合、外部電極は、半導体素子の載置面とは逆の面に形成されるランド上に形成しても良い。または、多層フレキシブル基板、ビルドアップ型フレキシブル基板を用いても良い。
【0046】
本実施の形態で、半導体素子30の実装の形態は、フェースアップボンディングであってもフェースダウンボンディングであってもよい。フェースアップボンディングでは、半導体素子30の電極32と配線パターン14は、ワイヤーボンディングもしくはTABボンディングで接続され、その後半導体素子30の実装部は樹脂で覆われることが多い。フェースダウンボンディングでは、導電樹脂ペーストによるもの、Au−Au、Au−Sn、ハンダなどによる金属接合によるもの、絶縁樹脂の収縮力によるものなどの形態があり、そのいずれの形態を用いてもよい。本実施の形態では、異方性導電材料20を使用して半導体チップ30をフェースダウンボンディングする構成で説明する。
【0047】
フレキシブル基板10における配線パターン14の形成された面には、異方性導電材料20を設ける。異方性導電材料20は、接着剤(バインダ)に導電粒子(フィラー)が分散されてなる。本実施の形態では、接着剤として熱硬化性樹脂が使用されるが、熱可塑性樹脂を使用してもよい。また、異方性導電材料20として、予めシート状に形成された異方性導電膜が使用されることが多いが、液状のものを使用してもよい。本実施の形態では、接着剤として異方性導電膜(ACF)を使用するが、本発明では、接着剤は半導体素子30を接着するためのものであるから、絶縁性の接着剤を使用してもよい。
【0048】
異方性導電材料20は、フレキシブル基板10における半導体素子30の搭載領域(電極32を有する面に対応する第1領域)よりも外側の領域(第1領域の周囲に相当する第2領域)に至るまで設けられる。すなわち、異方性導電材料20は、保護層16の上にも設けられる。なお、第2領域の裏面には、後述するように、外部電極50が設けられる。
【0049】
次に、図2に示すように、異方性導電材料20に、半導体素子30の複数の電極32を有する面を押圧する。この工程は、電極32を配線パターン14のランド(図示せず)上に位置合わせをしてから行う。こうして、半導体素子30の電極32と配線パターン14との間で、異方性導電材料20に含まれる導電粒子が押しつぶされて、電極32と配線パターン14とが電気的に導通する。この状態では、異方性導電材料20からなる接着剤をまだ硬化させない。
【0050】
次に、図3に示すように、保持材40をフレキシブル基板10に貼り付ける。保持材40は、フレキシブル基板10を補強して平坦性を確保するためのもので、剛性があれば材料は限定されない。例えば、ステンレス鋼や銅系合金などの金属を使用することが多いが、プラスチックやセラミックスなどの絶縁性を有する材料で形成してもよい。本実施の形態では、配線パターン14上に保護層16が設けられており、保護層16が絶縁性を有していれば、金属製の保持材40を使用しても、配線パターン14と保持材40との電気的な導通を遮断することができる。あるいは、保持材40を絶縁性を有する材料で形成すれば、保護層16がなくてもよい。また、保持材40における少なくとも異方性導電材料20との接触面に絶縁層を形成すれば、保持材40が金属製であっても、配線パターン14と保持材40との電気的な導通を遮断することができる。
【0051】
保持材40の中央には、半導体素子30を避ける開口部42が形成されている。あるいは、保持材40は、半導体素子30を囲む形状、例えばロ字状をなしている。したがって、保持材40は、半導体素子30の外周側において、異方性導電材料20を介して、フレキシブル基板10に接着される。また、保持材40の厚みは、半導体素子30の厚みよりも厚いことが好ましい。こうすることで、半導体素子30をフレキシブル基板10に実装した後に保持材40をフレキシブル基板10に貼り付けるときに、半導体素子30の厚みがじゃまになることなく、平坦面を有するツールを使用して、保持材40を貼り付けることができる。
【0052】
なお、半導体素子30をフレキシブル基板10にフェースダウンボンディングしてから、保持材40をフレキシブル基板10に貼り付けることが好ましい。こうすることで、異方性導電材料20の劣化がないときに、電極32と配線パターン14との接合を図るので、両者間の良好な電気的な接続を図ることができる。
【0053】
続いて、図4に示す状態で、異方性導電材料20の全体を加熱する。上述したように、異方性導電材料20は、熱硬化性であるから加熱されることで硬化する。こうして、半導体素子30及び保持材40がフレキシブル基板10に固定される。
【0054】
そして、図5に示すように、スルーホール12を介して、配線パターン14に電気的に導通する外部電極50を形成する。本実施の形態では、外部電極50は、ハンダボールである。ハンダボールの形成には、ハンダ球及びフラックス、又はクリームハンダなどを設けてから、これを加熱して溶融するリフロー工程が行われる。したがって、上述した異方性導電材料20の加熱を省略し、このリフロー工程で、ハンダボールの形成と同時に異方性導電材料20を加熱してもよい。外部電極50の少なくとも一つ(多くの場合、複数)は、保持材40が設けられた第2領域の裏面に位置する。これにより、保持材40によって、外部電極50のコプラナリティが確保される。
【0055】
こうして得られた半導体装置1によれば、半導体素子30及び保持材40のいずれもが、異方性導電材料20を介してフレキシブル基板10に接着されている。すなわち、保持材40を接着するための接着剤を、異方性導電材料20とは別に設ける必要がないので、保持材40の接着工程を容易に行うことができる
図6は、本実施の形態の変形例を示す図である。同図に示す半導体装置2は、保持材60の構成において、図5に示す半導体装置1と異なり、それ以外の構成は同じであるので同一の符号を付する。
【0056】
保持材60は、異方性導電材料20によってフレキシブル基板10に接着されるのみならず、半導体素子30に接触している。詳しくは、保持材60は、外周部においてフレキシブル基板10と接触し、中央部において、半導体素子30における電極32を有する面とは反対側の面に接触する。そのために、保持材60は、中央部がくぼんだ形状をしている。あるいは、中央部に凹部を形成することで同様の機能を果たすようにしてもよい。なお、保持材60と半導体素子30との接触部は、熱伝導性の接着剤(図示せず)によって接着されることが好ましい。また、保持材60は、熱伝導性の高い材料で構成されることが好ましい。
【0057】
この構成によれば、半導体素子30と保持材60とが接触しているので、半導体素子30の駆動により生じた熱を保持材60に伝えることができる。特に、半導体素子30と保持材60とを、熱伝導性の高い接着剤61で接着することが好ましい。そして、保持材60によって、より広い表面積での放熱が可能になる。その意味で、保持材60は、ヒートスプレッダとしての機能を果たし、半導体素子30の熱の発散を促進することができる。
【0058】
なお、保持材60と基板10との間に、閉空間が形成されないことが好ましい。そのために、例えば、保持材60に少なくとも一つ又は複数の穴62を形成する。あるいは、基板10に穴を形成してもよい。
【0059】
さらに、図4に示す状態に至る工程は変形が可能である。例えば、図1に示すようにフレキシブル基板10に異方性導電材料20を設けた後、半導体素子30及び保持材40を同時又は別工程で異方性導電材料20上に載せて、両者を一括して加圧してもよい。こうすることで、異方性導電材料20に対して、半導体素子30の電気的接続及び保持材40の接着を同時に行うことができる。この場合でも、保持材40の代わりに、図6に示す保持材60を使用することができる。
【0060】
図7には、本発明を適用した半導体装置1を実装した回路基板1000が示されている。回路基板には例えばガラスエポキシ基板等の有機系基板を用いることが一般的である。回路基板には例えば銅からなる配線パターンが所望の回路となるように形成されていて、それらの配線パターンと半導体装置1の外部電極50とを機械的に接続することでそれらの電気的導通を図る。
【0061】
そして、この回路基板1000を備える電子機器として、図8には、ノート型パーソナルコンピュータ1200が示されている。
【0062】
なお、半導体装置と同様に多数のバンプを必要とする面実装用の電子部品であれば、能動部品か受動部品かを問わず、本発明を応用することができる。電子部品として、例えば、抵抗器、コンデンサ、コイル、発振器、フィルタ、温度センサ、サーミスタ、バリスタ、ボリューム又はヒューズなどがある。
【図面の簡単な説明】
【図1】図1は、本発明の実施の形態に係る半導体装置の製造方法を示す図である。
【図2】図2は、本発明の実施の形態に係る半導体装置の製造方法を示す図である。
【図3】図3は、本発明の実施の形態に係る半導体装置の製造方法を示す図である。
【図4】図4は、本発明の実施の形態に係る半導体装置の製造方法を示す図である。
【図5】図5は、本発明の実施の形態に係る半導体装置の製造方法を示す図である。
【図6】図6は、本発明の実施の形態の変形例を示す図である。
【図7】図7は、本実施の形態に係る回路基板を示す図である。
【図8】図8は、本発明に係る方法を適用して製造された半導体装置を実装した回路基板を備える電子機器を示す図である。
【符号の説明】
1 半導体装置
10 フレキシブル基板
12 スルーホール
14 配線パターン
16 保護層
20 異方性導電材料
30 半導体素子
32 電極
40 保持材
42 開口部
50 外部電極
Claims (5)
- 配線パターンが形成されたフレキシブル基板上に接着剤を設ける工程と、
前記フレキシブル基板上の第1領域において、半導体素子に形成されてなる複数の電極と前記配線パターンとを前記接着剤によって接着する工程と、
前記第1の領域とは異なる前記フレキシブル基板上の第2領域において、前記フレキシブル基板と保持材を前記接着剤により貼り付ける工程と、
前記半導体素子の前記複数の電極及び前記保持材と前記フレキシブル基板との間に、一括して圧力を加える工程と、
を含む半導体装置の製造方法。 - 請求項1記載の半導体装置の製造方法において、
前記接着剤には導電粒子が分散されてなり、加えられた圧力により前記半導体素子の電極と前記配線パターンとを前記導電粒子により電気的に接続する半導体装置の製造方法。 - 請求項1又は請求項2記載の半導体装置の製造方法において、
前記保持材を、前記半導体素子を囲むように載置する半導体装置の製造方法。 - 請求項1乃至3のいずれかに記載の半導体装置の製造方法において、
前記接着剤は熱硬化性を有する材料から形成されてなり、
前記半導体素子及び前記保持材を、前記接着剤を介して前記フレキシブル基板に貼り付けてから、前記接着剤を加熱する工程を含む半導体装置の製造方法。 - 請求項4記載の半導体装置の製造方法において、
前記配線パターンに電気的に導通する外部電極を形成する工程をさらに含み、
前記外部電極を形成する工程は、加熱のためのリフロー工程を含み、
前記リフロー工程で、前記外部電極の形成と同時に前記接着剤を加熱する半導体装置の製造方法。
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JP2001308220A (ja) * | 2000-04-24 | 2001-11-02 | Nec Corp | 半導体パッケージ及びその製造方法 |
TW454320B (en) * | 2000-05-12 | 2001-09-11 | Siliconware Precision Industries Co Ltd | Semiconductor devices with heat-dissipation stiffener and manufacturing method thereof |
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JP2002353369A (ja) * | 2001-05-28 | 2002-12-06 | Sharp Corp | 半導体パッケージおよびその製造方法 |
TWI221664B (en) * | 2002-11-07 | 2004-10-01 | Via Tech Inc | Structure of chip package and process thereof |
JP4654865B2 (ja) * | 2005-09-30 | 2011-03-23 | パナソニック株式会社 | 電子部品実装方法 |
US20070120240A1 (en) * | 2005-11-29 | 2007-05-31 | 3M Innovative Properties Company | Circuit substrate and method of manufacture |
US7649254B2 (en) * | 2006-05-01 | 2010-01-19 | Flextronics Ap, Llc | Conductive stiffener for a flexible substrate |
KR100826982B1 (ko) * | 2006-12-29 | 2008-05-02 | 주식회사 하이닉스반도체 | 메모리 모듈 |
US20090091021A1 (en) * | 2007-10-03 | 2009-04-09 | Matsushita Electric Industrial Co., Ltd. | Semiconductor device and method of manufacturing the same |
US8017873B2 (en) * | 2008-03-03 | 2011-09-13 | Himax Technologies Limited | Built-in method of thermal dissipation layer for driver IC substrate and structure thereof |
DE102008052244A1 (de) * | 2008-10-18 | 2010-04-22 | Carl Freudenberg Kg | Flexible Leiterplatte |
KR101949632B1 (ko) * | 2015-03-26 | 2019-02-18 | 데쿠세리아루즈 가부시키가이샤 | 가요성 실장 모듈체의 제조 방법 |
Family Cites Families (8)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US5162262A (en) * | 1989-03-14 | 1992-11-10 | Mitsubishi Denki Kabushiki Kaisha | Multi-layered interconnection structure for a semiconductor device and manufactured method thereof |
US5646439A (en) * | 1992-05-13 | 1997-07-08 | Matsushita Electric Industrial Co., Ltd. | Electronic chip component with passivation film and organic protective film |
US5261593A (en) * | 1992-08-19 | 1993-11-16 | Sheldahl, Inc. | Direct application of unpackaged integrated circuit to flexible printed circuit |
EP0746875B1 (en) * | 1994-12-23 | 2002-03-06 | Koninklijke Philips Electronics N.V. | Method of manufacturing semiconductor devices with semiconductor elements formed in a layer of semiconductor material glued on a support wafer |
JPH08288424A (ja) * | 1995-04-18 | 1996-11-01 | Nec Corp | 半導体装置 |
JP3457123B2 (ja) * | 1995-12-07 | 2003-10-14 | 株式会社リコー | 半導体装置 |
US6249046B1 (en) * | 1997-02-13 | 2001-06-19 | Seiko Epson Corporation | Semiconductor device and method for manufacturing and mounting thereof, and circuit board mounted with the semiconductor device |
US6075710A (en) * | 1998-02-11 | 2000-06-13 | Express Packaging Systems, Inc. | Low-cost surface-mount compatible land-grid array (LGA) chip scale package (CSP) for packaging solder-bumped flip chips |
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