JP3517568B2 - 画像処理装置 - Google Patents
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- Computer Hardware Design (AREA)
- General Physics & Mathematics (AREA)
- Theoretical Computer Science (AREA)
- Control Of Indicators Other Than Cathode Ray Tubes (AREA)
- Liquid Crystal Display Device Control (AREA)
- Photovoltaic Devices (AREA)
- Liquid Crystal (AREA)
Description
【０００１】
【発明の属する技術分野】本発明は、画像処理装置に関
し、特に２次元状に配置された画素を順次駆動して画像
を表示する表示装置を駆動するための画像処理装置に関
するものである。
し、特に２次元状に配置された画素を順次駆動して画像
を表示する表示装置を駆動するための画像処理装置に関
するものである。
【０００２】
【従来の技術】マトリクス状に配列した画素を持つ液晶
表示装置などの表示装置を駆動する手段として、従来、
例えば水平方向２画素及び垂直方向２画素の計４画素な
ど複数の画素を同時に駆動する方法がある。かかる複数
画素を同時に駆動する方法は、１画素づつ駆動する場合
と比べ、画素を駆動する時間を大きく設ける事ができ、
画素を駆動するための時間が大きくかかる表示装置にお
いても、画素周波数が高い映像信号を表示する事ができ
るようになる。また、映像を水平方向や垂直方向にシフ
トさせる手段として、表示装置に入力する映像信号に対
し、画素駆動信号のタイミングをシフトするという方法
がある。
表示装置などの表示装置を駆動する手段として、従来、
例えば水平方向２画素及び垂直方向２画素の計４画素な
ど複数の画素を同時に駆動する方法がある。かかる複数
画素を同時に駆動する方法は、１画素づつ駆動する場合
と比べ、画素を駆動する時間を大きく設ける事ができ、
画素を駆動するための時間が大きくかかる表示装置にお
いても、画素周波数が高い映像信号を表示する事ができ
るようになる。また、映像を水平方向や垂直方向にシフ
トさせる手段として、表示装置に入力する映像信号に対
し、画素駆動信号のタイミングをシフトするという方法
がある。
【０００３】
【発明が解決しようとする課題】しかしながら、上記従
来例では、複数画素を同時に駆動するため、表示装置に
対して、複数画素に対応する映像信号を同時に入力する
必要があった。
来例では、複数画素を同時に駆動するため、表示装置に
対して、複数画素に対応する映像信号を同時に入力する
必要があった。
【０００４】そのため、映像信号を水平方向や垂直方向
にシフトさせる場合に、映像信号に対して画素駆動信号
のタイミングを変化させるという方法では、同時に入力
される複数画素の単位でしかシフトできないという問題
があった。
にシフトさせる場合に、映像信号に対して画素駆動信号
のタイミングを変化させるという方法では、同時に入力
される複数画素の単位でしかシフトできないという問題
があった。
【０００５】本発明の目的は、複数画素を同時に入力す
るような液晶装置やこれを用いた表示装置に対しても、
水平方向及び垂直方向に１画素毎のシフトを可能とする
画像処理回路を提供することである。
るような液晶装置やこれを用いた表示装置に対しても、
水平方向及び垂直方向に１画素毎のシフトを可能とする
画像処理回路を提供することである。
【０００６】
【課題を解決するための手段】本発明は、上記目的を達
成するため、複数の画素を同時に駆動する画像処理装置
において、前記複数の画素信号を同時に供給する信号処
理手段と、前記信号処理手段の複数の出力画素信号を遅
延させるための３つの遅延手段と、前記信号処理手段の
出力と前記遅延手段の出力とからなる４つの入力のいず
れかを選択して出力する２つ以上の選択手段と、を備え
たことを特徴とする。
成するため、複数の画素を同時に駆動する画像処理装置
において、前記複数の画素信号を同時に供給する信号処
理手段と、前記信号処理手段の複数の出力画素信号を遅
延させるための３つの遅延手段と、前記信号処理手段の
出力と前記遅延手段の出力とからなる４つの入力のいず
れかを選択して出力する２つ以上の選択手段と、を備え
たことを特徴とする。
【０００７】また、上記画像処理装置において、前記信
号処理手段および前記遅延手段と前記選択手段につい
て、前記信号処理手段および前記遅延手段と前記選択手
段について、サイクリック的な前記選択信号が１増加す
ると（１）画像上で隣り合う画素に対応する信号を選択
するか、又は（２）画像上の左隣の画素に対応する信号
を選択するか、（３）画像上の上隣の画素に対応する信
号を選択するか、のいずれかの信号を選択するように接
続したことを特徴とする。
号処理手段および前記遅延手段と前記選択手段につい
て、前記信号処理手段および前記遅延手段と前記選択手
段について、サイクリック的な前記選択信号が１増加す
ると（１）画像上で隣り合う画素に対応する信号を選択
するか、又は（２）画像上の左隣の画素に対応する信号
を選択するか、（３）画像上の上隣の画素に対応する信
号を選択するか、のいずれかの信号を選択するように接
続したことを特徴とする。
【０００８】さらに、本発明は、隣り合う複数の画素を
同時に駆動する画像処理装置において、前記隣り合う複
数の画素を同時に出力する信号処理手段と、前記信号処
理手段の複数の出力画素信号の少なくとも一つを遅延さ
せるための遅延手段と、上記信号処理手段の出力と上記
遅延手段の出力から、表示装置を同時駆動するための画
素信号を選択するための選択手段とを備えたことを特徴
とする。
同時に駆動する画像処理装置において、前記隣り合う複
数の画素を同時に出力する信号処理手段と、前記信号処
理手段の複数の出力画素信号の少なくとも一つを遅延さ
せるための遅延手段と、上記信号処理手段の出力と上記
遅延手段の出力から、表示装置を同時駆動するための画
素信号を選択するための選択手段とを備えたことを特徴
とする。
【０００９】さらにまた、複数の画素を同時に駆動する
画像処理装置において、前記複数の画素信号を同時に供
給する信号処理手段と、前記信号処理手段の複数の出力
画素信号の少なくとも一つを遅延させるための遅延手段
と、上記信号処理手段の出力と上記遅延手段の出力とを
入力とする２つ以上のマルチプレクサに対して、該マル
チプレクサの出力画素信号を選択する選択手段と、前記
２つ以上のマルチプレクサの出力によって同時に駆動さ
れる表示装置と、を備えたことを特徴とする。
画像処理装置において、前記複数の画素信号を同時に供
給する信号処理手段と、前記信号処理手段の複数の出力
画素信号の少なくとも一つを遅延させるための遅延手段
と、上記信号処理手段の出力と上記遅延手段の出力とを
入力とする２つ以上のマルチプレクサに対して、該マル
チプレクサの出力画素信号を選択する選択手段と、前記
２つ以上のマルチプレクサの出力によって同時に駆動さ
れる表示装置と、を備えたことを特徴とする。
【００１０】
［第１の実施形態］図１は、本発明の第１の実施形態で
ある画像処理装置の一回路の概略図である。図１におい
て、映像信号処理回路１から出力された映像信号Ｖ０及
びＶ１は、それぞれフリップフロップ２及び３に入力さ
れる。さらにフリップフロップ３の出力である映像信号
ＶB は、フリップフロップ４に入力される。
ある画像処理装置の一回路の概略図である。図１におい
て、映像信号処理回路１から出力された映像信号Ｖ０及
びＶ１は、それぞれフリップフロップ２及び３に入力さ
れる。さらにフリップフロップ３の出力である映像信号
ＶB は、フリップフロップ４に入力される。
【００１１】映像信号Ｖ0，Ｖ1及び各フリップフロップ
の出力ＶA ，ＶB ，ＶC はマルチプレクサ５及び６に入
力される。入力された映像信号は、サイクリックに巡回
する選択信号ＳＥＬによりいづれかが選択され、マルチ
プレクサ５及び６の出力すなわちＶ0′及びＶ1′とな
る。映像信号Ｖ0′，Ｖ1′は、水平方向にとなり合う２
画素を同時に書込む構造を持つ液晶パネル７に入力され
る。
の出力ＶA ，ＶB ，ＶC はマルチプレクサ５及び６に入
力される。入力された映像信号は、サイクリックに巡回
する選択信号ＳＥＬによりいづれかが選択され、マルチ
プレクサ５及び６の出力すなわちＶ0′及びＶ1′とな
る。映像信号Ｖ0′，Ｖ1′は、水平方向にとなり合う２
画素を同時に書込む構造を持つ液晶パネル７に入力され
る。
【００１２】つぎに、画像処理装置の回路の動作を説明
する。図２は、各映像信号Ｖ0，Ｖ1，ＶA ，ＶB ，
ＶC ，Ｖ0′，Ｖ1′のタイミングを示すタイミングチャ
ートである。まず、映像信号処理回路１から映像信号Ｖ
0及びＶ1がＣＬＫに同期して出力される。ここで、図２
（１），（２）に示すように、映像信号Ｖ0のＡ，Ｃ，
Ｅ…と映像信号Ｖ1のＢ，Ｄ，Ｆ…とは異なる映像信号
とする。映像信号Ｖ0をフリップフロップ２により１ク
ロック遅延させた信号がＶA となる。映像信号ＶA のタ
イミングを図２（４）に示す。同様に、映像信号ＶB ，
ＶC は図２（５），（６）に示すようなタイミングとな
る。
する。図２は、各映像信号Ｖ0，Ｖ1，ＶA ，ＶB ，
ＶC ，Ｖ0′，Ｖ1′のタイミングを示すタイミングチャ
ートである。まず、映像信号処理回路１から映像信号Ｖ
0及びＶ1がＣＬＫに同期して出力される。ここで、図２
（１），（２）に示すように、映像信号Ｖ0のＡ，Ｃ，
Ｅ…と映像信号Ｖ1のＢ，Ｄ，Ｆ…とは異なる映像信号
とする。映像信号Ｖ0をフリップフロップ２により１ク
ロック遅延させた信号がＶA となる。映像信号ＶA のタ
イミングを図２（４）に示す。同様に、映像信号ＶB ，
ＶC は図２（５），（６）に示すようなタイミングとな
る。
【００１３】各映像信号Ｖ0，Ｖ1，ＶA ，ＶB ，Ｖ
C は、図１に示すように２つのマルチプレクサ５，６に
接続される。選択信号ＳＥＬが各マルチプレクサ５，６
に接続され、選択信号ＳＥＬの値により２つのマルチプ
レクサ５，６の出力Ｖ0′及びＶ1′は、各マルチプレク
サ５，６の入力信号から選択することができる。
C は、図１に示すように２つのマルチプレクサ５，６に
接続される。選択信号ＳＥＬが各マルチプレクサ５，６
に接続され、選択信号ＳＥＬの値により２つのマルチプ
レクサ５，６の出力Ｖ0′及びＶ1′は、各マルチプレク
サ５，６の入力信号から選択することができる。
【００１４】選択信号ＳＥＬ＝０の場合について説明す
る。映像信号Ｖ0′にはＶ0が選択され、映像信号Ｖ1′
にはＶ1が選択される。このときの映像信号Ｖ0′及びＶ
1′のタイミングチャートを図２（７），（８）に示
す。
る。映像信号Ｖ0′にはＶ0が選択され、映像信号Ｖ1′
にはＶ1が選択される。このときの映像信号Ｖ0′及びＶ
1′のタイミングチャートを図２（７），（８）に示
す。
【００１５】映像信号Ｖ0′及びＶ1′は、液晶パネル７
の隣りあう画素に書込まれてゆく。このときに、図３
（１）に示すように、画素１に映像Ａ、画素２に映像Ｂ
という順で書込まれてゆくものとする。
の隣りあう画素に書込まれてゆく。このときに、図３
（１）に示すように、画素１に映像Ａ、画素２に映像Ｂ
という順で書込まれてゆくものとする。
【００１６】選択信号ＳＥＬ＝１とした場合、映像信号
Ｖ0′にはＶB が選択され、映像信号Ｖ1′にはＶ0が選
択される。このときの映像信号Ｖ0′及びＶ1′のタイミ
ングチャートを図２（９），（１０）に示す。このと
き、液晶パネル７に書込まれる位置は図３（２）に示す
ようになり、ＳＥＬ＝０の場合と比べ、右方向へ１画素
シフトする。
Ｖ0′にはＶB が選択され、映像信号Ｖ1′にはＶ0が選
択される。このときの映像信号Ｖ0′及びＶ1′のタイミ
ングチャートを図２（９），（１０）に示す。このと
き、液晶パネル７に書込まれる位置は図３（２）に示す
ようになり、ＳＥＬ＝０の場合と比べ、右方向へ１画素
シフトする。
【００１７】ＳＥＬ＝２の場合には、映像信号Ｖ0′及
びＶ1′のタイミングは図２（１１），（１２）に示す
ようになる。画素の位置は図３（３）に示すように、Ｓ
ＥＬ＝０の場合に対して右方向へ２画素シフトする。
びＶ1′のタイミングは図２（１１），（１２）に示す
ようになる。画素の位置は図３（３）に示すように、Ｓ
ＥＬ＝０の場合に対して右方向へ２画素シフトする。
【００１８】ＳＥＬ＝３の場合も同様に、映像信号
Ｖ0′及びＶ1′のタイミングは図２（１３），（１４）
に示すようになる。画素の位置は図３（４）に示すよう
に、ＳＥＬ＝０の場合に対して右方向へ３画素シフトす
る。
Ｖ0′及びＶ1′のタイミングは図２（１３），（１４）
に示すようになる。画素の位置は図３（４）に示すよう
に、ＳＥＬ＝０の場合に対して右方向へ３画素シフトす
る。
【００１９】以上のように、水平方向の２画素を同時に
書き込む構造を持つ液晶パネル７に対して、１画素単位
で画像をシフトさせる事ができる。
書き込む構造を持つ液晶パネル７に対して、１画素単位
で画像をシフトさせる事ができる。
【００２０】こうして、上記構成により、隣り合う２つ
の画素信号を同時に入力するような液晶パネル７の表示
装置に対して、水平方向に１画素毎のシフトを可能とす
る画像処理回路を提供することができる。
の画素信号を同時に入力するような液晶パネル７の表示
装置に対して、水平方向に１画素毎のシフトを可能とす
る画像処理回路を提供することができる。
【００２１】［第２の実施形態］第２の実施形態とし
て、水平方向の隣り合う４画素を同時に駆動する構造を
持つ表示装置を駆動する場合について説明する。
て、水平方向の隣り合う４画素を同時に駆動する構造を
持つ表示装置を駆動する場合について説明する。
【００２２】図４は、第２の実施形態である画像処理装
置の画像処理回路の概略図である。図４において、映像
信号処理回路１０１から、水平方向にとなり合う４画素
に対応した映像信号Ｖ0，Ｖ1，Ｖ2，Ｖ3が出力される。
Ｖ1，Ｖ2，Ｖ3は、それぞれフリップフロップ１０２，
１０３，１０４の入力に接続され、その出力はそれぞれ
ＶA，ＶB ，ＶC となる。
置の画像処理回路の概略図である。図４において、映像
信号処理回路１０１から、水平方向にとなり合う４画素
に対応した映像信号Ｖ0，Ｖ1，Ｖ2，Ｖ3が出力される。
Ｖ1，Ｖ2，Ｖ3は、それぞれフリップフロップ１０２，
１０３，１０４の入力に接続され、その出力はそれぞれ
ＶA，ＶB ，ＶC となる。
【００２３】各映像信号Ｖ0，Ｖ1，Ｖ2，Ｖ3，ＶA ，Ｖ
B ，ＶC は、４つのマルチプレクサ１０５，１０６，１
０７，１０８の入力に接続される。各マルチプレクサ１
０５〜１０８の映像信号出力Ｖ0′，Ｖ1′，Ｖ2′，
Ｖ3′は、選択信号ＳＥＬの値により各マルチプレクサ
の入力信号の中から選択される。なお、選択信号ＳＥＬ
は、例えば０〜３までの値をサイクリック的に順繰りに
繰り返す信号であり、各マルチプレクサから指定の画像
信号を出力させる。
B ，ＶC は、４つのマルチプレクサ１０５，１０６，１
０７，１０８の入力に接続される。各マルチプレクサ１
０５〜１０８の映像信号出力Ｖ0′，Ｖ1′，Ｖ2′，
Ｖ3′は、選択信号ＳＥＬの値により各マルチプレクサ
の入力信号の中から選択される。なお、選択信号ＳＥＬ
は、例えば０〜３までの値をサイクリック的に順繰りに
繰り返す信号であり、各マルチプレクサから指定の画像
信号を出力させる。
【００２４】映像信号出力Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′
は、水平方向の４画素を同時に駆動する構造を持つ表示
装置１０９に入力され、画像が表示される。
は、水平方向の４画素を同時に駆動する構造を持つ表示
装置１０９に入力され、画像が表示される。
【００２５】つぎに、本画像処理回路の動作を説明す
る。図５は、各映像信号のタイミングを示すチャートで
ある。
る。図５は、各映像信号のタイミングを示すチャートで
ある。
【００２６】映像信号処理回路１０１からの映像出力Ｖ
0，Ｖ1，Ｖ2，Ｖ3は、図５（１），（２），（３），
（４）に示すタイミングで出力されるとする。映像信号
Ｖ1，Ｖ2，Ｖ3を１クロック遅延させた信号がそれぞれ
映像信号ＶA ，ＶB ，ＶC であるから、映像信号ＶA ，
ＶB ，ＶC はそれぞれ図５（６），（７），（８）に示
すようなタイミングとなる。
0，Ｖ1，Ｖ2，Ｖ3は、図５（１），（２），（３），
（４）に示すタイミングで出力されるとする。映像信号
Ｖ1，Ｖ2，Ｖ3を１クロック遅延させた信号がそれぞれ
映像信号ＶA ，ＶB ，ＶC であるから、映像信号ＶA ，
ＶB ，ＶC はそれぞれ図５（６），（７），（８）に示
すようなタイミングとなる。
【００２７】ＳＥＬ＝０の場合、映像信号Ｖ0′＝Ｖ0，
Ｖ1′＝Ｖ1，Ｖ2′＝Ｖ2，Ｖ3′＝Ｖ3となる。このとき
の映像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチ
ャートを図５（９）〜（１２）に示す。またこのとき、
表示装置には、図３（１）に示す位置に表示されるとす
る。
Ｖ1′＝Ｖ1，Ｖ2′＝Ｖ2，Ｖ3′＝Ｖ3となる。このとき
の映像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチ
ャートを図５（９）〜（１２）に示す。またこのとき、
表示装置には、図３（１）に示す位置に表示されるとす
る。
【００２８】つぎに、ＳＥＬ＝１とした場合、映像信号
Ｖ0′＝ＶC ，Ｖ1′＝Ｖ0，Ｖ2′＝Ｖ1，Ｖ3′＝Ｖ2と
なる。このときのタイミングチャートを図５（１３）〜
（１６）に示す。表示装置に表示される位置は図３
（２）のようになり、ＳＥＬ＝０の場合と比べ、右方向
に１画素シフトする。
Ｖ0′＝ＶC ，Ｖ1′＝Ｖ0，Ｖ2′＝Ｖ1，Ｖ3′＝Ｖ2と
なる。このときのタイミングチャートを図５（１３）〜
（１６）に示す。表示装置に表示される位置は図３
（２）のようになり、ＳＥＬ＝０の場合と比べ、右方向
に１画素シフトする。
【００２９】次に、ＳＥＬ＝２の場合も同様であり、映
像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチャー
トを図５（１７）〜（２０）に、表示位置を図３（３）
に示す。ＳＥＬ＝０の場合と比べ、右方向に２画素シフ
トする。
像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチャー
トを図５（１７）〜（２０）に、表示位置を図３（３）
に示す。ＳＥＬ＝０の場合と比べ、右方向に２画素シフ
トする。
【００３０】さらに、ＳＥＬ＝３の場合も同様であり、
映像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチャ
ートを図５（２１）〜（２４）に、表示位置を図３
（４）に示す。ＳＥＬ＝０の場合と比べ、右方向に３画
素シフトする。
映像信号Ｖ0′，Ｖ1′，Ｖ2′，Ｖ3′のタイミングチャ
ートを図５（２１）〜（２４）に、表示位置を図３
（４）に示す。ＳＥＬ＝０の場合と比べ、右方向に３画
素シフトする。
【００３１】以上のように、この実施形態では、水平方
向の４画素を同時に書込む構造を持つ表示装置に対し
て、水平方向に１画素単位で画像をシフトすることがで
きる。
向の４画素を同時に書込む構造を持つ表示装置に対し
て、水平方向に１画素単位で画像をシフトすることがで
きる。
【００３２】上記各実施形態では、水平方向の２画素及
び４画素を同時に駆動する表示装置の場合について示し
たが、任意の画素数を同時に駆動する構造を持つ表示装
置に対して適用することができる。
び４画素を同時に駆動する表示装置の場合について示し
たが、任意の画素数を同時に駆動する構造を持つ表示装
置に対して適用することができる。
【００３３】上記第１，及び第２の実施形態において
は、水平方向の複数画素を同時に駆動する場合について
説明したが、垂直方向の画素を複数同時に駆動する場合
においても、上記実施形態の装置を垂直方向の複数画素
出力に対して、並列に接続すればよい。即ち、図１及び
図４に示す回路において、映像信号処理回路１，１０１
からの出力を垂直走査信号に応じて、各隣り合う画像信
号の垂直走査信号を出力し、フリップフロップを同様に
構成して、同様な配置のマルチプレクサに入力して、選
択信号ＳＥＬに応じて出力すれば、垂直走査信号のタイ
ミングに応じてマルチプレクサから出力することによ
り、垂直方向の画素を複数同時に駆動することができ
る。
は、水平方向の複数画素を同時に駆動する場合について
説明したが、垂直方向の画素を複数同時に駆動する場合
においても、上記実施形態の装置を垂直方向の複数画素
出力に対して、並列に接続すればよい。即ち、図１及び
図４に示す回路において、映像信号処理回路１，１０１
からの出力を垂直走査信号に応じて、各隣り合う画像信
号の垂直走査信号を出力し、フリップフロップを同様に
構成して、同様な配置のマルチプレクサに入力して、選
択信号ＳＥＬに応じて出力すれば、垂直走査信号のタイ
ミングに応じてマルチプレクサから出力することによ
り、垂直方向の画素を複数同時に駆動することができ
る。
【００３４】また上記第２の実施形態においては、０か
ら３画素のシフトができる装置について説明したが、シ
フト量は必要とされるシフト量に合わせて、フリップフ
ロップの遅延手段およびマルチプレクサによる選択手段
の追加および組み合せを行うことにより、任意の画素シ
フトが実現できる。
ら３画素のシフトができる装置について説明したが、シ
フト量は必要とされるシフト量に合わせて、フリップフ
ロップの遅延手段およびマルチプレクサによる選択手段
の追加および組み合せを行うことにより、任意の画素シ
フトが実現できる。
【００３５】また、選択手段であるマルチプレクサの数
は同時出力する画素数と同じであり、遅延手段であるフ
リップフロップの数は必要とされるシフト量と同じであ
る。従って、本発明による画像データのシフトを行うた
めには、少なくとも同時駆動端子数以上の画素選択手段
と、必要とされるシフト量以上の遅延手段が必要とな
る。
は同時出力する画素数と同じであり、遅延手段であるフ
リップフロップの数は必要とされるシフト量と同じであ
る。従って、本発明による画像データのシフトを行うた
めには、少なくとも同時駆動端子数以上の画素選択手段
と、必要とされるシフト量以上の遅延手段が必要とな
る。
【００３６】［第３の実施形態］次に、上記第１，第２
実施形態で説明した各液晶パネルのドライブ例を適用し
た周辺の回路を含めた第３の実施形態の画像処理装置に
ついて説明する。液晶表示装置の画像処理装置における
駆動回路系について、その全体ブロック図を図６に示
す。ここで、１３１０はパネルドライバーであり、上記
映像信号処理回路と遅延手段と選択手段を含み、ＲＧＢ
映像信号を極性反転し、かつ所定の電圧増幅をした液晶
駆動信号を形成するとともに、駆動信号、各種タイミン
グ信号等を形成して、高精細・高密度の液晶パネル１３
０２を複数ラインを同時にドライブしている。また、１
３１２はインターフェースであり、各種映像及び制御伝
送信号を標準映像信号等にデコードしている。また、１
３１１はデコーダーであり、インターフェース１３１２
からの標準映像信号をＲＧＢ原色映像信号及び同期信号
に、即ち液晶パネル１３０２に対応した画像信号にデコ
ード・変換している。１３１４はバラストである点灯回
路であり、楕円リフレクター１３０７内のアークランプ
１３０８を駆動点灯する。さらに、１３１５は電源回路
であり、各回路ブロックに対して電源を供給している。
また、１３１３は不図示の操作部を内在したコントロー
ラーであり、上記各回路ブロックを総合的にコントロー
ルするものである。このように本液晶表示装置は、その
駆動回路系は単板式プロジェクターとして、特に駆動回
路系に上記第１又は第２の実施形態を実施する以外は、
特に負担を掛けることなく、高密度の液晶パネルを対象
として、画像の品質のよい、良好な質感のカラー画像を
表示することができるものである。
実施形態で説明した各液晶パネルのドライブ例を適用し
た周辺の回路を含めた第３の実施形態の画像処理装置に
ついて説明する。液晶表示装置の画像処理装置における
駆動回路系について、その全体ブロック図を図６に示
す。ここで、１３１０はパネルドライバーであり、上記
映像信号処理回路と遅延手段と選択手段を含み、ＲＧＢ
映像信号を極性反転し、かつ所定の電圧増幅をした液晶
駆動信号を形成するとともに、駆動信号、各種タイミン
グ信号等を形成して、高精細・高密度の液晶パネル１３
０２を複数ラインを同時にドライブしている。また、１
３１２はインターフェースであり、各種映像及び制御伝
送信号を標準映像信号等にデコードしている。また、１
３１１はデコーダーであり、インターフェース１３１２
からの標準映像信号をＲＧＢ原色映像信号及び同期信号
に、即ち液晶パネル１３０２に対応した画像信号にデコ
ード・変換している。１３１４はバラストである点灯回
路であり、楕円リフレクター１３０７内のアークランプ
１３０８を駆動点灯する。さらに、１３１５は電源回路
であり、各回路ブロックに対して電源を供給している。
また、１３１３は不図示の操作部を内在したコントロー
ラーであり、上記各回路ブロックを総合的にコントロー
ルするものである。このように本液晶表示装置は、その
駆動回路系は単板式プロジェクターとして、特に駆動回
路系に上記第１又は第２の実施形態を実施する以外は、
特に負担を掛けることなく、高密度の液晶パネルを対象
として、画像の品質のよい、良好な質感のカラー画像を
表示することができるものである。
【００３７】
【発明の効果】以上説明したように、本発明によれば、
複数の画素を同時に駆動する表示装置に対して、映像信
号処理回路と表示装置との間に本回路を付加することに
より、水平方向及び垂直方向に１画素単位で画像をシフ
トさせることができる。本回路は遅延回路と選択手段に
より構成され、より具体的にはフリップフロップの遅延
手段と複数の選択信号により選択されるマルチプレクサ
の選択手段という簡単な構成で、上記効果を得ることが
できる。
複数の画素を同時に駆動する表示装置に対して、映像信
号処理回路と表示装置との間に本回路を付加することに
より、水平方向及び垂直方向に１画素単位で画像をシフ
トさせることができる。本回路は遅延回路と選択手段に
より構成され、より具体的にはフリップフロップの遅延
手段と複数の選択信号により選択されるマルチプレクサ
の選択手段という簡単な構成で、上記効果を得ることが
できる。
【図１】本発明の第１の実施形態の回路の概略図であ
る。
る。
【図２】図１中の各映像信号のタイミングを示すチャー
トである。
トである。
【図３】第１及び第２の実施形態の表示装置に表示され
る画像を示す図である。
る画像を示す図である。
【図４】本発明の第２の実施形態の回路の概略図であ
る。
る。
【図５】図４中の各映像信号のタイミングを示すチャー
トである。
トである。
【図６】本発明による液晶表示装置のブロック図であ
る。
る。
【符号の説明】
１，１０１ 映像信号処理回路
２，３，４，１０２，１０３，１０４ フリップフロッ
プ ５，６，１０５，１０６，１０７，１０８ マルチプレ
クサ ７，１０９ 液晶パネル
プ ５，６，１０５，１０６，１０７，１０８ マルチプレ
クサ ７，１０９ 液晶パネル
─────────────────────────────────────────────────────
フロントページの続き
(58)調査した分野(Int.Cl.7，ＤＢ名)
G09G 3/00 - 3/38
G02F 1/133
Claims (4)
- 【請求項１】 複数の画素を同時に駆動する画像処理装
置において、 前記複数の画素信号を同時に供給する信号処理手段と、 前記信号処理手段の複数の出力画素信号を遅延させるた
めの３つの遅延手段と、前記 信号処理手段の出力と前記遅延手段の出力とからな
る４つの入力のいずれかを選択して出力する２つ以上の
選択手段と、 を備えたことを特徴とする画像処理装置。 - 【請求項２】 請求項１に記載の画像処理装置におい
て、前記遅延手段は第１、第２のフリップフロップ回路と、
前記第１、第２のフリップフロップ回路のうち一方のフ
リップフロップ回路に直列に接続された第３のフリップ
フロップ回路とから構成され、 前記信号処理手段からの２つの映像信号が前記第１、第
２のフリップフロップ回路に供給され、 前記選択手段は、それぞれ４つの入力を有する第１、第
２のマルチプレクサから構成され、前記信号処理手段か
らの２つの映像信号と前記第１、第２、第３のフリップ
フロップ回路の出力の３つの映像信号との５つの映像信
号のうち、それぞれ異なる組み合わせの４つの映像信号
が前記第１、第２のマルチプレクサに供給され、 前記第１、第２のマルチプレクサにシフト量に応じた選
択信号を供給することによって、前記信号処理手段から
の映像信号を所望のシフト量だけシフトさせる ことを特
徴とする画像処理装置。 - 【請求項３】 請求項１に記載の画像処理装置におい
て、 前記遅延手段は第１、第２、第３のフリップフロップ回
路から構成され、前記選択手段はそれぞれ４つの入力を
有する第１、第２、第３のマルチプレクサから構成さ
れ、更に第４のマルチプレクサを有しており、 前記信号処理手段からの４つの映像信号のうち３つの映
像信号が前記第１、第２、第３のフリップフロップ回路
に供給され、 前記第１、第２、第３、第４のマルチプレクサには、前
記信号処理手段の４つの映像信号と、前記第１、第２、
第３のフリップフロップ回路の出力の３つの映像信号と
の７つの映像信号のうち、それぞれ異なる組み合わせの
４つの映像信号が供給され、 前記第１、第２、第３、第４のマルチプレクサにシフト
量に応じた選択信号を供給することによって、前記信号
処理手段からの映像信号を所望のシフト量だけシフトさ
せることを特徴とする画像処理装置。 - 【請求項４】 請求項１に記載の画像処理装置におい
て、 前記信号処理手段と前記遅延手段と前記選択手段を含
み、ＲＧＢ映像信号を極性反転し、かつ所定の電圧増幅
をした液晶駆動信号を形成して液晶パネルをドライブす
るパネルドライバーと、 各種映像及び制御伝送信号をデコードするインターフェ
ースと、 前記インターフェースからの標準映像信号をＲＧＢ原色
映像信号及び同期信号に対応した画像信号にデコード・
変換するデコーダーと、 光源を駆動点灯する点灯回路と、 前記パネルドライバーと前記インターフェースと前記デ
コーダーと前記点灯回路とを総合的にコントロールする
コントローラと、 を備えたことを特徴とする画像処理装置。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29247197A JP3517568B2 (ja) | 1997-10-24 | 1997-10-24 | 画像処理装置 |
| US09/176,275 US6310628B1 (en) | 1997-10-24 | 1998-10-21 | Image display drive apparatus |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29247197A JP3517568B2 (ja) | 1997-10-24 | 1997-10-24 | 画像処理装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH11126046A JPH11126046A (ja) | 1999-05-11 |
| JP3517568B2 true JP3517568B2 (ja) | 2004-04-12 |
Family
ID=17782248
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29247197A Expired - Fee Related JP3517568B2 (ja) | 1997-10-24 | 1997-10-24 | 画像処理装置 |
Country Status (2)
| Country | Link |
|---|---|
| US (1) | US6310628B1 (ja) |
| JP (1) | JP3517568B2 (ja) |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
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| US6630921B2 (en) * | 2001-03-20 | 2003-10-07 | Koninklijke Philips Electronics N.V. | Column driving circuit and method for driving pixels in a column row matrix |
| JP5142483B2 (ja) * | 2006-05-30 | 2013-02-13 | 株式会社東芝 | 半導体装置及び表示装置 |
| JP5110862B2 (ja) * | 2006-12-01 | 2012-12-26 | キヤノン株式会社 | 液晶表示装置及びその制御方法、コンピュータプログラム及び記憶媒体 |
| JP2009175468A (ja) * | 2008-01-25 | 2009-08-06 | Hitachi Displays Ltd | 表示装置 |
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| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US4386351A (en) * | 1980-12-20 | 1983-05-31 | Timex Corporation | Method and system for two-dimensional traveling display and driver circuits therefor |
| JPS582874A (ja) * | 1981-06-30 | 1983-01-08 | 富士通株式会社 | フルグラフィックディスプレイ装置の画面構成変更回路 |
| JPS61277991A (ja) * | 1985-05-30 | 1986-12-08 | インタ−ナショナル・ビジネス・マシ−ンズ・コ−ポレ−ション | スムース・スクロール方法 |
| CA1258912A (en) * | 1986-11-20 | 1989-08-29 | Stephen J. King | Interactive real-time video processor with zoom, pan and scroll capability |
| US5563624A (en) * | 1990-06-18 | 1996-10-08 | Seiko Epson Corporation | Flat display device and display body driving device |
| US5579027A (en) * | 1992-01-31 | 1996-11-26 | Canon Kabushiki Kaisha | Method of driving image display apparatus |
| JPH07281647A (ja) * | 1994-02-17 | 1995-10-27 | Aoki Kazuo | カラーパネルディスプレイ装置 |
| US5729245A (en) * | 1994-03-21 | 1998-03-17 | Texas Instruments Incorporated | Alignment for display having multiple spatial light modulators |
| JPH08286642A (ja) * | 1995-04-11 | 1996-11-01 | Sony Corp | 表示装置 |
| JPH11202841A (ja) * | 1998-01-12 | 1999-07-30 | Victor Co Of Japan Ltd | 多相化された画像信号によって表示が行なわれる液晶表示装置に対する多相化された画像信号の供給装置 |
-
1997
- 1997-10-24 JP JP29247197A patent/JP3517568B2/ja not_active Expired - Fee Related
-
1998
- 1998-10-21 US US09/176,275 patent/US6310628B1/en not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| US6310628B1 (en) | 2001-10-30 |
| JPH11126046A (ja) | 1999-05-11 |
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