JP3330805B2 - デジタル低域増強回路 - Google Patents
デジタル低域増強回路Info
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Description
【０００１】
【発明の属する技術分野】本発明は、いわゆるコンパク
トディスク再生装置やミニディスク再生装置などのデジ
タル音響機器の再生回路に設けられ、デジタル信号処理
によって低域を増強するための回路に関し、好ましく
は、特に聴感上低域の不足するヘッドホンによって音響
化が行われる携帯型のデジタル音響再生装置に好適に実
施されるデジタル低域増強回路に関する。
トディスク再生装置やミニディスク再生装置などのデジ
タル音響機器の再生回路に設けられ、デジタル信号処理
によって低域を増強するための回路に関し、好ましく
は、特に聴感上低域の不足するヘッドホンによって音響
化が行われる携帯型のデジタル音響再生装置に好適に実
施されるデジタル低域増強回路に関する。
【０００２】
【従来の技術】図４は、典型的な従来技術のデジタル低
域増強回路１の電気的構成を示すブロック図である。前
記コンパクトディスクやミニディスクから読出された該
デジタル低域増強回路１への入力デジタル音響信号は、
遅延器２を介して、加算器３の一方の入力に与えられる
とともに、ローパスフィルタ４において、低域成分が濾
波された後、アッテネータ５を介して、前記加算器３の
他方の入力に入力される。加算器３からの出力デジタル
音響信号は、デジタル／アナログ変換器でアナログ音響
信号に復元された後、ボリウムから増幅回路を介して前
記ヘッドホンなどの音響化手段に与えられて、音響化さ
れる。
域増強回路１の電気的構成を示すブロック図である。前
記コンパクトディスクやミニディスクから読出された該
デジタル低域増強回路１への入力デジタル音響信号は、
遅延器２を介して、加算器３の一方の入力に与えられる
とともに、ローパスフィルタ４において、低域成分が濾
波された後、アッテネータ５を介して、前記加算器３の
他方の入力に入力される。加算器３からの出力デジタル
音響信号は、デジタル／アナログ変換器でアナログ音響
信号に復元された後、ボリウムから増幅回路を介して前
記ヘッドホンなどの音響化手段に与えられて、音響化さ
れる。
【０００３】前記遅延器２での遅延時間は、ローパスフ
ィルタ４でのフィルタ処理による遅延時間およびアッテ
ネータ５での減衰処理による遅延時間の和に設定されて
おり、これによって加算器３においてローパスフィルタ
４およびアッテネータ５を介する低域成分を遅延器２か
らの全周波帯域成分に加算するにあたって、両者のタイ
ミングの一致が図られている。
ィルタ４でのフィルタ処理による遅延時間およびアッテ
ネータ５での減衰処理による遅延時間の和に設定されて
おり、これによって加算器３においてローパスフィルタ
４およびアッテネータ５を介する低域成分を遅延器２か
らの全周波帯域成分に加算するにあたって、両者のタイ
ミングの一致が図られている。
【０００４】一方、アッテネータ５でのゲインｇを決定
するにあたって、遅延器２側には最大値検出回路６が設
けられ、ローパスフィルタ４側には最大値検出回路７が
設けられるとともに、ゲイン演算を行い、アッテネータ
５に設定するための制御回路８が設けられる。最大値検
出回路６，７は、それぞれ比較器とメモリとなどを備え
て構成されており、メモリ容量などに対応して定められ
る所定のサンプリング期間内での入力デジタル音響信号
の最大値を検出し、制御回路８へ出力する。
するにあたって、遅延器２側には最大値検出回路６が設
けられ、ローパスフィルタ４側には最大値検出回路７が
設けられるとともに、ゲイン演算を行い、アッテネータ
５に設定するための制御回路８が設けられる。最大値検
出回路６，７は、それぞれ比較器とメモリとなどを備え
て構成されており、メモリ容量などに対応して定められ
る所定のサンプリング期間内での入力デジタル音響信号
の最大値を検出し、制御回路８へ出力する。
【０００５】ここで、入力デジタル音響信号をｓ０と
し、最大値検出回路６，７からの出力をそれぞれｓ１，
ｓ２とすると、制御回路８は、出力ｓ１が小さくなる
程、アッテネータ５でのゲインｇを大きく、すなわち減
衰量を小さくする。これによって、遅延器２からの出力
ｓ１とアッテネータ５からの出力ｓ４とが加算された加
算器３からの出力ｓ５の最大値が０ｄＢに抑制されて、
クリップの発生を抑えつつ、低域の増強が行われてい
る。
し、最大値検出回路６，７からの出力をそれぞれｓ１，
ｓ２とすると、制御回路８は、出力ｓ１が小さくなる
程、アッテネータ５でのゲインｇを大きく、すなわち減
衰量を小さくする。これによって、遅延器２からの出力
ｓ１とアッテネータ５からの出力ｓ４とが加算された加
算器３からの出力ｓ５の最大値が０ｄＢに抑制されて、
クリップの発生を抑えつつ、低域の増強が行われてい
る。
【０００６】
【発明が解決しようとする課題】上述の従来技術では、
マイクロコンピュータなどからの出力によって、制御回
路８によるゲインｇ、すなわち低域増強量が設定されて
も、入力されるデジタル音響信号ｓ０自体のレベルが大
きいときには、最大値検出回路６からの出力ｓ１が大き
くなって、前記ゲインｇは小さくされる。したがって、
入力されるデジタル音響信号ｓ０のレベルに応じて低域
の増強特性に変化が生じ、再生音響の低域にふらつきが
生じるという問題がある。
マイクロコンピュータなどからの出力によって、制御回
路８によるゲインｇ、すなわち低域増強量が設定されて
も、入力されるデジタル音響信号ｓ０自体のレベルが大
きいときには、最大値検出回路６からの出力ｓ１が大き
くなって、前記ゲインｇは小さくされる。したがって、
入力されるデジタル音響信号ｓ０のレベルに応じて低域
の増強特性に変化が生じ、再生音響の低域にふらつきが
生じるという問題がある。
【０００７】本発明の目的は、クリップの発生を抑えつ
つ、低域の増強特性を安定させることができるデジタル
低域増強回路を提供することである。
つ、低域の増強特性を安定させることができるデジタル
低域増強回路を提供することである。
【０００８】
【課題を解決するための手段】請求項１の発明に係るデ
ジタル低域増強回路は、入力されるデジタル音響信号を
予め定める第１のゲインで減衰させる第１のアッテネー
タと、入力されるデジタル音響信号を予め定める第２の
ゲインで減衰させる第２のアッテネータと、前記第２の
アッテネータの出力が入力されるローパスフィルタと、
前記第１のアッテネータの前段または後段に介在され、
前記第２のアッテネータおよびローパスフィルタでの信
号処理による遅延時間の和から前記第１のアッテネータ
での信号処理による遅延時間を減算した値の遅延時間を
有する遅延器と、前記第１のアッテネータ側および第２
のアッテネータ側からのデジタル音響信号を加算して出
力する加算器とを含み、前記第１および第２のゲイン
は、両者の和が１となるような固定値として選ばれてい
ることを特徴とする。
ジタル低域増強回路は、入力されるデジタル音響信号を
予め定める第１のゲインで減衰させる第１のアッテネー
タと、入力されるデジタル音響信号を予め定める第２の
ゲインで減衰させる第２のアッテネータと、前記第２の
アッテネータの出力が入力されるローパスフィルタと、
前記第１のアッテネータの前段または後段に介在され、
前記第２のアッテネータおよびローパスフィルタでの信
号処理による遅延時間の和から前記第１のアッテネータ
での信号処理による遅延時間を減算した値の遅延時間を
有する遅延器と、前記第１のアッテネータ側および第２
のアッテネータ側からのデジタル音響信号を加算して出
力する加算器とを含み、前記第１および第２のゲイン
は、両者の和が１となるような固定値として選ばれてい
ることを特徴とする。
【０００９】上記の構成によれば、所定レベル、たとえ
ば０ｄＢに最大値が規定されてコンパクトディスクやミ
ニディスクに記録されている入力デジタル音響信号に対
して、該デジタル低域増強回路内で全周波数帯域に亘る
成分が第１のアッテネータにおいて第１のゲインで減衰
され、低域成分は第２のアッテネータにおいて第２のゲ
インで減衰された後に、相互に加算される。
ば０ｄＢに最大値が規定されてコンパクトディスクやミ
ニディスクに記録されている入力デジタル音響信号に対
して、該デジタル低域増強回路内で全周波数帯域に亘る
成分が第１のアッテネータにおいて第１のゲインで減衰
され、低域成分は第２のアッテネータにおいて第２のゲ
インで減衰された後に、相互に加算される。
【００１０】したがって、第１および第２のゲインを予
想される入力音響信号の最大レベルおよび周波数の成分
分布などに対応して設定しておくことによって、低域成
分の増強された出力デジタル音響信号へのクリップの発
生を防止することができる。こうしてクリップの発生を
抑えつつ、安定した増強特性で低域を増強することがで
きる。
想される入力音響信号の最大レベルおよび周波数の成分
分布などに対応して設定しておくことによって、低域成
分の増強された出力デジタル音響信号へのクリップの発
生を防止することができる。こうしてクリップの発生を
抑えつつ、安定した増強特性で低域を増強することがで
きる。
【００１１】さらに、請求項１の発明に係るデジタル低
域増強回路では、前記第１および第２のゲインは、両者
の和が１となるような固定値として選ばれている。
域増強回路では、前記第１および第２のゲインは、両者
の和が１となるような固定値として選ばれている。
【００１２】したがって、入力デジタル音響信号のレベ
ルが比較的高くても、また低域成分が多く含まれている
ような音楽の種類等に係わりなく、クリップの発生を確
実に抑えることができるとともに、低域を常に一定の特
性で増強することができ、再生音響の低域にふらつきが
生じるようなことはない。
ルが比較的高くても、また低域成分が多く含まれている
ような音楽の種類等に係わりなく、クリップの発生を確
実に抑えることができるとともに、低域を常に一定の特
性で増強することができ、再生音響の低域にふらつきが
生じるようなことはない。
【００１３】たとえば、第１および第２のゲインを、た
とえば両者が等しい０．５や、低域を抑え気味の０．
６：０．４、または低域をより増強気味の０．４：０．
６等の増強具合に応じて設定しても、クリップの生じる
おそれはない。
とえば両者が等しい０．５や、低域を抑え気味の０．
６：０．４、または低域をより増強気味の０．４：０．
６等の増強具合に応じて設定しても、クリップの生じる
おそれはない。
【００１４】また、請求項２の発明に係るデジタル低域
増強回路では、前記第１および第２のゲインは、ユーザ
によって任意に選択可能であることを特徴とする。
増強回路では、前記第１および第２のゲインは、ユーザ
によって任意に選択可能であることを特徴とする。
【００１５】上記の構成によれば、ユーザ自身が、低域
成分が多く含まれているような音楽の種類などに対応す
るように、第１および第２のゲインを選択することがで
きる。
成分が多く含まれているような音楽の種類などに対応す
るように、第１および第２のゲインを選択することがで
きる。
【００１６】
【発明の実施の形態】本発明の実施の一形態について、
図１〜図３に基づいて説明すれば以下のとおりである。
図１〜図３に基づいて説明すれば以下のとおりである。
【００１７】図１は、本発明の実施の一形態のデジタル
低域増強回路１１の電気的構成を示すブロック図であ
る。コンパクトディスクやミニディスクなどから再生さ
れ、最大レベルが予め定めるレベル、たとえば０ｄＢに
抑制されている入力デジタル音響信号は、アッテネータ
１２および遅延器１３を介して、加算器１４の一方の入
力に与えられる。また、前記入力デジタル音響信号は、
アッテネータ１５およびローパスフィルタ１６を介し
て、前記加算器１４の他方の入力に入力される。加算器
１４からの出力デジタル音響信号は、デジタル／アナロ
グ変換器でアナログ音響信号に変換された後、ボリウム
を介して増幅回路に入力され、該増幅回路で増幅され、
さらにヘッドホンなどの音響化手段に与えられて音響化
される。
低域増強回路１１の電気的構成を示すブロック図であ
る。コンパクトディスクやミニディスクなどから再生さ
れ、最大レベルが予め定めるレベル、たとえば０ｄＢに
抑制されている入力デジタル音響信号は、アッテネータ
１２および遅延器１３を介して、加算器１４の一方の入
力に与えられる。また、前記入力デジタル音響信号は、
アッテネータ１５およびローパスフィルタ１６を介し
て、前記加算器１４の他方の入力に入力される。加算器
１４からの出力デジタル音響信号は、デジタル／アナロ
グ変換器でアナログ音響信号に変換された後、ボリウム
を介して増幅回路に入力され、該増幅回路で増幅され、
さらにヘッドホンなどの音響化手段に与えられて音響化
される。
【００１８】第１のアッテネータであるアッテネータ１
２における第１のゲインであるゲインＧ１および第２の
アッテネータであるアッテネータ１５における第２のゲ
インであるゲインＧ２は、マイクロコンピュータなどに
よって実現される制御回路１７によって設定される。こ
れらのアッテネータ１２，１５は、たとえば図２で示す
ように、２つのレジスタ２１，２２と乗算器２３とを備
えて構成されている。
２における第１のゲインであるゲインＧ１および第２の
アッテネータであるアッテネータ１５における第２のゲ
インであるゲインＧ２は、マイクロコンピュータなどに
よって実現される制御回路１７によって設定される。こ
れらのアッテネータ１２，１５は、たとえば図２で示す
ように、２つのレジスタ２１，２２と乗算器２３とを備
えて構成されている。
【００１９】前記入力デジタル音響信号は、入力端子２
５から入力され、レジスタ２１にストアされる。また、
前記制御回路１７からのゲイン信号は、入力端子２６か
ら入力され、レジスタ２２にストアされる。乗算器２３
は、レジスタ２１，２２のストア内容を乗算して、出力
端子２７へ出力する。こうして、入力デジタル音響信号
に、制御回路１７によって設定されたゲインＧ１，Ｇ２
に対応した係数が乗算されて、前記入力デジタル音響信
号が減衰されて出力されることになる。
５から入力され、レジスタ２１にストアされる。また、
前記制御回路１７からのゲイン信号は、入力端子２６か
ら入力され、レジスタ２２にストアされる。乗算器２３
は、レジスタ２１，２２のストア内容を乗算して、出力
端子２７へ出力する。こうして、入力デジタル音響信号
に、制御回路１７によって設定されたゲインＧ１，Ｇ２
に対応した係数が乗算されて、前記入力デジタル音響信
号が減衰されて出力されることになる。
【００２０】前記ゲインＧ１，Ｇ２は、 Ｇ１＋Ｇ２＝１
…（１） となるように、たとえばともに０．５の通常の低域増強
状態、Ｇ１＝０．６、Ｇ２＝０．４の増強の抑制状態、
またはＧ１＝０．４、Ｇ２＝０．６のより一層の増強状
態等に選ばれる。
…（１） となるように、たとえばともに０．５の通常の低域増強
状態、Ｇ１＝０．６、Ｇ２＝０．４の増強の抑制状態、
またはＧ１＝０．４、Ｇ２＝０．６のより一層の増強状
態等に選ばれる。
【００２１】前記ローパスフィルタ１６は、たとえば図
３に示すように、２つのアンプ３１，３２と、遅延器３
３と、加算器３４とを備えて構成されている。前記アッ
テネータ１５からのデジタル音響信号は、入力端子３５
から入力され、アンプ３１に入力される。アンプ３１か
らの出力は、加算器３４を介して出力端子３６に導出さ
れるとともに、遅延器３３およびアンプ３２から成る帰
還ループに入力される。遅延器３３は、１サンプリング
周期だけ入力データを遅延して出力する。遅延器３３か
らの出力は、アンプ３２において増幅された後、加算器
３４において前記アンプ３１からの出力と加算されて出
力端子３６へ導出される。前記ゲインＧ１１，Ｇ１２
は、Ｇ１１＋Ｇ１２≒１となるように選ばれている。し
たがって、アンプ３２のゲインＧ１２が大きくなる程、
低域成分の濾波特性が向上してゆくことになる。
３に示すように、２つのアンプ３１，３２と、遅延器３
３と、加算器３４とを備えて構成されている。前記アッ
テネータ１５からのデジタル音響信号は、入力端子３５
から入力され、アンプ３１に入力される。アンプ３１か
らの出力は、加算器３４を介して出力端子３６に導出さ
れるとともに、遅延器３３およびアンプ３２から成る帰
還ループに入力される。遅延器３３は、１サンプリング
周期だけ入力データを遅延して出力する。遅延器３３か
らの出力は、アンプ３２において増幅された後、加算器
３４において前記アンプ３１からの出力と加算されて出
力端子３６へ導出される。前記ゲインＧ１１，Ｇ１２
は、Ｇ１１＋Ｇ１２≒１となるように選ばれている。し
たがって、アンプ３２のゲインＧ１２が大きくなる程、
低域成分の濾波特性が向上してゆくことになる。
【００２２】前記遅延器１３は、たとえばランダムアク
セスメモリなどで実現され、そのデータアドレスをずら
すことによって、所望とする遅延時間を得ることができ
るように構成されている。この遅延器１３における遅延
時間は、アッテネータ１５における減衰処理による遅延
時間およびローパスフィルタ１６におけるフィルタ処理
による遅延時間の和からアッテネータ１２における減衰
処理による遅延時間を減算した値に設定され、したがっ
てアッテネータ１２，１５での遅延時間が相互に等しい
ときには、ローパスフィルタ１６での遅延時間と同一の
値に選ばれる。
セスメモリなどで実現され、そのデータアドレスをずら
すことによって、所望とする遅延時間を得ることができ
るように構成されている。この遅延器１３における遅延
時間は、アッテネータ１５における減衰処理による遅延
時間およびローパスフィルタ１６におけるフィルタ処理
による遅延時間の和からアッテネータ１２における減衰
処理による遅延時間を減算した値に設定され、したがっ
てアッテネータ１２，１５での遅延時間が相互に等しい
ときには、ローパスフィルタ１６での遅延時間と同一の
値に選ばれる。
【００２３】これによって、アッテネータ１２からの全
周波帯域のデジタル音響信号と、アッテネータ１５側か
らの低域成分の音響信号とのタイミングを相互に一致さ
せて、加算器１４において加算することができる。
周波帯域のデジタル音響信号と、アッテネータ１５側か
らの低域成分の音響信号とのタイミングを相互に一致さ
せて、加算器１４において加算することができる。
【００２４】上述のように構成されたデジタル低域増強
回路１１において、入力デジタル音響信号の最大振幅レ
ベルをＡとし、アッテネータ１２の出力の最大振幅レベ
ルをＢとし、遅延器１３の出力の最大振幅レベルをＣと
し、アッテネータ１５の出力の最大振幅レベルをＤと
し、ローパスフィルタ１６の出力の最大振幅レベルをＥ
とするとき、以下の各式が成立する。
回路１１において、入力デジタル音響信号の最大振幅レ
ベルをＡとし、アッテネータ１２の出力の最大振幅レベ
ルをＢとし、遅延器１３の出力の最大振幅レベルをＣと
し、アッテネータ１５の出力の最大振幅レベルをＤと
し、ローパスフィルタ１６の出力の最大振幅レベルをＥ
とするとき、以下の各式が成立する。
【００２５】 Ｂ＝Ｇ１・Ａ …（２） Ｃ＝Ｂ …（３） Ｄ＝Ｇ２・Ａ …（４） また、入力デジタル音響信号がほとんど低域成分で構成
されている最悪時には、 Ｅ＝Ｄ …（５） となる。
されている最悪時には、 Ｅ＝Ｄ …（５） となる。
【００２６】したがって、出力デジタル音響信号の最大
振幅レベルＦは、 Ｆ＝Ｃ＋Ｅ＝Ｂ＋Ｄ＝（Ｇ１＋Ｇ２）・Ａ …（６） となる。
振幅レベルＦは、 Ｆ＝Ｃ＋Ｅ＝Ｂ＋Ｄ＝（Ｇ１＋Ｇ２）・Ａ …（６） となる。
【００２７】ここで前述の式１で示すように、Ｇ１＋Ｇ
２＝１とすると、Ｆ＝Ａとなり、出力デジタル音響信号
のクリップの回避されることが理解される。
２＝１とすると、Ｆ＝Ａとなり、出力デジタル音響信号
のクリップの回避されることが理解される。
【００２８】このように本発明に従うデジタル低域増強
回路１１は、全周波帯域のデジタル音響信号のラインに
アッテネータ１２を介在し、このアッテネータ１２のゲ
インＧ１と、低域側のアッテネータ１５のゲインＧ２と
の和を１となるように設定するので、入力デジタル音響
信号のレベルが比較的高くても、また低域成分が多く含
まれているような音楽の種類等に係わりなく、クリップ
の発生を確実に抑えることができるとともに、低域を常
に一定の特性で増強することができ、再生音響の低域に
ふらつきが生じるようなことはない。
回路１１は、全周波帯域のデジタル音響信号のラインに
アッテネータ１２を介在し、このアッテネータ１２のゲ
インＧ１と、低域側のアッテネータ１５のゲインＧ２と
の和を１となるように設定するので、入力デジタル音響
信号のレベルが比較的高くても、また低域成分が多く含
まれているような音楽の種類等に係わりなく、クリップ
の発生を確実に抑えることができるとともに、低域を常
に一定の特性で増強することができ、再生音響の低域に
ふらつきが生じるようなことはない。
【００２９】なお、前記ゲインＧ１，Ｇ２は、前述のよ
うな固定値に選ばれてもよく、また前記音楽の種類など
に対応して、前記式１を満足する範囲で、ユーザによっ
て任意に選択可能とされてもよい。
うな固定値に選ばれてもよく、また前記音楽の種類など
に対応して、前記式１を満足する範囲で、ユーザによっ
て任意に選択可能とされてもよい。
【００３０】
【発明の効果】請求項１の発明に係るデジタル低域増強
回路は、以上のように、第２のゲインで減衰した低域成
分に、全周波数帯域に亘る成分を、固定値である第２の
ゲインとの和が１となるような固定値として選ばれた第
１のゲインで減衰して加算する。
回路は、以上のように、第２のゲインで減衰した低域成
分に、全周波数帯域に亘る成分を、固定値である第２の
ゲインとの和が１となるような固定値として選ばれた第
１のゲインで減衰して加算する。
【００３１】それゆえ、第１および第２のゲインを予想
される入力音響信号の最大レベルおよび周波数の成分分
布などに対応して設定しておくことによって、低域成分
の増強された出力デジタル音響信号へのクリップの発生
を防止することができる。こうしてクリップの発生を抑
えつつ、安定した増強特性で低域を増強することができ
る。
される入力音響信号の最大レベルおよび周波数の成分分
布などに対応して設定しておくことによって、低域成分
の増強された出力デジタル音響信号へのクリップの発生
を防止することができる。こうしてクリップの発生を抑
えつつ、安定した増強特性で低域を増強することができ
る。
【００３２】さらに、第１のゲインと第２のゲインと
は、和が１となるような固定値として選ばれているの
で、入力デジタル音響信号のレベルが比較的高くても、
また低域成分が多く含まれているような音楽の種類等に
係わりなく、クリップの発生を確実に抑えることができ
るとともに、低域を常に一定の特性で増強することがで
き、再生音響の低域にふらつきが生じるようなことはな
い。
は、和が１となるような固定値として選ばれているの
で、入力デジタル音響信号のレベルが比較的高くても、
また低域成分が多く含まれているような音楽の種類等に
係わりなく、クリップの発生を確実に抑えることができ
るとともに、低域を常に一定の特性で増強することがで
き、再生音響の低域にふらつきが生じるようなことはな
い。
【００３３】たとえば、第１および第２のゲインを、た
とえば両者が等しい０．５や、低域を抑え気味の０．
６：０．４、または低域をより増強気味の０．４：０．
６等の増強具合に応じて設定しても、クリップの生じる
おそれはない。
とえば両者が等しい０．５や、低域を抑え気味の０．
６：０．４、または低域をより増強気味の０．４：０．
６等の増強具合に応じて設定しても、クリップの生じる
おそれはない。
【００３４】請求項２の発明に係るデジタル低域増強回
路は、以上のように、第１および第２のゲインは、ユー
ザによって任意に選択可能である。
路は、以上のように、第１および第２のゲインは、ユー
ザによって任意に選択可能である。
【００３５】これにより、ユーザ自身が、低域成分が多
く含まれているような音楽の種類などに対応するよう
に、第１および第２のゲインを選択することができる。
く含まれているような音楽の種類などに対応するよう
に、第１および第２のゲインを選択することができる。
【図１】本発明の実施の一形態のデジタル低域増強回路
の電気的構成を示すブロック図である。
の電気的構成を示すブロック図である。
【図２】前記デジタル低域増強回路におけるアッテネー
タの具体的構成を示すブロック図である。
タの具体的構成を示すブロック図である。
【図３】前記デジタル低域増強回路におけるローパスフ
ィルタの具体的構成を示すブロック図である。
ィルタの具体的構成を示すブロック図である。
【図４】典型的な従来技術のデジタル低域増強回路の電
気的構成を示すブロック図である。
気的構成を示すブロック図である。
１１ デジタル低域増強回路 １２ アッテネータ（第１のアッテネータ） １３ 遅延器 １４ 加算器 １５ アッテネータ（第２のアッテネータ） １６ ローパスフィルタ １７ 制御回路 ２１ レジスタ ２２ レジスタ ２３ 乗算器 ３１ アンプ ３２ アンプ ３３ 遅延器 ３４ 加算器
Claims (2)
- 【請求項１】入力されるデジタル音響信号を予め定める
第１のゲインで減衰させる第１のアッテネータと、 入力されるデジタル音響信号を予め定める第２のゲイン
で減衰させる第２のアッテネータと、 前記第２のアッテネータの出力が入力されるローパスフ
ィルタと、 前記第１のアッテネータの前段または後段に介在され、
前記第２のアッテネータおよびローパスフィルタでの信
号処理による遅延時間の和から前記第１のアッテネータ
での信号処理による遅延時間を減算した値の遅延時間を
有する遅延器と、 前記第１のアッテネータ側および第２のアッテネータ側
からのデジタル音響信号を加算して出力する加算器とを
含み、 前記第１および第２のゲインは、両者の和が１となるよ
うな固定値として選ばれている ことを特徴とするデジタ
ル低域増強回路。 - 【請求項２】前記第１および第２のゲインは、ユーザに
よって任意に選択可能であることを特徴とする請求項１
に記載のデジタル低域増強回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29150195A JP3330805B2 (ja) | 1995-11-09 | 1995-11-09 | デジタル低域増強回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP29150195A JP3330805B2 (ja) | 1995-11-09 | 1995-11-09 | デジタル低域増強回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH09135138A JPH09135138A (ja) | 1997-05-20 |
| JP3330805B2 true JP3330805B2 (ja) | 2002-09-30 |
Family
ID=17769707
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP29150195A Expired - Fee Related JP3330805B2 (ja) | 1995-11-09 | 1995-11-09 | デジタル低域増強回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3330805B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5205762B2 (ja) * | 2007-01-12 | 2013-06-05 | ヤマハ株式会社 | 音源回路 |
-
1995
- 1995-11-09 JP JP29150195A patent/JP3330805B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH09135138A (ja) | 1997-05-20 |
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