JP3261187B2 - エンコーダにおけるアナログゲイン補正方法 - Google Patents
エンコーダにおけるアナログゲイン補正方法Info
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- JP3261187B2 JP3261187B2 JP00075693A JP75693A JP3261187B2 JP 3261187 B2 JP3261187 B2 JP 3261187B2 JP 00075693 A JP00075693 A JP 00075693A JP 75693 A JP75693 A JP 75693A JP 3261187 B2 JP3261187 B2 JP 3261187B2
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- signal
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- Transmission And Conversion Of Sensor Element Output (AREA)
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Description
【０００１】
【産業上の利用分野】本発明は、エンコーダにおけるア
ナログゲイン補正方法に関し、特に、エンコーダ信号の
二相信号の振幅変動を一定とし、振幅変動による精度誤
差をなくすための新規な改良に関する。
ナログゲイン補正方法に関し、特に、エンコーダ信号の
二相信号の振幅変動を一定とし、振幅変動による精度誤
差をなくすための新規な改良に関する。
【０００２】
【従来の技術】従来、用いられていたこの種のエンコー
ダとしては、一般に、特開昭６２−２７８４０８号公報
に開示されている構成を挙げることができるが、そのエ
ンコーダ信号としてのアナログの二相信号は、温度又は
外乱に対する補正をすることなく、そのままの状態で外
部のコントロール側へ供給されている。
ダとしては、一般に、特開昭６２−２７８４０８号公報
に開示されている構成を挙げることができるが、そのエ
ンコーダ信号としてのアナログの二相信号は、温度又は
外乱に対する補正をすることなく、そのままの状態で外
部のコントロール側へ供給されている。
【０００３】
【発明が解決しようとする課題】従来、用いられていた
エンコーダは、以上のように構成されていたため、次の
ような課題が存在していた。すなわち、エンコーダ信号
を構成するＳＩＮθ信号及びＣＯＳθ信号を用い、逓倍
又は内挿等の方法により分解能を基本波以上に上げる場
合、このエンコーダ信号の振幅が温度又は経時変化によ
り変動するため、このエンコーダ信号を基にして出力信
号を得た場合、精度誤差が大きくなり、この出力信号で
コントロール側に接続されてた各種機器を制御した場合
には、各種機器の暴走を招くことがあった。
エンコーダは、以上のように構成されていたため、次の
ような課題が存在していた。すなわち、エンコーダ信号
を構成するＳＩＮθ信号及びＣＯＳθ信号を用い、逓倍
又は内挿等の方法により分解能を基本波以上に上げる場
合、このエンコーダ信号の振幅が温度又は経時変化によ
り変動するため、このエンコーダ信号を基にして出力信
号を得た場合、精度誤差が大きくなり、この出力信号で
コントロール側に接続されてた各種機器を制御した場合
には、各種機器の暴走を招くことがあった。
【０００４】本発明は以上のような課題を解決するため
になされたもので、特に、エンコーダ信号の二相信号の
振幅変動を一定とし、振幅変動による精度誤差をなくす
ようにしたエンコーダにおけるアナログゲイン補正方法
を提供することを目的とする。
になされたもので、特に、エンコーダ信号の二相信号の
振幅変動を一定とし、振幅変動による精度誤差をなくす
ようにしたエンコーダにおけるアナログゲイン補正方法
を提供することを目的とする。
【０００５】
【課題を解決するための手段】本発明によるエンコーダ
におけるアナログゲイン補正方法は、エンコーダ部から
得られたＳＩＮθ信号が零レベルを通過する時点でＣＯ
Ｓθ信号をラッチさせ、前記ＣＯＳθ信号と予め設定さ
れた基準値との減少比を演算し、前記減少比と前記ＣＯ
Ｓθ信号とを掛けることにより前記ＣＯＳθ信号が前記
基準値となるように補正する構成である。
におけるアナログゲイン補正方法は、エンコーダ部から
得られたＳＩＮθ信号が零レベルを通過する時点でＣＯ
Ｓθ信号をラッチさせ、前記ＣＯＳθ信号と予め設定さ
れた基準値との減少比を演算し、前記減少比と前記ＣＯ
Ｓθ信号とを掛けることにより前記ＣＯＳθ信号が前記
基準値となるように補正する構成である。
【０００６】さらに詳細には、前記基準値はＡ／Ｄ変換
器の変換レンジ幅の最大値を用いている構成である。
器の変換レンジ幅の最大値を用いている構成である。
【０００７】
【作用】本発明によるエンコーダにおけるアナログゲイ
ン補正方法においては、ＳＩＮθ信号が零レベルを通過
する時点でＣＯＳθ信号をラッチさせ、このＣＯＳθ信
号と予め設定された基準値との減少比を演算し、この減
少比とＣＯＳθ信号とを掛けることによりＣＯＳθ信号
を前記基準値のレベルとなるように補正することができ
る。従って、ＳＩＮθ信号及びＣＯＳθ信号の何れにつ
いても前述と同様の補正を行うことにより、温度変化及
び経時変化に伴うＳＩＮ波及びＣＯＳ波の振幅変動が発
生した場合、その振幅を常に一定とすることができ、エ
ンコーダ信号の精度を安定化させることができる。
ン補正方法においては、ＳＩＮθ信号が零レベルを通過
する時点でＣＯＳθ信号をラッチさせ、このＣＯＳθ信
号と予め設定された基準値との減少比を演算し、この減
少比とＣＯＳθ信号とを掛けることによりＣＯＳθ信号
を前記基準値のレベルとなるように補正することができ
る。従って、ＳＩＮθ信号及びＣＯＳθ信号の何れにつ
いても前述と同様の補正を行うことにより、温度変化及
び経時変化に伴うＳＩＮ波及びＣＯＳ波の振幅変動が発
生した場合、その振幅を常に一定とすることができ、エ
ンコーダ信号の精度を安定化させることができる。
【０００８】
【実施例】以下、図面と共に本発明によるエンコーダに
おけるアナログゲイン補正方法の好適な実施例について
詳細に説明する。図１及び図２は本発明によるエンコー
ダにおけるアナログゲイン補正方法を示すもので、図１
はブロック図、図２は波形図である。図１において符号
１で示されるものはエンコーダの出力部であるエンコー
ダ部であり、このエンコーダ部１から出力されるＣＯＳ
θ信号２及びＳＩＮθ信号３は、第１、第２Ａ／Ｄ変換
器４，５及び第１、第２コンパレータ６，７に入力され
ている。
おけるアナログゲイン補正方法の好適な実施例について
詳細に説明する。図１及び図２は本発明によるエンコー
ダにおけるアナログゲイン補正方法を示すもので、図１
はブロック図、図２は波形図である。図１において符号
１で示されるものはエンコーダの出力部であるエンコー
ダ部であり、このエンコーダ部１から出力されるＣＯＳ
θ信号２及びＳＩＮθ信号３は、第１、第２Ａ／Ｄ変換
器４，５及び第１、第２コンパレータ６，７に入力され
ている。
【０００９】前記各Ａ／Ｄ変換器４，５からのデジタル
化されたＣＯＳθ信号２及びＳＩＮθ信号３は、ＣＯＳ
ピーク及びＳＩＮピークをラッチするための第１ラッチ
部８及び第２ラッチ部９に入力されていると共に、第１
掛け算部１０及び第２掛け算部１１に各々入力されてい
る。
化されたＣＯＳθ信号２及びＳＩＮθ信号３は、ＣＯＳ
ピーク及びＳＩＮピークをラッチするための第１ラッチ
部８及び第２ラッチ部９に入力されていると共に、第１
掛け算部１０及び第２掛け算部１１に各々入力されてい
る。
【００１０】前記各コンパレータ６，７の各比較出力６
ａ，７ａは、前記各ラッチ部８，９に各々入力され、各
ラッチ部８，９からの各ラッチ出力８ａ，９ａ、第１、
第２比算出部１２，１３に入力されている。前記各比算
出部１２，１３から得られた減少比α1，α2は各掛け算
部１０，１１に入力されており、この各減少比α1，α2
は、図２に示す前記各Ａ／Ｄ変換器４，５の変換レンジ
幅のピーク値である基準値Ｖ0と各ラッチ部８，９で得
たピーク値である各ラッチ出力８ａ，９ａとの差であ
る。
ａ，７ａは、前記各ラッチ部８，９に各々入力され、各
ラッチ部８，９からの各ラッチ出力８ａ，９ａ、第１、
第２比算出部１２，１３に入力されている。前記各比算
出部１２，１３から得られた減少比α1，α2は各掛け算
部１０，１１に入力されており、この各減少比α1，α2
は、図２に示す前記各Ａ／Ｄ変換器４，５の変換レンジ
幅のピーク値である基準値Ｖ0と各ラッチ部８，９で得
たピーク値である各ラッチ出力８ａ，９ａとの差であ
る。
【００１１】前記各掛け算部１０，１１からは、補正後
ＣＯＳθ信号１０ａ及び補正後ＳＩＮθ信号１１ａが出
力され、各補正後ＣＯＳθ信号１０ａ及び補正後ＳＩＮ
θ信号１１ａによりエンコーダ信号１２を出力するよう
に構成されている。
ＣＯＳθ信号１０ａ及び補正後ＳＩＮθ信号１１ａが出
力され、各補正後ＣＯＳθ信号１０ａ及び補正後ＳＩＮ
θ信号１１ａによりエンコーダ信号１２を出力するよう
に構成されている。
【００１２】次に、前述の構成において、実際にＣＯＳ
θ信号２及びＳＩＮθ信号３を補正する場合について説
明する。まず、各ＣＯＳθ信号２及びＳＩＮθ信号２，
３は各Ａ／Ｄ変換器４，５によりＡ／Ｄ変換されデジタ
ル信号として各ラッチ部８，９に入力され、そのピーク
であるＣＯＳピーク及びＳＩＮピークがラッチされる。
θ信号２及びＳＩＮθ信号３を補正する場合について説
明する。まず、各ＣＯＳθ信号２及びＳＩＮθ信号２，
３は各Ａ／Ｄ変換器４，５によりＡ／Ｄ変換されデジタ
ル信号として各ラッチ部８，９に入力され、そのピーク
であるＣＯＳピーク及びＳＩＮピークがラッチされる。
【００１３】この場合、まず、図２に示されるように、
ＳＩＮθ信号３が零レベルＯを通過する時点で第２コン
パレータ７からの第２比較出力７ａによりＣＯＳθ信号
２をラッチし、このＣＯＳθ信号２と第１比算出部１２
に内蔵された基準値Ｖ0に比較した減少比α1と前記ＣＯ
Ｓθ信号２とが第１掛け算部１０で掛け算され、例え
ば、図２におけるＶ2＝Ｖ1×α1＝Ｖ0又はＶ4＝Ｖ3×α
1（α1＝Ｖ0／Ｖ1）の処理が行われ、補正後ＣＯＳθ信
号１０ａが得られる。
ＳＩＮθ信号３が零レベルＯを通過する時点で第２コン
パレータ７からの第２比較出力７ａによりＣＯＳθ信号
２をラッチし、このＣＯＳθ信号２と第１比算出部１２
に内蔵された基準値Ｖ0に比較した減少比α1と前記ＣＯ
Ｓθ信号２とが第１掛け算部１０で掛け算され、例え
ば、図２におけるＶ2＝Ｖ1×α1＝Ｖ0又はＶ4＝Ｖ3×α
1（α1＝Ｖ0／Ｖ1）の処理が行われ、補正後ＣＯＳθ信
号１０ａが得られる。
【００１４】また、補正後ＳＩＮθ信号１１ａについて
も、前述と同様に、ＣＯＳθ信号２が零レベルＯを通過
する時点で前述と同様の動作を行うことにより得ること
ができ、何れの補正後ＣＯＳθ信号１０ａ及び補正後Ｓ
ＩＮθ信号１１ａにおいても基準値Ｖ0と等しいピーク
値を有する波形に基づくエンコーダ信号１２を得ること
ができる。なお前記基準値Ｖ0については前述の変換レ
ンジ幅に限らず、独立したレベルとすることもできる。
また、前述の補正はアナログ、デジタル何れの状態でも
可能である。
も、前述と同様に、ＣＯＳθ信号２が零レベルＯを通過
する時点で前述と同様の動作を行うことにより得ること
ができ、何れの補正後ＣＯＳθ信号１０ａ及び補正後Ｓ
ＩＮθ信号１１ａにおいても基準値Ｖ0と等しいピーク
値を有する波形に基づくエンコーダ信号１２を得ること
ができる。なお前記基準値Ｖ0については前述の変換レ
ンジ幅に限らず、独立したレベルとすることもできる。
また、前述の補正はアナログ、デジタル何れの状態でも
可能である。
【００１５】
【発明の効果】本発明によるエンコーダにおけるアナロ
グゲイン補正方法は、以上のように構成されているた
め、常に設定した基準値Ｖ0を基準として補正するた
め、例えば、温度変化及び経時変化によって変化したＣ
ＯＳθ信号及びＳＩＮθ信号と常に自動的に補正するこ
とができ、常に基準値Ｖ0のレベルとすることにより、
常に、高精度で安定したエンコーダ出力を発生するエン
コーダを得ることができる。
グゲイン補正方法は、以上のように構成されているた
め、常に設定した基準値Ｖ0を基準として補正するた
め、例えば、温度変化及び経時変化によって変化したＣ
ＯＳθ信号及びＳＩＮθ信号と常に自動的に補正するこ
とができ、常に基準値Ｖ0のレベルとすることにより、
常に、高精度で安定したエンコーダ出力を発生するエン
コーダを得ることができる。
【図１】本発明によるエンコーダにおけるアナログゲイ
ン補正方法を示すブロック図である。
ン補正方法を示すブロック図である。
【図２】波形図である。
１ エンコーダ部 Ｏ 零レベル ２ ＣＯＳθ信号 ３ ＳＩＮθ信号 Ｖ0 基準値 α1，α2 減少比 ４，５ Ａ／Ｄ変換器
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.7，ＤＢ名) G01D 5/00 - 5/62 G01B 7/00 - 7/34 G01B 11/00 - 11/30 G01P 1/00 - 3/80
Claims (2)
- 【請求項１】 エンコーダ部(1)から得られたＳＩＮθ
信号(3)が零レベル(O)を通過する時点でＣＯＳθ信号
(2)をラッチさせ、前記ＣＯＳθ信号(2)と予め設定され
た基準値(V0)との減少比(α1,α2)を演算し、前記減少
比(α1,α2)と前記ＣＯＳθ信号(2)とを掛けることによ
り前記ＣＯＳθ信号(2)が前記基準値(V0)のレベルとな
るように補正することを特徴とするエンコーダにおける
アナログゲイン補正方法。 - 【請求項２】 前記基準値(V0)はＡ／Ｄ変換器(4,5)の
変換レンジ幅の最大値を用いていることを特徴とする請
求項１記載のエンコーダにおけるアナログゲイン補正方
法。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP00075693A JP3261187B2 (ja) | 1993-01-06 | 1993-01-06 | エンコーダにおけるアナログゲイン補正方法 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP00075693A JP3261187B2 (ja) | 1993-01-06 | 1993-01-06 | エンコーダにおけるアナログゲイン補正方法 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06201403A JPH06201403A (ja) | 1994-07-19 |
| JP3261187B2 true JP3261187B2 (ja) | 2002-02-25 |
Family
ID=11482539
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP00075693A Expired - Fee Related JP3261187B2 (ja) | 1993-01-06 | 1993-01-06 | エンコーダにおけるアナログゲイン補正方法 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP3261187B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP3026949B2 (ja) | 1997-05-12 | 2000-03-27 | ファナック株式会社 | エンコーダのオフセット補正回路 |
-
1993
- 1993-01-06 JP JP00075693A patent/JP3261187B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06201403A (ja) | 1994-07-19 |
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