JP2969709B2 - 歪補正信号分割回路 - Google Patents
歪補正信号分割回路Info
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は投写型テレビジョン受信機のレジストレーシ
ョンの為に用いる歪補正信号分割回路に関する。
ョンの為に用いる歪補正信号分割回路に関する。
本発明は投写型テレビジョン受信機のレジストレーシ
ョンの為に用いる歪補正信号分割回路に関し、２個のPN
P型トランジスタの夫々のエミッタ及びコレクタを共通
接続した第１のエミッタフロワー回路と、２個のNPN型
トランジスタの夫々のエミッタ及びコレクタを共通接続
した第２のエミッタフロワー回路とを有し、第１及び第
２のエミッタフロワー回路の夫々の一方のトランジスタ
のベースを基準電位に接続し、夫々の他方のトランジス
タのベースに夫々垂直同期歪補正信号を供給して、第１
及び第２のエミッタフロワー回路のエミッタ側から垂直
同期歪補正信号の前半及び後半を分割して出力する様に
してラスタ歪の発生を防止させる様にしたものである。
ョンの為に用いる歪補正信号分割回路に関し、２個のPN
P型トランジスタの夫々のエミッタ及びコレクタを共通
接続した第１のエミッタフロワー回路と、２個のNPN型
トランジスタの夫々のエミッタ及びコレクタを共通接続
した第２のエミッタフロワー回路とを有し、第１及び第
２のエミッタフロワー回路の夫々の一方のトランジスタ
のベースを基準電位に接続し、夫々の他方のトランジス
タのベースに夫々垂直同期歪補正信号を供給して、第１
及び第２のエミッタフロワー回路のエミッタ側から垂直
同期歪補正信号の前半及び後半を分割して出力する様に
してラスタ歪の発生を防止させる様にしたものである。
従来からの投写型テレビジョン受信機では一般的には
３個のＲ（赤）,G（緑）,B（青）の陰極線管（以下CRT
と記す）を用い、これらCRTを３個のレンズを介してス
クリーン上に投影することで大型画像を得ていた。この
為にこれら三つのCRTを偏向するための偏向回路及びス
クリーン上で色コンバーセンスを行うためのレジストレ
ーション補正回路を必要とした、この為に上記した３個
のR,G,B用のCRTには通常のラスタを作る主偏向ヨークの
後方にそのラスタを目的に応じて補正するための副偏向
ヨークを設けてレジストレーション補正の役割を分担さ
せている。
３個のＲ（赤）,G（緑）,B（青）の陰極線管（以下CRT
と記す）を用い、これらCRTを３個のレンズを介してス
クリーン上に投影することで大型画像を得ていた。この
為にこれら三つのCRTを偏向するための偏向回路及びス
クリーン上で色コンバーセンスを行うためのレジストレ
ーション補正回路を必要とした、この為に上記した３個
のR,G,B用のCRTには通常のラスタを作る主偏向ヨークの
後方にそのラスタを目的に応じて補正するための副偏向
ヨークを設けてレジストレーション補正の役割を分担さ
せている。
上述の様なレジストレーション補正回路が必要となる
理由を第３図の投写型テレビジョン受信機の投写原理図
によって説明する。同図で三つのCRT（4R），（4G），
（4B）は一般的な水平インライの配置を示したが、これ
ら三つのCRTからの映像を光学系を構成する三つのレン
ズ（5R），（5G），（5B）を介してスクリーン（６）を
投影し、投写画像を正しい矩形状にしてスクリーン
（６）に重ね合わせねばならないが、三つのCRTの配置
状態や光学系の為に光学的な走査歪を発生する。この様
な走査歪は第３図に示す投写角度βと投写角度γにより
影響を受ける。ここで、投写角度γはＲのCRT（4R）と
ＢのCRT（5B）の光軸がＧのCRT（4G）の光軸と成す角で
あり、投写角度βはＲ、Ｇ、ＢのCRT（4R），（4G），
（4B）の三つの光軸を含む面とスクリーン（６）の面に
直角な直線EZとのなす角度である。この投写角度βによ
って例えば、ＧのCRT（4G）が直線EZに対し斜め下から
投影されたとすると、スクリーン（６）の上側では第４
図Ａに示す様に投写倍率が拡大され、下側で縮小され
て、水平台形歪（７）を発生する。又、垂直方向には第
４図Ｂに示す様な垂直直性線歪（８）が発生する。同様
に投写角度γで二個のCRT（4R），（4B）からスクリー
ン（６）にこれらCRT（4R），（4B）の像が投影された
とすれば同じく、第４図Ｃに示す様なＲのCRT（4R）に
よる垂直台形歪（9R）と、この垂直台形歪とは対称な歪
を持つＢのCRT（4B）による垂直台形歪（9B）を生ず
る、同様に水平方向の水平直線歪（9R），（9G）もCRT
（4R）と（4B）では第４図Ｄの様に対称的なものとな
る。
理由を第３図の投写型テレビジョン受信機の投写原理図
によって説明する。同図で三つのCRT（4R），（4G），
（4B）は一般的な水平インライの配置を示したが、これ
ら三つのCRTからの映像を光学系を構成する三つのレン
ズ（5R），（5G），（5B）を介してスクリーン（６）を
投影し、投写画像を正しい矩形状にしてスクリーン
（６）に重ね合わせねばならないが、三つのCRTの配置
状態や光学系の為に光学的な走査歪を発生する。この様
な走査歪は第３図に示す投写角度βと投写角度γにより
影響を受ける。ここで、投写角度γはＲのCRT（4R）と
ＢのCRT（5B）の光軸がＧのCRT（4G）の光軸と成す角で
あり、投写角度βはＲ、Ｇ、ＢのCRT（4R），（4G），
（4B）の三つの光軸を含む面とスクリーン（６）の面に
直角な直線EZとのなす角度である。この投写角度βによ
って例えば、ＧのCRT（4G）が直線EZに対し斜め下から
投影されたとすると、スクリーン（６）の上側では第４
図Ａに示す様に投写倍率が拡大され、下側で縮小され
て、水平台形歪（７）を発生する。又、垂直方向には第
４図Ｂに示す様な垂直直性線歪（８）が発生する。同様
に投写角度γで二個のCRT（4R），（4B）からスクリー
ン（６）にこれらCRT（4R），（4B）の像が投影された
とすれば同じく、第４図Ｃに示す様なＲのCRT（4R）に
よる垂直台形歪（9R）と、この垂直台形歪とは対称な歪
を持つＢのCRT（4B）による垂直台形歪（9B）を生ず
る、同様に水平方向の水平直線歪（9R），（9G）もCRT
（4R）と（4B）では第４図Ｄの様に対称的なものとな
る。
この様な光学的な歪を補正するためにスクリーン
（６）上で正常な画像と成る様にスクリーン（６）上の
歪とは逆になる様な歪を各CRT（4R）（4G）（4B）に予
め作っておく様にしている。この回路がレジストレーシ
ョン補正回路である。
（６）上で正常な画像と成る様にスクリーン（６）上の
歪とは逆になる様な歪を各CRT（4R）（4G）（4B）に予
め作っておく様にしている。この回路がレジストレーシ
ョン補正回路である。
この様なレジストレーション補正回路としては上記し
た様に主偏向ヨークに垂直，水平鋸歯状波や垂直，水平
パラボラ波等の補正波形を供給し、水平台形歪や垂直の
直線状等の補正を行なっている。又、主偏向ヨークの後
方に配設した副偏向ヨークには例えば、水平パラボラ波
を供給して水平直線状歪を補正し、垂直台形歪（9R）
（9B）等は同じくこれら各CRTの副偏向ヨークに水平鋸
歯状波プラス垂直鋸歯状波を供給することで補正が行な
われている。即ち、投射型テレビジョン受像機では水
平，垂直鋸歯状波発生回路並に水平，垂直パラボラ波発
生回路やレジストレーション調整の為のハッチ信号を発
生するセット信号発生回路等を持っている。例えば、上
述の垂直台形歪を補正するためには第５図に示す様に垂
直鋸歯状波発生回路（11）及び水平鋸歯状波発生回路
（12）からの垂直及び水平鋸歯状波（11a）及び（12a）
を垂直及び水平鋸歯状波変調回路（13）に供給し、ここ
で、平衡変調等を行なって、蝶々型の波形を有する歪補
正信号（13a）等を得て、この歪補正信号（13a）を分割
回路（14）に供給して、分割信号（14a）得る。この分
割信号（14a1）（14a2）（14a3）（14a4）は例えば、第
４図Ｃに示すスクリーン（６）上の中心点０を中心に４
分割した第１象限乃至第４象限I,II,III,IVの各領域の
台形歪を個々に補正する様に成される。この為に例えば
Ｒ及びＧのCRT（4R）及び（4B）に可変抵抗マトリック
ス回路（15）を設けて、この可変抵抗器を調整すること
で各象限の台形歪量を補正し、R,G,B用の駆動アンプ（1
6）を介してR,G,B用の副偏向ヨーク（17）に分割した歪
補正信号を供給して台形歪を補正している。実際には先
にも説明した様に台形歪だけでなくスクリーンが平らで
ない事で生ずる糸捲歪や上述の投射角度βとγの両方で
生ずる回転歪やその他弓形歪等の補正もされている。
た様に主偏向ヨークに垂直，水平鋸歯状波や垂直，水平
パラボラ波等の補正波形を供給し、水平台形歪や垂直の
直線状等の補正を行なっている。又、主偏向ヨークの後
方に配設した副偏向ヨークには例えば、水平パラボラ波
を供給して水平直線状歪を補正し、垂直台形歪（9R）
（9B）等は同じくこれら各CRTの副偏向ヨークに水平鋸
歯状波プラス垂直鋸歯状波を供給することで補正が行な
われている。即ち、投射型テレビジョン受像機では水
平，垂直鋸歯状波発生回路並に水平，垂直パラボラ波発
生回路やレジストレーション調整の為のハッチ信号を発
生するセット信号発生回路等を持っている。例えば、上
述の垂直台形歪を補正するためには第５図に示す様に垂
直鋸歯状波発生回路（11）及び水平鋸歯状波発生回路
（12）からの垂直及び水平鋸歯状波（11a）及び（12a）
を垂直及び水平鋸歯状波変調回路（13）に供給し、ここ
で、平衡変調等を行なって、蝶々型の波形を有する歪補
正信号（13a）等を得て、この歪補正信号（13a）を分割
回路（14）に供給して、分割信号（14a）得る。この分
割信号（14a1）（14a2）（14a3）（14a4）は例えば、第
４図Ｃに示すスクリーン（６）上の中心点０を中心に４
分割した第１象限乃至第４象限I,II,III,IVの各領域の
台形歪を個々に補正する様に成される。この為に例えば
Ｒ及びＧのCRT（4R）及び（4B）に可変抵抗マトリック
ス回路（15）を設けて、この可変抵抗器を調整すること
で各象限の台形歪量を補正し、R,G,B用の駆動アンプ（1
6）を介してR,G,B用の副偏向ヨーク（17）に分割した歪
補正信号を供給して台形歪を補正している。実際には先
にも説明した様に台形歪だけでなくスクリーンが平らで
ない事で生ずる糸捲歪や上述の投射角度βとγの両方で
生ずる回転歪やその他弓形歪等の補正もされている。
上述の第５図に示した分割回路（14）の構成の１例を
第６図に示す。この分割回路（14）の入力端子T6には垂
直同期信号と同期した補正用の録画状波信号（18）が供
給され、この補正用の鋸歯状波信号（18）は例えば、HD
−14053等のＣ−MOS−IC構成のアナログスイッチ（１）
の入力端子と、オペアンプ構成のコンパレータ（19）の
非反転入力端子に供給される。コンパレータ（19）の反
転入力端子は基準電位の例えば、零Ｖと成されているの
でコンパレータ（19）の出力端子T7には鋸歯状波信号
（18）に同期のとれたデューティ50％の矩形波から成る
制御信号（20）が得られる。この制御信号（20）によっ
てアナログスイッチ（１）を切換制御することで鋸歯状
波信号（18）は出力端子T8及びT9に零Ｖを基準にプラス
側の三角波状の補正波形信号（21）とマイナス側の三角
波状の補正波形信号（22）に分割される。この様な補正
波形信号（21）及び（22）は副偏向ヨーク（17）に供給
することでスクリーン（６）を４分割した場合の第１及
び第３象限の走査歪を個々に補正することが出来る。
第６図に示す。この分割回路（14）の入力端子T6には垂
直同期信号と同期した補正用の録画状波信号（18）が供
給され、この補正用の鋸歯状波信号（18）は例えば、HD
−14053等のＣ−MOS−IC構成のアナログスイッチ（１）
の入力端子と、オペアンプ構成のコンパレータ（19）の
非反転入力端子に供給される。コンパレータ（19）の反
転入力端子は基準電位の例えば、零Ｖと成されているの
でコンパレータ（19）の出力端子T7には鋸歯状波信号
（18）に同期のとれたデューティ50％の矩形波から成る
制御信号（20）が得られる。この制御信号（20）によっ
てアナログスイッチ（１）を切換制御することで鋸歯状
波信号（18）は出力端子T8及びT9に零Ｖを基準にプラス
側の三角波状の補正波形信号（21）とマイナス側の三角
波状の補正波形信号（22）に分割される。この様な補正
波形信号（21）及び（22）は副偏向ヨーク（17）に供給
することでスクリーン（６）を４分割した場合の第１及
び第３象限の走査歪を個々に補正することが出来る。
上述の従来技術で説明した様な従来の分割回路（14）
によると、アナログスイッチ（１）を切換制御する制御
信号（20）のクロストークが分割した補正波信号（21）
（22）に飛び込み、ヒゲ（23）を生ずる。この様なヒゲ
（23）の発生によって、スクリーン（６）上に例えば、
全白の映像信号を映出させた場合、第７図に示す様にス
クリーン（６）の真中に走査されない幅寸法ｔ＝１〜2m
m程度の黒筋による走査歪（24）が発生する問題があっ
た。
によると、アナログスイッチ（１）を切換制御する制御
信号（20）のクロストークが分割した補正波信号（21）
（22）に飛び込み、ヒゲ（23）を生ずる。この様なヒゲ
（23）の発生によって、スクリーン（６）上に例えば、
全白の映像信号を映出させた場合、第７図に示す様にス
クリーン（６）の真中に走査されない幅寸法ｔ＝１〜2m
m程度の黒筋による走査歪（24）が発生する問題があっ
た。
又制御信号（20）とのタイミングずれによって垂直鋸
歯状波信号（18）が零レベル位置で二分割されずに分割
波形に直流分を含む様な問題もあった。
歯状波信号（18）が零レベル位置で二分割されずに分割
波形に直流分を含む様な問題もあった。
本発明は叙上の問題点を解決するために成されたもの
で、その目的とするところは分割した補正波形信号によ
る補正量を多くしても、走査歪の発生しない歪補正信号
分割回路を得る様にしたものである。
で、その目的とするところは分割した補正波形信号によ
る補正量を多くしても、走査歪の発生しない歪補正信号
分割回路を得る様にしたものである。
本発明の歪補正信号分割回路はその例が第１図に示さ
れている様に、２個のPNP型トランジスタQ1,Q2の夫々エ
ミッタ及びコレクタを共通接続した第１のエミッタフロ
ワー回路（3a）と、２個のNPN型トランジスタQ3,Q4の夫
々のエミッタ及びコレクタを共通接続した第２のエミッ
タフロワー回路（3b）とを有し、第１及び第２のエミッ
タフロワー回路（3a）及び（3b）の夫々の一方のトラン
ジスタQ2,Q4のベースを基準電位に接続し、夫々の他方
のトランジスタQ1,Q3のベースに夫々垂直同期歪補正信
号を供給して、第１及び第２のエミッタフラワー回路
（3a）及び（3b）の垂直同期歪補正信号の前半及び後半
を分割して出力する様にして成るものである。
れている様に、２個のPNP型トランジスタQ1,Q2の夫々エ
ミッタ及びコレクタを共通接続した第１のエミッタフロ
ワー回路（3a）と、２個のNPN型トランジスタQ3,Q4の夫
々のエミッタ及びコレクタを共通接続した第２のエミッ
タフロワー回路（3b）とを有し、第１及び第２のエミッ
タフロワー回路（3a）及び（3b）の夫々の一方のトラン
ジスタQ2,Q4のベースを基準電位に接続し、夫々の他方
のトランジスタQ1,Q3のベースに夫々垂直同期歪補正信
号を供給して、第１及び第２のエミッタフラワー回路
（3a）及び（3b）の垂直同期歪補正信号の前半及び後半
を分割して出力する様にして成るものである。
本発明の歪補正信号分割回路は垂直同期歪補正信号を
第１及び第２のエミッタフロワー回路（3a）及び（3b）
に供給し基準電位と比較するだけでエミッタフロワー出
力として分割された垂直同期歪補正信号が前半及び後半
に分割されて得られる。この構成では制御信号（20）を
用いずに分割が出来るので、ヒゲ（23）の発生がなく、
走査歪（24）の生じない画像が得られる。
第１及び第２のエミッタフロワー回路（3a）及び（3b）
に供給し基準電位と比較するだけでエミッタフロワー出
力として分割された垂直同期歪補正信号が前半及び後半
に分割されて得られる。この構成では制御信号（20）を
用いずに分割が出来るので、ヒゲ（23）の発生がなく、
走査歪（24）の生じない画像が得られる。
以下、本発明の歪補正信号分割回路の一実施例を第１
図によって説明する。
図によって説明する。
第１図に於いて、入力端子T1には第５図で説明した蝶
々型の波形を有する歪補正信号（13a）が供給される。
この歪補正信号（13a）は１垂直同期信号間（1V）の水
平鋸歯状波形信号のエンベロープを示し、水平鋸歯状波
信号に垂直鋸歯状波信号が重畳されたものとなってい
る。入力端子T1はＣ−MOS IC構成のアナログスイッチ
（1a）の入力端子と、第６図で説明したと同様の構成を
有するコンパレータ（19a）の入力側に接続されてい
る。第６図の場合は垂直鋸歯状波信号のみをアナログス
イッチ（１）とコンパレータ（19）に供給した場合を説
明したが、本例ではコンパレータ（19a）に垂直鋸歯状
波信号プラス水平鋸歯状波信号（13a）が供給され、コ
ンパレータ（19a）の出力には１水平走査期間の1/2（以
下1/2Hと記す）の矩形波パネル（20a）が得られる。ア
ナログスイッチ（1a）はこの1/2Hの制御信号で切換が行
なわれる。即ち、本例では水平成分についてはノイズ等
の影響を受けにくい（実際にはスクリーンの縦方向に黒
筋があるが目立たない。）ので従来と同様にＣ−MOS構
成のアナログスイッチ（1a）を用いて水平鋸歯状波信号
を分割することで、アナログスイッチ（1a）の出力端子
には第１及び第２の垂直同期歪補正信号（25a）及び（2
5a′）を得る。第１の垂直同期歪補正信号（25a）はス
クリーン（６）上の第２及び第４の象限の領域の走査歪
を補正するための正方向の三角波形から成る垂直同期歪
補正信号成分（25a2）と負方向の三角波形から成る垂直
同期歪補正信号成分（25a4）より成り、第２の垂直同期
歪補正信号（25a′）はスクリーン（６）上の第１及び
第３象限の領域の走査歪を補正するための正方向の三角
波形から成る垂直同期補正信号成分（25a1′）と負方向
の三角波形から成る垂直同期歪補正信号成分（25a4′）
から成り、これら第１及び第２の垂直同期歪補正信号
（25a）及び（25a′）は夫々第１及び第２のエミッタフ
ロワー構成の垂直同期歪補正信号の分割回路（以下垂直
分割回路と記す）（2a）（2b）に供給される。この第１
及び第２の垂直分割回路（2a）及び（2b）によって垂直
同期歪補正信号（25a）及び（25a′）は４分割され、第
１及び第２の垂直分割回路（2a）及び（2b）の出力端子
T4とT5並にT4′とT5′より分割波形信号（14a4）と（14
a2）並に（14a3）と（14a1）が出力される。第１及び第
２の垂直分割回路（2a）及び（2b）はその内部構成は同
一であるので、第２の垂直分割回路（2b）は一点鎖線で
示し、その電源及び出力端子並にエミッタフロワー回路
は第１の垂直分割回路（2b）と同一符号にダッシュを付
して示してある。以下、第１の垂直分割回路（2a）のみ
説明を進める。
々型の波形を有する歪補正信号（13a）が供給される。
この歪補正信号（13a）は１垂直同期信号間（1V）の水
平鋸歯状波形信号のエンベロープを示し、水平鋸歯状波
信号に垂直鋸歯状波信号が重畳されたものとなってい
る。入力端子T1はＣ−MOS IC構成のアナログスイッチ
（1a）の入力端子と、第６図で説明したと同様の構成を
有するコンパレータ（19a）の入力側に接続されてい
る。第６図の場合は垂直鋸歯状波信号のみをアナログス
イッチ（１）とコンパレータ（19）に供給した場合を説
明したが、本例ではコンパレータ（19a）に垂直鋸歯状
波信号プラス水平鋸歯状波信号（13a）が供給され、コ
ンパレータ（19a）の出力には１水平走査期間の1/2（以
下1/2Hと記す）の矩形波パネル（20a）が得られる。ア
ナログスイッチ（1a）はこの1/2Hの制御信号で切換が行
なわれる。即ち、本例では水平成分についてはノイズ等
の影響を受けにくい（実際にはスクリーンの縦方向に黒
筋があるが目立たない。）ので従来と同様にＣ−MOS構
成のアナログスイッチ（1a）を用いて水平鋸歯状波信号
を分割することで、アナログスイッチ（1a）の出力端子
には第１及び第２の垂直同期歪補正信号（25a）及び（2
5a′）を得る。第１の垂直同期歪補正信号（25a）はス
クリーン（６）上の第２及び第４の象限の領域の走査歪
を補正するための正方向の三角波形から成る垂直同期歪
補正信号成分（25a2）と負方向の三角波形から成る垂直
同期歪補正信号成分（25a4）より成り、第２の垂直同期
歪補正信号（25a′）はスクリーン（６）上の第１及び
第３象限の領域の走査歪を補正するための正方向の三角
波形から成る垂直同期補正信号成分（25a1′）と負方向
の三角波形から成る垂直同期歪補正信号成分（25a4′）
から成り、これら第１及び第２の垂直同期歪補正信号
（25a）及び（25a′）は夫々第１及び第２のエミッタフ
ロワー構成の垂直同期歪補正信号の分割回路（以下垂直
分割回路と記す）（2a）（2b）に供給される。この第１
及び第２の垂直分割回路（2a）及び（2b）によって垂直
同期歪補正信号（25a）及び（25a′）は４分割され、第
１及び第２の垂直分割回路（2a）及び（2b）の出力端子
T4とT5並にT4′とT5′より分割波形信号（14a4）と（14
a2）並に（14a3）と（14a1）が出力される。第１及び第
２の垂直分割回路（2a）及び（2b）はその内部構成は同
一であるので、第２の垂直分割回路（2b）は一点鎖線で
示し、その電源及び出力端子並にエミッタフロワー回路
は第１の垂直分割回路（2b）と同一符号にダッシュを付
して示してある。以下、第１の垂直分割回路（2a）のみ
説明を進める。
第１の破線内に示された第１の垂直分割回路（2a）は
互に導電型式が異なるPNPとNPN型トランジスタから成る
第１及び第２のエミッタフロワー回路（3a）及び（3b）
により構成されている。第１のエミッタフロワー回路
（3a）は第１多び第２のPNP型トランジスタQ1及びQ2の
夫々のエミッタを共通に接続しこの共通接続点をエミッ
タ抵抗器R3を介して正電圧V1＝＋5Vの供給される電源端
子T2に接続し、更に第１及び第２のPNP型トランジスタQ
1及びQ2の夫々コレクタも共通に接続し、負電圧V2＝−5
Vの供給される電源端子T3に接続し、第１のPNP型トラン
ジスタQ1のベースにはベース抵抗器R1を介して上述の垂
直同期歪補正信号（25a）が供給される。第２のPNP型ト
ランジスタQ2のベースは基準電位の例えば、接地電位と
されている。第１及び第２のPNP型トランジスタQ1及びQ
2の共通接続したエミッタとコレクタ間にVBE補償用の第
５のトランジスタQ5と抵抗器R5の直列回路が接続されて
いる。即ち、第５のNPN型トランジスタQ5のベース及び
コレクタを第１及び第２のPNP型トランジスタQ1及びQ2
のコレクタの共通接続点と抵抗器R3の接続中点に接続
し、第５のNPN型トランジスタQ5のエミッタと抵抗器R5
の接続中点から出力端子T4にエミッタフロワー出力がと
り出され、抵抗器R5の他端は負電圧の供給される電源端
子T3に接続されている。
互に導電型式が異なるPNPとNPN型トランジスタから成る
第１及び第２のエミッタフロワー回路（3a）及び（3b）
により構成されている。第１のエミッタフロワー回路
（3a）は第１多び第２のPNP型トランジスタQ1及びQ2の
夫々のエミッタを共通に接続しこの共通接続点をエミッ
タ抵抗器R3を介して正電圧V1＝＋5Vの供給される電源端
子T2に接続し、更に第１及び第２のPNP型トランジスタQ
1及びQ2の夫々コレクタも共通に接続し、負電圧V2＝−5
Vの供給される電源端子T3に接続し、第１のPNP型トラン
ジスタQ1のベースにはベース抵抗器R1を介して上述の垂
直同期歪補正信号（25a）が供給される。第２のPNP型ト
ランジスタQ2のベースは基準電位の例えば、接地電位と
されている。第１及び第２のPNP型トランジスタQ1及びQ
2の共通接続したエミッタとコレクタ間にVBE補償用の第
５のトランジスタQ5と抵抗器R5の直列回路が接続されて
いる。即ち、第５のNPN型トランジスタQ5のベース及び
コレクタを第１及び第２のPNP型トランジスタQ1及びQ2
のコレクタの共通接続点と抵抗器R3の接続中点に接続
し、第５のNPN型トランジスタQ5のエミッタと抵抗器R5
の接続中点から出力端子T4にエミッタフロワー出力がと
り出され、抵抗器R5の他端は負電圧の供給される電源端
子T3に接続されている。
第２のエミッタフロワー回路（3b）は第３及び第４の
NPN型トランジスタQ3及びQ4の夫々のエミッタを共通接
続し、この共通接続点をエミッタ抵抗器R4を介して、負
電圧V2＝−5Vの供給される電源端子T3に接続し、更に第
３及び第４のNPN型トランジスタQ3及びQ4の夫々のコレ
クタも共通接続し、正電圧V1＝＋5Vの供給された電源端
子T2に接続し、第３のNPN型トランジスタQ3のベースに
はベース抵抗器R2を介して上述の垂直同期歪補正信号
（25a）が供給される。第４のNPN型トランジスタQ4のベ
ースは基準電位の例えば、接地電位とされている。第３
及び第4NPN型トランジスタQ3及びQ4の共通接続したエミ
ッタとコレクタ間にVBEの補償用の第６のPNP型トランジ
スタQ6と抵抗器R6の直列回路が接続されている。即ち、
第６のNPN型トランジスタQ6のベース及びコレクタを第
３及び第４のNPN型トランジスタQ3及びQ5のコレクタの
共通接続点に接続し、第６のPNP型トランジスタQ6のエ
ミッタと抵抗器R6の接続中点から出力端子T5にエミッタ
フロワー出力が取り出され、抵抗器R6の他端は正電圧の
供給される電源端子T2に接続されている。
NPN型トランジスタQ3及びQ4の夫々のエミッタを共通接
続し、この共通接続点をエミッタ抵抗器R4を介して、負
電圧V2＝−5Vの供給される電源端子T3に接続し、更に第
３及び第４のNPN型トランジスタQ3及びQ4の夫々のコレ
クタも共通接続し、正電圧V1＝＋5Vの供給された電源端
子T2に接続し、第３のNPN型トランジスタQ3のベースに
はベース抵抗器R2を介して上述の垂直同期歪補正信号
（25a）が供給される。第４のNPN型トランジスタQ4のベ
ースは基準電位の例えば、接地電位とされている。第３
及び第4NPN型トランジスタQ3及びQ4の共通接続したエミ
ッタとコレクタ間にVBEの補償用の第６のPNP型トランジ
スタQ6と抵抗器R6の直列回路が接続されている。即ち、
第６のNPN型トランジスタQ6のベース及びコレクタを第
３及び第４のNPN型トランジスタQ3及びQ5のコレクタの
共通接続点に接続し、第６のPNP型トランジスタQ6のエ
ミッタと抵抗器R6の接続中点から出力端子T5にエミッタ
フロワー出力が取り出され、抵抗器R6の他端は正電圧の
供給される電源端子T2に接続されている。
上述の如き構成によれば第１及び第２のエミッタフロ
ワー回路（3a）及び（3b）に第１図に示す垂直同期歪補
正信号（25a）が供給されると、第１のエミッタフロワ
ー回路（3a）の第１のNPN型トランジスタQ1に入力され
た垂直同期歪補正信号（25a）は第２のNPN型トランジス
タQ2の基準電位の零レベルと比較され、負成分即ち、垂
直同期歪補正信号成分（25a4）のみ第１及び第２のPNP
型トランジスタQ1及びQ2のエミッタ側へ出力し、VBEを
第５のNPN型トランジスタQ5で補償して、出力端子T4に
分割出力波形信号（14a4）を出力する。
ワー回路（3a）及び（3b）に第１図に示す垂直同期歪補
正信号（25a）が供給されると、第１のエミッタフロワ
ー回路（3a）の第１のNPN型トランジスタQ1に入力され
た垂直同期歪補正信号（25a）は第２のNPN型トランジス
タQ2の基準電位の零レベルと比較され、負成分即ち、垂
直同期歪補正信号成分（25a4）のみ第１及び第２のPNP
型トランジスタQ1及びQ2のエミッタ側へ出力し、VBEを
第５のNPN型トランジスタQ5で補償して、出力端子T4に
分割出力波形信号（14a4）を出力する。
同様に第２のエミッタフロワー回路（3b）側の第３の
NPN型トランジスタQ3に入力された垂直同期歪補正信号
（25a）は第４のNPN型トランジスタQ4の基準電位の零レ
ベル比較され正成分、即ち、垂直同期歪補正信号成分
（25a2）のみ第３及び第４のNPN型トランジスタQ3及びQ
5のエミッタ側に出力し、VBEを第６のPNP型トランジス
タQ6で補償して、出力端子T5に分割出力波形信号（14
a2）を出力する。
NPN型トランジスタQ3に入力された垂直同期歪補正信号
（25a）は第４のNPN型トランジスタQ4の基準電位の零レ
ベル比較され正成分、即ち、垂直同期歪補正信号成分
（25a2）のみ第３及び第４のNPN型トランジスタQ3及びQ
5のエミッタ側に出力し、VBEを第６のPNP型トランジス
タQ6で補償して、出力端子T5に分割出力波形信号（14
a2）を出力する。
第２の垂直分割回路（2b）側の第３及び第４のエミッ
タフロワー回路（3a′）及び（3b′）には垂直同期歪補
正信号（25a′）が供給され、夫々、第３及び第４のエ
ミッタフロワー回路（3a′）及び（3b′）によって垂直
同期歪補正信号（25a′）の前半の垂直同期歪補正信号
成分（25a1′）と後半の垂直同期歪補正信号成分（25
a3′）に分離されて出力端子T4′及びT5′に分割出力波
形信号（14a3）及び（14a1）が出力される。
タフロワー回路（3a′）及び（3b′）には垂直同期歪補
正信号（25a′）が供給され、夫々、第３及び第４のエ
ミッタフロワー回路（3a′）及び（3b′）によって垂直
同期歪補正信号（25a′）の前半の垂直同期歪補正信号
成分（25a1′）と後半の垂直同期歪補正信号成分（25
a3′）に分離されて出力端子T4′及びT5′に分割出力波
形信号（14a3）及び（14a1）が出力される。
この様な分割出力波形信号をR,B用の各CRTの副偏向ヨ
ーク（17）に供給することで、第２図に示す様にスクリ
ーン（６）上の中心点から４分割した第１象限乃至第４
象限のＩ〜IVの垂直方向の走査歪を個々に大きく補正し
ても、走査歪が発生しないので短時間に調整が可能とな
る。即ち、従来ではレジストレーション調整を行う際に
分割出力波形信号を大きく調整すると、必ず第７図で説
明した様な黒線が発生したので、分割する前の波形で出
来るだけレジストレーションを正確に調整し、分割出力
波形信号を用いる場合には黒線が出ない程度の微調整を
行うために用いていたが、この様なことを行なわずに各
領域（各象限）内で可変抵抗マトリックスを大きく調整
しても、黒線が発生しないので極めて短時間にレジスト
レーション調整を行うことが出来る。
ーク（17）に供給することで、第２図に示す様にスクリ
ーン（６）上の中心点から４分割した第１象限乃至第４
象限のＩ〜IVの垂直方向の走査歪を個々に大きく補正し
ても、走査歪が発生しないので短時間に調整が可能とな
る。即ち、従来ではレジストレーション調整を行う際に
分割出力波形信号を大きく調整すると、必ず第７図で説
明した様な黒線が発生したので、分割する前の波形で出
来るだけレジストレーションを正確に調整し、分割出力
波形信号を用いる場合には黒線が出ない程度の微調整を
行うために用いていたが、この様なことを行なわずに各
領域（各象限）内で可変抵抗マトリックスを大きく調整
しても、黒線が発生しないので極めて短時間にレジスト
レーション調整を行うことが出来る。
尚、上述の実施例に於ては分割回路（14）に入力させ
る垂直同期歪補正信号として垂直鋸歯状波形を用いて1V
を1/2に分割したが、垂直方向のＳ字状の歪等を補正す
る場合には垂直同期した正弦波形等を分割回路（14）に
供給させればスクリーン上の直線性の補正を分割数に対
応して正確に行うことが出来る。
る垂直同期歪補正信号として垂直鋸歯状波形を用いて1V
を1/2に分割したが、垂直方向のＳ字状の歪等を補正す
る場合には垂直同期した正弦波形等を分割回路（14）に
供給させればスクリーン上の直線性の補正を分割数に対
応して正確に行うことが出来る。
尚、本発明は上記実施例に限定されることなく本発明
の要旨を逸脱しない範囲で種々変更し得ることは明白で
ある。
の要旨を逸脱しない範囲で種々変更し得ることは明白で
ある。
本発明によれば走査歪の発生しない分割回路が得ら
れ、分割出力波形信号を個々に大きく調整出来るのでレ
ジストレーション調整を極めて短時間に行うことが出来
る。
れ、分割出力波形信号を個々に大きく調整出来るのでレ
ジストレーション調整を極めて短時間に行うことが出来
る。
第１図は本発明の歪補正信号分割回路の一実施例を示す
系統図、第２図は補正説明図、第３図は投写テレビジョ
ン受像機の投射原理図、第４図は投射角βとγによる歪
の説明図、第５図は従来の垂直台形歪補正回路の系統
図、第６図は従来の分割回路の系統図、第７図は従来の
走査歪の説明図である。 （1a）はアナログスイッチ、（2a）（2b）は垂直分割回
路、（3a）（3b）はエミッタフロワー回路、（６）はス
クリーン、（14）は分割回路である。
系統図、第２図は補正説明図、第３図は投写テレビジョ
ン受像機の投射原理図、第４図は投射角βとγによる歪
の説明図、第５図は従来の垂直台形歪補正回路の系統
図、第６図は従来の分割回路の系統図、第７図は従来の
走査歪の説明図である。 （1a）はアナログスイッチ、（2a）（2b）は垂直分割回
路、（3a）（3b）はエミッタフロワー回路、（６）はス
クリーン、（14）は分割回路である。
───────────────────────────────────────────────────── フロントページの続き (58)調査した分野(Int.Cl.6，ＤＢ名) H04N 9/31 H03K 3/023
Claims (1)
- 【請求項１】２個のPNP型トランジスタの夫々のエミッ
タ及びコレクタを共通接続した第１のエミッタフロワー
回路と、 ２個のNPN型トランジスタの夫々のエミッタ及びコレク
タを共通接続した第２のエミッタフロワー回路とを有
し、 上記第１及び第２のエミッタフロワー回路の夫々の一方
のトランジスタのベースを基準電位に接続し、夫々の他
方のトランジスタのベースに夫々垂直同期歪補正信号を
供給して、上記第１及び第２のエミッタフロワー回路の
エミッタ側から上記垂直同期歪補正信号の前半及び後半
を分割して出力する様にして成ることを特徴とする歪補
正信号分割回路
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1330837A JP2969709B2 (ja) | 1989-12-20 | 1989-12-20 | 歪補正信号分割回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1330837A JP2969709B2 (ja) | 1989-12-20 | 1989-12-20 | 歪補正信号分割回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03190486A JPH03190486A (ja) | 1991-08-20 |
| JP2969709B2 true JP2969709B2 (ja) | 1999-11-02 |
Family
ID=18237092
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP1330837A Expired - Fee Related JP2969709B2 (ja) | 1989-12-20 | 1989-12-20 | 歪補正信号分割回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2969709B2 (ja) |
-
1989
- 1989-12-20 JP JP1330837A patent/JP2969709B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03190486A (ja) | 1991-08-20 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |