JP2929827B2 - 磁気ディスク装置の電源電圧異常検出回路および磁気ディスク装置 - Google Patents
磁気ディスク装置の電源電圧異常検出回路および磁気ディスク装置Info
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- JP2929827B2 JP2929827B2 JP4048369A JP4836992A JP2929827B2 JP 2929827 B2 JP2929827 B2 JP 2929827B2 JP 4048369 A JP4048369 A JP 4048369A JP 4836992 A JP4836992 A JP 4836992A JP 2929827 B2 JP2929827 B2 JP 2929827B2
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Description
【０００１】
【産業上の利用分野】本発明は磁気ディスク装置の電源
電圧異常検出回路に関し、特にマイクロ・プロセッサ・
ユニット（ＭＰＵ）の制御のもとに装置の電源電圧異常
検出回路に関する。
電圧異常検出回路に関し、特にマイクロ・プロセッサ・
ユニット（ＭＰＵ）の制御のもとに装置の電源電圧異常
検出回路に関する。
【０００２】
【従来の技術】従来、磁気ディスク装置の電源電圧異常
検出回路は、異常を検出する場合の基準とする基準電圧
は、１種類のみとして異常検出を行なっていた。
検出回路は、異常を検出する場合の基準とする基準電圧
は、１種類のみとして異常検出を行なっていた。
【０００３】
【発明が解決しようとする課題】この従来の磁気ディス
クの電源電圧異常検出回路においては、異常を検出する
場合の基準とする基準電圧は１種類のみに固定され、そ
のため、電源電圧が過渡的に低下した場合でもこれを異
常として検出してしまう問題点があった。
クの電源電圧異常検出回路においては、異常を検出する
場合の基準とする基準電圧は１種類のみに固定され、そ
のため、電源電圧が過渡的に低下した場合でもこれを異
常として検出してしまう問題点があった。
【０００４】本発明の目的は上述した問題点を解決し、
過渡的な電圧の低下を検知しうる磁気ディスク装置の電
源電圧異常検出回路を提供することにある。
過渡的な電圧の低下を検知しうる磁気ディスク装置の電
源電圧異常検出回路を提供することにある。
【０００５】
【課題を解決するための手段】本発明の回路は、外部か
ら少なくとも２種類のＤＣ電源を受け、マイクロ・プロ
セッサ・ユニットの制御をもとに動作する磁気ディスク
装置の前記ＤＣ電源の電圧異常を検出する磁気ディスク
装置の電源電圧異常検出回路において、グランドレベル
による論理値０レベルを出力するモードとハイ・インピ
ーダンス状態となるモードとのいずれかのモードをＩ／
Ｏポートに設定可能なマイクロ・プロセッサ・ユニット
と、外部から所定の電圧を印加され前記Ｉ／Ｏポートの
設定モードに対応して相異る分圧電圧を２種類の基準電
圧として出力する第一の複合抵抗器群と、前記ＤＣ電源
の１種類を印加されこれを所定の分圧比で分圧して電源
電圧異常検出用の検出電圧として出力する第二の複合抵
抗器群と、前記基準電圧と前記検出電圧とを比較して前
記ＤＣ電源の電圧異常の有無を検出するコンパレータと
を備えて構成される。
ら少なくとも２種類のＤＣ電源を受け、マイクロ・プロ
セッサ・ユニットの制御をもとに動作する磁気ディスク
装置の前記ＤＣ電源の電圧異常を検出する磁気ディスク
装置の電源電圧異常検出回路において、グランドレベル
による論理値０レベルを出力するモードとハイ・インピ
ーダンス状態となるモードとのいずれかのモードをＩ／
Ｏポートに設定可能なマイクロ・プロセッサ・ユニット
と、外部から所定の電圧を印加され前記Ｉ／Ｏポートの
設定モードに対応して相異る分圧電圧を２種類の基準電
圧として出力する第一の複合抵抗器群と、前記ＤＣ電源
の１種類を印加されこれを所定の分圧比で分圧して電源
電圧異常検出用の検出電圧として出力する第二の複合抵
抗器群と、前記基準電圧と前記検出電圧とを比較して前
記ＤＣ電源の電圧異常の有無を検出するコンパレータと
を備えて構成される。
【０００６】また本発明の磁気ディスク装置は、前述し
た電源電圧異常検出回路を装備した構成を有する。
た電源電圧異常検出回路を装備した構成を有する。
【０００７】
【実施例】次に、本発明について図面を参照して説明す
る。
る。
【０００８】図１は本発明の一実施例の構成を示すブロ
ック図である。
ック図である。
【０００９】図１において、磁気ディスク装置を制御す
るＭＰＵ１の１ Ｉ／Ｏポートを検出レベルの制御信号
線１０１で表現する。
るＭＰＵ１の１ Ｉ／Ｏポートを検出レベルの制御信号
線１０１で表現する。
【００１０】第１の複合抵抗器群としての複合抵抗器群
としての複合抵抗機群（Ａ）２０１は、２つの固定抵抗
Ｚ（１）３，Ｚ（３）５および１つの可変抵抗Ｚ（２）
４から構成され、Ｚ（１）３の片端は＋５Ｖに接続され
ている。また、Ｚ（３）５の片端はグランドに接続され
ている。
としての複合抵抗機群（Ａ）２０１は、２つの固定抵抗
Ｚ（１）３，Ｚ（３）５および１つの可変抵抗Ｚ（２）
４から構成され、Ｚ（１）３の片端は＋５Ｖに接続され
ている。また、Ｚ（３）５の片端はグランドに接続され
ている。
【００１１】制御信号線１０１は、Ｚ（２）４とＺ
（３）５の接続部と接続している。
（３）５の接続部と接続している。
【００１２】異常検出対象となるＶＣＣの電圧値を分圧
する抵抗器が、第２の複合抵抗器群としての複合抵抗器
群（Ｂ）２０２である。複合抵抗器群（Ｂ）２０２は、
２つの固定抵抗Ｚ（４）６とＺ（５）７から構成されて
いる。
する抵抗器が、第２の複合抵抗器群としての複合抵抗器
群（Ｂ）２０２である。複合抵抗器群（Ｂ）２０２は、
２つの固定抵抗Ｚ（４）６とＺ（５）７から構成されて
いる。
【００１３】コンパレータ２は、複合抵抗器群（Ａ）２
０１の出力である基準電圧１０３と、複合抵抗器群
（Ｂ）２０２の出力する検出電圧１０４とを比較し、検
出電圧１０４の方が基準電圧１０３より低い場合に異常
検出信号線１０２をアクティブにし、電源電圧の異常を
表示する。
０１の出力である基準電圧１０３と、複合抵抗器群
（Ｂ）２０２の出力する検出電圧１０４とを比較し、検
出電圧１０４の方が基準電圧１０３より低い場合に異常
検出信号線１０２をアクティブにし、電源電圧の異常を
表示する。
【００１４】ＭＰＵ１は、制御信号線１０１を論理値０
レベルにすることにより基準電圧１０３が分圧比に対応
して低下する。これをラフ・チェック・モードと呼ぶ。
レベルにすることにより基準電圧１０３が分圧比に対応
して低下する。これをラフ・チェック・モードと呼ぶ。
【００１５】逆に制御信号線１０１をハイ・インピーダ
ンスに設定することにより、基準電圧１０３の電圧値は
上昇する。これをファイン・チェック・モードと呼ぶ。
ンスに設定することにより、基準電圧１０３の電圧値は
上昇する。これをファイン・チェック・モードと呼ぶ。
【００１６】このようにして、制御信号線１０１の論理
値０レベルおよびハイ・インピーダンスの２状態設定で
異常検出レベルを２種類のいずれかに可変とすることが
できる。
値０レベルおよびハイ・インピーダンスの２状態設定で
異常検出レベルを２種類のいずれかに可変とすることが
できる。
【００１７】いま、一例として、Ｚ（１）３＝３．５ｋ
Ω，Ｚ（２）４＝１．５ｋΩ，Ｚ（３）５＝２ｋΩ，Ｚ
（４）６＝９．４ｋΩ，Ｚ（５）７＝２．６ｋΩとし、
またＶＣＣ＝１２Ｖとする。
Ω，Ｚ（２）４＝１．５ｋΩ，Ｚ（３）５＝２ｋΩ，Ｚ
（４）６＝９．４ｋΩ，Ｚ（５）７＝２．６ｋΩとし、
またＶＣＣ＝１２Ｖとする。
【００１８】この状態でのラフ・チェック・モード時、
基準電圧１０３は１．５Ｖとなる。この時、ＶＣＣが
６．９Ｖ以下になると異常検出信号線１０２がアクティ
ブとなる。
基準電圧１０３は１．５Ｖとなる。この時、ＶＣＣが
６．９Ｖ以下になると異常検出信号線１０２がアクティ
ブとなる。
【００１９】また、ファイン・チェック・モード時、基
準電圧１０３は２．５Ｖとなる。この時ＶＣＣが１１．
５Ｖ以下になると、異常検出信号線１０２がアクティブ
となる。
準電圧１０３は２．５Ｖとなる。この時ＶＣＣが１１．
５Ｖ以下になると、異常検出信号線１０２がアクティブ
となる。
【００２０】このようにして、ラフ・チェック・モード
では６．９Ｖ以下のＶＣＣを異常として検出し、ファイ
ン・チェック・モードでは１１．５Ｖ以下のＶＣＣを異
常として検出し、過渡的な電源電圧の低下と、正常動作
時の電源電圧の低下を分離検出することができる。
では６．９Ｖ以下のＶＣＣを異常として検出し、ファイ
ン・チェック・モードでは１１．５Ｖ以下のＶＣＣを異
常として検出し、過渡的な電源電圧の低下と、正常動作
時の電源電圧の低下を分離検出することができる。
【００２１】
【発明の効果】以上説明したように本発明は、外部ＤＣ
電源を必要とする磁気ディスク装置において、磁気ディ
スク装置を制御するＭＰＵの１Ｉ／Ｏポートを使用して
外部ＤＣ電圧源の異常検出回路の基準電圧を可変とする
ことにより、磁気ディスク装置のスピンドル回転起動時
における過渡的な電圧低下を電圧異常として検出して機
能停止することを排除し、またスピンドル回転起動時か
ら定常回転中は、ファインな異常検出モードへと切り替
えて２種類の基準値で電圧源の異常検出が可能となり、
適性な電圧異常検出を行うことができるという効果を有
する。
電源を必要とする磁気ディスク装置において、磁気ディ
スク装置を制御するＭＰＵの１Ｉ／Ｏポートを使用して
外部ＤＣ電圧源の異常検出回路の基準電圧を可変とする
ことにより、磁気ディスク装置のスピンドル回転起動時
における過渡的な電圧低下を電圧異常として検出して機
能停止することを排除し、またスピンドル回転起動時か
ら定常回転中は、ファインな異常検出モードへと切り替
えて２種類の基準値で電圧源の異常検出が可能となり、
適性な電圧異常検出を行うことができるという効果を有
する。
【図１】本発明の一実施例のブロック図である。
１ マイクロ・プロセッサ・ユニット ２ コンパレータ ３ 固定抵抗Ｚ（１） ４ 可変抵抗Ｚ（２） ５ 固定抵抗Ｚ（３） ６ 固定抵抗Ｚ（４） ７ 固定抵抗Ｚ（５） １０１ 検出レベル制御信号線 １０２ 異常検出信号線 １０３ 基準電圧 １０４ 検出電圧 ２０１ 複合抵抗器群（Ａ） ２０２ 複合抵抗器群（Ｂ）
Claims (2)
- 【請求項１】 外部から少なくとも２種類のＤＣ電源を
受け、マイクロ・プロセッサ・ユニットの制御をもとに
動作する磁気ディスク装置の前記ＤＣ電源の電圧異常を
検出する磁気ディスク装置の電源電圧異常検出回路にお
いて、グランドレベルによる論理値０レベルを出力する
モードとハイ・インピーダンス状態となるモードとのい
ずれかのモードをＩ／Ｏポートに設定可能なマイクロ・
プロセッサ・ユニットと、外部から所定の電圧を印加さ
れ前記Ｉ／Ｏポートの設定モードに対応して相異る分圧
電圧を２種類の基準電圧として出力する第一の複合抵抗
器群と、前記ＤＣ電源の１種類を印加されこれを所定の
分圧比で分圧して電源電圧異常検出用の検出電圧として
出力する第二の複合抵抗器群と、前記基準電圧と前記検
出電圧とを比較して前記ＤＣ電源の電圧異常の有無を検
出するコンパレータとを備えて成ることを特徴とする磁
気ディスク装置の電源電圧異常検出回路。 - 【請求項２】 請求項１記載の磁気ディスク装置の電源
電圧異常検出回路を装備したことを特徴とする磁気ディ
スク装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4048369A JP2929827B2 (ja) | 1992-03-05 | 1992-03-05 | 磁気ディスク装置の電源電圧異常検出回路および磁気ディスク装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP4048369A JP2929827B2 (ja) | 1992-03-05 | 1992-03-05 | 磁気ディスク装置の電源電圧異常検出回路および磁気ディスク装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05252655A JPH05252655A (ja) | 1993-09-28 |
| JP2929827B2 true JP2929827B2 (ja) | 1999-08-03 |
Family
ID=12801426
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP4048369A Expired - Lifetime JP2929827B2 (ja) | 1992-03-05 | 1992-03-05 | 磁気ディスク装置の電源電圧異常検出回路および磁気ディスク装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2929827B2 (ja) |
-
1992
- 1992-03-05 JP JP4048369A patent/JP2929827B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05252655A (ja) | 1993-09-28 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 19990420 |