JP2885570B2 - セル生成回路 - Google Patents
セル生成回路Info
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- JP2885570B2 JP2885570B2 JP9206892A JP9206892A JP2885570B2 JP 2885570 B2 JP2885570 B2 JP 2885570B2 JP 9206892 A JP9206892 A JP 9206892A JP 9206892 A JP9206892 A JP 9206892A JP 2885570 B2 JP2885570 B2 JP 2885570B2
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Description
【０００１】
【産業上の利用分野】本発明は、広帯域ＩＳＤＮ（サー
ビス統合デジタル網）の、非同期転送方式における固定
長パケットであるセルの生成方式に関し、特にパケット
データ等の送信相手先のアドレス情報が通信データに含
まれるデータに対するセル化方式に関する。
ビス統合デジタル網）の、非同期転送方式における固定
長パケットであるセルの生成方式に関し、特にパケット
データ等の送信相手先のアドレス情報が通信データに含
まれるデータに対するセル化方式に関する。
【０００２】
【従来の技術】従来方式のパケットデータに対するセル
生成は、図３に示すように、パケットデータ１１のアド
レス情報により各アドレス毎に分配器１６で分配し、分
配された通信データ１２はチャネル毎にバッファ器１７
で固定長データ１３に区切られた後、セル組立器１８で
セルデータ１４に変換される。このとき、使用されるセ
ルのチャネル情報はセル組立器１８で一つ持っている。
さらに、セルデータは多重器１９により多重セルデータ
１５として出力されるという方法で多重セルに変換され
るものである。
生成は、図３に示すように、パケットデータ１１のアド
レス情報により各アドレス毎に分配器１６で分配し、分
配された通信データ１２はチャネル毎にバッファ器１７
で固定長データ１３に区切られた後、セル組立器１８で
セルデータ１４に変換される。このとき、使用されるセ
ルのチャネル情報はセル組立器１８で一つ持っている。
さらに、セルデータは多重器１９により多重セルデータ
１５として出力されるという方法で多重セルに変換され
るものである。
【０００３】
【発明が解決しようとする課題】従来の構成では、セル
生成を各チャネル対応で行っているため、パケットデー
タ１１の送信相手数、即ち多重度に比例して、バッファ
器１７とセル組立器１８との設置数も大きくなり、膨大
な装置規模となるという問題がある。
生成を各チャネル対応で行っているため、パケットデー
タ１１の送信相手数、即ち多重度に比例して、バッファ
器１７とセル組立器１８との設置数も大きくなり、膨大
な装置規模となるという問題がある。
【０００４】また、従来の構成では、セル生成を行うパ
ケットデータのアドレス情報と入力アドレス情報の比較
に時間が最大セル化を行うアドレス数分かかるという問
題がある。
ケットデータのアドレス情報と入力アドレス情報の比較
に時間が最大セル化を行うアドレス数分かかるという問
題がある。
【０００５】本発明の目的は、前記課題を解決したセル
生成回路を提供することにある。
生成回路を提供することにある。
【０００６】
【課題を解決するための手段】前記目的を達成するた
め、本発明に係るセル生成回路は、通信データ中に相手
先の第１のアドレス情報を含むデータを多重入力し、広
帯域ＩＳＤＮ（サービス統合デジタル網）の非同期転送
方式の固定長パケットであるセルに分割して、送信相手
先別にセル内のチャネル番号を割り当てるセル生成回路
であって、 リードアドレスにより読み出される第２のア
ドレス情報と出力セルのチャネルナンバーに対応した中
間アドレスが前記第２のアドレス情報の値の大小関係の
順番に蓄積されている第１のメモリと、 前記中間アドレ
スによってセルのチャネル番号が読み出される第２のメ
モリと、 多重入カデータの送信相手先の前記第１のアド
レス情報をあらかじめ定められた値で除算した商である
比較開始アドレスを生成する比較開始アドレス生成手段
と、 前記第１のメモリから読み出された前記第２のアド
レス情報の値と入力データの前記第１のアドレス情報の
値との大小関係の比較を行うアドレス情報比較手段と、
前記アドレス情報比較手段の結果から入カデータの前記
第１のアドレス情報が大きい場合に前記第１のメモリの
前記リードアドレスをカウントアップさせ、前記第１の
アドレス情報が小さい場合にカウントダウンすることで
アドレス情報が一致するまで変化させるリードアドレス
コントロール手段と、 前記第１のメモリから読み出され
た前記第２のアドレス情報と入力データの前記第１のア
ドレス情報が一致したときの信号と読み出された中間ア
ドレスを前記第２のメモリのアドレスとして前記第２の
メモリの内容を読み出すメモリリード手段と、 入力デー
タをセル長に分割するデータ分割手段と、 前記データ分
割手段によって分割された固定長データとメモリリード
手段によって読み出されたセルのチャネル番号とからセ
ルを組み立てるセル組み立て手段とを有するものであ
る。
め、本発明に係るセル生成回路は、通信データ中に相手
先の第１のアドレス情報を含むデータを多重入力し、広
帯域ＩＳＤＮ（サービス統合デジタル網）の非同期転送
方式の固定長パケットであるセルに分割して、送信相手
先別にセル内のチャネル番号を割り当てるセル生成回路
であって、 リードアドレスにより読み出される第２のア
ドレス情報と出力セルのチャネルナンバーに対応した中
間アドレスが前記第２のアドレス情報の値の大小関係の
順番に蓄積されている第１のメモリと、 前記中間アドレ
スによってセルのチャネル番号が読み出される第２のメ
モリと、 多重入カデータの送信相手先の前記第１のアド
レス情報をあらかじめ定められた値で除算した商である
比較開始アドレスを生成する比較開始アドレス生成手段
と、 前記第１のメモリから読み出された前記第２のアド
レス情報の値と入力データの前記第１のアドレス情報の
値との大小関係の比較を行うアドレス情報比較手段と、
前記アドレス情報比較手段の結果から入カデータの前記
第１のアドレス情報が大きい場合に前記第１のメモリの
前記リードアドレスをカウントアップさせ、前記第１の
アドレス情報が小さい場合にカウントダウンすることで
アドレス情報が一致するまで変化させるリードアドレス
コントロール手段と、 前記第１のメモリから読み出され
た前記第２のアドレス情報と入力データの前記第１のア
ドレス情報が一致したときの信号と読み出された中間ア
ドレスを前記第２のメモリのアドレスとして前記第２の
メモリの内容を読み出すメモリリード手段と、 入力デー
タをセル長に分割するデータ分割手段と、 前記データ分
割手段によって分割された固定長データとメモリリード
手段によって読み出されたセルのチャネル番号とからセ
ルを組み立てるセル組み立て手段とを有するものであ
る。
【０００７】
【０００８】
【作用】多重通信データのアドレス情報をメモリアドレ
スに変換することにより、多重通信データのセル生成回
路を小規模に構成する。
スに変換することにより、多重通信データのセル生成回
路を小規模に構成する。
【０００９】
【実施例】本発明について図面を参照して説明する。
【００１０】（参考例）図１は、本発明の参考例を示す
ブロック図である。
ブロック図である。
【００１１】図１に示すセル生成回路は、通信データ中
に相手先のアドレス情報を含むデータを多重入力し、広
帯域ＩＳＤＮ（サービス統合デジタル網）の非同期転送
方式の固定長パケットであるセルに分割して、送信相手
先別にセル内のチャネル番号を割り当てるものであり、
多重入カデータの送信相手先アドレス情報をメモリのア
ドレスに変換するアドレス変換手段９と、変換されたア
ドレスによってセルのチャネル番号が読み出されるセル
チャネルメモリ１０と、入カデータをセル長に分割する
データ分割手段７と、データ分割手段７によって分割さ
れた固定長データとメモリ１０から読み出されたセルの
チャネル番号とからセルを組み立てるセル組み立て手段
８とを有するものである。
に相手先のアドレス情報を含むデータを多重入力し、広
帯域ＩＳＤＮ（サービス統合デジタル網）の非同期転送
方式の固定長パケットであるセルに分割して、送信相手
先別にセル内のチャネル番号を割り当てるものであり、
多重入カデータの送信相手先アドレス情報をメモリのア
ドレスに変換するアドレス変換手段９と、変換されたア
ドレスによってセルのチャネル番号が読み出されるセル
チャネルメモリ１０と、入カデータをセル長に分割する
データ分割手段７と、データ分割手段７によって分割さ
れた固定長データとメモリ１０から読み出されたセルの
チャネル番号とからセルを組み立てるセル組み立て手段
８とを有するものである。
【００１２】まず、入力したパケットデータ１のアドレ
ス情報をアドレス変換手段９で通信パケットデータの先
頭を示す先頭信号２から、通信パケットデータのアドレ
ス情報を検出し、そのアドレス情報に対応したセルチャ
ネル情報５が蓄積されているメモリアドレス４に変換さ
れる。
ス情報をアドレス変換手段９で通信パケットデータの先
頭を示す先頭信号２から、通信パケットデータのアドレ
ス情報を検出し、そのアドレス情報に対応したセルチャ
ネル情報５が蓄積されているメモリアドレス４に変換さ
れる。
【００１３】また、入力したパケットデータは、データ
分割手段７でセルのフォーマットに必要な固定長データ
３に区切られ、セル組立手段８でセルチャネルメモリ１
０から読み出されたセルチャネル情報５と、固定長デー
タ３から多重セルデータ６を出力するものである。
分割手段７でセルのフォーマットに必要な固定長データ
３に区切られ、セル組立手段８でセルチャネルメモリ１
０から読み出されたセルチャネル情報５と、固定長デー
タ３から多重セルデータ６を出力するものである。
【００１４】（実施例）図２は、本発明の実施例を示す
ブロック図である。
ブロック図である。
【００１５】本実施例は、入力多重通信データのセル生
成において、アドレスからチャネルに変換するときのメ
モリアクセスの回数を小さくすること、すなわち、アド
レス情報の値の順番にメモリに蓄積することと比較開始
アドレスからメモリアドレスを変化させることでメモリ
アクセスの回数を減らせることにある。
成において、アドレスからチャネルに変換するときのメ
モリアクセスの回数を小さくすること、すなわち、アド
レス情報の値の順番にメモリに蓄積することと比較開始
アドレスからメモリアドレスを変化させることでメモリ
アクセスの回数を減らせることにある。
【００１６】具体的には、入力アドレス情報２４から作
られる比較開始アドレス２３により、セル化アドレス情
報２６の値の順番に蓄積されているアドレス情報メモリ
３６から読み出されるセル化アドレス情報２６と入力ア
ドレス２４を比較し比較結果からアドレス情報メモリア
ドレス２５を変化させ出力セルデータ３３のチャネル情
報３２に対応した中間アドレス２７を導くことを特徴と
する。
られる比較開始アドレス２３により、セル化アドレス情
報２６の値の順番に蓄積されているアドレス情報メモリ
３６から読み出されるセル化アドレス情報２６と入力ア
ドレス２４を比較し比較結果からアドレス情報メモリア
ドレス２５を変化させ出力セルデータ３３のチャネル情
報３２に対応した中間アドレス２７を導くことを特徴と
する。
【００１７】次に本実施例の構成について説明する。本
実施例は、通信データの中に相手先の第１のアドレス情
報を含むデータを多重入力し、広帯域ＩＳＤＮ（サービ
ス統合デジタル網）の非同期転送方式の固定長パケット
であるセルに分割して、送信相手先別にセル内のチャネ
ル番号を割り当てるセル生成回路を対象とするものであ
り、リードアドレスにより読み出される第２のアドレス
情報２６と出力セルのチャネルナンバに対応した中間ア
ドレス２７が前記第２のアドレス情報の値の大小関係の
順番に蓄積されているアドレス情報メモリ３６と、中間
アドレス２７によってセルのチャネル番号が読み出され
るセルチャネルメモリ４０とを有している。
実施例は、通信データの中に相手先の第１のアドレス情
報を含むデータを多重入力し、広帯域ＩＳＤＮ（サービ
ス統合デジタル網）の非同期転送方式の固定長パケット
であるセルに分割して、送信相手先別にセル内のチャネ
ル番号を割り当てるセル生成回路を対象とするものであ
り、リードアドレスにより読み出される第２のアドレス
情報２６と出力セルのチャネルナンバに対応した中間ア
ドレス２７が前記第２のアドレス情報の値の大小関係の
順番に蓄積されているアドレス情報メモリ３６と、中間
アドレス２７によってセルのチャネル番号が読み出され
るセルチャネルメモリ４０とを有している。
【００１８】また、多重入力データの送信相手先の前記
第１のアドレス情報をあらかじめ定められた値で除算し
た商である比較開始アドレス生成手段３５と、メモリ３
６から読み出された第２のアドレス情報２６の値と入力
データの前記第１のアドレス情報２４の値との大小関係
の比較を行うアドレス情報比較手段３８と、アドレス情
報比較手段３８の結果から入力データの前記第１のアド
レス情報が大きい時メモリ３６の前記リードアドレスを
カウントアップさせ、前記第１のアドレス情報が小さい
時カウントダウンすることでアドレス情報が一致するま
で変化させるリードアドレスコントロール手段３７とメ
モリ３６から読み出された前記第２のアドレス情報と入
力データの前記第１のアドレス情報が一致したときの信
号と読み出された中間アドレスをメモリ４０のアドレス
としてメモリ４０の内容を読み出すメモリリード手段４
１とを有している。
第１のアドレス情報をあらかじめ定められた値で除算し
た商である比較開始アドレス生成手段３５と、メモリ３
６から読み出された第２のアドレス情報２６の値と入力
データの前記第１のアドレス情報２４の値との大小関係
の比較を行うアドレス情報比較手段３８と、アドレス情
報比較手段３８の結果から入力データの前記第１のアド
レス情報が大きい時メモリ３６の前記リードアドレスを
カウントアップさせ、前記第１のアドレス情報が小さい
時カウントダウンすることでアドレス情報が一致するま
で変化させるリードアドレスコントロール手段３７とメ
モリ３６から読み出された前記第２のアドレス情報と入
力データの前記第１のアドレス情報が一致したときの信
号と読み出された中間アドレスをメモリ４０のアドレス
としてメモリ４０の内容を読み出すメモリリード手段４
１とを有している。
【００１９】さらに入力データをセル長に分割するデー
タ分割手段１５と、データ分割手段１５によって分割さ
れた固定長データとセルチャネルメモリリード手段４１
によって読み出されたセルのチャネル番号とからセルを
組み立てるセル組み立て手段１９とを有している。
タ分割手段１５と、データ分割手段１５によって分割さ
れた固定長データとセルチャネルメモリリード手段４１
によって読み出されたセルのチャネル番号とからセルを
組み立てるセル組み立て手段１９とを有している。
【００２０】まず、比較開始アドレス生成手段３５で入
力したパケットデータ２１とパケットデータの先頭を示
す先頭信号２２から入力アドレス情報２４を検出し、さ
らにその入力アドレス情報２４をセル化するアドレス数
により割り算しその商を比較開始アドレス２３として生
成する。
力したパケットデータ２１とパケットデータの先頭を示
す先頭信号２２から入力アドレス情報２４を検出し、さ
らにその入力アドレス情報２４をセル化するアドレス数
により割り算しその商を比較開始アドレス２３として生
成する。
【００２１】比較開始アドレス２３は、リードアドレス
コントロール手段３７でアドレス情報メモリアドレス２
５としてセル化するアドレス情報値の小さい順番に蓄積
されているアドレス情報メモリ３６からセル化アドレス
情報２６と中間アドレス２７を読み出す。そして読み出
されたセル化アドレス情報２６と入力アドレス情報２４
を比較し、一致が取れていればセルチャネルメモリリー
ド手段４１にアドレス一致信号２８を出力し、一致が取
れていない場合はリードアドレスコントロール手段３７
へ入力アドレス情報２４とセル化アドレス情報２６の大
小関係の示してあるアドレス不一致信号３０を出力す
る。
コントロール手段３７でアドレス情報メモリアドレス２
５としてセル化するアドレス情報値の小さい順番に蓄積
されているアドレス情報メモリ３６からセル化アドレス
情報２６と中間アドレス２７を読み出す。そして読み出
されたセル化アドレス情報２６と入力アドレス情報２４
を比較し、一致が取れていればセルチャネルメモリリー
ド手段４１にアドレス一致信号２８を出力し、一致が取
れていない場合はリードアドレスコントロール手段３７
へ入力アドレス情報２４とセル化アドレス情報２６の大
小関係の示してあるアドレス不一致信号３０を出力す
る。
【００２２】リードアドレスコントロール手段３７では
アドレス不一致信号３０を受け入力アドレス情報２４の
値がセル化アドレス情報２６の値より大きいときはアド
レス情報メモリアドレス２５をインクリメントし、セル
化アドレス情報２６の値が入力アドレス情報２４の値よ
り大きいときはアドレス情報メモリアドレス２５をデク
リメントしアドレス一致が取れるまで行う。
アドレス不一致信号３０を受け入力アドレス情報２４の
値がセル化アドレス情報２６の値より大きいときはアド
レス情報メモリアドレス２５をインクリメントし、セル
化アドレス情報２６の値が入力アドレス情報２４の値よ
り大きいときはアドレス情報メモリアドレス２５をデク
リメントしアドレス一致が取れるまで行う。
【００２３】アドレス一致信号２８が有効のときセルチ
ャネルメモリリード変換手段４１では中間アドレス２７
をリード中間アドレス３１に変換しセルチャネルメモリ
４０からセルチャネル情報３２を読み出す。
ャネルメモリリード変換手段４１では中間アドレス２７
をリード中間アドレス３１に変換しセルチャネルメモリ
４０からセルチャネル情報３２を読み出す。
【００２４】入力パケットデータ２１はデータ分割手段
３４で固定長データ２９に分割されセル組立手段３９に
出力され、セル組立手段３９でセルチャネル情報３２と
固定長データから出力セルデータ３３を生成する。
３４で固定長データ２９に分割されセル組立手段３９に
出力され、セル組立手段３９でセルチャネル情報３２と
固定長データから出力セルデータ３３を生成する。
【００２５】本実施例によれば、アドレス情報を順番に
蓄積し、比較開始アドレスを決めることによりアドレス
情報の検索を従来方式に比べ短時間に行える。
蓄積し、比較開始アドレスを決めることによりアドレス
情報の検索を従来方式に比べ短時間に行える。
【００２６】
【発明の効果】以上説明したように本発明は、パケット
系データのアドレス情報をメモリのアドレスに変換し、
メモリからセルのチャネル情報を読み出すことにより、
大多重通信データのセル生成回路を小規模化できるとい
う効果を有する。
系データのアドレス情報をメモリのアドレスに変換し、
メモリからセルのチャネル情報を読み出すことにより、
大多重通信データのセル生成回路を小規模化できるとい
う効果を有する。
【図１】本発明の参考例を示すブロック図である。
【図２】本発明の実施例を示すブロック図である。
【図３】従来例を示すブロック図である。
１ パケットデータ ２ 先頭信号 ３ 固定長データ ４ メモリアドレス ５ セルチャネル情報 ６ 多重セルデータ ７ データ分割手段 ８ セル組み立て手段 ９ アドレス変換手段 １０ セルチャネルメモリ ２１ パケットデータ ２２ 先頭信号 ２３ 比較開始アドレス ２４ 入力アドレス情報 ２５ アドレス情報メモリアドレス ２６ セル化アドレス情報 ２７ 中間アドレス ２８ アドレス一致信号 ２９ 固定長データ ３０ アドレス不一致信号 ３１ リード中間アドレス ３２ セルチャネル情報 ３３ 出力セルデータ ３４ データ分割手段 ３５ 比較開始アドレス生成手段 ３６ アドレス情報メモリ ３７ リードアドレスコントロール手段 ３８ アドレス情報比較手段 ３９ セル組み立て手段
Claims (1)
- 【請求項１】 通信データ中に相手先の第１のアドレス
情報を含むデータを多重入力し、広帯域ＩＳＤＮ（サー
ビス統合デジタル網）の非同期転送方式の固定長パケッ
トであるセルに分割して、送信相手先別にセル内のチャ
ネル番号を割り当てるセル生成回路であって、 リードアドレスにより読み出される第２のアドレス情報
と出力セルのチャネルナンバーに対応した中間アドレス
が前記第２のアドレス情報の値の大小関係の順番に蓄積
されている第１のメモリと、 前記中間アドレスによってセルのチャネル番号が読み出
される第２のメモリと、 多重入カデータの送信相手先の前記第１のアドレス情報
をあらかじめ定められた値で除算した商である比較開始
アドレスを生成する比較開始アドレス生成手段と、前記 第１のメモリから読み出された前記第２のアドレス
情報の値と入力データの前記第１のアドレス情報の値と
の大小関係の比較を行うアドレス情報比較手段と、前記 アドレス情報比較手段の結果から入カデータの前記
第１のアドレス情報が大きい場合に前記第１のメモリの
前記リードアドレスをカウントアップさせ、前記第１の
アドレス情報が小さい場合にカウントダウンすることで
アドレス情報が一致するまで変化させるリードアドレス
コントロール手段と、前記 第１のメモリから読み出された前記第２のアドレス
情報と入力データの前記第１のアドレス情報が一致した
ときの信号と読み出された中間アドレスを前記第２のメ
モリのアドレスとして前記第２のメモリの内容を読み出
すメモリリード手段と、 入力データをセル長に分割するデータ分割手段と、前記 データ分割手段によって分割された固定長データと
メモリリード手段によって読み出されたセルのチャネル
番号とからセルを組み立てるセル組み立て手段とを有す
ることを特徴とするセル生成回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP9206892A JP2885570B2 (ja) | 1991-05-14 | 1992-03-18 | セル生成回路 |
Applications Claiming Priority (3)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP3-138444 | 1991-05-14 | ||
| JP13844491 | 1991-05-14 | ||
| JP9206892A JP2885570B2 (ja) | 1991-05-14 | 1992-03-18 | セル生成回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH05110587A JPH05110587A (ja) | 1993-04-30 |
| JP2885570B2 true JP2885570B2 (ja) | 1999-04-26 |
Family
ID=26433554
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP9206892A Expired - Fee Related JP2885570B2 (ja) | 1991-05-14 | 1992-03-18 | セル生成回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2885570B2 (ja) |
-
1992
- 1992-03-18 JP JP9206892A patent/JP2885570B2/ja not_active Expired - Fee Related
Non-Patent Citations (1)
| Title |
|---|
| 信学技報 ＳＳＥ９０−１２８ |
Also Published As
| Publication number | Publication date |
|---|---|
| JPH05110587A (ja) | 1993-04-30 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| R250 | Receipt of annual fees |
Free format text: JAPANESE INTERMEDIATE CODE: R250 |
|
| LAPS | Cancellation because of no payment of annual fees |