JP2885164B2 - 超格子アバランシェフォトダイオード - Google Patents
超格子アバランシェフォトダイオードInfo
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Description
信頼特性を有するプレーナ型の超格子アバランシェフォ
トダイオード(APD)の構造に関する。
用受光素子として、図4に示すような超格子アバランシ
ェフォトダイオードが報告されている(アプライド フ
ィジックス レターズ。Appl. Phys. Lett., 1895 〜18
97ページ、57巻、1990年)。この素子では増倍層
として用いるInGaAs/InAlAs超格子のイオ
ン化率比増大効果で高利得帯域幅積(GB積)、低雑音
化がなされている。
42はn+ 型InPバッファ層、43はノンドープIn
GaAs/InAlAs超格子増倍層、44はp型In
P電界緩和層、45はp- 型InGaAs光吸収層、4
6はp+ 型InPキャップ層、47はp+ 型InGaA
sコンタクト層、48は表面パッシベーション膜、49
はp電極、410はn電極である。
代表される従来の超格子APDはメサ型構造であり、メ
サ端面の表面パッシベーション膜48としてSiNもし
くはポリイミドが用いられているが、このような構造で
は、素子雑音を支配する暗電流(主に表面リーク暗電
流)が経時的に増大するため、素子寿命が短いという欠
点を有している。
ものの、すでに高信頼特性が確認されているプレーナ型
3元APO(ジャーナル オブ ライトウェイブ テク
ノロジー。Journal of Lightwave Technology, 1643 〜
1655ページ、6巻、1988年)の素子構造を図5に示
す。図5において、51はn+ 型InP基板、52はn
型InPバッファ層、53はノンドープInGaAs光
吸収層、54はn型InGaAsP中間組成層、55は
n型InP増倍層、56はp+ 型InPキャップ層、5
7はp+ 型ガードリング部である。
合部56は急峻なプロファイルの得られるZn拡散で、
また、ガードリング部57はグレーデッドな(濃度が徐
々に変化している)プロファイルの得られるBeイオン
注入により形成されている。しかし、同様の構造を電子
を倍増するIn(Al)GaAs/InAlAs超格子
もしくはInGaAs(P)/InAlAs超格子を用
いる超格子APDで実現するには、n型領域を形成しな
ければならないが、現在の拡散、イオン注入技術では、
InPやInAlAs等の半導体材料に所望のプロファ
イルを深さ精度良く形成することができないという問題
点がある。
として小川らが提案する構造(特開昭61−19967
5)を図6に示す。図6において、61はn+ 型InP
基板、62はn- 型InGaAs光吸収層、63はp+
型InGaAs、64は高抵抗領域、65は絶縁膜、6
6はp電極、67はn電極、68は受光領域である。
打ち込みにより形成した高抵抗領域64がpn接合端面
を埋め込んでいるが、一般にプロトンのイオン注入によ
る高抵抗化は、イオン注入ダメージにより半導体中に欠
陥が導入され、これが深い準位(禁制帯の中央付近に形
成される不純物準位)を形成して、キャリアを補償して
高抵抗化するというメカニズムをもつ。特に、この従来
例では受光領域68外の高濃度p型領域を高抵抗化して
いるが、このような高濃度p領域を高抵抗化するには、
高ドーズのイオン打ち込みが必要となり、これにより高
濃度の欠陥が導入されるという欠点を有する。このため
pin構造に逆方向電界を印加する受光素子の場合、こ
の欠陥が暗電流の増大を招き実用上使用不可能なレベル
に達する。すなわち、本従来例に記載の高抵抗形成手法
(プロトンに代表される軽質量元素のイオン注入)で
は、元ウェハにおいて高濃度p、あるいはn型キャップ
層が全面につながっている層構造である場合、低暗電流
の受光素子を形成することができない。
型超格子APDを提供することである。
シェフォトダイオードは、第1導電型半導体基板に、第
1導電型半導体バッファ層、ノンドープ超格子増倍層、
第2導電型半導体電界緩和層、第2導電型半導体光吸収
層、第1導電型半導体キャップ層、第1導電型半導体コ
ンタクト層を順次積層した光吸収増倍分離型の超格子ア
バランシェフォトダイオードの受光領域の外周領域で、
第2導電型半導体電界緩和層と該第2導電型光吸収層の
2層もしくは第2導電型光吸収層の1層を選択的に第1
導電型化もしくは高抵抗化し、かつ、前記第1導電型半
導体キャップ層および第1導電型半導体コンタクト層
の、受光領域で限定された領域と、選択的に第1導電型
化した光吸収層で受光領域と接する領域の、第1導電型
半導体キャップ層および第1導電型半導体コンタクト層
を含む領域とを選択的に第2導電型化した構造を有する
ことを特徴とする。
は、選択的第1導電型化もしくは高抵抗化領域を、T
i,Fe,Co,Oのイオン注入とそれに引き続く熱ア
ニールを用いて形成されている。
イオードは、選択的第1導電型化もしくは高抵抗化領域
を、H,He,Bのイオン注入によって形成されてい
る。
ェフォトダイオードの素子構造を示す図、図2は本発明
と従来例の電界分布を説明する図である。
ンシェフォトダイオードは、第1導電型半導体基板11
に、第1導電型半導体バッファ層12、ノンドープ半導
体超格子増倍層13、第2導電型半導体電界緩和層1
4、第2導電型半導体光吸収層15、第1導電型半導体
キャップ層16、第1導電型半導体コンタクト層17を
順次積層した光吸収倍増分離型の超格子アバランシェフ
ォトダイオードであって、受光領域19の外周領域で、
第2導電型半導体電界緩和層14と第2導電型光吸収層
15の2層(第2導電型光吸収層15の1層でもよい)
を選択的に第1導電型化もしくは高抵抗化した領域18
を有し、かつ、第1導電型半導体キャップ層16および
第1導電型半導体コンタクト層17の、受光領域19で
限定された領域1101と、前記の選択的第1導電型化
もしくは高抵抗化した光吸収層18で受光領域19と接
する領域の、第1導電型半導体キャップ層16および第
1導電型半導体コンタクト層17を含む領域1102と
を選択的に第2導電型化した構造を有する。
のように、選択的に第2導電型化した領域110が、選
択的に第1導電型化あるいは高抵抗化した領域18の一
部の上部を覆うような構造となっているため、電界緩和
層14の受光領域19外周部では、電界分布21の曲率
が大きくなっていることがわかる。このためエッジ部2
0での電界集中が抑制され、エッジ増倍(エッジ部20
のみ強調された不均一増幅)が抑制されて均一な増倍分
布が得られる。さらに、選択的に第1導電型化あるいは
高抵抗化した領域18を形成する手段としてTi,F
e,Co,Oのイオン注入とそれに引き続いて熱アニー
ルを用いるため、軽質量イオン注入で形成される欠陥が
生成されないので、素子の暗電流が小さいという利点を
有する。
濃度pあるいはn型キャップ層が全面につながっていな
い層構造であるため、選択的高抵抗化領域18を形成す
る手段としてH,He,B等の軽質量イオン注入を用い
ても、これにより形成される欠陥が少量でも高抵抗化が
生じるので、素子の暗電流が小さいという利点を有す
る。
例では、選択的第2導電型領域110’が、選択的高抵
抗化領域18の一部の上部を覆わない構造となっている
ため、増倍層13の受光領域外周部では、電界分布21
の曲率が小さくなっていることがわかる。このためエッ
ジ部20での電界集中が発生し、エッジ増倍が発生して
均一な増倍分布が得られない。さらに、元ウェハにおい
て高濃度p、あるいはn型キャップ層が全面につながっ
ている層構造であるため、選択的高抵抗化領域18を形
成する手段として高ドーズの軽質量イオン注入を用いて
いるので、非常に多くの欠陥が生成され、素子の暗電流
が大きいという欠点を有する。
明する。
InAlAs超格子APDの場合の実施例について説明
する。
nPバッファ層12を0.2μm、ノンドープInAl
GaAs/InAlAs超格子倍増層13を0.23μ
m、p+ 型InP電界緩和層14を30〜100nm、
p- 型InGaAs光吸収層15を1μm、n- 型In
Pキャップ層16を0.5μm、n- 型InGaAsコ
ンタクト層17を0.1μm、順次ガスソースMBE法
で積層する(図3(a))。次に、受光領域19の外周
領域で、前述のp+ 型InP電界緩和層14とp- In
GaAs光吸収層15、およびn- InPキャップ層1
6、n- 型InGaAsコンタクト層17に選択的にT
iイオンを注入し、引き続いてアニールを600〜70
0℃で施し高抵抗化領域18を形成する(図3
(b))。次に、受光領域19のn- 型InPキャップ
層16とn- 型InGaAsコンタクト層17を含む領
域1101と、前述の選択的に高抵抗化した光吸収層1
8で受光領域19と接する領域の上部の、InPキャッ
プ層16とInGaAsコンタクト層17を含む領域1
102を、選択的にZnの熱拡散によりp+ 型化した領
域110を形成する(図3(c))。最後に、パッシベ
ーション膜111、p電極112、n電極113、AR
コート114を形成する。
レーナ型超格子アバランシェフォトダイオードが製作で
きる。
Aの低暗電流で高速な(GB積120GHz)特性が確
認され、さらには、暗電流の経時的安定性も、例えば1
50℃のエージングで1000時間経過後も暗電流の増
加が全くない高信頼な特性が確認された。
o,O等にした場合も基本的プロセスは同様である。
As/InAlAs超格子APDの場合の実施例につい
て説明する。
nPバッファ層12を0.2μm、ノンドープInAl
GaAs/InAlAs超格子増倍層13を0.23μ
m、p+ 型InP電界緩和層14を30〜100nm、
p- 型InGaAs光吸収層15を1μm、n- 型In
Pキャップ層16を0.5μm、n- 型InGaAsコ
ンタクト層17を0.1μm、順次ガスソースMBE法
で積層する。次に、受光領域19となる領域の、n- 型
InPキャップ層16とn- 型InGaAsコンタクト
層17を含む領域を、選択的にZnの熱拡散によりp+
型化した領域110を形成する。次に、受光領域19の
外周域でp+ 型化InPキャップ層とp + 型化InGa
Asコンタクト層と重なる部分を持ちながら、InPキ
ャップ層とInGaAsコンタクト層およびp+ 型In
P電界緩和層14に選択的にHeイオンを注入し高抵抗
化領域18を形成する。最後に、パッシベーション膜1
11、p電極112、n電極113、ARコート114
を形成する。
レーナ型超格子アバランシェフォトダイオードが製作で
きる。
Aの低暗電流で高速な(GB積120GHz)特性が確
認され、さらには、暗電流の経時的安定性も、例えば1
50℃のエージングで1000時間経過後も暗電流の増
加が全くない高信頼な特性が確認された。
にした場合も基本的プロセスは同様である。
信頼性で、低暗電流、高速応答のプレーナ型超格子AP
Dが製作でき、2.5〜10Gb/sの高信頼な幹線系
光通信システム用受光素子が実現できる。
の素子構造を示す図である。
る。
る。
域 19 受光領域 20 エッジ部 21 電界分布 110,1101,1102 選択的に第2導電型化し
た領域 111 パッシベーション膜 112 p電極 113 n電極 114 ARコート 41 n+ 型InP基板 42 n+ 型InPバッファ層 43 ノンドープInGaAs/InAlAs超格子
増倍層 44 p型InP電界緩和層 45 p- 型InGaAs光吸収層 46 p+ 型InPキャップ層 47 p+ 型InGaAsコンタクト層 48 表面パッシベーション膜 49 p電極 410 n電極 51 n+ 型InP基板 52 n型InPバッファ層 53 ノンドープInGaAs光吸収層 54 n型InGaAs中間組成層 55 n型InP増倍層 56 p+ 型InPキャップ層 57 p+ 型ガードリング 61 n+ InP基板 62 n- 型InGaAs光吸収層 63 p+ 型InGaAs 64 高抵抗領域 65 絶縁膜 66 p電極 67 n電極 68 受光領域
Claims (3)
- 【請求項1】 第1導電型半導体基板に、第1導電型半
導体バッファ層、ノンドープ超格子増倍層、第2導電型
半導体電界緩和層、第2導電型半導体光吸収層、第1導
電型半導体キャップ層、第1導電型半導体コンタクト層
を順次積層した光吸収増倍分離型の超格子アバランシェ
フォトダイオードにおいて、 受光領域の外周領域で、前記第2導電型半導体電界緩和
層と前記第2導電型光吸収層の2層もしくは前記第2導
電型光吸収層の1層を選択的に第1導電型化もしくは高
抵抗化し、かつ、前記第1導電型半導体キャップ層およ
び前記第1導電型半導体コンタクト層の、前記受光領域
で限定された領域と、前記の選択的に第1導電型化ある
いは高抵抗化された光吸収層で前記受光領域と接する領
域の、前記第1導電型半導体キャップ層および前記第1
導電型半導体コンタクト層を含む領域とを選択的に第2
導電型化した構造を有することを特徴とする超格子アバ
ランシェフォトダイオード。 - 【請求項2】 選択的第1導電型化もしくは高抵抗化領
域の形成のために、Ti,Fe,Co,Oのイオン注入
とそれに引き続いて熱アニールを用いて形成された請求
項1記載の超格子アバランシェフォトダイオード。 - 【請求項3】 選択的第1導電型化もしくは高抵抗化領
域の形成のために、H,He,Bのイオン注入を用いて
形成された請求項1記載の超格子アバランシェフォトダ
イオード。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8008451A JP2885164B2 (ja) | 1996-01-22 | 1996-01-22 | 超格子アバランシェフォトダイオード |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP8008451A JP2885164B2 (ja) | 1996-01-22 | 1996-01-22 | 超格子アバランシェフォトダイオード |
Publications (2)
Publication Number | Publication Date |
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JPH09199753A JPH09199753A (ja) | 1997-07-31 |
JP2885164B2 true JP2885164B2 (ja) | 1999-04-19 |
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ID=11693499
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP8008451A Expired - Fee Related JP2885164B2 (ja) | 1996-01-22 | 1996-01-22 | 超格子アバランシェフォトダイオード |
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Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP3177962B2 (ja) | 1998-05-08 | 2001-06-18 | 日本電気株式会社 | プレーナ型アバランシェフォトダイオード |
CA2474560C (en) * | 2002-02-01 | 2012-03-20 | Picometrix, Inc. | Planar avalanche photodiode |
-
1996
- 1996-01-22 JP JP8008451A patent/JP2885164B2/ja not_active Expired - Fee Related
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