JP2795100B2 - 画像圧縮回路並びに画像伸長回路 - Google Patents
画像圧縮回路並びに画像伸長回路Info
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Description
【０００１】
【産業上の利用分野】この発明は画像データを圧縮また
は伸長する画像符号化および復号化装置に関する。
は伸長する画像符号化および復号化装置に関する。
【０００２】
【従来の技術】従来、画像データの入出力処理の高速化
のために入出力用ラインバッファをトグルで使用する方
法が提案されおり、その一つが特開昭６３−８４２７０
号などに示されている。図４に示す特開昭６３−８４２
７０号ではトグルラインバッファを実現するために同サ
イズのラインバッファを１２、１３と二つ必要として
る。動作としては一方のラインバッファ１３に画像デー
タを書き込む間に他方のラインバッファ１２から画像デ
ータを読み出すことにより画像データを連続して処理で
きる効果がある。
のために入出力用ラインバッファをトグルで使用する方
法が提案されおり、その一つが特開昭６３−８４２７０
号などに示されている。図４に示す特開昭６３−８４２
７０号ではトグルラインバッファを実現するために同サ
イズのラインバッファを１２、１３と二つ必要として
る。動作としては一方のラインバッファ１３に画像デー
タを書き込む間に他方のラインバッファ１２から画像デ
ータを読み出すことにより画像データを連続して処理で
きる効果がある。
【０００３】またラインバッファ１２、１３から画像デ
ータの入出力を行なう場合、ラインバッファ１２または
１３をセレクタ１６でライン単位に切り替えて行なう必
要がある。
ータの入出力を行なう場合、ラインバッファ１２または
１３をセレクタ１６でライン単位に切り替えて行なう必
要がある。
【０００４】
【発明が解決しようとする課題】従来の画像処理装置は
以上のように構成されているので、この方式をブロック
符号化方式に適用する場合、画像データの処理はブロッ
クサイズのラインを一つの単位で扱う必要がある。従っ
て入出力のそれぞれについて、一つのラインバッファが
ブロックサイズ分の数だけ必要であり、合計ブロックサ
イズの２倍の数のラインバッファが必要となり、ライン
バッファの数が多くなり装置コストが高くなるという問
題点がある。
以上のように構成されているので、この方式をブロック
符号化方式に適用する場合、画像データの処理はブロッ
クサイズのラインを一つの単位で扱う必要がある。従っ
て入出力のそれぞれについて、一つのラインバッファが
ブロックサイズ分の数だけ必要であり、合計ブロックサ
イズの２倍の数のラインバッファが必要となり、ライン
バッファの数が多くなり装置コストが高くなるという問
題点がある。
【０００５】更に、ラインバッファから画像データを読
み出す場合、ブロック間のラインバッファの切り替え以
外にブロック内のラインバッファをブロックサイズ内の
単位で切り替える処理が必要である。そしてこのブロッ
ク内のラインバッファの切り替え時間は最短時、１画素
の画像データの転送時間内で行なう必要がある。
み出す場合、ブロック間のラインバッファの切り替え以
外にブロック内のラインバッファをブロックサイズ内の
単位で切り替える処理が必要である。そしてこのブロッ
ク内のラインバッファの切り替え時間は最短時、１画素
の画像データの転送時間内で行なう必要がある。
【０００６】また本方式では、画像データの転送速度が
ラインバッファのセレクタの応答（ＩＦＯの読み出し）
速度より早い場合にはラインバッファの切り替えが間に
合わなくなり、隣合うラインバッファの出力データが衝
突し、高速な画像圧縮・伸長処理が行えなくなるという
問題点がある。
ラインバッファのセレクタの応答（ＩＦＯの読み出し）
速度より早い場合にはラインバッファの切り替えが間に
合わなくなり、隣合うラインバッファの出力データが衝
突し、高速な画像圧縮・伸長処理が行えなくなるという
問題点がある。
【０００７】この発明は上記のような問題点を解消する
ためになされたもので、原画像データの所定領域を一旦
格納するラインバッファの数を少なくし安価な画像圧縮
回路を得ることを目的としている。
ためになされたもので、原画像データの所定領域を一旦
格納するラインバッファの数を少なくし安価な画像圧縮
回路を得ることを目的としている。
【０００８】また、高速な画像圧縮処理が行なえること
を目的としている。
を目的としている。
【０００９】さらに、符号化された画像データを一旦格
納するラインバッファの数を少なくし安価な画像伸長回
路を得ることを目的としている。
納するラインバッファの数を少なくし安価な画像伸長回
路を得ることを目的としている。
【００１０】
【課題を解決するための手段】前述の目的を達成するた
めに、請求項１にかかる発明の画像圧縮回路は、画像デ
ータを小領域のブロックに分割して各ブロックごとに圧
縮処理部で固定長符号化するために原画像データの所定
領域を一旦格納するラインバッファを前段と後段との２
段の形にし、前段をブロックサイズのライン数より一つ
少ないラインバッファで、後段をブロックサイズのライ
ン数と同数のラインバッファで構成し、更に各ラインバ
ッファの読み出し・書き込みを制御する制御信号を発生
する制御回路を有する。
めに、請求項１にかかる発明の画像圧縮回路は、画像デ
ータを小領域のブロックに分割して各ブロックごとに圧
縮処理部で固定長符号化するために原画像データの所定
領域を一旦格納するラインバッファを前段と後段との２
段の形にし、前段をブロックサイズのライン数より一つ
少ないラインバッファで、後段をブロックサイズのライ
ン数と同数のラインバッファで構成し、更に各ラインバ
ッファの読み出し・書き込みを制御する制御信号を発生
する制御回路を有する。
【００１１】また、請求項２にかかる発明の画像圧縮回
路は、後段のラインバッファの前記圧縮処理部への読み
出し用データ線は隣合わないラインバッファを組として
接続する。
路は、後段のラインバッファの前記圧縮処理部への読み
出し用データ線は隣合わないラインバッファを組として
接続する。
【００１２】また、請求項３にかかる発明の画像伸長回
路は、復号化された画像データの所定領域を一旦格納す
るラインバッファを前段と後段の２段の形にし、前段を
ブロックサイズと同じ数のラインバッファで、後段をブ
ロックサイズより一つ少ない数のラインバッファで構成
し、更に各ラインバッファの読み出し・書き込みを制御
する制御信号を発生する制御回路を有する。
路は、復号化された画像データの所定領域を一旦格納す
るラインバッファを前段と後段の２段の形にし、前段を
ブロックサイズと同じ数のラインバッファで、後段をブ
ロックサイズより一つ少ない数のラインバッファで構成
し、更に各ラインバッファの読み出し・書き込みを制御
する制御信号を発生する制御回路を有する。
【００１３】
【作用】この発明における前段と後段の２段で形成され
たラインバッファは、圧縮処理部へ読み込まれる原画像
データの所定領域を一旦格納し、このラインバッファへ
の原画像データの読み出し・書き込みは制御回路からの
制御信号で制御する。
たラインバッファは、圧縮処理部へ読み込まれる原画像
データの所定領域を一旦格納し、このラインバッファへ
の原画像データの読み出し・書き込みは制御回路からの
制御信号で制御する。
【００１４】また、ラインバッファから圧縮処理部への
原画像データの読み込みは隣合うラインバッファの出力
データが別個のデータ線で行われ、転送速度がセレクタ
の応答速度より早い場合でも、隣合うラインバッファの
出力データが衝突せずに読み込まれる。
原画像データの読み込みは隣合うラインバッファの出力
データが別個のデータ線で行われ、転送速度がセレクタ
の応答速度より早い場合でも、隣合うラインバッファの
出力データが衝突せずに読み込まれる。
【００１５】また、前段と後段の２段で形成されたライ
ンバッファは復号化された画像データの所定領域を一旦
格納し、このラインバッファへの復号化された画像デー
タの読み出し・書き込みは制御回路からの制御信号で制
御する。
ンバッファは復号化された画像データの所定領域を一旦
格納し、このラインバッファへの復号化された画像デー
タの読み出し・書き込みは制御回路からの制御信号で制
御する。
【００１６】
実施例１．図１にこの発明の画像圧縮回路の一実施例を
示す構成ブロック図である。この図で、１ａ，２ａ，３
ａは前段のラインバッファでＦＩＦＯが用いられ、並列
に接続されている。１ｂ，２ｂ，３ｂ，４ｂは後段のラ
インバッファでＦＩＦＯが用いられ、１ｂ〜３ｂは前記
前段のラインバッファ１ａ〜３ａに接続されている。５
は圧縮処理部で後段のラインバッファ１ｂ〜４ｂの原画
像データを小領域のブロックに分割して読み出し、符号
化するとともに前記各ラインバッファの書き込み・読み
だしを制御する制御信号を発生する制御回路６を具備し
ている。７は原画像データが入力される入力線である。
この実施例ではブロックサイズを４×４にしているの
で、前段のラインバッファは３個、後段のラインバッフ
ァは４個で構成される。
示す構成ブロック図である。この図で、１ａ，２ａ，３
ａは前段のラインバッファでＦＩＦＯが用いられ、並列
に接続されている。１ｂ，２ｂ，３ｂ，４ｂは後段のラ
インバッファでＦＩＦＯが用いられ、１ｂ〜３ｂは前記
前段のラインバッファ１ａ〜３ａに接続されている。５
は圧縮処理部で後段のラインバッファ１ｂ〜４ｂの原画
像データを小領域のブロックに分割して読み出し、符号
化するとともに前記各ラインバッファの書き込み・読み
だしを制御する制御信号を発生する制御回路６を具備し
ている。７は原画像データが入力される入力線である。
この実施例ではブロックサイズを４×４にしているの
で、前段のラインバッファは３個、後段のラインバッフ
ァは４個で構成される。
【００１７】次に動作について説明する。この場合はブ
ロックサイズを４×４にしているので、４ライン分の画
像データ（以下ブロックラインと呼ぶ）を一つの単位と
して処理が行なわれる。入力線７から入力される第１ラ
イン分の画像データはまずＷＥａ１信号によりＦＩＦＯ
１ａに書き込まれる。次に同様に第２ライン分の画像デ
ータはＷＥａ２によりＦＩＦＯ２ａに、第３ライン分の
画像データはＷＥａ３によりＦＩＦＯ３ａに順次書き込
まれる。次に第４ライン分の画像データはＷＥｂ信号に
よりＦＩＦＯ４ｂに書き込まれ、同じタイミングでＲＥ
ａ信号によりＦＩＦＯ１ａから画像データが読み出され
同時にＦＩＦＯ１ｂに書き込まれる。同様にＲＥａ信号
により第４ライン分の画像データがＷＥｂ信号によりＦ
ＩＦＯ４ｂに書き込まれと同じタイミングでＦＩＦＯ２
ａからＦＩＦＯ２ｂへ、ＦＩＦＯ３ａからＦＩＦＯ３ｂ
へ画像データが転送される。このようにして、第１ブロ
ックラインの第１ラインから第４ラインまでの画像デー
タがＦＩＦＯ１ｂからＦＩＦＯ４ｂまでに格納される。
ロックサイズを４×４にしているので、４ライン分の画
像データ（以下ブロックラインと呼ぶ）を一つの単位と
して処理が行なわれる。入力線７から入力される第１ラ
イン分の画像データはまずＷＥａ１信号によりＦＩＦＯ
１ａに書き込まれる。次に同様に第２ライン分の画像デ
ータはＷＥａ２によりＦＩＦＯ２ａに、第３ライン分の
画像データはＷＥａ３によりＦＩＦＯ３ａに順次書き込
まれる。次に第４ライン分の画像データはＷＥｂ信号に
よりＦＩＦＯ４ｂに書き込まれ、同じタイミングでＲＥ
ａ信号によりＦＩＦＯ１ａから画像データが読み出され
同時にＦＩＦＯ１ｂに書き込まれる。同様にＲＥａ信号
により第４ライン分の画像データがＷＥｂ信号によりＦ
ＩＦＯ４ｂに書き込まれと同じタイミングでＦＩＦＯ２
ａからＦＩＦＯ２ｂへ、ＦＩＦＯ３ａからＦＩＦＯ３ｂ
へ画像データが転送される。このようにして、第１ブロ
ックラインの第１ラインから第４ラインまでの画像デー
タがＦＩＦＯ１ｂからＦＩＦＯ４ｂまでに格納される。
【００１８】続いて第５ラインすなわち次ブロックライ
ンの第１ラインの画像データをＦＩＦＯ１ａに書き込む
タイミングに合わせて、ＲＥａ１信号によりＦＩＦＯ１
ａに格納されている前ブロックラインの第１ラインの１
画素目の画像データを読み出し圧縮処理部５に入力す
る。続いてＲＥａ２信号によりＦＩＦＯ２ｂに格納され
ている前ブロックラインの第２ラインの１画素目の画像
データを読み出し圧縮処理部５に入力する。続いてＲＥ
ａ３信号により前ブロックラインの第３ラインの１画素
目の画像データの読み出しを行ない圧縮処理部５に入力
する。続いてＲＥａ４信号により前ブロックラインの第
４ラインの１画素目の画像データの読み出しを行ない圧
縮処理部５に入力する。この動作を繰り返し、途中ＦＩ
ＦＯ１ａへ次ブロックラインの第１ラインの画像データ
の書き込みが終了すると、第２ラインの画像データをＦ
ＩＦＯ２ａへ、第３ラインの画像データをＦＩＦＯ３ａ
へ書き込む。このように前段のＦＩＦＯ１ａからＦＩＦ
Ｏ３ａまでにはライン単位で画像データを書き込み、後
段のＦＩＦＯ１ｂからＦＩＦＯ４ｂまでの画像データの
読み出しは画素単位にラインを切り替えて行なう。
ンの第１ラインの画像データをＦＩＦＯ１ａに書き込む
タイミングに合わせて、ＲＥａ１信号によりＦＩＦＯ１
ａに格納されている前ブロックラインの第１ラインの１
画素目の画像データを読み出し圧縮処理部５に入力す
る。続いてＲＥａ２信号によりＦＩＦＯ２ｂに格納され
ている前ブロックラインの第２ラインの１画素目の画像
データを読み出し圧縮処理部５に入力する。続いてＲＥ
ａ３信号により前ブロックラインの第３ラインの１画素
目の画像データの読み出しを行ない圧縮処理部５に入力
する。続いてＲＥａ４信号により前ブロックラインの第
４ラインの１画素目の画像データの読み出しを行ない圧
縮処理部５に入力する。この動作を繰り返し、途中ＦＩ
ＦＯ１ａへ次ブロックラインの第１ラインの画像データ
の書き込みが終了すると、第２ラインの画像データをＦ
ＩＦＯ２ａへ、第３ラインの画像データをＦＩＦＯ３ａ
へ書き込む。このように前段のＦＩＦＯ１ａからＦＩＦ
Ｏ３ａまでにはライン単位で画像データを書き込み、後
段のＦＩＦＯ１ｂからＦＩＦＯ４ｂまでの画像データの
読み出しは画素単位にラインを切り替えて行なう。
【００１９】このようにＦＩＦＯ１ｂ〜４ｂまでの画像
データが画素単位に圧縮処理部５に入力され、圧縮処理
部５で符号化される間、ＦＩＦＯ１ａ、２ａ、３ａへ次
ブロックラインの第１から第３ラインまでの画像データ
が書き込まれ、更に次ブロックラインの第４ラインの画
像データをＦＩＦＯ４ｂに書き込まむと同時に次ブロッ
クラインの第１から第３ラインの画像データをＦＩＦＯ
１ａ〜３ａから読み出し、ＦＩＦＯ１ｂ〜３ｂに書き込
みを行なう。この書き込みが終了するとＦＩＦＯ１ｂ〜
４ｂまでの画像データの読み出しを画素単位にラインを
切り替えて行ない、圧縮処理部５に入力、圧縮処理を行
なう。以上の動作を原画像データの最終ラインまで繰り
返して画像データの読み込み及び圧縮処理を行なう。
データが画素単位に圧縮処理部５に入力され、圧縮処理
部５で符号化される間、ＦＩＦＯ１ａ、２ａ、３ａへ次
ブロックラインの第１から第３ラインまでの画像データ
が書き込まれ、更に次ブロックラインの第４ラインの画
像データをＦＩＦＯ４ｂに書き込まむと同時に次ブロッ
クラインの第１から第３ラインの画像データをＦＩＦＯ
１ａ〜３ａから読み出し、ＦＩＦＯ１ｂ〜３ｂに書き込
みを行なう。この書き込みが終了するとＦＩＦＯ１ｂ〜
４ｂまでの画像データの読み出しを画素単位にラインを
切り替えて行ない、圧縮処理部５に入力、圧縮処理を行
なう。以上の動作を原画像データの最終ラインまで繰り
返して画像データの読み込み及び圧縮処理を行なう。
【００２０】実施例２． 図２にこの発明の画像伸長回路の構成ブロック図を示
す。この図で、１ｃ，２ｃ，３ｃ，４ｃは前段のライン
バッファでＦＩＦＯが用いられ、並列に接続されてい
る。２ｄ，３ｄ，４ｄは後段のラインバッファでＦＩＦ
Ｏが用いられ、このＦＩＦＯ２ｄ〜４ｄは前記前段のラ
インバッファ２ｃ〜４ｃに接続されている。８は伸長処
理部で小領域のブロックに分割され各ブロックごとに固
定長符号化された固定長符号をブロックごとに復号化す
るとともに前記各ラインバッファ１ｃ〜４ｃ及び２ｄ〜
４ｄの書き込み・読みだしを制御する制御信号を発生す
る制御回路９を具備している。１０は復号化データの読
み出しを行う読出線である。この実施例ではブロックサ
イズを４×４にしているので、前段のラインバッファは
４個、後段のラインバッファは３個で構成される。
す。この図で、１ｃ，２ｃ，３ｃ，４ｃは前段のライン
バッファでＦＩＦＯが用いられ、並列に接続されてい
る。２ｄ，３ｄ，４ｄは後段のラインバッファでＦＩＦ
Ｏが用いられ、このＦＩＦＯ２ｄ〜４ｄは前記前段のラ
インバッファ２ｃ〜４ｃに接続されている。８は伸長処
理部で小領域のブロックに分割され各ブロックごとに固
定長符号化された固定長符号をブロックごとに復号化す
るとともに前記各ラインバッファ１ｃ〜４ｃ及び２ｄ〜
４ｄの書き込み・読みだしを制御する制御信号を発生す
る制御回路９を具備している。１０は復号化データの読
み出しを行う読出線である。この実施例ではブロックサ
イズを４×４にしているので、前段のラインバッファは
４個、後段のラインバッファは３個で構成される。
【００２１】ここではブロックサイズを４×４、ライン
バッファにＦＩＦＯを用いた場合を例にあげ動作を説明
する。画像データの処理はブロックラインを一つの単位
として行なわれる。伸長処理部８より出力される第１ラ
インの１画素目の復号化データはまずＷＥｃ１信号によ
りＦＩＦＯ１ｃに書き込まれる。次に第２ラインの１画
素目の復号化データはＷＥｃ２によりＦＩＦＯ２ｃに、
第３ラインの１画素目の復号化データはＷＥｃ３により
ＦＩＦＯ３ｃに、第４ラインの１画素目の復号化データ
はＷＥｃ４信号によりＦＩＦＯ４ｃに書き込まれる。こ
のように画素単位にラインを切り替えて４ライン分の復
号化データをＦＩＦＯ１ｃからＦＩＦＯ４ｃに書き込
む。
バッファにＦＩＦＯを用いた場合を例にあげ動作を説明
する。画像データの処理はブロックラインを一つの単位
として行なわれる。伸長処理部８より出力される第１ラ
インの１画素目の復号化データはまずＷＥｃ１信号によ
りＦＩＦＯ１ｃに書き込まれる。次に第２ラインの１画
素目の復号化データはＷＥｃ２によりＦＩＦＯ２ｃに、
第３ラインの１画素目の復号化データはＷＥｃ３により
ＦＩＦＯ３ｃに、第４ラインの１画素目の復号化データ
はＷＥｃ４信号によりＦＩＦＯ４ｃに書き込まれる。こ
のように画素単位にラインを切り替えて４ライン分の復
号化データをＦＩＦＯ１ｃからＦＩＦＯ４ｃに書き込
む。
【００２２】続いてＲＥｃ信号でＦＩＦＯ１ｃに格納さ
れた前ブロックラインの第１ラインの復号化データをシ
リアルに読み出して出力すると共に、同じタイミングで
ＦＩＦＯ２ｃからＦＩＦＯ２ｄと、ＦＩＦＯ３ｃからＦ
ＩＦＯ３ｄと、ＦＩＦＯ４ｃからＦＩＦＯ４ｄに復号化
データがライン単位に読み出され書き込まれる。このよ
うにしてＦＩＦＯ１ｃから前ブロックラインの第１ライ
ンの復号化データが出力されると前ブロックラインの第
２から第４ラインの復号化データは、ＦＩＦＯ２ｄから
ＦＩＦＯ４ｄに格納される。
れた前ブロックラインの第１ラインの復号化データをシ
リアルに読み出して出力すると共に、同じタイミングで
ＦＩＦＯ２ｃからＦＩＦＯ２ｄと、ＦＩＦＯ３ｃからＦ
ＩＦＯ３ｄと、ＦＩＦＯ４ｃからＦＩＦＯ４ｄに復号化
データがライン単位に読み出され書き込まれる。このよ
うにしてＦＩＦＯ１ｃから前ブロックラインの第１ライ
ンの復号化データが出力されると前ブロックラインの第
２から第４ラインの復号化データは、ＦＩＦＯ２ｄから
ＦＩＦＯ４ｄに格納される。
【００２３】第１ラインの復号化データの読み出しが終
了すると、ＦＩＦＯ２ｄに格納された前ブロックライン
の第２ラインの復号化データ、更に第３第４ラインの復
号化データの読み出しを行なう。この前段のＦＩＦＯ１
ｃと後段のＦＩＦＯ２ｄ、ＦＩＦＯ３ｄ及びＦＩＦＯ４
ｄからの復号化データの読み出しと同期して、上述した
前段のＦＩＦＯ１ｃ、ＦＩＦＯ２ｃ、ＦＩＦＯ３ｃ及び
ＦＩＦＯ４ｃに画素単位のラインを切り替えて書き込み
動作を行なう。以上の動作を画像データの最終ラインま
で繰り返して復号化データの読み出しを行なう。
了すると、ＦＩＦＯ２ｄに格納された前ブロックライン
の第２ラインの復号化データ、更に第３第４ラインの復
号化データの読み出しを行なう。この前段のＦＩＦＯ１
ｃと後段のＦＩＦＯ２ｄ、ＦＩＦＯ３ｄ及びＦＩＦＯ４
ｄからの復号化データの読み出しと同期して、上述した
前段のＦＩＦＯ１ｃ、ＦＩＦＯ２ｃ、ＦＩＦＯ３ｃ及び
ＦＩＦＯ４ｃに画素単位のラインを切り替えて書き込み
動作を行なう。以上の動作を画像データの最終ラインま
で繰り返して復号化データの読み出しを行なう。
【００２４】実施例３．図３にこの発明の他の実施例を
示す画像圧縮回路の構成ブロック図である。ここではブ
ロックサイズを４×４、ラインバッファにＦＩＦＯを用
いた場合を例にあげ動作を説明する。画像データの処理
はブロックラインを一つの単位として行なわれる。後段
のＦＩＦＯ１ｂ、ＦＩＦＯ２ｂ、ＦＩＦＯ３ｂ及びＦＩ
ＦＯ４ｂに画像データが格納されるまでは実施例１の場
合の動作と同様である。ＦＩＦＯ１ｂ、ＦＩＦＯ２ｂ、
ＦＩＦＯ３ｂ及びＦＩＦＯ４ｂに格納されたブロックラ
インの画像データはＲＥａ１、ＲＥａ２、ＲＥａ３及び
ＲＥａ４によって画素単位にラインを切り替えるが、画
像データの信号線は第１ラインと第３ラインの時はＤａ
ｔａ１から、第２ラインと第４ラインの時はＤａｔａ２
から圧縮処理部５に読み込まれる。
示す画像圧縮回路の構成ブロック図である。ここではブ
ロックサイズを４×４、ラインバッファにＦＩＦＯを用
いた場合を例にあげ動作を説明する。画像データの処理
はブロックラインを一つの単位として行なわれる。後段
のＦＩＦＯ１ｂ、ＦＩＦＯ２ｂ、ＦＩＦＯ３ｂ及びＦＩ
ＦＯ４ｂに画像データが格納されるまでは実施例１の場
合の動作と同様である。ＦＩＦＯ１ｂ、ＦＩＦＯ２ｂ、
ＦＩＦＯ３ｂ及びＦＩＦＯ４ｂに格納されたブロックラ
インの画像データはＲＥａ１、ＲＥａ２、ＲＥａ３及び
ＲＥａ４によって画素単位にラインを切り替えるが、画
像データの信号線は第１ラインと第３ラインの時はＤａ
ｔａ１から、第２ラインと第４ラインの時はＤａｔａ２
から圧縮処理部５に読み込まれる。
【００２５】このように構成することにより、画像デー
タの転送速度がセレクタ（半導体素子）の応答速度より
早い場合でも、読み出すラインバッファが隣合っていな
いため、隣合うラインバッファの出力データが衝突せず
高速なデータ処理が行なえる。
タの転送速度がセレクタ（半導体素子）の応答速度より
早い場合でも、読み出すラインバッファが隣合っていな
いため、隣合うラインバッファの出力データが衝突せず
高速なデータ処理が行なえる。
【００２６】実施例４．前述の実施例１では、ＦＩＦＯ
１ｂ〜４ｂからの画像データの読み出しは１画素単位に
ラインを切り替えて行なう例を示したが、１ライン内で
ブロックサイズ分の画素を続けて読み出してからライン
を切り替えてもよい。
１ｂ〜４ｂからの画像データの読み出しは１画素単位に
ラインを切り替えて行なう例を示したが、１ライン内で
ブロックサイズ分の画素を続けて読み出してからライン
を切り替えてもよい。
【００２７】実施例５． 前述の実施例２では、ＦＩＦＯ１ｃ〜４ｃへの復号化デ
ータの書き込みは１画素単位にラインを切り替えて行な
う例を示したが、１ライン内でブロックサイズ分の画素
を続けて書き込んでからラインを切り替えてもよい。
ータの書き込みは１画素単位にラインを切り替えて行な
う例を示したが、１ライン内でブロックサイズ分の画素
を続けて書き込んでからラインを切り替えてもよい。
【００２８】実施例６．前述の実施例３では、ＦＩＦＯ
１ｄ、ＦＩＦＯ２ｄ、ＦＩＦＯ３ｄ及びＦＩＦＯ４ｄか
らの画像データの読み出しはＤａｔａ１とＤａｔａ２を
交互に使用する例を示したが、同時に読み込み読み出
し、その読み出し速度を遅くしてもよい。
１ｄ、ＦＩＦＯ２ｄ、ＦＩＦＯ３ｄ及びＦＩＦＯ４ｄか
らの画像データの読み出しはＤａｔａ１とＤａｔａ２を
交互に使用する例を示したが、同時に読み込み読み出
し、その読み出し速度を遅くしてもよい。
【００２９】
【発明の効果】以上説明したように高速化のためにはト
グルラインバッファを用いる必要があるが、ブロック符
号化方式を用いた場合でもラインバッファの数を少なく
することができ、安価な装置を得ることができる。
グルラインバッファを用いる必要があるが、ブロック符
号化方式を用いた場合でもラインバッファの数を少なく
することができ、安価な装置を得ることができる。
【００３０】また、画像データの転送速度がセレクタの
応答速度より早い場合でも、読み出すラインバッファが
隣合っていないため、隣合うラインバッファの出力デー
タが衝突せず高速なデータ処理が行なえる。
応答速度より早い場合でも、読み出すラインバッファが
隣合っていないため、隣合うラインバッファの出力デー
タが衝突せず高速なデータ処理が行なえる。
【図１】この発明の一実施例を示す画像圧縮回路のブロ
ック図
ック図
【図２】この発明の他の実施例を示す画像伸長回路のブ
ロック図
ロック図
【図３】この発明の他の実施例を示す画像圧縮回路のブ
ロック図
ロック図
【図４】従来の画像圧縮・伸長回路を示すブロック図
１ａ〜３ａ 原画像データ用ラインバッファ １ｂ〜４ｂ 原画像データ用ラインバッファ １ｃ〜４ｃ 復合化データ用ラインバッファ ２ｄ〜４ｄ 復合化データ用ラインバッファ ５ 圧縮処理部 ６ 制御回路 ７ 入力線 ８ 伸長処理部 ９ 制御回路 １０ 読出線
Claims (3)
- 【請求項１】 原画像データを小領域のブロックに分割
して各ブロックごとに符号化する画像圧縮回路におい
て、圧縮処理部で圧縮処理するため原画像データを一時
格納する格納手段を前段のラインバッファと後段のライ
ンバッファの２段にし、かつ前段は前記小領域のライン
数より１つ少ないラインバッファで、後段は前記小領域
のライン数と同じ数のラインバッファにより構成され、
前段の各ラインバッファヘの原画像データの書き込みは
ライン単位にシリアルに、前段の各ラインバッファから
読み出して後段の各ラインバッファへの書き込みと前段
のラインバッファに格納されない前記小領域の最終ライ
ンの原画像データの後段へのラインバッファへの書き込
みを各ラインパラレルに、後段の各ラインバッファから
の読み出しはブロックサイズ以下の画素単位で各ライン
を切り替えるかブロックサイズ以下のライン単位で各ラ
インを切り替えて行なう制御信号を発する制御回路を備
えたことを特徴とする画像圧縮回路。 - 【請求項２】 前記後段のラインバッファの前記圧縮処
理部への読み出し用データ線は隣合わないラインバッフ
ァを組として接続されていることを特徴とする請求項１
記載の画像圧縮回路。 - 【請求項３】 原画像データが小領域のブロックに分割
され各ブロックごとに符号化された符号をブロックごと
に復号化する画像伸長回路において、ブロックごとに復
号化された画像データをライン単位にシリアルに読み出
すため画像データの所定領域を一旦格納する格納手段を
前段のラインバッファと後段のラインバッファの２段で
形成し、かつ前段は前記小領域のライン数と同じ数のラ
インバッファで、後段は前記小領域のライン数より１つ
少ないラインバッファにより構成され、前段の各ライン
バッファへの復号化された画像データの書き込みはブロ
ックサイズ以下の画素単位で各ラインを切り替えるかブ
ロックサイズ以下のライン単位で各ラインを切り替えて
行ない、前段の各ラインバッファからの読み出し及び後
段の各インバッファへの書き込みは各ラインパラレル
に、後段のラインバッファに格納されない前記小領域の
先頭ラインの復号化された画像データの転送と後段の各
ラインバッファからの読み出しをライン単位にシリアル
に行なう制御信号を発する制御回路を備えたことを特徴
とする画像伸長回路。
Priority Applications (2)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27592992A JP2795100B2 (ja) | 1992-10-14 | 1992-10-14 | 画像圧縮回路並びに画像伸長回路 |
| US09/195,120 US6263111B1 (en) | 1992-10-14 | 1998-11-18 | Image data compression-expansion circuit |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP27592992A JP2795100B2 (ja) | 1992-10-14 | 1992-10-14 | 画像圧縮回路並びに画像伸長回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH06125465A JPH06125465A (ja) | 1994-05-06 |
| JP2795100B2 true JP2795100B2 (ja) | 1998-09-10 |
Family
ID=17562399
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP27592992A Expired - Lifetime JP2795100B2 (ja) | 1992-10-14 | 1992-10-14 | 画像圧縮回路並びに画像伸長回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2795100B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| US6934049B1 (en) | 1999-09-13 | 2005-08-23 | Minolta Co., Ltd. | Data processing apparatus |
-
1992
- 1992-10-14 JP JP27592992A patent/JP2795100B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH06125465A (ja) | 1994-05-06 |
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