JP2743550B2 - レーダ映像表示回路 - Google Patents
レーダ映像表示回路Info
- Publication number
- JP2743550B2 JP2743550B2 JP2040121A JP4012190A JP2743550B2 JP 2743550 B2 JP2743550 B2 JP 2743550B2 JP 2040121 A JP2040121 A JP 2040121A JP 4012190 A JP4012190 A JP 4012190A JP 2743550 B2 JP2743550 B2 JP 2743550B2
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- Japan
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- signal
- video
- weather
- circuit
- output signal
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Description
【発明の詳細な説明】 〔産業上の利用分野〕 本発明は１次レーダ装置における映像表示回路に関
し、特にウェザークラッタ映像信号と目標信号とを視認
できるレーダ映像表示回路に関する。
し、特にウェザークラッタ映像信号と目標信号とを視認
できるレーダ映像表示回路に関する。
従来、１次レーダ装置において、目標機を観測するだ
けでなく、目標機周辺のウェザー・クラッタの状況を観
測する必要性がある場合がある。しかし、この種のレー
ダ映像表示方式は、レーダ受信機にて受信処理された信
号をウェザー信号と目標信号とを区別せずそのまま表示
装置へ送出し、表示装置に表示される映像信号の強度を
制御する方式となっていた。
けでなく、目標機周辺のウェザー・クラッタの状況を観
測する必要性がある場合がある。しかし、この種のレー
ダ映像表示方式は、レーダ受信機にて受信処理された信
号をウェザー信号と目標信号とを区別せずそのまま表示
装置へ送出し、表示装置に表示される映像信号の強度を
制御する方式となっていた。
上述した従来のレーダ映像表示回路は、ウェザー信号
と目標信号とを表示装置内で混合し、表示装置のPPI表
示画面上に表示するようになっているので、ウェザー領
域内の目標機が観測しにくくなる場合があるという欠点
があった。
と目標信号とを表示装置内で混合し、表示装置のPPI表
示画面上に表示するようになっているので、ウェザー領
域内の目標機が観測しにくくなる場合があるという欠点
があった。
本発明の目的は、前述の問題点を解決するために、ウ
ェザー・クラッタ映像信号も視認でき、さらにウェザー
・クラッタ内にある目標機の観測を容易にできるレーダ
映像表示回路を提供しようとするものである。
ェザー・クラッタ映像信号も視認でき、さらにウェザー
・クラッタ内にある目標機の観測を容易にできるレーダ
映像表示回路を提供しようとするものである。
本発明のレーダ映像表示回路は、ウェザービデオ信号
と目標物ビデオ信号とを表示するレーダ映像表示回路に
おいて、前記ウェザービデオ信号を２等分する分配器
と、この２等分された一方のウェザービデオ信号を反転
増幅した後に定められた遅延時間を付与する遅延回路
と、前記２等分された他方のウェザービデオ信号を増幅
する増幅器と、前記遅延回路の出力信号と前記増幅器の
出力信号とを入力して減算する減算器と、前記減算器の
出力信号における負極性成分を除去するリミッタ回路部
と、前記リミッタ回路部の出力信号を波形整形した後に
目標物を有するビデオ信号とともに重畳して表示する映
像表示部とを備えている。
と目標物ビデオ信号とを表示するレーダ映像表示回路に
おいて、前記ウェザービデオ信号を２等分する分配器
と、この２等分された一方のウェザービデオ信号を反転
増幅した後に定められた遅延時間を付与する遅延回路
と、前記２等分された他方のウェザービデオ信号を増幅
する増幅器と、前記遅延回路の出力信号と前記増幅器の
出力信号とを入力して減算する減算器と、前記減算器の
出力信号における負極性成分を除去するリミッタ回路部
と、前記リミッタ回路部の出力信号を波形整形した後に
目標物を有するビデオ信号とともに重畳して表示する映
像表示部とを備えている。
次に、本発明について図面を参照して説明する。
第１図は本発明の一実施例の構成図である。第１図に
おいて、受信機（図示せず）から送出されるウェザーの
みの信号であるウェザー・ビデオ信号20は分配器１にて
Ａ信号20とＢ信号21とに等分配される。一方のＡ信号20
は、増幅器２で増幅された後、減算器５に入力される。
他方のＢ信号21は反転増幅器３で、信号の極性を反転し
増幅した後に、後述するＡ信号20と遅延調整する遅延回
路４経由減算器５に入力され、Ｃ信号22とＤ信号23との
差信号22が抽出される。この差信号22は、分配器６にて
Ｃ信号23とＤ信号24とに等分配される。一方のＣ信号23
は、リミッター回路７で負極性成分が除去され、合成器
10へ入力される。他方のＤ信号24は、反転増幅器８で、
信号の極性を反転した後リミッター回路９で負極性成分
が除去され、合成器10へ入力される。合成器10で合成さ
れた信号25は波形整形回路11にて信号波形を整形した
後、レーダの映像表示装置12へ送出される。なお映像表
示装置12には外部から目標物のビデオ信号であるMTIビ
デオ信号27またはノーマルビデオ信号28が入力され前述
のウェザービデオ信号と重畳される。
おいて、受信機（図示せず）から送出されるウェザーの
みの信号であるウェザー・ビデオ信号20は分配器１にて
Ａ信号20とＢ信号21とに等分配される。一方のＡ信号20
は、増幅器２で増幅された後、減算器５に入力される。
他方のＢ信号21は反転増幅器３で、信号の極性を反転し
増幅した後に、後述するＡ信号20と遅延調整する遅延回
路４経由減算器５に入力され、Ｃ信号22とＤ信号23との
差信号22が抽出される。この差信号22は、分配器６にて
Ｃ信号23とＤ信号24とに等分配される。一方のＣ信号23
は、リミッター回路７で負極性成分が除去され、合成器
10へ入力される。他方のＤ信号24は、反転増幅器８で、
信号の極性を反転した後リミッター回路９で負極性成分
が除去され、合成器10へ入力される。合成器10で合成さ
れた信号25は波形整形回路11にて信号波形を整形した
後、レーダの映像表示装置12へ送出される。なお映像表
示装置12には外部から目標物のビデオ信号であるMTIビ
デオ信号27またはノーマルビデオ信号28が入力され前述
のウェザービデオ信号と重畳される。
次に前述の遅延回路４の動作原理を第２図（ａ），
（ｂ）に示す従来例のクラッタ表示（第２図（ａ））と
本実施例のクラッタ表示（第２図（ｂ））の説明図を対
比しながら説明する。第２図（ａ）の左側のＡスコープ
表示は２個のクラッタビデオ信号30,31がベーシック雑
音上に存在する状態を示し、図の右側のPPI表示はこの
クラッタ残像30A,31Aが映像表示としてわずかに残って
いる状態を示している。本実施例を示す第２図（ｂ）の
左側のＡスコープ表示は第１図におけるＢ信号21の反転
信号に対して約数ナノ秒程度の遅延時間を遅延回路４に
より付与している。したがってＣ信号22と遅延されたＤ
信号23とは第２図（ｂ）のＡスコープ表示に示すように
消去されたクラッタビデオ信号32,33のそれぞれ前縁32
A,33Aと後縁32B,33Bにおいてクラッタビデオ信号が相殺
されずに残ることになる。なお、クラッタ信号に時間に
よる変化は左程大きくないので十分に相殺される。した
がって第２図（ｂ）の右側のPPI表示に示すようにクラ
ッタの位置32C,33Cの輪郭のみが映像として残り、もし
目標物がクラッタ内に存在する場合に明瞭に区別して視
認することができる。
（ｂ）に示す従来例のクラッタ表示（第２図（ａ））と
本実施例のクラッタ表示（第２図（ｂ））の説明図を対
比しながら説明する。第２図（ａ）の左側のＡスコープ
表示は２個のクラッタビデオ信号30,31がベーシック雑
音上に存在する状態を示し、図の右側のPPI表示はこの
クラッタ残像30A,31Aが映像表示としてわずかに残って
いる状態を示している。本実施例を示す第２図（ｂ）の
左側のＡスコープ表示は第１図におけるＢ信号21の反転
信号に対して約数ナノ秒程度の遅延時間を遅延回路４に
より付与している。したがってＣ信号22と遅延されたＤ
信号23とは第２図（ｂ）のＡスコープ表示に示すように
消去されたクラッタビデオ信号32,33のそれぞれ前縁32
A,33Aと後縁32B,33Bにおいてクラッタビデオ信号が相殺
されずに残ることになる。なお、クラッタ信号に時間に
よる変化は左程大きくないので十分に相殺される。した
がって第２図（ｂ）の右側のPPI表示に示すようにクラ
ッタの位置32C,33Cの輪郭のみが映像として残り、もし
目標物がクラッタ内に存在する場合に明瞭に区別して視
認することができる。
以上説明したように、本発明は、ウェザー・ビデオ信
号の前縁及び後縁成分の信号のみ抽出し、波形整形後、
レーダ映像表示装置に入力されるので、他のレーダビデ
オ、すなわちノーマルビデオによる映像信号又はMTIビ
デオによる映像信号と重畳した場合にウェザー領域内の
目標映像が容易に視認できるという効果がある。
号の前縁及び後縁成分の信号のみ抽出し、波形整形後、
レーダ映像表示装置に入力されるので、他のレーダビデ
オ、すなわちノーマルビデオによる映像信号又はMTIビ
デオによる映像信号と重畳した場合にウェザー領域内の
目標映像が容易に視認できるという効果がある。
第１図は本発明の一実施例の構成図、第２図（ａ），
（ｂ）はそれぞれ従来例および本実施例のウェザー・ビ
デオ信号のＡスコープ、PPI表示例の説明図である。 1,6……分配器、２……増幅器、3,8……反転増幅器、４
……遅延回路、５……減算器、7,9……リミッタ回路、1
0……合成器、11……波形整形回路、12……映像表示装
置。
（ｂ）はそれぞれ従来例および本実施例のウェザー・ビ
デオ信号のＡスコープ、PPI表示例の説明図である。 1,6……分配器、２……増幅器、3,8……反転増幅器、４
……遅延回路、５……減算器、7,9……リミッタ回路、1
0……合成器、11……波形整形回路、12……映像表示装
置。
Claims (1)
- 【請求項１】ウェザービデオ信号と目標物ビデオ信号と
を表示するレーダ映像表示回路において、前記ウェザー
ビデオ信号を２等分する分配器と、この２等分された一
方のウェザービデオ信号を反転増幅した後に定められた
遅延時間を付与する遅延回路と、前記２等分された他方
のウェザービデオ信号を増幅する増幅器と、前記遅延回
路の出力信号と前記増幅器の出力信号とを入力して減算
する減算器と、前記減算器の出力信号における負極性成
分を除去するリミッタ回路部と、前記リミッタ回路部の
出力信号を波形整形した後に目標物を有するビデオ信号
とともに重畳して表示する映像表示部とを備えたことを
特徴とするレーダ映像表示回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2040121A JP2743550B2 (ja) | 1990-02-20 | 1990-02-20 | レーダ映像表示回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP2040121A JP2743550B2 (ja) | 1990-02-20 | 1990-02-20 | レーダ映像表示回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH03242578A JPH03242578A (ja) | 1991-10-29 |
| JP2743550B2 true JP2743550B2 (ja) | 1998-04-22 |
Family
ID=12571990
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP2040121A Expired - Lifetime JP2743550B2 (ja) | 1990-02-20 | 1990-02-20 | レーダ映像表示回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2743550B2 (ja) |
Families Citing this family (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JP5634183B2 (ja) * | 2010-09-13 | 2014-12-03 | 株式会社東芝 | 精測進入レーダ及びレーダ信号処理方法 |
-
1990
- 1990-02-20 JP JP2040121A patent/JP2743550B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPH03242578A (ja) | 1991-10-29 |
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