JP2732390B2 - Current output type comparator - Google Patents

Current output type comparator

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JP2732390B2 JP8799489A JP8799489A JP2732390B2 JP 2732390 B2 JP2732390 B2 JP 2732390B2 JP 8799489 A JP8799489 A JP 8799489A JP 8799489 A JP8799489 A JP 8799489A JP 2732390 B2 JP2732390 B2 JP 2732390B2
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Description

【発明の詳細な説明】 [産業上の利用分野] この発明は電流出力形コンパレータに関し、特にその
出力電流の値を微小な定電流値に保つことが容易な電流
出力形コンパレータに関するものである。
Description: BACKGROUND OF THE INVENTION 1. Field of the Invention The present invention relates to a current output type comparator, and more particularly to a current output type comparator which can easily maintain its output current at a minute constant current value.

[従来の技術] 第3図は従来の回路を示す接続図であって、図におい
て、Q1,Q2,Q6,Q7はそれぞれnpnトランジスタ、Q3,Q4,Q
5,Q8はそれぞれpnpトランジスタ、IEは定電流回路、R1,
R2,R3,R4,R5,R6はそれぞれ抵抗、VINは信号電圧、VTHは
スレシホールド電圧、IrはQ1のコレクタ電流、IC3,IC7,
IC8はそれぞれQ3,Q7,Q8のコレクタ電流である。Q7,Q8の
コレクタ接続点が出力端子となり、負荷はこの出力端子
と接地との間に接続される。
[Prior Art] FIG. 3 is a connection diagram showing a conventional circuit, in which Q1, Q2, Q6, and Q7 are npn transistors, Q3, Q4, and Q, respectively.
5, Q8 is a pnp transistor, IE is a constant current circuit, R1,
R2, R3, R4, R5, R6 are resistors, VIN is the signal voltage, VTH is the threshold voltage, Ir is the collector current of Q1, IC3, IC7,
IC8 is the collector current of Q3, Q7, Q8, respectively. The collector connection point of Q7 and Q8 becomes the output terminal, and the load is connected between this output terminal and the ground.

1対のトランジスタQ1,Q2によって差動増幅回路が形
成されるが、VINの大きさはQ2の電流を殆どカットオフ
して (Ir)=(IE)になるように制御するか、Q1の電流を
殆どカットオフして (Ir)=0になるように制御するかの2値的制御の場
合について考えることにする。但し、(IE)は定電流回
路IEの電流値を表す。その他( )につつんだ場合はこ
れに準ずる。
A differential amplifier circuit is formed by a pair of transistors Q1 and Q2. The magnitude of VIN is controlled by cutting off the current of Q2 almost so that (Ir) = (IE), or by controlling the current of Q1. Let us consider the case of binary control of controlling whether (Ir) = 0 by almost cutting off. Here, (IE) indicates the current value of the constant current circuit IE. If you wrap it in other (), this applies.

すなわち、Q7がカットオフされ、Q8から定電流IOを負
荷に与える電流ソースとして動作するか、負荷から定電
流をQ7に流す(そのときQ8はカットオフされている)電
流シンクとして動作するかの電流出力形コンパレータの
場合について考える。
That is, whether Q7 is cut off and operates as a current source that supplies a constant current IO from Q8 to the load, or operates as a current sink that passes a constant current from the load to Q7 (Q8 is then cut off). Consider the case of a current output type comparator.

また、電流シンクとしての動作は電流ソースとしての
動作に類似しているので、以下の説明においては、特別
な必要がない限り電流ソースとしての動作だけについて
説明する。
In addition, since the operation as a current sink is similar to the operation as a current source, only the operation as a current source will be described below unless otherwise required.

Q2がカットオフされると、Q4,Q5,Q6,Q7もカットオフ
される。
When Q2 is cut off, Q4, Q5, Q6, and Q7 are also cut off.

(Ir)=(IE),(IC3)=(Ir)であり、Q8はQ3の
カレントミラーとして接続されているので、抵抗R1,R4
の値の選定によって、(IC8)=A(IC3)に設定するこ
とができる。
Since (Ir) = (IE) and (IC3) = (Ir), and Q8 is connected as a current mirror of Q3, resistors R1 and R4
(IC8) = A (IC3) can be set by selecting the value of.

(IO)=(IC8)であるので、 (IO)=A(IE)…(1)となる。Aも(IE)も既知
であり、所定の定電流の電流ソースまたは電流シンクと
して動作する。負荷がキャパシタである場合は所定の定
電流でこれを充電または放電して鋸歯状波を発生するこ
とが出来る。
Since (IO) = (IC8), (IO) = A (IE) (1). Both A and (IE) are known and operate as a current source or sink of a given constant current. When the load is a capacitor, it can be charged or discharged with a predetermined constant current to generate a sawtooth wave.

[発明が解決しようとする課題] ところで、式(1)で表される電流IOの値には色々な
誤差が含まれる。たとえば、Irの中にはQ3,Q8のベース
電流が含まれているのでその補正をしなければならぬ。
[Problem to be Solved by the Invention] By the way, the value of the current IO represented by the equation (1) includes various errors. For example, since Ir includes the base currents of Q3 and Q8, it must be corrected.

第4図はこのような補正をした従来の回路を示す接続
図で、図において第3図と同一符号は同一又は相当部分
を示し、Q9,Q10,Q11はそれぞれ、Q3,Q8;Q4,Q5;Q6,Q7の
ベース電流を流すために設けられたトランジスタであ
り、ベース電流はこれらのトランジスタに流れるのでこ
れが誤差として入ってくることはなくなる。
FIG. 4 is a connection diagram showing a conventional circuit with such correction, in which the same reference numerals as those in FIG. 3 denote the same or corresponding parts, and Q9, Q10, Q11 denote Q3, Q8; Q4, Q5, respectively. A transistor provided to allow the base currents of Q6 and Q7 to flow, and since the base current flows through these transistors, this does not enter as an error.

然し、このコンパレータを鋸歯状波発光器に用いる場
合にはなお問題点がある。負荷のキャパシタを外付き部
品にしないで集積回路中に構成したいのであるが、集積
回路中に容易に構成できるキャパシタの容量は小さいの
で所望の鋸歯状波を発生するためには充電電流IOの値を
充分に小さくしなければならぬ。このことはQ8が小さな
電流領域で動作することを意味し、電流増幅率βの値が
不安定であり、かつ製造によるばらつきが多いことを意
味する。従って式(1)におけるAの値が正確でなくな
り、所望の鋸歯状液を発生出来なくなるという問題点が
ある。
However, there are still problems when using this comparator in a sawtooth wave light emitter. I would like to configure a load capacitor in an integrated circuit without using external components. Must be small enough. This means that Q8 operates in a small current region, that the value of the current amplification factor β is unstable, and that there is much variation due to manufacturing. Therefore, there is a problem that the value of A in the equation (1) becomes inaccurate and a desired saw-tooth liquid cannot be generated.

この発明は従来の回路における上記の課題を解決し、
微小な電流を正確な値で供給または(および)吸収する
ことができる電流出力形コンパレータを提供することを
目的としている。
The present invention solves the above-mentioned problems in the conventional circuit,
It is an object of the present invention to provide a current output type comparator capable of supplying or absorbing a minute current at an accurate value.

[課題を解決するための手段] この発明では、定電流IEのA倍の定電流を発生するカ
レントミラー回路と、IEのB倍の定電流を発生するカレ
ントミラー回路とを設け、(A−B)(IE)の値の定電
流を出力するようにした。
Means for Solving the Problems According to the present invention, a current mirror circuit that generates a constant current that is A times the constant current IE and a current mirror circuit that generates a constant current that is B times the IE are provided. B) A constant current having the value of (IE) was output.

[作用] 以上のように構成することで、A及びBはそれぞれ適
当な動作範囲の値を保ちながらA−Bの値を正確なかつ
小さな値にすることが出来る。
[Operation] With the configuration described above, A and B can make the value of AB accurate and small while maintaining the values of the appropriate operation ranges.

[実施例] 以下、図面を用いてこの発明の実施例について説明す
る。第1図はこの発明の一実施例を示す接続図で、第3
図と同一符号は同一または相当部分を示し、Q12,Q13,Q1
4はそれぞれnpnトランジスタ、Q15,Q16はそれぞれpnpト
ランジスタ、R7,R8,R9,R10はそれぞれ抵抗、IC12はQ12
のコレクタ電流を示す。Q15はQ3のカレントミラーとし
て、Q12はQ13のカレントミラーとして、Q16はQ4のカレ
ントミラーとしてそれぞれ接続されている。
Embodiment An embodiment of the present invention will be described below with reference to the drawings. FIG. 1 is a connection diagram showing an embodiment of the present invention.
The same reference numerals as those in the drawing indicate the same or corresponding parts, and Q12, Q13, Q1
4 is an npn transistor, Q15 and Q16 are pnp transistors, R7, R8, R9, and R10 are resistors, and IC12 is Q12.
Shows the collector current of Q15 is connected as a current mirror of Q3, Q12 is connected as a current mirror of Q13, and Q16 is connected as a current mirror of Q4.

第1図において第3図と同一符号の部分は第3図につ
いて説明したと同様に動作する。Q2がカットオフされた
場合は、Q4,Q5,Q6,Q7,Q16がカットオフされ、Q3,Q8,Q1
5,Q13,Q14,Q12に電流が流れるので (IO)=(IC8)−(IC12)…(2)となる。
1 operate in the same manner as described with reference to FIG. If Q2 is cut off, Q4, Q5, Q6, Q7, Q16 are cut off and Q3, Q8, Q1
5, Since current flows through Q13, Q14, and Q12, (IO) = (IC8)-(IC12) ... (2).

抵抗R1,R4,R7,R8,R9の値を適当に選定することによっ
て (IC8)=A(Ir),(IC12)=B(Ir)とすること
が出来る。実際の場合は R1=R4=R9としてA=1とし、R7,R8の選定によって
A−Bの値を所望の小さな値とすることが出来る。
By appropriately selecting the values of the resistors R1, R4, R7, R8, and R9, (IC8) = A (Ir) and (IC12) = B (Ir) can be obtained. In an actual case, R = 1 = R4 = R9 and A = 1, and the value of AB can be made a desired small value by selecting R7 and R8.

Q1がカットオフされる場合はQ2,Q4,Q5,Q6,Q7,Q16に電
流が流れIO(第1図の矢印とは反対方向)は (IO)=(IC7)−(IC16)となり、(IC7)=D(I
r),(IC16)=E(Ir)としD−Eの値を所望の小さ
な値とすることが出来る。
When Q1 is cut off, current flows through Q2, Q4, Q5, Q6, Q7, and Q16, and IO (in the direction opposite to the arrow in FIG. 1) becomes (IO) = (IC7)-(IC16), IC7) = D (I
r), (IC16) = E (Ir), and the value of DE can be a desired small value.

第1図のQ14はQ12,Q13のベース電流を流すために設け
られる。
Q14 in FIG. 1 is provided for flowing the base currents of Q12 and Q13.

第2図はこの発明の他の実施例を示す接続図で、図に
おいて第1図、第4図と同一符号は同一または相当部分
を示し、第2図のQ9,Q10,Q11の動作は第4図の同一符号
のトランジスタの動作と同様である。
FIG. 2 is a connection diagram showing another embodiment of the present invention, in which the same reference numerals as in FIGS. 1 and 4 denote the same or corresponding parts, and the operation of Q9, Q10, Q11 The operation is the same as that of the transistors having the same reference numerals in FIG.

第1図に示す実施例は電流ソースとしても電流シンク
としても微小な定電流を与えることの出来る回路を示す
が、使用の目的によればソースかシンクのいずれかの場
合だけ微小な定電流であればよく、その逆の場合の電流
は問題にされぬ場合がある。このような目的にこの発明
を使用する場合は第1図の回路から適宜な省略をした回
路を構成することが出来る。
Although the embodiment shown in FIG. 1 shows a circuit capable of supplying a small constant current both as a current source and a current sink, depending on the purpose of use, only a small constant current is required for either the source or the sink. The current in the opposite case may not be a problem. When the present invention is used for such a purpose, it is possible to construct a circuit in which the circuit of FIG. 1 is appropriately omitted.

第5図はこの発明の更に他の実施例を示す接続図で、
第1図に比しQ16が省略されている。
FIG. 5 is a connection diagram showing still another embodiment of the present invention.
Q16 is omitted from FIG.

(IC8)>(IC12)の場合は微小な定電流のソースと
なり (IC8)<(IC12)の場合はシンクとなる。第6図は
この発明の更に他の実施例を示す接続図で、第1図に比
しQ12,Q13,Q15が省略されている。
When (IC8)> (IC12), it becomes the source of a minute constant current, and when (IC8) <(IC12), it becomes the sink. FIG. 6 is a connection diagram showing still another embodiment of the present invention, and Q12, Q13 and Q15 are omitted from FIG.

(IC16)>(IC7)の場合は微小な定電流のソースと
なり (IC16)<(IC7)の場合はシンクとなる。
When (IC16)> (IC7), it becomes the source of a small constant current, and when (IC16) <(IC7), it becomes the sink.

[発明の効果] 以上のようにこの発明によれば、微小な電流値を正確
に出力することができる電流出力形コンパレータを構成
することが出来る。
[Effect of the Invention] As described above, according to the present invention, it is possible to configure a current output type comparator that can accurately output a small current value.

【図面の簡単な説明】[Brief description of the drawings]

第1図はこの発明の一実施例を示す接続図、第2図はこ
の発明の他の実施例を示す接続図、第3図、第4図は従
来の回路を示す接続図、第5図、第6図はこの発明の更
に他の実施例を示す接続図。 Q1,Q2,Q6,Q7,Q12,Q13……それぞれnpnトランジスタ、Q
3,Q4,Q5,Q8,Q15,Q16……それぞれpnpトランジスタ。 なお、図中同一符号は同一または相当部分を示す。
FIG. 1 is a connection diagram showing one embodiment of the present invention, FIG. 2 is a connection diagram showing another embodiment of the present invention, FIGS. 3 and 4 are connection diagrams showing a conventional circuit, and FIG. FIG. 6 is a connection diagram showing still another embodiment of the present invention. Q1, Q2, Q6, Q7, Q12, Q13 ... each is an npn transistor, Q
3, Q4, Q5, Q8, Q15, Q16 ... Each is a pnp transistor. In the drawings, the same reference numerals indicate the same or corresponding parts.

Claims (1)

(57)【特許請求の範囲】(57) [Claims] 【請求項1】1対のnpnトランジスタQ1,Q2のエミッタを
共通の定電流回路を経て接地に接続し、Q1のベースに信
号電圧を加え、Q2のベースにスレシホールド電圧を加え
て構成する差動増幅器、 Q1のロードとして電源とQ1のコレクタとの間に接続され
るpnpトランジスタQ3、 Q2のロードとして電源とQ2のコレクタとの間に接続され
るpnpトランジスタQ4、 Q4に対するカレントミラーとしてQ4のエミッタ電流に比
例するエミッタ電流を流すように接続されるpnpトラン
ジスタQ5、 Q5のロードとしてQ5のコレクタと接地の間に接続される
npnトランジスタQ6、 Q6に対するカレントミラーとしてQ6のエミッタ電流に比
例するエミッタ電流を流すように接続されるnpnトラン
ジスタQ7、 Q3に対するカレントミラーとしてQ3のエミッタ電流に比
例するエミッタ電流を流すように接続されるpnpトラン
ジスタQ8、を備え、 Q7と8のコレクタを接続し、この接続点を出力端子とし
てこの出力端子と接地との間に負荷を接続して構成する
電流出力形コンパレータにおいて、 Q4に対するカレントミラーとしてQ4のエミッタ電流に比
例するエミッタ電流を流すように接続されるpnpトラン
ジスタQ16を設けQ16のコレクタを上記出力端子に接続
し、 及び(又は)、 Q3に対するカレントミラーとしてQ3のエミッタ電流に比
例するエミッタ電流を流すように接続されるpnpトラン
ジスタQ15と、 Q15のロードとしてQ15のコレクタと接地との間に接続さ
れるnpnトランジスタQ13と、 Q13に対するカレントミラーとしてQ13のエミッタ電流に
比例するエミッタ電流を流すように接続されるnpnトラ
ンジスタQ12とを設けQ12のコレクタを上記出力端子に接
続することを特徴とする電流出力形コンパレータ。
An emitter of a pair of npn transistors Q1 and Q2 is connected to ground via a common constant current circuit, a signal voltage is applied to the base of Q1, and a threshold voltage is applied to the base of Q2. Differential amplifier, pnp transistor Q3 connected between power supply and collector of Q1 as load of Q1, pnp transistor Q4 connected between power supply and collector of Q2 as load of Q2 Q4 as current mirror for Q4 A pnp transistor Q5 connected to flow an emitter current proportional to the emitter current of Q5, connected between the collector of Q5 and ground as the load of Q5
The npn transistors Q6 and Q6 are connected to flow an emitter current proportional to the emitter current of Q6 as a current mirror to Q6.The npn transistors Q7 and Q3 are connected to flow an emitter current proportional to the emitter current of Q3 as a current mirror to Q3. a current output type comparator comprising a pnp transistor Q8, connecting the collectors of Q7 and Q8, and connecting this node to an output terminal and connecting a load between the output terminal and the ground, as a current mirror for Q4 Providing a pnp transistor Q16 connected to flow an emitter current proportional to the emitter current of Q4, connecting the collector of Q16 to the output terminal, and / or an emitter proportional to the emitter current of Q3 as a current mirror for Q3 A pnp transistor Q15 connected to allow current to flow, and Q15 And an npn transistor Q12 connected as a current mirror to Q13 so that an emitter current proportional to the emitter current of Q13 flows, and a collector of Q12 is connected to the output terminal. A current output type comparator characterized by being connected.
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