JP2611197B2 - 感熱ヘツドの駆動制御回路 - Google Patents
感熱ヘツドの駆動制御回路Info
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- JP2611197B2 JP2611197B2 JP10139486A JP10139486A JP2611197B2 JP 2611197 B2 JP2611197 B2 JP 2611197B2 JP 10139486 A JP10139486 A JP 10139486A JP 10139486 A JP10139486 A JP 10139486A JP 2611197 B2 JP2611197 B2 JP 2611197B2
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- JP
- Japan
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- correction
- head
- counter
- drive
- control circuit
- Prior art date
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- Expired - Lifetime
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-
- B—PERFORMING OPERATIONS; TRANSPORTING
- B41—PRINTING; LINING MACHINES; TYPEWRITERS; STAMPS
- B41J—TYPEWRITERS; SELECTIVE PRINTING MECHANISMS, i.e. MECHANISMS PRINTING OTHERWISE THAN FROM A FORME; CORRECTION OF TYPOGRAPHICAL ERRORS
- B41J2/00—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed
- B41J2/315—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material
- B41J2/32—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads
- B41J2/35—Typewriters or selective printing mechanisms characterised by the printing or marking process for which they are designed characterised by selective application of heat to a heat sensitive printing or impression-transfer material using thermal heads providing current or voltage to the thermal head
- B41J2/355—Control circuits for heating-element selection
Landscapes
- Electronic Switches (AREA)
Description
【発明の詳細な説明】 ［産業上の利用分野］ 本発明は、階調付カラープリンターなどにおいて正確
な色再現を行うための感熱ヘツドの駆動制御回路に関す
る。
な色再現を行うための感熱ヘツドの駆動制御回路に関す
る。
［発明の概要］ 本発明は、ヘツド素子各々の駆動・非駆動情報をシフ
トレジスタに記憶し、ストローブ信号の周期にて前記ヘ
ツド素子の駆動時間を制御する感熱ヘツドの駆動制御回
路において、 同時に駆動するヘツド素子の本数をカウントし、その
本数に応じてストローブ信号の周期を可変することによ
り、 感熱ヘツドへの駆動電圧の変動に対しきめ細かい補正
ができ良好な色再現を可能とするものである。
トレジスタに記憶し、ストローブ信号の周期にて前記ヘ
ツド素子の駆動時間を制御する感熱ヘツドの駆動制御回
路において、 同時に駆動するヘツド素子の本数をカウントし、その
本数に応じてストローブ信号の周期を可変することによ
り、 感熱ヘツドへの駆動電圧の変動に対しきめ細かい補正
ができ良好な色再現を可能とするものである。
［従来の技術］ 例えば、感熱ヘツドを有する階調カラープリンターに
おいては、感熱ヘツドの駆動時間によつて色濃度を出す
ため、階調情報に応じたパルス巾変調信号（PWM信号）
をもつて感熱ヘツドを駆動する駆動制御回路が知られて
いる（特開昭56−115280号公報）。
おいては、感熱ヘツドの駆動時間によつて色濃度を出す
ため、階調情報に応じたパルス巾変調信号（PWM信号）
をもつて感熱ヘツドを駆動する駆動制御回路が知られて
いる（特開昭56−115280号公報）。
このようなPWM信号でもつて感熱ヘツドを駆動する従
来の駆動制御回路は、第３図に示すように、縦ｍドツト
×横ｎドツトのプリント画を印画するプリンターにおい
て感熱ヘツド13には縦ｍラインに相当する複数のヘツド
素子TH−１〜TH−512（この場合ｍ＝512とする。）が１
列に設けられ、この複数のヘツド素子TH−１〜TH−512
は直流電源14に接続されている。感熱ヘツド13は前記ヘ
ツド素子TH−１〜TH−512各々の駆動・非駆動情報を記
憶するシフトレジスタ６を備え、このシフトレジスタ６
にはヘツドコントロール部15から駆動データが入力され
る。而して、ストローブ信号が入力されるとラツチ＆ド
ライブ回路７にてシフトレジスタ６の情報に基づいてヘ
ツド素子TH−１〜TH−512に所定時間だけ電圧が印加さ
れる。だが、同時に駆動するヘッド素子TH−１〜TH−51
2の本数が多くなると、電源14の特性とか配線抵抗等に
より各ヘツド素子TH−１〜TH−512の端子電圧が降下し
各ヘツド素子TH−１〜TH−512が所定の熱エネルギーを
放出しなくなる。
来の駆動制御回路は、第３図に示すように、縦ｍドツト
×横ｎドツトのプリント画を印画するプリンターにおい
て感熱ヘツド13には縦ｍラインに相当する複数のヘツド
素子TH−１〜TH−512（この場合ｍ＝512とする。）が１
列に設けられ、この複数のヘツド素子TH−１〜TH−512
は直流電源14に接続されている。感熱ヘツド13は前記ヘ
ツド素子TH−１〜TH−512各々の駆動・非駆動情報を記
憶するシフトレジスタ６を備え、このシフトレジスタ６
にはヘツドコントロール部15から駆動データが入力され
る。而して、ストローブ信号が入力されるとラツチ＆ド
ライブ回路７にてシフトレジスタ６の情報に基づいてヘ
ツド素子TH−１〜TH−512に所定時間だけ電圧が印加さ
れる。だが、同時に駆動するヘッド素子TH−１〜TH−51
2の本数が多くなると、電源14の特性とか配線抵抗等に
より各ヘツド素子TH−１〜TH−512の端子電圧が降下し
各ヘツド素子TH−１〜TH−512が所定の熱エネルギーを
放出しなくなる。
このため、従来においてはヘツド素子TH−１〜TH−51
2の端子電圧値VHを増幅器16を介してパルス発生器１に
フイードバツクしクロツクパルス周期を可変してヘツド
素子TH−１〜TH−512の駆動時間を補正していた。
2の端子電圧値VHを増幅器16を介してパルス発生器１に
フイードバツクしクロツクパルス周期を可変してヘツド
素子TH−１〜TH−512の駆動時間を補正していた。
［発明が解決しようとする問題点］ しかしながら、ヘツド素子TH−１〜TH−512の端子電
圧値VHをフイードバツクするものにあつては、端子電圧
値の変動がごくわずかであるため細かい補正ができず充
分な成果が得られないという欠点があつた。
圧値VHをフイードバツクするものにあつては、端子電圧
値の変動がごくわずかであるため細かい補正ができず充
分な成果が得られないという欠点があつた。
そこで、本発明はきめ細かい補正ができ良好な色再現
が可能となる感熱ヘツドの駆動制御回路を提供すること
を目的とする。
が可能となる感熱ヘツドの駆動制御回路を提供すること
を目的とする。
［問題点を解決するための手段］ 而して、上記目的を達成するための本発明の構成は、
複数のヘツド素子と、このヘツド素子の各々の駆動・非
駆動情報を記憶するシフトレジスタと、このシフトレジ
スタの情報を一時的に保持するラツチ＆ドライブ回路と
を備え、ストローブ信号の周期にて前記ヘツド素子の駆
動時間を制御する感熱ヘツドの駆動制御回路において、
同時に駆動するヘツド素子の本数をカウントし、このカ
ウント値に応じた補正カウント基準値を出力するメモリ
を設け、この補正カウント基準値に基づき補正用クロッ
クパルスのカウントを行って補正時間を設定し、この補
正時間により前記ストローブ信号の周期を可変して前記
ヘツド素子の駆動時間を補正したことを特徴とする。
複数のヘツド素子と、このヘツド素子の各々の駆動・非
駆動情報を記憶するシフトレジスタと、このシフトレジ
スタの情報を一時的に保持するラツチ＆ドライブ回路と
を備え、ストローブ信号の周期にて前記ヘツド素子の駆
動時間を制御する感熱ヘツドの駆動制御回路において、
同時に駆動するヘツド素子の本数をカウントし、このカ
ウント値に応じた補正カウント基準値を出力するメモリ
を設け、この補正カウント基準値に基づき補正用クロッ
クパルスのカウントを行って補正時間を設定し、この補
正時間により前記ストローブ信号の周期を可変して前記
ヘツド素子の駆動時間を補正したことを特徴とする。
［作用］ 従つて、駆動するヘツド素子の本数をカウントしてそ
の本数に応じて駆動時間が補正されるもので、きめ細か
な補正が可能となる。
の本数に応じて駆動時間が補正されるもので、きめ細か
な補正が可能となる。
［実施例］ 以下、本発明の実施例を図面に基づいて説明する。
プリンターは、縦512ドツト×横256ドツトのプリント
画面で、256階調を出すことができるものとして説明さ
れる。
画面で、256階調を出すことができるものとして説明さ
れる。
パルス発生器１は、出力端子ａからはデータ用クロツ
クパルスを、出力端子ｂからは補正用クロツクパルスを
出力する。この補正用クロツクパルスは、その周波数が
ヘツド素子TH−１〜TH−512の本数，感熱ヘツド内の内
部抵抗等から適宜決定される。
クパルスを、出力端子ｂからは補正用クロツクパルスを
出力する。この補正用クロツクパルスは、その周波数が
ヘツド素子TH−１〜TH−512の本数，感熱ヘツド内の内
部抵抗等から適宜決定される。
アドレスカウンタ２は、スイツチ20を介して前記パル
ス発生器１から動作クロツクを供給され、ラインメモリ
３に記憶されている階調データを読み出すと共に512カ
ウントする毎にキヤリー信号を階調カウンタ４に出力す
る。
ス発生器１から動作クロツクを供給され、ラインメモリ
３に記憶されている階調データを読み出すと共に512カ
ウントする毎にキヤリー信号を階調カウンタ４に出力す
る。
スイツチ20は、パルス発生器１がアドレスカウンタ２
等に送るクロツクパルスの出力をオン・オフするもの
で、このスイツチ20は下記するストローブカウンタ８の
ストローブ信号によつてオン・オフされる。
等に送るクロツクパルスの出力をオン・オフするもの
で、このスイツチ20は下記するストローブカウンタ８の
ストローブ信号によつてオン・オフされる。
ラインメモリ３は、縦方向の１ライン分の階調データ
（１ドツト＝８ビツト）を記憶する容量を有し、前記ア
ドレスカウンタ２からのアドレス信号に応じて１ドツト
目から512ドツト目までの各８ビツトの記憶内容をパラ
レルに順次比較器５に出力する。
（１ドツト＝８ビツト）を記憶する容量を有し、前記ア
ドレスカウンタ２からのアドレス信号に応じて１ドツト
目から512ドツト目までの各８ビツトの記憶内容をパラ
レルに順次比較器５に出力する。
前記階調カウンタ４は、１階調目から256階調目まで
の基準階調を順次比較器５に出力する。
の基準階調を順次比較器５に出力する。
この比較器５は、ラインメモリ３からの階調データを
階調カウンタ４から送られてくる基準階調の１階調目か
ら256階調目まで順次比較し、階調データが基準階調よ
り大又は等しいときはＨ信号を、階調データが基準階調
より小さいときはＬ信号をデータとしてシフトレジスタ
６にシリアルに出力する。従つて、１つの階調について
ｍドツトに対応する、つまり512個のＨ信号及びＬ信号
を出力する。
階調カウンタ４から送られてくる基準階調の１階調目か
ら256階調目まで順次比較し、階調データが基準階調よ
り大又は等しいときはＨ信号を、階調データが基準階調
より小さいときはＬ信号をデータとしてシフトレジスタ
６にシリアルに出力する。従つて、１つの階調について
ｍドツトに対応する、つまり512個のＨ信号及びＬ信号
を出力する。
ヘツド素子TH−１〜TH−512は、この実施例では縦ｍ
ドツトに対応する個数である512個が並設されている。
ドツトに対応する個数である512個が並設されている。
前記シフトレジスタ６は、ヘツド素子TH−１〜TH−51
2の各々の駆動・非駆動情報（駆動がＨ信号，非駆動が
Ｌ信号）を記憶できる記憶容量（512×１ビツト）を有
し、比較器５から送られてくるデータをパルス発生器１
からのシフトクロツクにて所定箇所に記憶する。
2の各々の駆動・非駆動情報（駆動がＨ信号，非駆動が
Ｌ信号）を記憶できる記憶容量（512×１ビツト）を有
し、比較器５から送られてくるデータをパルス発生器１
からのシフトクロツクにて所定箇所に記憶する。
ラツチ＆ドライブ回路７は、ストローブ信号が入力さ
れるとシフトレジスタ６の記憶状態を次のストローブ信
号が入力されるまでの間ラツチする。具体的にはストロ
ーブ信号の立ち下がり時間毎にラッチ状態を更新し、且
つ、駆動情報（Ｈ信号）がラツチされているヘツド素子
TH−１〜TH512を駆動し、非駆動情報（Ｌ信号）がラツ
チされているヘツド素子TH−１〜TH−512は駆動しな
い。
れるとシフトレジスタ６の記憶状態を次のストローブ信
号が入力されるまでの間ラツチする。具体的にはストロ
ーブ信号の立ち下がり時間毎にラッチ状態を更新し、且
つ、駆動情報（Ｈ信号）がラツチされているヘツド素子
TH−１〜TH512を駆動し、非駆動情報（Ｌ信号）がラツ
チされているヘツド素子TH−１〜TH−512は駆動しな
い。
ストローブカウンタ８は、パルス発生器１からシフト
レジスタ６に送出されるシフトクロツクの個数をカウン
トし、512個数えた時点で立ち上がるストローブパルス
を出力する。このストローブパルスの幅は下記するよう
にカウンタ９からのキヤリー信号によつて決定され、こ
のストローブパルスの立ち下がり時点で前記ラツチ＆ド
ライブ回路７は次の駆動・非駆動情報をラツチする。従
つて、ストローブパルスのパルス幅によつてヘツド素子
TH−１〜TH−512の１単位階調の駆動時間が補正され
る。
レジスタ６に送出されるシフトクロツクの個数をカウン
トし、512個数えた時点で立ち上がるストローブパルス
を出力する。このストローブパルスの幅は下記するよう
にカウンタ９からのキヤリー信号によつて決定され、こ
のストローブパルスの立ち下がり時点で前記ラツチ＆ド
ライブ回路７は次の駆動・非駆動情報をラツチする。従
つて、ストローブパルスのパルス幅によつてヘツド素子
TH−１〜TH−512の１単位階調の駆動時間が補正され
る。
尚、ストローブカウンタ８は、カウンタ９からのキヤ
リー出力の立ち下がりによつてクリアされ再びシフトク
ロツクの個数をカウントする。
リー出力の立ち下がりによつてクリアされ再びシフトク
ロツクの個数をカウントする。
クロツク切換スイツチ10は、カウンタ９に供給する周
波数を切り換えるもので、シフトレジスタ６へのデータ
入力時はデータ用クロツクをカウンタ９に供給し、補正
時は補正用クロツクをカウンタ９に供給する。
波数を切り換えるもので、シフトレジスタ６へのデータ
入力時はデータ用クロツクをカウンタ９に供給し、補正
時は補正用クロツクをカウンタ９に供給する。
このカウンタ９は、比較器５からシフトレジスタ６に
送出されるデータ中のＨ信号をデータ用クロツクに同期
させてカウントし、Ｈ信号の個数をストローブパルスの
立ち上がり時点でインバータ11に出力する。即ち、スト
ローブカウンタ８からのストローブパルスが入力される
とそのストローブパルスの立ち上がりにカウンタ９の出
力がインバータ11,ROM12を介してカウンタ９の入力にロ
ードされる。
送出されるデータ中のＨ信号をデータ用クロツクに同期
させてカウントし、Ｈ信号の個数をストローブパルスの
立ち上がり時点でインバータ11に出力する。即ち、スト
ローブカウンタ８からのストローブパルスが入力される
とそのストローブパルスの立ち上がりにカウンタ９の出
力がインバータ11,ROM12を介してカウンタ９の入力にロ
ードされる。
インバータ11は、カウンタ９の出力を反転することに
より512からＨ信号の個数を差し引いた分をROM12に出力
する。
より512からＨ信号の個数を差し引いた分をROM12に出力
する。
メモリであるROM12にはヘツド素子TH−１〜TH−512の
電流対発熱温度特性情報が記憶され前記インバータ11か
らの入力情報に応じた補正カウント基準値をカウンタ９
に出力する。例えば、インバータ11から12の入力があつ
た場合には補正された値（補正カウント基準値）として
10をカウンタ９にフイードバツクする用な補正が行われ
る。
電流対発熱温度特性情報が記憶され前記インバータ11か
らの入力情報に応じた補正カウント基準値をカウンタ９
に出力する。例えば、インバータ11から12の入力があつ
た場合には補正された値（補正カウント基準値）として
10をカウンタ９にフイードバツクする用な補正が行われ
る。
クロツク切換スイツチ10は、前記カウンタ９に入力さ
れるパルス周波数を切り換えるためのもので、前記スト
ローブカウンタ８からのストローブパルスの１（Ｈレベ
ル）の期間、データ用クロツクから補正用クロツクに切
り換えられる（Ｄ端子からＣ端子に接続が切り換えられ
る）。
れるパルス周波数を切り換えるためのもので、前記スト
ローブカウンタ８からのストローブパルスの１（Ｈレベ
ル）の期間、データ用クロツクから補正用クロツクに切
り換えられる（Ｄ端子からＣ端子に接続が切り換えられ
る）。
以下、上記感熱ヘツドの駆動制御回路の作用を第１図
及び第２図に基づいて説明する。
及び第２図に基づいて説明する。
アドレスカウンタ２からのアドレス信号に従いライン
メモリ３からデータが縦１ドツト目から512ドツト目ま
で順次比較器５に送られ、このデータが階調カウンタ４
の１階調目の基準階調と比較され、シフトレジスタ６に
その結果が順次出力される。
メモリ３からデータが縦１ドツト目から512ドツト目ま
で順次比較器５に送られ、このデータが階調カウンタ４
の１階調目の基準階調と比較され、シフトレジスタ６に
その結果が順次出力される。
シフトレジスタ６は、比較器５からのデータを順次所
定位置に記憶する。カウンタ９は512ドツト分のデータ
のＨ信号だけをカウントし（第２図（ｄ）参照）、この
カウントが終了するとストローブカウンタ８のストロー
ブパルスの立ち上がりで前記カウント値をインバータ11
に出力し、ROM12よりカウント値に応じた補正カウント
基準値がカウンタ９にフイードバツクされる。このフイ
ードバツクされた補正カウント基準値をロードしてこの
補正カウント基準値から512まで補正用クロツクでカウ
ントする（第２図（ｄ）参照）。このカウントが終了す
るとストローブカウンタ８にキヤリー信号が出力されス
トローブパルスが立ち下がる（第２図（ｂ）参照）。即
ち、この補正用クロツクのカウント時間が補正時間とな
り、ロードされる値が大きいとカウントが早く終了し、
また、ロードされる値が小さいとカウントに時間がかか
り、ロードされる値によつてキヤリー信号が出るタイミ
ングが異なる。
定位置に記憶する。カウンタ９は512ドツト分のデータ
のＨ信号だけをカウントし（第２図（ｄ）参照）、この
カウントが終了するとストローブカウンタ８のストロー
ブパルスの立ち上がりで前記カウント値をインバータ11
に出力し、ROM12よりカウント値に応じた補正カウント
基準値がカウンタ９にフイードバツクされる。このフイ
ードバツクされた補正カウント基準値をロードしてこの
補正カウント基準値から512まで補正用クロツクでカウ
ントする（第２図（ｄ）参照）。このカウントが終了す
るとストローブカウンタ８にキヤリー信号が出力されス
トローブパルスが立ち下がる（第２図（ｂ）参照）。即
ち、この補正用クロツクのカウント時間が補正時間とな
り、ロードされる値が大きいとカウントが早く終了し、
また、ロードされる値が小さいとカウントに時間がかか
り、ロードされる値によつてキヤリー信号が出るタイミ
ングが異なる。
ストローブカウンタ８は、シフトクロツクの個数を51
2個数えた時点で立ち上がり、カウンタ512からのキヤリ
ー信号にて立ち下がるストローブパルスをラツチ＆ドラ
イブ回路７とカウンタ９に出力する（第２図（ｂ），
（ｃ）参照）。尚、カウンタ９はこのストローブパルス
間で上述のような補正を行なうと共に、このストローブ
パルスはスイツチ10,20、カウンタ９等に送出され補正
時はスイツチ20が開放される等してラインメモリ３のデ
ータ処理が一時中断される（第２図（ｆ），（Ｇ）参
照）。
2個数えた時点で立ち上がり、カウンタ512からのキヤリ
ー信号にて立ち下がるストローブパルスをラツチ＆ドラ
イブ回路７とカウンタ９に出力する（第２図（ｂ），
（ｃ）参照）。尚、カウンタ９はこのストローブパルス
間で上述のような補正を行なうと共に、このストローブ
パルスはスイツチ10,20、カウンタ９等に送出され補正
時はスイツチ20が開放される等してラインメモリ３のデ
ータ処理が一時中断される（第２図（ｆ），（Ｇ）参
照）。
ラツチ＆ドライブ回路７は、前回のストローブパルス
の立ち下がりにてシフトレジスタ６内の駆動・非駆動情
報をラツチしており、今回のストローブ信号の立ち下が
り箇所で上記情報を更新する。従つて、ストローブパル
ス幅（補正時間）だけ駆動時間が伸ばされる。（第２図
（ａ）参照）。
の立ち下がりにてシフトレジスタ６内の駆動・非駆動情
報をラツチしており、今回のストローブ信号の立ち下が
り箇所で上記情報を更新する。従つて、ストローブパル
ス幅（補正時間）だけ駆動時間が伸ばされる。（第２図
（ａ）参照）。
而して、以上の工程が終了すると２階調目の動作に移
り、これが256階調目まで終了すると次の縦ラインの印
画に移りこれが256回繰り返されて例えばイエローのプ
リントが終了する。
り、これが256階調目まで終了すると次の縦ラインの印
画に移りこれが256回繰り返されて例えばイエローのプ
リントが終了する。
即ち、駆動されるヘツド素子TH−１〜TH−512の本数
に応じて前記ストローブパルス幅即ちストローブパルス
の周期が可変されてきめ細かな補正ができ、さらに、こ
の実施例においてはROM12を介してカウンタ９に駆動さ
れるヘツド素子TH−１〜TH−512の本数をフイードバツ
クするので、非線形な補正もできなお正確な色再現が可
能となる。
に応じて前記ストローブパルス幅即ちストローブパルス
の周期が可変されてきめ細かな補正ができ、さらに、こ
の実施例においてはROM12を介してカウンタ９に駆動さ
れるヘツド素子TH−１〜TH−512の本数をフイードバツ
クするので、非線形な補正もできなお正確な色再現が可
能となる。
［発明の効果］ 以上述べたように本発明によれば、同時に駆動するヘ
ツド素子の本数をカウントしその本数に応じてヘツド素
子の駆動時間を補正したので、ヘツド素子の本数だけ分
割した補正ができるためきめ細かな補正ができ正確な色
再現が可能であるという効果を奏する。
ツド素子の本数をカウントしその本数に応じてヘツド素
子の駆動時間を補正したので、ヘツド素子の本数だけ分
割した補正ができるためきめ細かな補正ができ正確な色
再現が可能であるという効果を奏する。
また、補正用クロックパルスのカウントを行って補正
時間を設定するため、同時に駆動するヘッド素子の本数
に対応する個々の補正時間のレベルはメモリ内のデータ
を補正しなければならないが、全体的な補正時間のレベ
ルについては補正用クロックパルスの周波数を可変する
ことにより簡単に行うことができる。
時間を設定するため、同時に駆動するヘッド素子の本数
に対応する個々の補正時間のレベルはメモリ内のデータ
を補正しなければならないが、全体的な補正時間のレベ
ルについては補正用クロックパルスの周波数を可変する
ことにより簡単に行うことができる。
さらに、同時に駆動するヘッド素子の本数のカウント
と、補正カウント基準値に基づく補正用クロックパルス
のカウントとを同一のカウンタにて行うよう構成したの
で、１つのカウンタで駆動ヘッド素子のカウントと補正
時間の設定ができる。
と、補正カウント基準値に基づく補正用クロックパルス
のカウントとを同一のカウンタにて行うよう構成したの
で、１つのカウンタで駆動ヘッド素子のカウントと補正
時間の設定ができる。
第１図は本発明の実施例を示す感熱ヘツドの駆動制御回
路のブロツク図であり、第２図は各部の動作状態を説明
する図、第３図は従来例を示す感熱ヘツドの駆動制御回
路のブロツク図である。 TH−１〜TH−512……ヘツド素子、６……シフトレジス
タ、７……ラツチ＆ドライブ回路、９……カウンタ。
路のブロツク図であり、第２図は各部の動作状態を説明
する図、第３図は従来例を示す感熱ヘツドの駆動制御回
路のブロツク図である。 TH−１〜TH−512……ヘツド素子、６……シフトレジス
タ、７……ラツチ＆ドライブ回路、９……カウンタ。
───────────────────────────────────────────────────── フロントページの続き (56)参考文献 特開 昭58−14787（ＪＰ，Ａ) 特開 昭57−78265（ＪＰ，Ａ) 特開 昭62−36976（ＪＰ，Ａ) 特開 昭60−23063（ＪＰ，Ａ)
Claims (2)
- 【請求項１】複数のヘツド素子と、このヘツド素子の各
々の駆動・非駆動情報を記憶するシフトレジスタと、こ
のシフトレジスタの情報を一時的に保持するラツチ＆ド
ライブ回路とを備え、ストローブ信号の周期にて前記ヘ
ツド素子の駆動時間を制御する感熱ヘツドの駆動制御回
路において、 同時に駆動するヘツド素子の本数をカウントし、このカ
ウント値に応じた補正カウント基準値を出力するメモリ
を設け、この補正カウント基準値に基づき補正用クロッ
クパルスのカウントを行って補正時間を設定し、この補
正時間により前記ストローブ信号の周期を可変して前記
ヘツド素子の駆動時間を補正したことを特徴とする感熱
ヘツドの駆動制御回路。 - 【請求項２】同時に駆動するヘッド素子の本数のカウン
トと、補正カウント基準値に基づく補正用クロックパル
スのカウントとを同一のカウンタにて行うよう構成した
ことを特徴とする請求項１に記載の感熱ヘッドの駆動制
御回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10139486A JP2611197B2 (ja) | 1986-05-01 | 1986-05-01 | 感熱ヘツドの駆動制御回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP10139486A JP2611197B2 (ja) | 1986-05-01 | 1986-05-01 | 感熱ヘツドの駆動制御回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS62257865A JPS62257865A (ja) | 1987-11-10 |
| JP2611197B2 true JP2611197B2 (ja) | 1997-05-21 |
Family
ID=14299524
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP10139486A Expired - Lifetime JP2611197B2 (ja) | 1986-05-01 | 1986-05-01 | 感熱ヘツドの駆動制御回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2611197B2 (ja) |
Families Citing this family (2)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| KR0138362B1 (ko) * | 1993-05-17 | 1998-05-15 | 김광호 | 열전사 프린터장치 및 그 방법 |
| JP5574347B2 (ja) * | 2009-07-27 | 2014-08-20 | ナルテック株式会社 | サーマルヘッドを制御するユニットを有する装置 |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS6023063A (ja) * | 1983-07-18 | 1985-02-05 | Matsushita Graphic Commun Syst Inc | 記録装置 |
-
1986
- 1986-05-01 JP JP10139486A patent/JP2611197B2/ja not_active Expired - Lifetime
Also Published As
| Publication number | Publication date |
|---|---|
| JPS62257865A (ja) | 1987-11-10 |
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| Date | Code | Title | Description |
|---|---|---|---|
| EXPY | Cancellation because of completion of term |