JP2574740Y2 - エンコーダ結線チェッカ - Google Patents
エンコーダ結線チェッカInfo
- Publication number
- JP2574740Y2 JP2574740Y2 JP1991102194U JP10219491U JP2574740Y2 JP 2574740 Y2 JP2574740 Y2 JP 2574740Y2 JP 1991102194 U JP1991102194 U JP 1991102194U JP 10219491 U JP10219491 U JP 10219491U JP 2574740 Y2 JP2574740 Y2 JP 2574740Y2
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- JP
- Japan
- Prior art keywords
- encoder
- pulse signal
- pulse
- output
- connection
- Prior art date
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- Transmission And Conversion Of Sensor Element Output (AREA)
Description
【０００１】
【産業上の利用分野】本考案は、サーボモータ等の回転
速度および磁極の位置等を検出するロータリーエンコー
ダにおいて、ロータリーエンコーダとコネクタ間の結線
をチェックするエンコーダ結線チェッカに関する。
速度および磁極の位置等を検出するロータリーエンコー
ダにおいて、ロータリーエンコーダとコネクタ間の結線
をチェックするエンコーダ結線チェッカに関する。
【０００２】
【従来の技術】近年、自動機械または工作機等に利用さ
れているサーボモータにおいては、高い応答性と広くし
かも精密な速度制御が要求されている。そのため、精度
と応答性の高い速度検出器が必要であり、モータの回転
角度および磁界の検出手段として、モータの回転角度に
対し所定のパルス信号を発生するパルスエンコーダが用
いられている。以下の説明においては、パルスエンコー
ダを単にエンコーダと呼ぶ。通常、モータの回転軸に取
り付けられたエンコーダはモータと同期して回転するロ
ータリーエンコーダ型であり、このエンコーダのパルス
信号出力端は多数のケーブルによりコネクタに接続され
る。特に、エンコーダが差動出力の場合、エンコーダは
その制御系装置であるドライバと、電源ケーブルを含
め、約２０本のケーブルで接続される。
れているサーボモータにおいては、高い応答性と広くし
かも精密な速度制御が要求されている。そのため、精度
と応答性の高い速度検出器が必要であり、モータの回転
角度および磁界の検出手段として、モータの回転角度に
対し所定のパルス信号を発生するパルスエンコーダが用
いられている。以下の説明においては、パルスエンコー
ダを単にエンコーダと呼ぶ。通常、モータの回転軸に取
り付けられたエンコーダはモータと同期して回転するロ
ータリーエンコーダ型であり、このエンコーダのパルス
信号出力端は多数のケーブルによりコネクタに接続され
る。特に、エンコーダが差動出力の場合、エンコーダは
その制御系装置であるドライバと、電源ケーブルを含
め、約２０本のケーブルで接続される。
【０００３】そして、エンコーダとコネクタとの間の結
線は、作業者の手作業により行われており、結線ミスが
発生しやすいため、結線の確認をする必要がある。つま
り、結線ミスがあるか否か、また、結線ミスがある場
合、どのケーブルにおける結線ミスであるかを検出しな
ければならない。従来の結線の確認手段としては、コネ
クタをドライバと組み合わせ、運転状態の良否により判
断する方法がある。この場合、これらの運転状態が良く
なければ、結線ミスがあると判断し、どの配線における
結線ミスかを判断する手段としては、各々のケーブルに
対し、目視によって検査が行われる。
線は、作業者の手作業により行われており、結線ミスが
発生しやすいため、結線の確認をする必要がある。つま
り、結線ミスがあるか否か、また、結線ミスがある場
合、どのケーブルにおける結線ミスであるかを検出しな
ければならない。従来の結線の確認手段としては、コネ
クタをドライバと組み合わせ、運転状態の良否により判
断する方法がある。この場合、これらの運転状態が良く
なければ、結線ミスがあると判断し、どの配線における
結線ミスかを判断する手段としては、各々のケーブルに
対し、目視によって検査が行われる。
【０００４】
【考案が解決しようとする課題】上述のように、エンコ
ーダとコネクタとの結線において、結線ミスがあるか否
かを調べる際、コネクタとドライバとを接続し、その運
転状態の良否において判断し、また、結線ミスのある配
線の検出においては、各々のケーブルに対し目視によっ
て検査が行わなければならないため、その作業は容易で
はなく、長時間を要するという欠点がある。また、この
目視による検査は人為的であるため、その調査結果が常
に正確であるとは限らないという問題がある。本考案は
上述した事情に鑑みてなされたもので、エンコーダとコ
ネクタ間の結線ミスを容易に検出することを目的とす
る。
ーダとコネクタとの結線において、結線ミスがあるか否
かを調べる際、コネクタとドライバとを接続し、その運
転状態の良否において判断し、また、結線ミスのある配
線の検出においては、各々のケーブルに対し目視によっ
て検査が行わなければならないため、その作業は容易で
はなく、長時間を要するという欠点がある。また、この
目視による検査は人為的であるため、その調査結果が常
に正確であるとは限らないという問題がある。本考案は
上述した事情に鑑みてなされたもので、エンコーダとコ
ネクタ間の結線ミスを容易に検出することを目的とす
る。
【０００５】
【課題を解決するための手段】本考案は、パルスエンコ
ーダから出力されるパルス信号のパルス数を所定数逓倍
して出力する周波数逓倍回路と、前記周波数逓倍回路の
出力パルス信号のパルス数を数えるカウンタと、前記カ
ウンタの出力値をラッチするラッチ回路と、前記ラッチ
回路によりラッチされた前記カウンタの出力値と前記パ
ルスエンコーダの仕様パルス数とを比較し、その差が所
定値よりも小さいか否かを判断する処理、および、既知
の論理パターンと前記パルスエンコーダの回転子の絶対
位置に対応する論理パターンとを比較し、一致するか否
かを判断する処理、および、さらにもし上記比較の結果
が不一致の場合は上記比較の結果に基づいて、その結線
ミスの箇所を特定する処理を行う処理手段とを有するこ
とを特徴とする。
ーダから出力されるパルス信号のパルス数を所定数逓倍
して出力する周波数逓倍回路と、前記周波数逓倍回路の
出力パルス信号のパルス数を数えるカウンタと、前記カ
ウンタの出力値をラッチするラッチ回路と、前記ラッチ
回路によりラッチされた前記カウンタの出力値と前記パ
ルスエンコーダの仕様パルス数とを比較し、その差が所
定値よりも小さいか否かを判断する処理、および、既知
の論理パターンと前記パルスエンコーダの回転子の絶対
位置に対応する論理パターンとを比較し、一致するか否
かを判断する処理、および、さらにもし上記比較の結果
が不一致の場合は上記比較の結果に基づいて、その結線
ミスの箇所を特定する処理を行う処理手段とを有するこ
とを特徴とする。
【０００６】
【作用】エンコーダからのパルス信号が、周波数逓倍回
路により逓倍され、その出力パルス信号のパルス数がカ
ウンタにより数えられる。そして、エンコーダが一回転
するときにエンコーダの基準位置において発生される基
準パルス信号により、カウンタ内の値がラッチ回路にお
いてラッチされ、そのラッチされた値を用いてエンコー
ダとコネクタとの結線における結線ミスの有無を判断す
る処理が行われる。
路により逓倍され、その出力パルス信号のパルス数がカ
ウンタにより数えられる。そして、エンコーダが一回転
するときにエンコーダの基準位置において発生される基
準パルス信号により、カウンタ内の値がラッチ回路にお
いてラッチされ、そのラッチされた値を用いてエンコー
ダとコネクタとの結線における結線ミスの有無を判断す
る処理が行われる。
【０００７】
【実施例】以下、図面を参照して本考案の一実施例につ
いて説明する。図１は、本考案のエンコーダ結線チェッ
カ１の内部回路の構成（破線内に示す）およびその入力
側に接続されるエンコーダ２を示すブロック図である。
ただし、本実施例で取り扱うモータは２ポールの同期機
形サーボモータであり、エンコーダ２はインクリメント
エンコーダである。また、以下の説明において、エンコ
ーダ２とコネクタ間のケーブルによる結線を単に結線と
呼ぶ。
いて説明する。図１は、本考案のエンコーダ結線チェッ
カ１の内部回路の構成（破線内に示す）およびその入力
側に接続されるエンコーダ２を示すブロック図である。
ただし、本実施例で取り扱うモータは２ポールの同期機
形サーボモータであり、エンコーダ２はインクリメント
エンコーダである。また、以下の説明において、エンコ
ーダ２とコネクタ間のケーブルによる結線を単に結線と
呼ぶ。
【０００８】図１に示すエンコーダ２のＡ相、Ｂ相、Ｕ
相、Ｖ相、Ｗ相、およびＺ相からは、図３に示すような
パルス信号ＦＡ、ＦＢ、ＦＵ、ＦＶ、ＦＷ、およびＦＺ
が出力される。このうち、パルス信号ＦＡおよびＦＢ
は、モータの回転角度、すなわち、エンコーダ２の回転
角度を示すパルス信号であり、特に、各々エンコーダ２
の正回転および逆回転に対する回転角度を示す。また、
パルス信号ＦＺは、モータにおける回転子の固定子に対
する絶対位置を示す基準パルス信号であり、モータの回
転子が一回転するとき、回転子の固定子に対する絶対位
置に対応して出力される一つの基準パルス信号である。
さらに、パルス信号ＦＵ、ＦＶ、ＦＷは、モータの回転
子磁石の固定子に対する位置を示すパルス信号である。
相、Ｖ相、Ｗ相、およびＺ相からは、図３に示すような
パルス信号ＦＡ、ＦＢ、ＦＵ、ＦＶ、ＦＷ、およびＦＺ
が出力される。このうち、パルス信号ＦＡおよびＦＢ
は、モータの回転角度、すなわち、エンコーダ２の回転
角度を示すパルス信号であり、特に、各々エンコーダ２
の正回転および逆回転に対する回転角度を示す。また、
パルス信号ＦＺは、モータにおける回転子の固定子に対
する絶対位置を示す基準パルス信号であり、モータの回
転子が一回転するとき、回転子の固定子に対する絶対位
置に対応して出力される一つの基準パルス信号である。
さらに、パルス信号ＦＵ、ＦＶ、ＦＷは、モータの回転
子磁石の固定子に対する位置を示すパルス信号である。
【０００９】また、図１において、エンコーダ２から出
力されたパルス信号ＦＡまたはＦＢは、コネクタ、ケー
ブル等のインターフェイス３を通過し、４逓倍回路４に
おいて、その周波数が４倍され、各々パルス信号ＵＣま
たはＤＣとなる。そして、モータの回転方向に応じて出
力されたパルス信号ＵＣまたはＤＣは、カウンタ５にお
いて、そのパルス数がカウントされ、パルス信号ＵＣま
たはＤＣのパルス数ＣＮＴ＊が出力される。次に、パル
ス数ＣＮＴ＊は、ラッチ回路６においてラッチされてパ
ルス数ＣＮＴとなり、演算処理等を行うＣＰＵ７に入力
される。そして、ＣＰＵ７からは、カウンタ５の値をク
リアするためのクリアパルス信号ＣＬＲが出力され、カ
ウンタ５に入力される。このクリアパルス信号ＣＬＲ
は、パルス信号ＦＺの立ち下がりの時刻よりも遅れて発
生するため、ＣＰＵ７がパルス数ＣＮＴをラッチする
前、つまり、ＣＰＵ７がそのパルス数ＣＮＴを読み込む
前にカウンタ５がクリアされてしまう危険を避けること
ができる。
力されたパルス信号ＦＡまたはＦＢは、コネクタ、ケー
ブル等のインターフェイス３を通過し、４逓倍回路４に
おいて、その周波数が４倍され、各々パルス信号ＵＣま
たはＤＣとなる。そして、モータの回転方向に応じて出
力されたパルス信号ＵＣまたはＤＣは、カウンタ５にお
いて、そのパルス数がカウントされ、パルス信号ＵＣま
たはＤＣのパルス数ＣＮＴ＊が出力される。次に、パル
ス数ＣＮＴ＊は、ラッチ回路６においてラッチされてパ
ルス数ＣＮＴとなり、演算処理等を行うＣＰＵ７に入力
される。そして、ＣＰＵ７からは、カウンタ５の値をク
リアするためのクリアパルス信号ＣＬＲが出力され、カ
ウンタ５に入力される。このクリアパルス信号ＣＬＲ
は、パルス信号ＦＺの立ち下がりの時刻よりも遅れて発
生するため、ＣＰＵ７がパルス数ＣＮＴをラッチする
前、つまり、ＣＰＵ７がそのパルス数ＣＮＴを読み込む
前にカウンタ５がクリアされてしまう危険を避けること
ができる。
【００１０】また、エンコーダ２のＺ相に対応した基準
パルス信号ＦＺは、インターフェイス３を通過し、ＣＰ
Ｕ７に入力されるとともに、入力パルス信号を反転する
インバータ９を介してラッチ回路６に入力される。エン
コーダ２のＵ相、Ｖ相、およびＷ相に対応した各々のパ
ルス信号ＦＵ、ＦＶ、ＦＷは、インターフェイス３を通
過し、ＣＰＵ７に入力される。そして、ＣＰＵ７から
は、結線が正常であることを示す正常出力信号ＳN、Ａ
ＢＺ相に結線ミスがあることを示すＡＢＺ相異常出力信
号ＳABZ、および、ＵＶＷ相に結線ミスがあることを示
すＵＶＷ相異常出力信号ＳUVWが出力され、異常箇所を
表示する表示器８に入力される。
パルス信号ＦＺは、インターフェイス３を通過し、ＣＰ
Ｕ７に入力されるとともに、入力パルス信号を反転する
インバータ９を介してラッチ回路６に入力される。エン
コーダ２のＵ相、Ｖ相、およびＷ相に対応した各々のパ
ルス信号ＦＵ、ＦＶ、ＦＷは、インターフェイス３を通
過し、ＣＰＵ７に入力される。そして、ＣＰＵ７から
は、結線が正常であることを示す正常出力信号ＳN、Ａ
ＢＺ相に結線ミスがあることを示すＡＢＺ相異常出力信
号ＳABZ、および、ＵＶＷ相に結線ミスがあることを示
すＵＶＷ相異常出力信号ＳUVWが出力され、異常箇所を
表示する表示器８に入力される。
【００１１】次に、図２に結線チェック時における各装
置の接続図を示す。エンコーダ結線チェッカ１を用いる
には、モータ１０の回転軸に取り付けられたエンコーダ
２とコネクタ１１とを結線した後、そのコネクタ１１
と、結線チェッカ本体１ｂにケーブル１ｃを介して結線
されているコネクタ１ａとを接続する。１２は、結線チ
ェッカ本体１ｂに電圧を供給する電源である。
置の接続図を示す。エンコーダ結線チェッカ１を用いる
には、モータ１０の回転軸に取り付けられたエンコーダ
２とコネクタ１１とを結線した後、そのコネクタ１１
と、結線チェッカ本体１ｂにケーブル１ｃを介して結線
されているコネクタ１ａとを接続する。１２は、結線チ
ェッカ本体１ｂに電圧を供給する電源である。
【００１２】以下、図３に示すタイムチャートに基づい
て、上述した構成による本実施例の動作を説明する。ま
ず、Ａ相、Ｂ相、およびＺ相に関する結線確認の動作に
ついて説明する。モータ１０の回転子を人為的、または
機械的手段を用い回転させると、図３に示すように、モ
ータ１０の回転子が固定子に対する所定の基準位置を通
過する時刻t0において、Ｚ相の最初のパルスである第一
パルス信号ＦＺ１が発生する。つまり、時刻ｔ0におい
て、基準パルス信号ＦＺは”Ｌ”レベルから”Ｈ”レベ
ルに変化し、時刻t1（ｔ0＜ｔ1）において、”Ｈ”レベ
ルから”Ｌ”レベルに変化する。基準パルス信号ＦＺ
が”Ｈ”レベルから”Ｌ”レベルに変化すると、時間的
遅れを伴い、ＣＰＵ７から出力されるクリアパルス信号
ＣＬＲが発生する。この場合、時刻t2（ｔ1＜ｔ2）にお
いて、クリアパルス信号ＣＬＲは”Ｌ”レベルから”
Ｈ”レベルに変化し、時刻t3（ｔ2＜ｔ3）において、”
Ｈ”レベルから”Ｌ”レベルに変化する。また、時刻t3
においては、クリアパルス信号ＣＬＲが立ち下がると同
時に、カウンタ５から出力されるパルス数ＣＮＴ＊の値
はクリアされ、４逓倍回路４の出力パルス信号ＵＣまた
はＤＣのパルス数ＣＮＴ＊を０から数える状態になる。
ただし、第一基準パルス信号ＦＺ１において、ＣＰＵは
ラッチ回路の出力値であるパルス数ＣＮＴを読み込まな
い。この場合のモータ１０は一回転以上回転しておら
ず、パルス数ＣＮＴは、結線チェッカの電源投入後から
時刻ｔ3までのパルス数であるためである。
て、上述した構成による本実施例の動作を説明する。ま
ず、Ａ相、Ｂ相、およびＺ相に関する結線確認の動作に
ついて説明する。モータ１０の回転子を人為的、または
機械的手段を用い回転させると、図３に示すように、モ
ータ１０の回転子が固定子に対する所定の基準位置を通
過する時刻t0において、Ｚ相の最初のパルスである第一
パルス信号ＦＺ１が発生する。つまり、時刻ｔ0におい
て、基準パルス信号ＦＺは”Ｌ”レベルから”Ｈ”レベ
ルに変化し、時刻t1（ｔ0＜ｔ1）において、”Ｈ”レベ
ルから”Ｌ”レベルに変化する。基準パルス信号ＦＺ
が”Ｈ”レベルから”Ｌ”レベルに変化すると、時間的
遅れを伴い、ＣＰＵ７から出力されるクリアパルス信号
ＣＬＲが発生する。この場合、時刻t2（ｔ1＜ｔ2）にお
いて、クリアパルス信号ＣＬＲは”Ｌ”レベルから”
Ｈ”レベルに変化し、時刻t3（ｔ2＜ｔ3）において、”
Ｈ”レベルから”Ｌ”レベルに変化する。また、時刻t3
においては、クリアパルス信号ＣＬＲが立ち下がると同
時に、カウンタ５から出力されるパルス数ＣＮＴ＊の値
はクリアされ、４逓倍回路４の出力パルス信号ＵＣまた
はＤＣのパルス数ＣＮＴ＊を０から数える状態になる。
ただし、第一基準パルス信号ＦＺ１において、ＣＰＵは
ラッチ回路の出力値であるパルス数ＣＮＴを読み込まな
い。この場合のモータ１０は一回転以上回転しておら
ず、パルス数ＣＮＴは、結線チェッカの電源投入後から
時刻ｔ3までのパルス数であるためである。
【００１３】その後、モータ１０の回転に伴い、パルス
信号ＦＡまたはＦＢが４逓倍回路４に入力され、その各
々の出力パルス信号ＵＣまたはＤＣのパルス数ＣＮＴ＊
がカウンタ５により数えられる。さらに、回転子が固定
子に対する所定の基準位置を再び通過するとき、Ｚ相に
おいて、第二基準パルス信号ＦＺ２が発生する。つま
り、時刻ｔ4（ｔ3＜ｔ4）において、基準パルス信号Ｆ
Ｚは”Ｌ”レベルから”Ｈ”レベルに変化し、時刻t
5（ｔ4＜ｔ5）において、”Ｈ”レベルから”Ｌ”レベ
ルに変化する。この場合、時刻t4において、カウンタ５
から出力されるパルス数ＣＮＴ＊の値は、ラッチ回路６
によりラッチされ、パルス数ＣＮＴとしてＣＰＵ７に読
み込まれる。その後、第一基準パルス信号ＦＺ１の場合
と同様に、時間的遅延を伴いクリアパルス信号がＣＰＵ
７から発生され、カウンタ５の値であるパルス数ＣＮＴ
＊がクリアされる。そして、ＣＰＵ７においては、パル
ス数ＣＮＴに関する次式が満たされるか否かが判断され
る。
信号ＦＡまたはＦＢが４逓倍回路４に入力され、その各
々の出力パルス信号ＵＣまたはＤＣのパルス数ＣＮＴ＊
がカウンタ５により数えられる。さらに、回転子が固定
子に対する所定の基準位置を再び通過するとき、Ｚ相に
おいて、第二基準パルス信号ＦＺ２が発生する。つま
り、時刻ｔ4（ｔ3＜ｔ4）において、基準パルス信号Ｆ
Ｚは”Ｌ”レベルから”Ｈ”レベルに変化し、時刻t
5（ｔ4＜ｔ5）において、”Ｈ”レベルから”Ｌ”レベ
ルに変化する。この場合、時刻t4において、カウンタ５
から出力されるパルス数ＣＮＴ＊の値は、ラッチ回路６
によりラッチされ、パルス数ＣＮＴとしてＣＰＵ７に読
み込まれる。その後、第一基準パルス信号ＦＺ１の場合
と同様に、時間的遅延を伴いクリアパルス信号がＣＰＵ
７から発生され、カウンタ５の値であるパルス数ＣＮＴ
＊がクリアされる。そして、ＣＰＵ７においては、パル
ス数ＣＮＴに関する次式が満たされるか否かが判断され
る。
【００１４】 ｜４×Ｐ−ＣＮＴ｜ ＜ ｎ …（１） ここで、Ｐはエンコーダ仕様の一回転に対するパルス信
号ＦＡまたはＦＢのパルス数である。また、パルス信号
ＦＺとＣＰＵ７からのクリアパルス信号ＣＬＲとでは時
間的なずれがある。この時間的なずれは、ＣＰＵ７にお
いてクリアパルス信号を発生のための物理的時間、およ
び、ＣＰＵ７においてパルス信号ＦＺを読み込む際、そ
のサンプルピッチの間隔により起こる時間的誤差のため
に発生する。ｎは、その時間的なずれを補正するための
定数であり、その値はＰの１／１００程度である。この
とき、式（１）が満たされれば、結線は正常であると判
断され、満たされなければ、ＣＰＵ７から表示器８にＡ
ＢＺ相異常出力信号ＳABZが出力される。
号ＦＡまたはＦＢのパルス数である。また、パルス信号
ＦＺとＣＰＵ７からのクリアパルス信号ＣＬＲとでは時
間的なずれがある。この時間的なずれは、ＣＰＵ７にお
いてクリアパルス信号を発生のための物理的時間、およ
び、ＣＰＵ７においてパルス信号ＦＺを読み込む際、そ
のサンプルピッチの間隔により起こる時間的誤差のため
に発生する。ｎは、その時間的なずれを補正するための
定数であり、その値はＰの１／１００程度である。この
とき、式（１）が満たされれば、結線は正常であると判
断され、満たされなければ、ＣＰＵ７から表示器８にＡ
ＢＺ相異常出力信号ＳABZが出力される。
【００１５】次に、Ｕ相、Ｖ相、およびＷ相に関する結
線確認の動作について説明する。これらの結線確認の動
作は、上述した動作において、Ａ相、Ｂ相、Ｚ相に関す
る結線が正しいと判定された後に行われる。まず最初
に、Ｚ相の基準パルス信号ＦＺが発生してからのＡ相ま
たはＢ相における各々のパルス信号ＦＡまたはＦＢのパ
ルス数が数えられる、つまり、パルス信号ＵＣまたはＤ
Ｃのパルス数ＣＮＴ＊がカウンタ５により数えられるこ
とにより、モータ１０の回転子の固定子に対する絶対位
置が検出される。そのため、パルス信号ＦＵ、ＦＶ、Ｆ
Ｗによる論理パターンが変化するとき、各々の論理パタ
ーンの所定の時刻において、既知の結線が正常である場
合の論理パターンと実際にＣＰＵ７に入力される論理パ
ターンとを比較することができる。２ポールモータの場
合のモータ１０の一回転における論理パターンは、六状
態に分けることができ、各々の時刻t11〜t16における論
理パターンは図３に示す表のようになる。
線確認の動作について説明する。これらの結線確認の動
作は、上述した動作において、Ａ相、Ｂ相、Ｚ相に関す
る結線が正しいと判定された後に行われる。まず最初
に、Ｚ相の基準パルス信号ＦＺが発生してからのＡ相ま
たはＢ相における各々のパルス信号ＦＡまたはＦＢのパ
ルス数が数えられる、つまり、パルス信号ＵＣまたはＤ
Ｃのパルス数ＣＮＴ＊がカウンタ５により数えられるこ
とにより、モータ１０の回転子の固定子に対する絶対位
置が検出される。そのため、パルス信号ＦＵ、ＦＶ、Ｆ
Ｗによる論理パターンが変化するとき、各々の論理パタ
ーンの所定の時刻において、既知の結線が正常である場
合の論理パターンと実際にＣＰＵ７に入力される論理パ
ターンとを比較することができる。２ポールモータの場
合のモータ１０の一回転における論理パターンは、六状
態に分けることができ、各々の時刻t11〜t16における論
理パターンは図３に示す表のようになる。
【００１６】したがって、図３に示す時刻t11〜t16の各
々の論理パターンと実際にモータ１０を一回転させたと
きに得られる論理パターンとが一致すれば、結線は正常
であると判断され、ＣＰＵ７から表示器８に正常出力信
号ＳNが出力され、それらが一致しなければ、結線ミス
があると判断され、ＣＰＵ７から表示器８にＵＶＷ相異
常出力信号ＳUVWが出力される。
々の論理パターンと実際にモータ１０を一回転させたと
きに得られる論理パターンとが一致すれば、結線は正常
であると判断され、ＣＰＵ７から表示器８に正常出力信
号ＳNが出力され、それらが一致しなければ、結線ミス
があると判断され、ＣＰＵ７から表示器８にＵＶＷ相異
常出力信号ＳUVWが出力される。
【００１７】
【考案の効果】以上説明したように、結線チェッカをモ
ータの回転軸に取り付けられたエンコーダのコネクタに
接続し、回転軸を数回転させることにより、結線ミスが
あるか否か、また、結線ミスがある場合、どの配線にお
いてミスがあるかを短時間で容易に検出することができ
る。
ータの回転軸に取り付けられたエンコーダのコネクタに
接続し、回転軸を数回転させることにより、結線ミスが
あるか否か、また、結線ミスがある場合、どの配線にお
いてミスがあるかを短時間で容易に検出することができ
る。
【図１】本考案の一実施例の内部回路構成を示すブロッ
ク図である。
ク図である。
【図２】エンコーダの結線チェック時における装置の接
続図である。
続図である。
【図３】本考案の一実施例における動作を示すタイムチ
ャートである。
ャートである。
１ エンコーダ結線チェッカ ２ エンコーダ ４ ４逓倍回路 ５ カウンタ ６ ラッチ回路 ７ ＣＰＵ
Claims (1)
- 【請求項１】 パルスエンコーダから出力されるパルス
信号のパルス数を所定数逓倍して出力する周波数逓倍回
路と、 前記周波数逓倍回路の出力パルス信号のパルス数を数え
るカウンタと、 前記カウンタの出力値をラッチするラッチ回路と、 前記ラッチ回路によりラッチされた前記カウンタの出力
値と前記パルスエンコーダの仕様パルス数とを比較し、
その差が所定値よりも小さいか否かを判断する処理、お
よび、既知の論理パターンと前記パルスエンコーダの回
転子の絶対位置に対応する論理パターンとを比較し、一
致するか否かを判断する処理、および、さらにもし上記
比較の結果が不一致の場合は上記比較の結果に基づい
て、その結線ミスの箇所を特定する処理を行う処理手段
とを有することを特徴とするエンコーダ結線チェッカ。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1991102194U JP2574740Y2 (ja) | 1991-12-11 | 1991-12-11 | エンコーダ結線チェッカ |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP1991102194U JP2574740Y2 (ja) | 1991-12-11 | 1991-12-11 | エンコーダ結線チェッカ |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH0555021U JPH0555021U (ja) | 1993-07-23 |
| JP2574740Y2 true JP2574740Y2 (ja) | 1998-06-18 |
Family
ID=14320860
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
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