JP2532623B2 - パイロットバ―ストゲ―トパルス発生装置 - Google Patents
パイロットバ―ストゲ―トパルス発生装置Info
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- JP2532623B2 JP2532623B2 JP63299798A JP29979888A JP2532623B2 JP 2532623 B2 JP2532623 B2 JP 2532623B2 JP 63299798 A JP63299798 A JP 63299798A JP 29979888 A JP29979888 A JP 29979888A JP 2532623 B2 JP2532623 B2 JP 2532623B2
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- burst gate
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- gate pulse
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Description
【発明の詳細な説明】 産業上の利用分野 この発明は、PAL方式のビデオテープレコーダ（VTR）
における信号処理装置に関し、特にパイロットバースト
信号を挿入及び抜き取るためのパイロットバーストゲー
トパルスを発生する装置に関するものである。
における信号処理装置に関し、特にパイロットバースト
信号を挿入及び抜き取るためのパイロットバーストゲー
トパルスを発生する装置に関するものである。
従来の技術 第３図に従来のこの種のパイロットバーストゲートパ
ルス発生装置の一例を示す。図において、１はリセット
パルス作成器、６はバイナリーカウンタ、10〜13は各ラ
ッチ回路を構成する各一致ゲートである。
ルス発生装置の一例を示す。図において、１はリセット
パルス作成器、６はバイナリーカウンタ、10〜13は各ラ
ッチ回路を構成する各一致ゲートである。
すなわち、従来の装置は、テレビジョン信号の同期信
号をトリガ信号とし、パルスを発生するリセットパルス
作成器１と、その出力信号であるリセットパルスにより
リセットされるカウンタ６を有し、前記リセットパルス
作成器１とカウンタ６にはクロック入力信号が印加さ
れ、互いにクロスカップリングされた一致ゲート10〜13
でなる第1,第２の一致ゲート対構成の各ラッチ回路を備
え、各々の一致ゲート対の一方の入力端子には前記リセ
ットパルスが印加され、第１の一致ゲート対の他方の入
力端子には、前記カウンタの第１のデコード出力（Ｃ）
が印加され、第２の一致ゲート対の他方の入力端子には
第２のデコード出力（Ｄ）が印加され、前記一致ゲート
対第1,第２による各々ラッチ回路の第１の一致ゲート対
出力端子と第２の一致ゲート対の反転出力端子14が各々
出力ゲート15の入力端子に接続され、その出力ゲートの
出力端子がPBGP出力端子に接続されている。
号をトリガ信号とし、パルスを発生するリセットパルス
作成器１と、その出力信号であるリセットパルスにより
リセットされるカウンタ６を有し、前記リセットパルス
作成器１とカウンタ６にはクロック入力信号が印加さ
れ、互いにクロスカップリングされた一致ゲート10〜13
でなる第1,第２の一致ゲート対構成の各ラッチ回路を備
え、各々の一致ゲート対の一方の入力端子には前記リセ
ットパルスが印加され、第１の一致ゲート対の他方の入
力端子には、前記カウンタの第１のデコード出力（Ｃ）
が印加され、第２の一致ゲート対の他方の入力端子には
第２のデコード出力（Ｄ）が印加され、前記一致ゲート
対第1,第２による各々ラッチ回路の第１の一致ゲート対
出力端子と第２の一致ゲート対の反転出力端子14が各々
出力ゲート15の入力端子に接続され、その出力ゲートの
出力端子がPBGP出力端子に接続されている。
第４図にその動作波形図を示す。第４図でHSSは水平
同期信号、はリセットパルス作成器の出力信号、Ａは
カウンタ６の計算値をアナログ表示したものであり、
B1，B2は各々ラッチ回路の出力信号、Ｅがパイロットバ
ースゲートパルス（PBGP）の出力信号である。
同期信号、はリセットパルス作成器の出力信号、Ａは
カウンタ６の計算値をアナログ表示したものであり、
B1，B2は各々ラッチ回路の出力信号、Ｅがパイロットバ
ースゲートパルス（PBGP）の出力信号である。
まず、水平同期信号のアクティブエッジが到来する
と、クロック入力信号１周期分のパルス幅のリセットパ
ルスがリセットパルス作成器１により発生させられ、こ
のパルスによりカウンタ６がリセットされ、以後、前記
クロック入力信号によりカウントが進められる。カウン
タ６のカウントが第１のデコード値（Ｃ）に達した時点
で第１のラッチ回路（第１の一致ゲート対）の出力が
“0"から“1"に移行し、前記カウンタ６のカウントが第
２のデコード値（Ｄ）に達した時点で第２のラッチ回路
（第２の一致ゲート対）の反転出力が“1"から“0"にな
るので、第１のラッチ回路の出力信号と第２のラッチ回
路の反転出力信号の論理積（正論理）出力によりパイロ
ットバーストゲートパルス信号が出力される。
と、クロック入力信号１周期分のパルス幅のリセットパ
ルスがリセットパルス作成器１により発生させられ、こ
のパルスによりカウンタ６がリセットされ、以後、前記
クロック入力信号によりカウントが進められる。カウン
タ６のカウントが第１のデコード値（Ｃ）に達した時点
で第１のラッチ回路（第１の一致ゲート対）の出力が
“0"から“1"に移行し、前記カウンタ６のカウントが第
２のデコード値（Ｄ）に達した時点で第２のラッチ回路
（第２の一致ゲート対）の反転出力が“1"から“0"にな
るので、第１のラッチ回路の出力信号と第２のラッチ回
路の反転出力信号の論理積（正論理）出力によりパイロ
ットバーストゲートパルス信号が出力される。
発明が解決しようとする課題 しかしながら、以上に示したパイロットバーストゲー
トパルス発生装置では、入力の水平同期信号のエッジか
ら時間遅れのきわめて小さいパイロットバーストゲート
パルス（規格では0.8μsec±0.3μsec）を発生させるの
に困難があった。すなわち、複合同期信号から水平同期
信号を得る段階でほぼ0.8μsec程度は遅れてしまい、も
はや同期分離される前の水平同期信号のエッジに対して
0.8μsec遅延したタイミングにパルスは発生させられな
くなってしまう。
トパルス発生装置では、入力の水平同期信号のエッジか
ら時間遅れのきわめて小さいパイロットバーストゲート
パルス（規格では0.8μsec±0.3μsec）を発生させるの
に困難があった。すなわち、複合同期信号から水平同期
信号を得る段階でほぼ0.8μsec程度は遅れてしまい、も
はや同期分離される前の水平同期信号のエッジに対して
0.8μsec遅延したタイミングにパルスは発生させられな
くなってしまう。
課題を解決するための手段 以上のような問題点を解決するために、本発明は、水
平同期信号のエッジにより作成されるリセットパルスの
１発おきにリセットされるカウンタを２台用い、ある水
平同期信号に対するパイロットバーストゲートパルスの
デコード値は、その1H（水平同期期間）前の水平同期信
号のエッジからカウント開始するようにしたものであ
る。
平同期信号のエッジにより作成されるリセットパルスの
１発おきにリセットされるカウンタを２台用い、ある水
平同期信号に対するパイロットバーストゲートパルスの
デコード値は、その1H（水平同期期間）前の水平同期信
号のエッジからカウント開始するようにしたものであ
る。
作用 ある水平同期信号に対するパイロットバーストゲート
パルスは1H前の水平同期信号のエッジからカウントされ
たカウンタのデコード出力により得られるので、同期分
離される前の水平同期信号のエッジからきわめて短い時
間後にもデコード出力することができ、同期分離に必要
な遅延量が大きくても、安定にパイロットバーストゲー
トパルスを発生させることができる。
パルスは1H前の水平同期信号のエッジからカウントされ
たカウンタのデコード出力により得られるので、同期分
離される前の水平同期信号のエッジからきわめて短い時
間後にもデコード出力することができ、同期分離に必要
な遅延量が大きくても、安定にパイロットバーストゲー
トパルスを発生させることができる。
実施例 本発明の実施例を、第１図，第２図を用いて説明す
る。第１図が実施例の回路構成図であり、第２図がその
動作タイミング図である。
る。第１図が実施例の回路構成図であり、第２図がその
動作タイミング図である。
水平同期信号をトリガ信号とし、クロック入力信号を
クロックとして、パルスを発生するリセットパルス作成
器１と、その出力信号であるリセットパルスによりトリ
ガされ、クロック入力信号により一定幅のパルスを出力
するデジタルモノマルチ２と、その入力端子が、前記デ
ジタルモノマルチの出力端子に接続される1/2分周器３
と、その入力端子が各々前記リセットパルス作成器１の
出力端子に接続され、各々他方の入力端子が前記1/2分
周器３の非反転出力端子（Ｑ）と、反転出力端子（）
に接続される第1,第２の一致ゲート（AND回路）4,5と、
そのリセット入力端子が各々前記第1,第２の一致ゲート
の出力端子に接続される第1,第２のカウンタ6,7とその
入力端子が各々前記第1,第２のカウンタの第１のデコー
ド値出力端子に接続される第１の負論理一致ゲート（NO
R回路）８と、その入力端子が各各前記第1,第２のカウ
ンタの第２のデコード値出力端子に接続される第２の負
論理一致ゲート（NOR回路）９と、互いにクロスカップ
リングされた第１の一致ゲート対（ラッチ回路）10,11
と第２の一致ゲート対（ラッチ回路）12,13の各々一方
の入力端子がその入力端子が前記デジタルモノマルチ２
の出力端子に接続されクロック入力端子がクロック印加
端子に接続された第２のリセットパルス作成器15の出力
端子に接続され、第１の一致ゲート対の他方の入力端子
に前記第１の負論理一致ゲート８の出力端子が接続さ
れ、第２の一致ゲート対の他方の入力端子が前記第２の
負論理一致ゲート９の出力端子に接続され、前記第１の
一致ゲート対の出力信号と、第２の一致ゲート対の反転
出力信号の論理積出力が、パイロットバーストゲートパ
ルス出力端子に接続されている。
クロックとして、パルスを発生するリセットパルス作成
器１と、その出力信号であるリセットパルスによりトリ
ガされ、クロック入力信号により一定幅のパルスを出力
するデジタルモノマルチ２と、その入力端子が、前記デ
ジタルモノマルチの出力端子に接続される1/2分周器３
と、その入力端子が各々前記リセットパルス作成器１の
出力端子に接続され、各々他方の入力端子が前記1/2分
周器３の非反転出力端子（Ｑ）と、反転出力端子（）
に接続される第1,第２の一致ゲート（AND回路）4,5と、
そのリセット入力端子が各々前記第1,第２の一致ゲート
の出力端子に接続される第1,第２のカウンタ6,7とその
入力端子が各々前記第1,第２のカウンタの第１のデコー
ド値出力端子に接続される第１の負論理一致ゲート（NO
R回路）８と、その入力端子が各各前記第1,第２のカウ
ンタの第２のデコード値出力端子に接続される第２の負
論理一致ゲート（NOR回路）９と、互いにクロスカップ
リングされた第１の一致ゲート対（ラッチ回路）10,11
と第２の一致ゲート対（ラッチ回路）12,13の各々一方
の入力端子がその入力端子が前記デジタルモノマルチ２
の出力端子に接続されクロック入力端子がクロック印加
端子に接続された第２のリセットパルス作成器15の出力
端子に接続され、第１の一致ゲート対の他方の入力端子
に前記第１の負論理一致ゲート８の出力端子が接続さ
れ、第２の一致ゲート対の他方の入力端子が前記第２の
負論理一致ゲート９の出力端子に接続され、前記第１の
一致ゲート対の出力信号と、第２の一致ゲート対の反転
出力信号の論理積出力が、パイロットバーストゲートパ
ルス出力端子に接続されている。
この実施例構成を、第２図の動作タイミング図に照ら
して説明すると、まず、水平同期信号のエッジが到来す
ると、クロック入力信号１分周期分のパルス幅のリセッ
トパルスR1がリセットパルス作成器１により発生し、か
つ、デジタルモノマルチ２の出力信号R2が“0"から“1"
に移行する。
して説明すると、まず、水平同期信号のエッジが到来す
ると、クロック入力信号１分周期分のパルス幅のリセッ
トパルスR1がリセットパルス作成器１により発生し、か
つ、デジタルモノマルチ２の出力信号R2が“0"から“1"
に移行する。
このデジタルモノマルチ２の出力信号R2は次の水平同
期信号が到来するまでに“0"に復帰するが、この時点で
次段の1/2分周器３と第２のリセットパルス作成器15と
をトリガする。R3は1/2分周器３の出力信号である。し
たがって一致ゲート4,5の出力端子には、R4，R5（）
として出力され、前記リセットパルスが１発おきに交互
に出力されることになり、カウンタ6,7は信号B6，B7の
ように、各々交互に2Hの周期でリセットされながらクロ
ック入力信号をカウントしていくことになる。
期信号が到来するまでに“0"に復帰するが、この時点で
次段の1/2分周器３と第２のリセットパルス作成器15と
をトリガする。R3は1/2分周器３の出力信号である。し
たがって一致ゲート4,5の出力端子には、R4，R5（）
として出力され、前記リセットパルスが１発おきに交互
に出力されることになり、カウンタ6,7は信号B6，B7の
ように、各々交互に2Hの周期でリセットされながらクロ
ック入力信号をカウントしていくことになる。
したがって前記各々のカウンタ6,7のデコード値（第
1,第２）を適当に選び、（Ａ＝Ａ′,B＝Ｂ′）各々どち
らのデコード出力でもトリガされるラッチ回路の出力を
各々パイロットバーストゲートパルスのエッジとするこ
とにより、ある水平同期信号のエッジから、きわめて短
い時間の後にパルスを出力することができる。
1,第２）を適当に選び、（Ａ＝Ａ′,B＝Ｂ′）各々どち
らのデコード出力でもトリガされるラッチ回路の出力を
各々パイロットバーストゲートパルスのエッジとするこ
とにより、ある水平同期信号のエッジから、きわめて短
い時間の後にパルスを出力することができる。
以上、本発明の実施例の動作を説明したように、ある
水平同期信号に対するパイロットバーストゲートパルス
は1H前の水平同期信号のエッジからカウント開始したカ
ウンタのデコード値により決められる。
水平同期信号に対するパイロットバーストゲートパルス
は1H前の水平同期信号のエッジからカウント開始したカ
ウンタのデコード値により決められる。
発明の効果 以上に示したように、本発明のパイロットバーストゲ
ートパルス発生装置では、水平同期信号が同期分離され
るのに大きく遅延してしまうとしても、ある水平同期信
号のエッジからきわめて短い時間の後にパイロットバー
ストゲートパルスを発生させることができ、従来の同期
分離装置をそのまま使えるだけでなく、パイロットバー
ストゲートパルスの安定な動作が保証できるなど大なる
結果を呈する。
ートパルス発生装置では、水平同期信号が同期分離され
るのに大きく遅延してしまうとしても、ある水平同期信
号のエッジからきわめて短い時間の後にパイロットバー
ストゲートパルスを発生させることができ、従来の同期
分離装置をそのまま使えるだけでなく、パイロットバー
ストゲートパルスの安定な動作が保証できるなど大なる
結果を呈する。
第１図は本発明の実施例の回路構成図、第２図はその各
部の動作波形図、第３図，第４図は従来技術によるパイ
ロットバーストゲートパルス発生装置の回路構成図とそ
の動作波形図である。 1,15……リセットパルス作成器、３……デジタルモノマ
ルチ、4,5……第1,第２の一致ゲート、6,7……第1,第２
のカウンタ、8,9……第1,第２の負論理一致ゲート、10
〜13……第1,第２の一致ゲート対、16……論理積出力ゲ
ート、20……クロック入力印加端子、21……水平同期信
号印加端子、22……パイロットバーストゲートパルス出
力端子。
部の動作波形図、第３図，第４図は従来技術によるパイ
ロットバーストゲートパルス発生装置の回路構成図とそ
の動作波形図である。 1,15……リセットパルス作成器、３……デジタルモノマ
ルチ、4,5……第1,第２の一致ゲート、6,7……第1,第２
のカウンタ、8,9……第1,第２の負論理一致ゲート、10
〜13……第1,第２の一致ゲート対、16……論理積出力ゲ
ート、20……クロック入力印加端子、21……水平同期信
号印加端子、22……パイロットバーストゲートパルス出
力端子。
Claims (2)
- 【請求項１】１水平期間間隔毎に並んだ複数の水平同期
信号を供給する手段と、 上記複数の水平同期信号のうちの第１の水平同期信号に
応答し、上記第１の水平同期信号の次に到来する第２の
水平同期信号のアクティブエッジから所定時間遅れたタ
イミングでパイロットバーストゲートパルスを発生する
手段と、 を備えたことを特徴とするパイロットバーストゲートパ
ルス発生装置。 - 【請求項２】パイロットバーストゲートパルスを発生す
る手段と、 ２水平期間を一周期としてカウント動作を行う第１のカ
ウンタ手段と、 ２水平期間を一周期としてカウント動作を行う第２のカ
ウンタ手段と、 順次供給される複数の水平同期信号に同期して上記第１
および第２のカウンタ手段を交互にリセットする手段
と、 上記第１および第２のカウンタ手段の予め定められたカ
ウント値に応答して交互にパイロットバーストゲートパ
ルスを発生する手段と、 で構成したことを特徴とする特許請求の範囲第１項記載
のパイロットバーストゲートパルス発生装置。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63299798A JP2532623B2 (ja) | 1988-11-28 | 1988-11-28 | パイロットバ―ストゲ―トパルス発生装置 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP63299798A JP2532623B2 (ja) | 1988-11-28 | 1988-11-28 | パイロットバ―ストゲ―トパルス発生装置 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPH02145087A JPH02145087A (ja) | 1990-06-04 |
| JP2532623B2 true JP2532623B2 (ja) | 1996-09-11 |
Family
ID=17877065
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP63299798A Expired - Fee Related JP2532623B2 (ja) | 1988-11-28 | 1988-11-28 | パイロットバ―ストゲ―トパルス発生装置 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2532623B2 (ja) |
-
1988
- 1988-11-28 JP JP63299798A patent/JP2532623B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPH02145087A (ja) | 1990-06-04 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |