JP2522486B2 - リレ−駆動回路 - Google Patents
リレ−駆動回路Info
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- JP2522486B2 JP2522486B2 JP62171565A JP17156587A JP2522486B2 JP 2522486 B2 JP2522486 B2 JP 2522486B2 JP 62171565 A JP62171565 A JP 62171565A JP 17156587 A JP17156587 A JP 17156587A JP 2522486 B2 JP2522486 B2 JP 2522486B2
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- Japan
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- relay
- transistor
- drive circuit
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Description
【発明の詳細な説明】 〔概要〕 リレー駆動回路において、トランジスタのベースに入
力する制御信号に対応して一次電源からリレーに駆動電
流を供給する際に、二次電源で一次電源を利用して生成
した電圧を該トランジスタのベースと論理回路に同時に
加えることにより、一次電源投入時の該リレーの誤動作
の可能性をなくす様にしたものである。
力する制御信号に対応して一次電源からリレーに駆動電
流を供給する際に、二次電源で一次電源を利用して生成
した電圧を該トランジスタのベースと論理回路に同時に
加えることにより、一次電源投入時の該リレーの誤動作
の可能性をなくす様にしたものである。
本発明はリレー駆動回路，例えば交換機から送出され
る交換機信号をデイジタル信号に変換する信号変換器内
で使用するリレー駆動回路の改良に関するものである。
る交換機信号をデイジタル信号に変換する信号変換器内
で使用するリレー駆動回路の改良に関するものである。
第３図は信号変換器接続説明図を示す。
図において，例えば，相手側のSH−１形クロスバー交
換機（以下,SH−１形XBと省略するが，図示せず）から
の交換器信号，例えば起動信号はこのSH−１形XBに接続
された伝送端局装置内の信号変換器（図示せず）でデイ
ジタル信号に変換された後、他の信号変換器（図示せ
ず）からのデイジタル信号と共に多量化されて伝送路に
送出される。
換機（以下,SH−１形XBと省略するが，図示せず）から
の交換器信号，例えば起動信号はこのSH−１形XBに接続
された伝送端局装置内の信号変換器（図示せず）でデイ
ジタル信号に変換された後、他の信号変換器（図示せ
ず）からのデイジタル信号と共に多量化されて伝送路に
送出される。
一方、多重化されたデイジタル信号は図示の伝送端局
装置で分離等の処理が施された後、信号変換器内のリレ
ー駆動回路に加えられてリレーSEZを駆動する。そこ
で、接点sezが閉じてSH−１形XB内のリレーRLが駆動さ
れ，相手側から起動がかかったことを検出する。
装置で分離等の処理が施された後、信号変換器内のリレ
ー駆動回路に加えられてリレーSEZを駆動する。そこ
で、接点sezが閉じてSH−１形XB内のリレーRLが駆動さ
れ，相手側から起動がかかったことを検出する。
この時、リレー駆動回路としては電源投入の際に誤動
作しないことが必要である。
作しないことが必要である。
第４図は従来例のブロック図，第５図は第４図の動作
説明図を示す。尚、第５図中の左側の符号は第４図中の
同じ符号の部分の波形を示す。以下，第５図を参照しな
がら第４図の動作を説明する。
説明図を示す。尚、第５図中の左側の符号は第４図中の
同じ符号の部分の波形を示す。以下，第５図を参照しな
がら第４図の動作を説明する。
第４図の電源スイッチ２を閉じるとエミッタが接地さ
れたトランジスタQ1のコレクタ及びベースに一次電源１
からの，例えば−48VがリレーSEZ及び抵抗R1を介して加
えられる。
れたトランジスタQ1のコレクタ及びベースに一次電源１
からの，例えば−48VがリレーSEZ及び抵抗R1を介して加
えられる。
この時、第５図‐に示す様に二次電源はまだ正常値
まで立上らないので，論理回路は動作しない。この為、
第５図‐に示す様にトランジスタQ1がオンになってリ
レーSEZが動作する。
まで立上らないので，論理回路は動作しない。この為、
第５図‐に示す様にトランジスタQ1がオンになってリ
レーSEZが動作する。
しかし、二次電源が正常値まで立上ると論理回路内の
インバータ４はＨレベルを出力するので、第５図‐の
右側に示す様にトランジスタQ1はオンからオフになりリ
レーSEZの駆動電流も０になる。
インバータ４はＨレベルを出力するので、第５図‐の
右側に示す様にトランジスタQ1はオンからオフになりリ
レーSEZの駆動電流も０になる。
その後、制御信号として，例えば起動信号が入力する
とトランジスタQ1はオンになり，リレーSEZは正常に動
作する。
とトランジスタQ1はオンになり，リレーSEZは正常に動
作する。
即ち，一次電源をオンにすると二次電源が正常に立上
るまでの間，リレーが誤動作すると云う問題点がある。
るまでの間，リレーが誤動作すると云う問題点がある。
これにより、回線が使用状態になる。
上記の問題点はエミッタがアースされ、コレクタが直
列接続されたリレーと電源スイッチを介して一次電源
（１）に、ベースが制御信号を送出する論理回路（４）
にそれぞれ接続されたトランジスタ（Q1）を具備するリ
レー駆動回路（５）と、該電源スイッチを介して接続し
た一次電源を用いて該論理回路の動作に必要な電圧を生
成する二次電源（３）とを有するリレー駆動回路におい
て、該二次電源からトランジスタのバイアス電圧と該論
理回路への電圧を同時に供給させて、該バイアス電圧と
論理回路の立ち上がりタイミングが一致する構成にし
た。
列接続されたリレーと電源スイッチを介して一次電源
（１）に、ベースが制御信号を送出する論理回路（４）
にそれぞれ接続されたトランジスタ（Q1）を具備するリ
レー駆動回路（５）と、該電源スイッチを介して接続し
た一次電源を用いて該論理回路の動作に必要な電圧を生
成する二次電源（３）とを有するリレー駆動回路におい
て、該二次電源からトランジスタのバイアス電圧と該論
理回路への電圧を同時に供給させて、該バイアス電圧と
論理回路の立ち上がりタイミングが一致する構成にし
た。
本発明はトランジスタQ1のバイアス電圧を二次電源３
から供給することにより、バイアス電圧の立上るタイミ
ングと論理回路４が立上るタイミングとが一致する様に
した。
から供給することにより、バイアス電圧の立上るタイミ
ングと論理回路４が立上るタイミングとが一致する様に
した。
そこで、従来の様にバイアス電圧の立上りが論理回路
の立上りよりも早くなることはないので誤動作の発生す
る可能性はなくなる。
の立上りよりも早くなることはないので誤動作の発生す
る可能性はなくなる。
第１図は本発明の実施例のブロック図、第２図は第１
図の動作説明図を示す。
図の動作説明図を示す。
尚，第２図の左側の符号は第１図中の同じ符号の部分
の波形を示す。又、全図を通じて同一符号は同一対象物
を示す。以下，第２図を参照して第１図の動作を説明す
る。
の波形を示す。又、全図を通じて同一符号は同一対象物
を示す。以下，第２図を参照して第１図の動作を説明す
る。
先ず、電源スイッチ２を閉じると，第２図‐に示す
様に一次電源１からリレーSEZ,トランジスタQ1に，例え
ば−48Vが印加される。一方、二次電源３から，例えば
トランジスタQ1のバイアス電圧−12V及び論理回路用電
圧＋5Vが第２図‐，に示す様に同時に立上るのでト
ランジスタQ1は動作しない。
様に一次電源１からリレーSEZ,トランジスタQ1に，例え
ば−48Vが印加される。一方、二次電源３から，例えば
トランジスタQ1のバイアス電圧−12V及び論理回路用電
圧＋5Vが第２図‐，に示す様に同時に立上るのでト
ランジスタQ1は動作しない。
尚、立上った後に制御信号が入力しなければインバー
タ41からのＨによりトランジスタQ1は前の状態を保持す
る。
タ41からのＨによりトランジスタQ1は前の状態を保持す
る。
即ち、第２図‐に示す様にリレーが誤動作する可能
性はなくなる。
性はなくなる。
以上詳細に説明した様に、本発明によればリレーが誤
動作する可能性がなくなると云う効果がある。
動作する可能性がなくなると云う効果がある。
第１図は本発明の実施例のブロック図、 第２図は第１図の動作説明図、 第３図は信号変換器接続説明図、 第４図は従来例のブロック図、 第５図は第４図の動作説明図を示す。 図において、 １は一次電源、２は電源スイッチ、３は二次電源、４は
論理回路、５はリレー駆動手段を示す。
論理回路、５はリレー駆動手段を示す。
Claims (1)
- 【請求項１】エミッタがアースされ、コレクタが直列接
続されたリレーと電源スイッチを介して一次電源（１）
に、ベースが制御信号を送出する論理回路（４）にそれ
ぞれ接続されたトランジスタ（Q1）を具備するリレー駆
動手段（５）と、該電源スイッチを介して接続した一次
電源を用いて該論理回路の動作に必要な電圧を生成する
二次電源（３）とを有するリレー駆動回路において、 該二次電源からトランジスタのバイアス電圧と該論理回
路への電圧を同時に供給させて、該バイアス電圧と論理
回路の立ち上がりタイミングが一致する構成にしたこと
を特徴とするリレー駆動回路。
Priority Applications (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62171565A JP2522486B2 (ja) | 1987-07-09 | 1987-07-09 | リレ−駆動回路 |
Applications Claiming Priority (1)
| Application Number | Priority Date | Filing Date | Title |
|---|---|---|---|
| JP62171565A JP2522486B2 (ja) | 1987-07-09 | 1987-07-09 | リレ−駆動回路 |
Publications (2)
| Publication Number | Publication Date |
|---|---|
| JPS6414838A JPS6414838A (en) | 1989-01-19 |
| JP2522486B2 true JP2522486B2 (ja) | 1996-08-07 |
Family
ID=15925496
Family Applications (1)
| Application Number | Title | Priority Date | Filing Date |
|---|---|---|---|
| JP62171565A Expired - Fee Related JP2522486B2 (ja) | 1987-07-09 | 1987-07-09 | リレ−駆動回路 |
Country Status (1)
| Country | Link |
|---|---|
| JP (1) | JP2522486B2 (ja) |
Families Citing this family (5)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| SE514645C2 (sv) | 1998-10-06 | 2001-03-26 | Perstorp Flooring Ab | Golvbeläggningsmaterial innefattande skivformiga golvelement avsedda att sammanfogas av separata sammanfogningsprofiler |
| SE518184C2 (sv) | 2000-03-31 | 2002-09-03 | Perstorp Flooring Ab | Golvbeläggningsmaterial innefattande skivformiga golvelement vilka sammanfogas med hjälp av sammankopplingsorgan |
| SE529076C2 (sv) | 2005-07-11 | 2007-04-24 | Pergo Europ Ab | En fog till paneler |
| DE102010004717A1 (de) | 2010-01-15 | 2011-07-21 | Pergo (Europe) Ab | Set aus Paneelen umfassend Halteprofile mit einem separaten Clip sowie Verfahren zum Einbringen des Clips |
| CA2797092C (en) | 2010-05-10 | 2015-11-03 | Pergo (Europe) Ab | Set of panels |
Family Cites Families (1)
| Publication number | Priority date | Publication date | Assignee | Title |
|---|---|---|---|---|
| JPS51108760A (ja) * | 1975-03-20 | 1976-09-27 | Hitachi Ltd | Rireedoraibarotsukukairo |
-
1987
- 1987-07-09 JP JP62171565A patent/JP2522486B2/ja not_active Expired - Fee Related
Also Published As
| Publication number | Publication date |
|---|---|
| JPS6414838A (en) | 1989-01-19 |
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Legal Events
| Date | Code | Title | Description |
|---|---|---|---|
| LAPS | Cancellation because of no payment of annual fees |