JP2022177230A5

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Publication number: JP2022177230A5
Application number: JP2022151841A
Authority: JP
Filing date: 2022-09-22
Publication date: 2022-12-07
Anticipated expiration: 2039-09-30

Claims

少なくとも１つのプロセッサが実行する、符号化された動画像ビットストリームにおける、現在ブロックを符号化するために使用されるイントラ予測モードをシグナリングする方法であって、
前記少なくとも１つのプロセッサが、
前記現在ブロックのゼロ参照ラインに対応する第１の最確モードリスト（ＭＰＭリスト）を生成するステップであって、前記第１のＭＰＭリストが、平面モードを含む第１の複数のイントラ予測モードを含む、ステップと、
前記現在ブロックの１つ以上の非ゼロ参照ラインに対応する第２のＭＰＭリストを生成するステップであって、前記第２のＭＰＭリストが、第２の複数のイントラ予測モードを含み、前記第２の複数のイントラ予測モードが、前記第１の複数のイントラ予測モードのうち前記平面モードを除く他のすべてのイントラ予測モードを含む、ステップと、
前記ゼロ参照ラインおよび前記１つ以上の非ゼロ参照ラインのうち、前記現在ブロックを符号化するために使用される参照ラインを示す参照ラインインデックスをシグナリングするステップと、
前記イントラ予測モードを示すイントラモードインデックスをシグナリングするステップとを含み、
前記参照ラインが前記ゼロ参照ラインであることを前記参照ラインインデックスが示すことに基づいて、前記イントラモードインデックスが、第１のＭＰＭリスト内の前記イントラ予測モードを示す、もしくは、
前記参照ラインが前記１つ以上の非ゼロ参照ラインのうちの１つであることを前記参照ラインインデックスが示すことに基づいて、前記イントラモードインデックスが、前記第２のＭＰＭリスト内の前記イントラ予測モードを示す、方法。
前記ゼロ参照ラインが、前記現在ブロックの複数の参照ラインのうち、最も近い参照ラインを含む、請求項１に記載の方法。
前記第１の複数のイントラ予測モードの数が６である、請求項１に記載の方法。
前記参照ラインが前記ゼロ参照ラインであることを前記参照ラインインデックスが示すことに基づいて、第１の数のビンを使用して、前記イントラモードインデックスがシグナリングされ、
前記参照ラインが前記１つ以上の非ゼロ参照ラインのうちの前記１つであることを前記参照ラインインデックスが示すことに基づいて、前記第１の数のビンよりも少ない第２の数のビンを使用して、前記イントラモードインデックスがシグナリングされる、
請求項１に記載の方法。
前記参照ラインインデックスが、前記イントラモードインデックスの前にシグナリングされる、請求項１に記載の方法。
符号化された動画像ビットストリームにおける、現在ブロックを符号化するために使用されるイントラ予測モードをシグナリングするデバイスであって、
プログラムコードを記憶するように構成された少なくとも１つのメモリと、
前記プログラムコードを読み、前記プログラムコードによって命令されるように動作するように構成された少なくとも１つのプロセッサとを備え、
前記プログラムコードが、
前記現在ブロックのゼロ参照ラインに対応する第１の最確モードリスト（ＭＰＭリスト）を生成することを前記プロセッサに行わせるように構成された第１生成コードであって、前記第１のＭＰＭリストが、平面モードを含む第１の複数のイントラ予測モードを含む、第１生成コードと、
前記現在ブロックの１つ以上の非ゼロ参照ラインに対応する第２のＭＰＭリストを生成することを前記プロセッサに行わせるように構成された第２生成コードであって、前記第２のＭＰＭリストが、第２の複数のイントラ予測モードを含み、前記第２の複数のイントラ予測モードが、前記第１の複数のイントラ予測モードのうち前記平面モードを除く他のすべてのイントラ予測モードを含む、第２生成コードと、
前記ゼロ参照ラインおよび前記１つ以上の非ゼロ参照ラインのうち、前記現在ブロックを符号化するために使用される参照ラインを示す参照ラインインデックスをシグナリングすることを前記プロセッサに行わせるように構成された第１通知コードと、
前記イントラ予測モードを示すイントラモードインデックスをシグナリングすることを前記プロセッサに行わせるように構成された第２通知コードとを含み、
前記参照ラインが前記ゼロ参照ラインであることを前記参照ラインインデックスが示すことに基づいて、前記イントラモードインデックスが第１のＭＰＭリスト内の前記イントラ予測モードを示す、もしくは、
前記参照ラインが前記１つ以上の非ゼロ参照ラインのうちの１つであることを前記参照ラインインデックスが示すことに基づいて、前記イントラモードインデックスが、前記第２のＭＰＭリスト内の前記イントラ予測モードを示す、デバイス。
前記第１の複数のイントラ予測モードの数が６である、請求項６に記載のデバイス。
前記参照ラインが前記ゼロ参照ラインであることを前記参照ラインインデックスが示すことに基づいて、第１の数のビンを使用して、前記イントラモードインデックスがシグナリングされ、
前記参照ラインが前記１つ以上の非ゼロ参照ラインのうちの１つであることを前記参照ラインインデックスが示すことに基づいて、前記第１の数のビンよりも少ない第２の数のビンを使用して、前記イントラモードインデックスがシグナリングされる、
請求項６に記載のデバイス。
前記参照ラインインデックスが、前記イントラモードインデックスの前にシグナリングされる、請求項６に記載のデバイス。
コンピュータに請求項１乃至５の何れか一項に記載の方法を実行させるコンピュータプログラム。