JP2021040171A - 通信装置 - Google Patents
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Abstract
Description
(第1実施形態)
以下、第1実施形態について図1〜図5を参照して説明する。
図1に示す通信システム1は、例えば車両に搭載された複数の電子制御装置間の制御通信のために用いられるものである。通信システム1は、複数の通信装置2a、2b、2cが伝送路に相当するバス3を介して接続された構成となっている。以下では、通信装置2a、2b、2cについて、それぞれを区別する必要がない場合には通信装置2と総称することとする。この場合、通信システム1は、3つの通信装置2を備えているが、2つの通信装置2を備えていてもよいし、4つ以上の通信装置2を備えていてもよい。
マスター2mとスレーブ2sとは、クロックを供給するための構成の有無など一部構成が異なるが、概ね同様の構成を有している。すなわち、図2に示すように、通信装置2は、ドライバ回路4、レシーバ回路5および制御回路6を備えている。ドライバ回路4には、制御回路6から出力される送信信号TXが与えられている。
図3に示すように、レシーバ回路5は、フィルタ回路7およびコンパレータ8を備えている。この場合、バス3の信号は、フィルタ回路7を介してコンパレータ8の非反転入力端子に与えられている。フィルタ回路7は、例えば低域通過フィルタ、つまりLPFなどであり、ノイズ対策として挿入されたものである。フィルタ回路7の出力信号は、バス3の信号に対し、ノイズが除去されるとともにフィルタ回路7の時定数に応じた遅れが生じた信号となる。
図4に示すように、ドライバ回路4は、前述したバス調停が可能となるように、オープンドレイン出力の回路構成となっており、その出力段を構成するトランジスタQ1、ダイオードD1、D2、抵抗R1および駆動回路9を備えている。ドライバ回路4において、バス3にはダイオードD1のカソードが接続されている。ダイオードD1のアノードは、プルアップ用の抵抗R1を介して電源電圧Vaが供給される電源線L1に接続されている。電源電圧Vaは、車両に搭載されるバッテリーの電源+Bから生成される+B系の電源電圧である。
I1=2×I2…(1)
CXPI通信では、マスター2mは、常にレセッシブ符号を出力しており、これが前述したクロックとなる。スレーブ2sは、このクロックに同期して動作する。具体的には、スレーブ2sは、レシーバ回路5により前述したようにして境界エッジが検出されたタイミング、つまりクロックの立ち下がりエッジが検出されたタイミングに同期して動作する。スレーブ2sでは、制御回路6は、境界エッジが検出されると、駆動回路9に対してロウレベルの送信信号TXを与える。そして、駆動回路9は、ロウレベルの送信信号TXが与えられるとトランジスタQ1をオン駆動する。
Vt(Q3)=Vt(Q1)−α (2)
これにより、ノードN1の電圧VN1は、下記(3)式により表される電圧となる。ただし、ダイオードD3の順方向電圧をVfとする。
VN1=Vt(Q3)+Vf …(3)
VN2=Vt(Q3)=Vt(Q1)−α …(4)
本実施形態の通信装置2は、境界エッジからトランジスタQ1がオンする時点までに要する遅延時間を短縮する遅延短縮部14を備えている。このような構成によれば、遅延時間を短縮することが可能となり、本実施形態の構成のようにレシーバ回路5の前段にフィルタ回路7を挿入するような場合であっても、通信プロトコルを十分に満足することができる。
以下、第1実施形態に対しドライバ回路の具体的な構成が変更された第2実施形態について図6を参照して説明する。
第1実施形態の遅延短縮部14は、ノードN2、つまりゲートドライバ13の入力端子の電圧を制御することにより、トランジスタQ1のゲート電圧を間接的に制御する構成となっていた。しかし、遅延短縮部は、トランジスタQ1のゲート電圧を直接的に制御する構成であってもよい。
以下、第1実施形態に対しドライバ回路の具体的な構成が変更された第3実施形態について図7および図8を参照して説明する。
図7に示すように、本実施形態のドライバ回路31は、図4に示した第1実施形態のドライバ回路4に対し、ダイオードD21が追加されている点、駆動回路9に代えて駆動回路32を備えている点などが異なる。
この場合、駆動回路32がトランジスタQ1をオフ駆動するオフ期間における各部の動作は、次のようなものとなる。すなわち、送信信号TXSがハイレベルであることから、スイッチS21がオフする。これにより、電流源12の電流によりトランジスタQ1のゲート・ソース間容量が放電されることでゲート電圧Vgが低下してトランジスタQ1がオフする。
以下、第4実施形態について図9および図10を参照して説明する。
図9に示すように、本実施形態の通信装置41は、第1実施形態の通信装置2に対し、レシーバ回路5に代えてレシーバ回路42を備えている点、制御回路6に代えて制御回路43を備えている点などが異なっている。レシーバ回路42は、図3に示したレシーバ回路5に対し、フィルタ回路7が省かれている点などが異なっている。この場合、コンパレータ8の非反転入力端子には、バス3の信号が直接与えられている。
以下、第1実施形態に対しドライバ回路および制御回路の具体的な構成が変更された第5実施形態について図11〜図13を参照して説明する。
図11に示すように、本実施形態のドライバ回路51は、図4に示した第1実施形態のドライバ回路4に対し、駆動回路9に代えて駆動回路52を備えている点などが異なっている。
この場合、駆動回路52がトランジスタQ1をオフ駆動するオフ期間における各部の動作は、次のようなものとなる。すなわち、送信信号TXSがハイレベルであることから、スイッチS51がオフする。これにより、電流源12の電流によりトランジスタQ1のゲート・ソース間容量が放電されることでゲート電圧Vgが低下してトランジスタQ1がオフする。
以下、第6実施形態について図14を参照して説明する。
第5実施形態の構成では、制御回路53は、バス3の信号が変化したことをトリガとしてロウレベルの送信信号TXSの出力を開始するのではなく、学習された境界エッジの周期の学習値に基づいてロウレベルの送信信号TXSの出力を前倒しして開始するようになっており、バス3の信号の変化を待つことはない。つまり、制御回路53は、たとえマスター2mからクロックが出力されていなくとも、ドミナント符号を出力する場合には、ロウレベルの送信信号TXSの出力を開始するようになっている。
なお、本発明は上記し且つ図面に記載した各実施形態に限定されるものではなく、その要旨を逸脱しない範囲で任意に変形、組み合わせ、あるいは拡張することができる。
上記各実施形態で示した数値などは例示であり、それに限定されるものではない。
Claims (8)
- 伝送路を介してデータを送受信する複数の通信装置のうちいずれか一つの通信装置の通信に同期して他の通信装置が送信を行う通信システムにおいて用いられる前記通信装置であって、
前記伝送路上で優位な信号レベルを優位レベルとし、劣位な信号レベルを劣位レベルとしたとき、
前記伝送路の信号レベルが前記劣位レベルから前記優位レベルに変化するエッジを検出するエッジ検出回路(5、42)と、
オンすることにより前記伝送路の信号レベルを前記優位レベルとすることができるスイッチング素子(Q1)と、
前記スイッチング素子を駆動する駆動回路(9、22、32、52)と、
前記駆動回路の動作を制御するものであり、前記エッジ検出回路により前記エッジが検出されると前記駆動回路に対して前記スイッチング素子のオン駆動を指令するオン指令を与える制御回路(6、43、53)と、
を備え、
前記駆動回路または前記制御回路には、前記エッジから前記スイッチング素子がオンする時点までに要する遅延時間を短縮する遅延短縮部(14、23、34、57)が設けられている通信装置。 - 前記遅延短縮部(14、23、34)は、
前記駆動回路(9、22、32)に設けられたものであり、
前記駆動回路が前記スイッチング素子をオン駆動するオン期間の開始時点を含む期間に、前記スイッチング素子の制御端子の電圧である制御電圧が、前記スイッチング素子がオンに転じる閾値電圧よりも所定値だけ低い第1電圧まで上昇するように電圧制御を行うことで前記遅延時間を短縮する請求項1に記載の通信装置。 - 前記遅延短縮部(14、23)が設けられた駆動回路(9、22)は、
前記電圧制御を行うことにより前記制御電圧が前記第1電圧まで上昇した後、前記スイッチング素子の制御端子に一定の電流を供給する定電流制御を行う請求項2に記載の通信装置。 - 前記遅延短縮部(34)が設けられた駆動回路(32)は、
前記電圧制御を行うことにより前記制御電圧が前記第1電圧まで上昇した後、前記制御端子の電圧が前記閾値電圧よりも高い第2電圧まで上昇するように電圧制御を継続する請求項2に記載の通信装置。 - 前記遅延制御部は、
前記スイッチング素子の制御端子に対する前記第2電圧の供給経路に直列に介在するフィルタ回路(33)を備える請求項4に記載の通信装置。 - さらに、前記伝送路の信号を所定のサンプリングタイミングにおいてサンプリングすることにより前記伝送路を介して伝送される符号を判定する判定部(44)と、
前記伝送路の信号レベルを検出し、その検出結果に基づいて前記伝送路に重畳するノイズを検出するノイズ検出部(45)と、
を備え、
前記判定部は、前記ノイズ検出部によりノイズが検出されると、前記サンプリングタイミングを前記ノイズが検出された期間に応じた所定時間だけ遅らせる請求項1から5のいずれか一項に記載の通信装置。 - 前記遅延短縮部(57)は、
前記制御回路(53)に設けられたものであり、
前記エッジ検出回路による検出結果に基づいて前記エッジの周期を学習する学習制御と、
前記学習制御により学習された前記エッジの周期に基づいて、次回の前記エッジが検出されるタイミングを予測する予測制御と、
前記予測制御により予測されたタイミングよりも前の時点において前記駆動回路に対して前記オン指令を与える先出し制御と、
を実行することにより前記遅延時間を短縮する請求項1に記載の通信装置。 - 前記遅延短縮部は、
前記エッジ検出回路により前記エッジが検出された時点から次に前記エッジ検出回路により前記エッジが検出される時点までカウント動作を実行するカウンタ(54a)を備え、
前記学習制御では、前記カウンタのカウント値に基づいて前記エッジの周期を学習するようになっており、
前記カウンタのカウント値が前記エッジの周期として想定される値よりも大きい上限値に達すると、前記学習制御による学習結果を一旦リセットして前記学習制御を再度実行するようになっており、
前記学習制御による学習結果が得られるまでの期間は前記予測制御および前記先出し制御の実行を停止するようになっている請求項7に記載の通信装置。
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