JP2019004448A5 - - Google Patents

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ステップS1002において、インターリーバ104は、２次元配列の行方向にデータシンボルグループd(k)を書き込む（図５Ａを参照）。インターリーバ104は、Ny個のデータシンボルグループd(0)からd(Ny-1)を２次元配列の行番号0の行に書き込み、Ny個のデータシンボルグループd(Ny)からd(2Ny-1)を２次元配列の行番号１に書き込む。インターリーバ104は、同様に各行への書き込みを行い、行番号Nx-1（最終行。図５Ａでは行番号4）には、Ny個以下のデータシンボルグループd((Nx-1)×Ny)からd(NSD/NS-1)を書き込む。
n_offset(q)の値は、２次元配列において、読み出し開始位置を含む列より前の列に含まれるデータシンボルグループ数を表す。例えば、図１０Ａでは、読み出し開始位置を含む列（d(14)を含む列）より前の列（d(0)からd(13)を含む列）に含まれるデータシンボルグループ数は63個であるから、n_offset(1)の値は63である。
また、式２０Ａにおいて、floor(k(q) offset/NS)の値がＮＬ以下か、ＮＬを超えるかによって、第1式と第2式を選択する。第1式（floor(k(q) offset/NS)の値がＮＬ以下の場合）は、図１０Ｂ及び図１２のように、読み出し開始位置を含む列が、最終行にデータシンボルグループを含まない列（図１０Ｂ及び図１２において、d(84)からd(90)の何れも含まない列）である場合に用いる。
データサブキャリアアドレス算出回路1051は、データサブキャリア順位(r)から算出したサブキャリア番号(k)に応じて、データシンボルc(h,q)をメモリ1052へ書き込む。ここで、c(h,q)はOFDMシンボル番号qにおけるh番目(hは0以上NSD未満の整数)のデータシンボルを表す。データシンボルc(h,q)が含まれるデータシンボルグループd(n,q)の番号nは、式２８により算出される。
Figure 2019004448
図２０は、一例として、NSDが728、LCWが624、NCBPSが4の場合に、インターリーバ104がOFDMシンボル０(q=0)のインターリーブを行う例を示す。インターリーバ104は、図５Ａと同様に行毎の書き込みを行うが、図２０では、書き込み順序を示す矢印を省略する。また、インターリーバ104は、図５Ｂ、図１０Ａ、図１２と同様に列毎の書き込みを行う。図２０において、読み出し順序を示す矢印は、読み出し位置を明記するために始めの2列分を記載するが、残りの列番号に関して省略する。
また、行番号2のずれ量は12シンボル、すなわち1.5データシンボルグループに相当する。そのため、行番号1の最終2列（d(58),d(59)）を除く列（d(40)からd(57)）はコードワード3のデータシンボルグループを含み、d(58)には、コードワード3とコードワード4のデータシンボルが混在し、最終列(d(59))はコードワード4のデータシンボルグループを含む。
式４０及び式４２の意味を、図１０Ａを参照して説明する。floor(koffset (q)/NS)は、読み出し開始位置の列番号（例えば14）を表す。行番号0、列番号（floor(koffset (q)/NS)）のデータシンボルグループは、ステップS1103において、floor(koffset (q)/NS)番目に書き込まれるデータシンボルグループd(floor(koffset (q)/NS))である。インターリーバ104は、データシンボルd(k)をidx-1(k)番目に読み出すので、データシンボルグループd(floor(koffset (q)/NS))はidx-1(floor(koffset (q)/NS))番目に読み出される。つまり、式４０及び式４２が得られる。
１００，１００ａ 通信装置
１０１ MAC制御回路
１０２ FEC符号化回路
１０３ 変調回路
１０４，１０４ａ，１０４ｂ，１０４ｃ インターリーバ
１０５，１０５ａ OFDM変調回路
１０６ 送信RF回路
１０７ 送信アンテナアレイ
１１１ 受信アンテナアレイ
１１２ 受信RF回路
１１３ 同期回路
１１４ DFT回路
１１５ 等化回路
１１６，１１６ａ デインターリーバ
１１７，１１７ａ 復調回路
１１８ FEC復号回路
１１９ チャネル推定回路
１０４０，１０５２ メモリ
１０４１，１０４１ａ アドレスカウンタ
１０４２，１１６１ Nx,Ny算出回路
１０４３，１１６２ OFDMシンボル数カウンタ
１０４４，１１６３ シフト量算出回路
１０４５ ブロックインターリーブアドレスidx0生成回路
１０４６ インターリーブアドレスidx1生成回路
１０４７，１０４７ａ アドレスシフト回路
１０４８ デインターリーブアドレステーブルメモリ
１０５１ データサブキャリアアドレス算出回路
１０５３ パイロット及びガードサブキャリア挿入回路
１０５４ アドレス生成回路
１０５５ IDFT回路
１０５６ CP付加及び窓関数回路
１１６４ 行カウンタ
１１６５ 列カウンタ
１１６６ デマルチプレクサ

Claims (8)

  1. 第1から第Nのコードワードをインターリーブするインターリーバ回路と、
    前記インターリーブされた第1から第NのコードワードをＯＦＤＭ信号に変換するＯＦＤＭ変調回路と、
    前記ＯＦＤＭ信号を送信する送信回路と、
    を具備し、
    前記第1のコードワードに含まれるデータシンボル数は、前記第2のコードワードに含まれるデータシンボル数よりも少なく、
    前記インターリーバ回路は、前記第1のコードワードから前記第Nのコードワードまで昇順に書き込み、前記第2のコードワードから読み出しを開始する、
    送信装置。
  2. 前記インターリーバ回路は、Ｎｘ×Ｎｙのメモリサイズを有し、
    Ｎｙは、前記第2のコードワードに含まれるデータシンボル数に等しい、
    請求項１に記載の送信装置。
  3. 前記インターリーバ回路は、インターリーブサイズに応じて生成したインターリーブアドレスを、前記第1のコードワードに含まれるデータシンボル数に応じてシフトしたアドレスを用いて、前記第2のコードワードを読み出す、
    請求項１に記載の送信装置。
  4. 送信装置においてインターリーブされた第1から第Nのコードワードを含むＯＦＤＭ信号を受信する受信回路と、
    前記ＯＦＤＭ信号から、前記インターリーブされた第1から第Nのコードワードを抽出するＤＦＴ回路と、
    前記インターリーブされた第1から第Nのコードワードをデインターリーブするデインターリーバ回路と、
    を具備し、
    前記第1のコードワードに含まれるデータシンボル数は、前記第2のコードワードに含まれるデータシンボル数よりも少なく、
    前記インターリーブされた第1から第Nのコードワードは、前記送信装置のインターリーバ回路において、前記第1のコードワードから前記第Nのコードワードまで昇順に書き込まれ、前記第2のコードワードから読み出しが開始されて生成される、
    受信装置。
  5. 前記デインターリーバ回路は、Ｎｘ×Ｎｙのメモリサイズを有し、
    Ｎｙは、前記第2のコードワードに含まれるデータシンボル数に等しい、
    請求項４に記載の受信装置。
  6. 前記インターリーバ回路は、インターリーブサイズに応じて生成したインターリーブアドレスを、前記第1のコードワードに含まれるデータシンボル数に応じてシフトしたアドレスを用いて、前記第2のコードワードを読み出す、
    請求項４に記載の受信装置。
  7. 第1から第Nのコードワードをインターリーブし、
    前記インターリーブされた第1から第NのコードワードをＯＦＤＭ信号に変換し、
    前記ＯＦＤＭ信号を送信し、
    前記第1のコードワードに含まれるデータシンボル数は、前記第2のコードワードに含まれるデータシンボル数よりも少なく、
    前記第1のコードワードから前記第Nのコードワードまで昇順に書き込み、前記第2のコードワードから読み出しが開始される、
    送信方法。
  8. 送信装置においてインターリーブされた第1から第Nのコードワードを含むＯＦＤＭ信号を受信し、
    前記ＯＦＤＭ信号から、前記インターリーブされた第1から第Nのコードワードを抽出し、
    前記インターリーブされた第1から第Nのコードワードをデインターリーブし、
    前記第1のコードワードに含まれるデータシンボル数は、前記第2のコードワードに含まれるデータシンボル数よりも少なく、
    前記インターリーブされた第1から第Nのコードワードは、前記送信装置のインターリーバ回路において、前記第1のコードワードから前記第Nのコードワードまで昇順に書き込まれ、前記第2のコードワードから読み出しが開始されて生成される、
    受信方法。
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