JP2018528607A - 供給ネットワークから動作されるユニットをサージから保護するための回路アセンブリ - Google Patents
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Abstract
Description
本発明は、例示的な実施形態に基づき、図面を参照しながら、より詳細に以下で説明される。
Claims (6)
- 供給ネットワークから動作されるユニットをサージから保護するための回路アセンブリであって、
該供給ネットワークに接続される第1および第2の入力接続(L、N)を有する入力部と、
保護される該ユニットを接続することができる出力部(A)と、
印加される電圧を制限するために該第1の入力接続と第2の入力接続(L、N)の間に設けられた保護回路とを備え、該保護回路が電力半導体(IGBT)を備え、
さらに少なくとも1つのツェナー素子(TVS)が、該電力半導体のコレクタとゲートの間に接続され、ツェナー電圧により該電力半導体(IGBT)のためのクランプ電圧が生じる、回路アセンブリにおいて、
複数のツェナー素子(TVS1〜TVSn)が直列に接続され、該供給ネットワークの電圧の瞬時値に応じて、該ツェナー素子のうちの1つが導通状態に入り、したがって該保護回路の保護レベルが自動的に適応されることを特徴とする、回路アセンブリ。 - 供給ネットワークから動作されるユニットをサージから保護するための回路アセンブリであって、
該供給ネットワークに接続される第1および第2の入力接続(L、N)を有する入力部と、
保護される該ユニットを接続することができる出力部(A)と、
印加される電圧を制限するために該第1の入力接続と第2の入力接続(L、N)の間に設けられた保護回路とを備え、該保護回路が電力半導体(IGBT)を備え、
さらに少なくとも1つのツェナー素子(TVS)が、該電力半導体のコレクタとゲートの間に接続され、ツェナー電圧により該電力半導体(IGBT)のためのクランプ電圧が生じる、回路アセンブリにおいて、
該ツェナー素子(TVS)が、該電力半導体(IGBT)の該ゲートと該コレクタの間に接続されたリニア・レギュレータ(SQ)の一体部分であり、供給電圧の電圧レベルに対する保護レベルを維持するように、該供給ネットワークの電圧に追従することを特徴とする、回路アセンブリ。 - 供給ネットワークから動作されるユニットをサージから保護するための回路アセンブリであって、
該供給ネットワークに接続される第1および第2の入力接続(L、N)を有する入力部と、
保護される該ユニットを接続することができる出力部(A)と、印加される電圧を制限するために該第1の入力接続と第2の入力接続(L、N)の間に設けられた保護回路とを備え、該保護回路が電力半導体(IGBT)を備え、
さらに少なくとも1つのツェナー素子(TVS)が、該電力半導体のコレクタとゲートの間に接続され、ツェナー電圧により該電力半導体(IGBT)のためのクランプ電圧が生じる、回路アセンブリにおいて、
該ツェナー素子(TVS)に並列に接続することができるさらなるツェナー素子(TVS1〜TVSn)のグループが設けられ、該ツェナー素子はドライバ・ユニットによって作動させることができ、該ドライバ・ユニットが、それぞれの事例においてトランジスタ・スイッチ(T1〜Tn)の入力部に接続され、該トランジスタ・スイッチに対して、それぞれの事例において該さらなるツェナー素子(TVS1〜TVSn)のうちの1つが関連付けられていることを特徴とする、回路アセンブリ。 - 前記ドライバ・ユニットが、マイクロコントローラ(μC)によって制御され、該マイクロコントローラが、前記供給ネットワークの電圧の瞬時値を判定し、該ドライバ・ユニットを介してそれぞれの適切なトランジスタ・スイッチ(T1〜Tn)を作動させて、保護レベルを適応させることを特徴とする、請求項3に記載の回路アセンブリ。
- 供給ネットワークから動作されるユニットをサージから保護するための回路アセンブリであって、
該供給ネットワークに接続される第1および第2の入力接続(L、N)を有する入力部と、
保護される該ユニットを接続することができる出力部(A)と、
印加される電圧を制限するために該第1の入力接続と第2の入力接続(L、N)の間に設けられた保護回路とを備え、該保護回路が電力半導体(IGBT)を備えた、回路アセンブリにおいて、
該電力半導体(IGBT)のコレクタとゲートの間にデジタル/アナログ変換器(DA)が配置され、そのデジタル入力部が、マイクロコントローラ(μC)の出力部に接続され、該マイクロコントローラが、その入力側において該供給ネットワークに接続され、該回路の保護レベルを、該デジタル/アナログ変換器(DA)のアナログ出力を介して定義することができることを特徴とする、回路アセンブリ。 - 前記保護回路が、前記入力部に接続されたダイオード・ブリッジ(DB)を介して給電され、それにより負と正の過電圧パルスを放電することができることを特徴とする、請求項1〜5のいずれか一項に記載の回路アセンブリ。
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