JP2018511085A - 垂直pnシリコン変調器 - Google Patents
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Abstract
Description
110、1410、1610、1810、2010、2110 導波路
111、1311、1411、1611、1811、1911、2011、2111 正にドープされた領域P1
112、1312、1412、1612、1812、1912、2012、2112 正にドープされた領域P2
113、1313、1413、1613、1813、1913、2013、2113 負にドープされた領域N2
114、1314、1414、1614、1814、1914、2014、2114 負にドープされた領域N1
118、401、1501、1701 導波路コア
121、1321、1421、1927、1929、2027、2029、2127、2129 正にドープされた領域P+
123、1323、1423、1623、1625、1823、1825、1923、1925、2023、2025、2123、2125 正にドープされた領域P++
131、1331、1431、1631、1632、1831、1832、1931、1932、2031、2032、2131、2132 負にドープされた領域N+
133、1333、1433、1633、1634、1833、1834、1933、1934、2033、2034、2133、2134 負にドープされた領域N++
141、1341、1441、1641、1642、1841、1842、1941、1942、2041、2042、2141、2142 カソード
143、1343、1643、1843、1943、1944、2043、2143 アノード
151、153、1351、1353、1651、1653、1851、1853、1951、1953、2051、2053、2151、2153 導波路コアのエッジ
201、301 上部平板
205、305 下部平板
210、310 PN接合
403、1003、1705 第1の結合
405、1005、1706 第2の結合
410、1510、1710 光学キャリア
1200 製造プロセス
1415 正にドープされた領域P3
1503 第1の結合平板
1505 第2の結合平板
1707 第3の結合
1709 第4の結合
Claims (25)
- 導波路コアを含むシリコン導波路を含む光学変調器であって、
前記導波路コアが、
第2の正にドープされた(P2)領域に垂直に隣接する第1の正にドープされた(P1)領域であって、前記P2領域が前記P1領域よりも強く正にドープされた、P1領域及びP2領域と、
第2の負にドープされた(N2)領域に垂直に隣接する第1の負にドープされた(N1)領域であって、前記N2領域が前記N1よりも強く負にドープされ、前記N2領域及び前記P2領域が垂直に隣接するように配置されて正負(PN)接合を形成する、N1領域及びN2領域と、
少なくとも1つのカソードと、
前記PN接合を介して前記導波路コアにわたって前記カソードと選択的かつ電気的に結合された少なくとも1つのアノードであって、前記カソードと前記アノードとの間に印加された電圧降下が、前記導波路コアの屈折率を変化させることによって前記PN接合を通過する光学キャリアを変調する、少なくとも1つのアノードと、
を含み、
前記P2領域及び前記N2領域が、前記P1領域及び前記N1領域よりも大きな、屈折率変化に対する効果を有し、前記P1領域及び前記N1領域が、前記P2領域及び前記N2領域よりも小さな、前記光学キャリアの光学損失に対する影響を有するように、前記P2領域が前記P1領域よりも小さく、前記N2領域が前記N2領域よりも小さい、光学変調器。 - 前記P2領域が、前記電圧降下が前記カソードと前記アノードとの間に印加されたときに、前記P2領域が完全に陽イオンが欠乏するように選択された厚さを含む、請求項1に記載の光学変調器。
- 前記N2領域が、前記電圧降下が前記カソードと前記アノードとの間に印加されたときに、前記N2領域が完全に陰イオンが欠乏するように選択された厚さを含む、請求項2に記載の光学変調器。
- 前記P2領域がその場ドープ成長によって形成された、請求項1に記載の光学変調器。
- 前記N2領域がその場ドープ成長によって形成された、請求項1に記載の光学変調器。
- 前記P2領域が表面ドーピングによって形成された、請求項1に記載の光学変調器。
- 前記N2領域が表面ドーピングによって形成された、請求項1に記載の光学変調器。
- 前記導波路がさらに、
前記P1領域に水平に隣接する第3の正にドープされた(P+)領域であって、前記P+領域が前記P1領域よりも強く正にドープされた、第3の正にドープされた(P+)領域と、
前記N1領域に水平に隣接する第3の負にドープされた(N+)領域であって、前記N+領域が前記N1領域よりも強く負にドープされた、第3の負にドープされた(N+)領域と、を含み、
前記P+領域及び前記N+領域が、前記N1領域、前記N2領域、前記P1領域、及び前記P2領域に対して前記光学キャリアの光学損失に対する影響を最小化し、前記P+領域及び前記N+領域が前記N1領域、前記N2領域、前記P1領域、及び前記P2領域に対して前記カソードと前記アノードとの間の電気抵抗を低減するように、前記P+領域及び前記N+領域が前記導波路コアの外側に配置された、請求項1に記載の光学変調器。 - 前記導波路がさらに、前記P1領域と前記P+領域との間及び前記N1領域と前記P+領域との間に配置された第4の正にドープされた(P3)領域を含み、前記P3領域及び前記N1領域が水平PN接合を形成する、請求項8に記載の光学変調器。
- 前記導波路がさらに、
前記P1領域と垂直に隣接した複数の正にドープされた(P++)ポールであって、前記P++ポールが前記P1領域よりも強く正にドープされ、前記P++ポールが前記導波路の誘電部によって離隔された、複数の正にドープされた(P++)ポールと、
前記N1領域と水平に隣接した複数の負にドープされた(N++)領域であって、前記N++領域が前記N1領域よりも強く負にドープされ、前記N++領域が前記N1領域によって離隔された、複数の負にドープされた(N++)領域と、を含み、
前記P++ポール及び前記N++領域が、前記N1領域、前記N2領域、前記P1領域及び前記P2領域に対して前記光学キャリアの光学損失に対する影響を最小化し、前記P++ポール及び前記N++領域が前記N1領域、前記N2領域、前記P1領域及び前記P2領域に対して前記カソードと前記アノードとの間の電気抵抗を低減するように、前記P++ポール及び前記N++領域が前記導波路コアの外側に配置され、
前記アノードが前記P++ポールに垂直に隣接して直接結合され、
前記少なくとも1つのカソードが各N++領域に直接結合されたカソードを含む、請求項1に記載の光学変調器。 - 前記導波路がさらに、複数の正にドープされた(P+)領域を含み、P+領域が前記P++ポールよりも軽く正にドープされ、前記P1領域よりも強く正にドープされるように、各P+領域が前記P++ポールの1つと前記P1領域との間に配置された、請求項10に記載の光学変調器。
- 前記導波路がさらに、複数の負にドープされた(N+)領域を含み、前記N+領域が、前記N++領域よりも軽く正にドープされ、前記N1領域よりも強く正にドープされるように、各N+領域が前記N++領域の1つと前記N1領域との間に配置された、請求項10に記載の光学変調器。
- 前記導波路がさらに、
前記P1領域に水平に隣接する複数の正にドープされた(P++)ポールであって、前記P++ポールが前記P1領域よりも強く正にドープされ、前記P++ポールが前記P1領域によって離隔された、複数の正にドープされた(P++)ポールと、
前記N1領域に水平に隣接する複数の負にドープされた(N++)領域であって、前記N++領域が前記N1領域よりも強く負にドープされ、前記N++領域が前記N1領域によって離隔された、複数の負にドープされた(N++)領域と、を含み、
前記少なくとも1つのアノードが、各P++ポールに結合されたアノードを含み、
前記少なくとも1つのカソードが、各N++ポールに結合されたカソードを含み、
前記P++ポール及び前記N++領域が前記N1領域、前記N2領域、前記P1領域及び前記P2領域に対して前記光学キャリアの光学損失における効果を最小化し、前記P++ポール及び前記N++領域が前記N1領域、前記N2領域、前記P1領域及び前記P2領域に対して前記カソードと前記アノードとの間の電気抵抗を低減するように、前記P++ポール及び前記N++領域が前記導波路コアの外側に配置された、請求項1に記載の光学変調器。 - 前記導波路がさらに、複数の正にドープされた(P+)領域を含み、前記P+領域が前記P++ポールよりも軽く正にドープされ、前記P1領域よりも強く正にドープされるように、各P+領域が、前記P++ポールの1つの前記P1領域との間に配置された、請求項13に記載の光学変調器。
- 前記導波路がさらに、複数の負にドープされた(N+)ポールを含み、前記N+ポールが前記N++領域よりも軽く正にドープされ、前記N1領域よりも強く正にドープされるように、各N+ポールが前記N++領域の1つと前記N1領域との間に配置された、請求項13に記載の光学変調器。
- シリコンウェハの第1の負にドープされた(N1)領域をドープして、垂直に隣接する第2の負にドープされた(N2)領域を形成する段階であって、前記N2領域が前記N1領域よりも強く負にドープされる、段階と、
第1の正にドープされた(P1)領域と、前記N2領域に垂直に隣接する、垂直に隣接する第2の正にドープされた(P2)領域であって、前記P2領域が前記P1領域よりも強く正にドープされ、前記P2領域及び前記N2領域が垂直な正−負(PN)接合の欠乏領域を形成する、段階と、を含むプロセスによって製造された、光学変調器。 - 前記N1領域、前記N2領域、前記P1領域及び前記P2領域が、導波路コアの中心に配置され、
前記プロセスがさらに、
前記導波路コアの中心を取り囲む前記導波路コアの水平方向のエッジをエッチングする段階と、
前記導波路コアのエッチングされた前記水平方向のエッジを二酸化シリコン(SiO2)で充填する段階と、を含む、請求項16に記載の光学変調器。 - 前記プロセスがさらに、
少なくとも1つのエッチングされた前記水平方向のエッジに垂直方向に隣接するシリコン層を追加する段階と、
前記PN接合への電気的接続をサポートするために前記シリコン層にドーピングを行う段階と、を含む、請求項17に記載の光学変調器。 - 前記プロセスがさらに、前記カソードが第1の電気接続アームを介して前記垂直PN接合と電気的に連通し、前記アノードが第2の電気接続アームを介して前記垂直PN接合と電気的に連通するように、前記シリコンウェハにカソード及びアノードを埋め込む段階を含む、請求項18に記載の光学変調器。
- 電圧が前記カソード及び前記アノードを介して前記PN接合にわたって印加されるときに、前記P2領域及び前記N2領域が、イオンの前記P2領域及び前記N2領域の完全な欠乏をサポートするような大きさとされる、請求項19に記載の光学変調器。
- 光学変調器を製造するための方法であって、
シリコンウェハの第1の負にドープされた(N1)領域をドープして、垂直に隣接する第2の負にドープされた(N2)領域を形成する段階であって、前記N2領域が前記N1領域よりも強く負にドープされる、段階と、
第1の正にドープされた(P1)領域及び、前記N2領域に垂直に隣接する、垂直に隣接する第2の正にドープされた(P2)領域をドープする段階であって、前記P2領域が前記P1領域よりも強く正にドープされ、前記P2領域及び前記N2領域が、垂直な正−負(PN)接合の欠乏領域を形成する、段階と、を含む方法。 - 前記N1領域、前記N2領域、前記P1領域及び前記P2領域が、導波路コアの中心に配置され、
前記プロセスがさらに、
前記導波路コアの中心を取り囲む前記導波路コアの水平方向のエッジをエッチングする段階と、
前記導波路コアのエッチングされた前記水平方向のエッジを二酸化シリコン(SiO2)で充填する段階と、を含む、請求項21に記載の方法。 - 前記プロセスがさらに、
エッチングされた前記水平方向のエッジの少なくとも1つと垂直に隣接するシリコン層を追加する段階と、
前記PN接合への電気的接続をサポートするために前記シリコン層をドーピングする段階と、を含む、請求項22に記載の方法。 - 前記プロセスがさらに、カソード及びアノードを前記シリコンウェハに埋め込む段階を含み、前記カソードが第1の電気接続アームを介して前記垂直PN接合と電気的に連通し、前記アノードが第2の電気接続アームを介して前記垂直PN接合と電気的に連通する、請求項23に記載の方法。
- 電圧が前記カソード及び前記アノードを介して前記PN接合にわたって印加されるときに、前記P2領域及び前記N2領域が、イオンの前記P2領域及び前記N2領域の完全な欠乏をサポートするような大きさにされる、請求項24に記載の方法。
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