JP2016091305A - 画像形成装置及び並列処理制御プログラム並びに並列処理制御方法 - Google Patents
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Abstract
【解決手段】キャッシュメモリを保持するプロセッサコアを複数有し、複数のプロセッサコアが1つのメインメモリを共有するマルチコアプロセッサを搭載する画像形成装置であって、制御部は、複数のジョブの処理ステップの重なりに応じて規定される期間毎に、メインメモリへのメモリアクセス負荷を算出する負荷算出部と、期間毎のメモリアクセス負荷に基づいて、メインメモリへのメモリアクセス負荷が最大となる第1の期間を予測する期間予測部と、第1の期間に実行される予定の複数の処理ステップの内のいずれかの処理ステップを、第1の期間よりも前の期間に、複数のジョブの処理を行っていないプロセッサコアでダミー実行し、ダミー実行完了後、当該処理ステップを実実行する処理制御部と、を備える。
【選択図】図11
Description
11 制御部
11a 負荷算出部
11b 期間予測部
11c 処理制御部
12 マルチコアプロセッサ
12a プロセッサコア
12b キャッシュメモリ
13 メインメモリ
14 メモリバス
15 HDD
16 ネットワークI/F部
17 スキャナ部
18 FAX制御部
19 画像形成部
20 操作表示部
Claims (12)
- キャッシュメモリを保持するプロセッサコアを複数有し、前記複数のプロセッサコアが1つのメインメモリを共有するマルチコアプロセッサを搭載する画像形成装置であって、
前記画像形成装置の動作を制御する制御部は、
複数のジョブの処理ステップの重なりに応じて規定される期間毎に、前記メインメモリへのメモリアクセス負荷を算出する負荷算出部と、
前記期間毎のメモリアクセス負荷に基づいて、前記メインメモリへのメモリアクセス負荷が最大となる第1の期間を予測する期間予測部と、
前記第1の期間に実行される予定の複数の処理ステップの内のいずれかの処理ステップを、前記第1の期間よりも前の期間に、前記複数のジョブの処理を行っていないプロセッサコアでダミー実行し、前記ダミー実行完了後、当該処理ステップを実実行する処理制御部と、を備える、
ことを特徴とする画像形成装置。 - 前記処理制御部は、前記第1の期間に実行される予定の前記複数の処理ステップの内の後のジョブの処理ステップに対して、前記ダミー実行及び前記実実行を行う、
ことを特徴とする請求項1に記載の画像形成装置。 - 前記負荷算出部は、各ジョブの各処理ステップに対して予め設定されたメモリアクセス負荷情報に基づいて、前記期間毎のメモリアクセス負荷を算出する、
ことを特徴とする請求項1又は2に記載の画像形成装置。 - 前記期間予測部は、前記複数のジョブがコピージョブ及びプリントジョブであり、前記コピージョブにおけるデータ変換と前記プリントジョブにおけるRIP処理とが重なる場合は、当該処理が重なる期間を、前記第1の期間と判断する、
ことを特徴とする請求項1乃至3のいずれか一に記載の画像形成装置。 - 前記期間予測部は、新規ジョブの受信開始時に、前記第1の期間の予測を行う、
ことを特徴とする請求項1乃至4のいずれか一に記載の画像形成装置。 - 前記処理制御部は、前記第1の期間よりも前、かつ、前記メモリアクセス負荷が最小となる第2の期間に、前記ダミー実行を行う、
ことを特徴とする請求項1乃至5のいずれか一に記載の画像形成装置。 - 前記処理制御部は、前記ダミー実行を行ったプロセッサコアで、前記実実行を行う、
ことを特徴とする請求項1乃至6のいずれか一に記載の画像形成装置。 - 前記処理制御部は、前記ダミー実行と前記実実行との切り替えを、フラグにより制御する、
ことを特徴とする請求項1乃至7のいずれか一に記載の画像形成装置。 - 前記ダミー実行は、前記メインメモリからジョブに応じた命令を読み出して前記キャッシュメモリに保存する実行形態であり、前記実実行は、前記メインメモリから前記ジョブに応じたデータを読み出し、読み出した前記データを参照して、前記キャッシュメモリに保存した前記命令を実行する実行形態である、
ことを特徴とする請求項1乃至8のいずれか一に記載の画像形成装置。 - 前記処理制御部は、前記処理ステップの前記ダミー実行に際して、前記データを参照せずに前記命令を実行する、
ことを特徴とする請求項9に記載の画像形成装置。 - キャッシュメモリを保持するプロセッサコアを複数有し、前記複数のプロセッサコアが1つのメインメモリを共有するマルチコアプロセッサを搭載する画像形成装置で動作する並列処理制御プログラムであって、
前記画像形成装置に、
複数のジョブの処理ステップの重なりに応じて規定される期間毎に、前記メインメモリへのメモリアクセス負荷を算出する第1処理、
前記期間毎のメモリアクセス負荷に基づいて、前記メインメモリへのメモリアクセス負荷が最大となる第1の期間を予測する第2処理、
前記第1の期間に実行される予定の複数の処理ステップの内のいずれかの処理ステップを、前記第1の期間よりも前の期間に、前記複数のジョブの処理を行っていないプロセッサコアでダミー実行し、前記ダミー実行完了後、当該処理ステップを実実行する第3処理、を実行させる、
ことを特徴とする並列処理制御プログラム。 - キャッシュメモリを保持するプロセッサコアを複数有し、前記複数のプロセッサコアが1つのメインメモリを共有するマルチコアプロセッサを搭載する画像形成装置における並列処理制御方法であって、
複数のジョブの処理ステップの重なりに応じて規定される期間毎に、前記メインメモリへのメモリアクセス負荷を算出する第1処理と、
前記期間毎のメモリアクセス負荷に基づいて、前記メインメモリへのメモリアクセス負荷が最大となる第1の期間を予測する第2処理と、
前記第1の期間に実行される予定の複数の処理ステップの内のいずれかの処理ステップを、前記第1の期間よりも前の期間に、前記複数のジョブの処理を行っていないプロセッサコアでダミー実行し、前記ダミー実行完了後、当該処理ステップを実実行する第3処理と、を実行する、
ことを特徴とする並列処理制御方法。
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