JP2016009872A - 撮像素子および撮像装置 - Google Patents
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Abstract
Description
また、特許文献2に記載された技術では、被写体の明るさが比較的低い場合に、解像度の低下を本質的に解決しないという問題がある。
また、本発明は、2画素共有読み出し構造を備えた単板カラー撮像素子において、2画素同時読み出しを行った場合にも色画素信号を混合させずに読み出すことのできる撮像素子および撮像装置を提供しようとするものである。
また、上記の構成によれば、加算読出によって縦・横いずれかの方向のみに解像度が低下することがない。つまり、縦と横の解像度にバランスが取れている。
また、上記の構成によれば、
また、読出制御信号出力部に対する制御信号を撮像素子の外部から入力できるようにしてよい。これにより、画素の加算読出を行うか否かを、撮像素子の外部から制御することが可能となる。
また、オンチップカラーフィルター(CFA)の色の配置の一例として、三原色(赤、緑、青)の斜め方向のストライプ構造としてよい。
以下では、図面を参照しながら、本発明の第1実施形態について説明する。
図1は、同実施形態による単板カラー撮像素子の画素の構成および回路の概略を示す概略回路図である。同図は、撮像素子における画素の配置を平面視して示しているものであり、撮像素子全体の中のごく一部の画素のマトリックスを拡大して示している。つまり、実際の単板カラー撮像素子は、縦横それぞれ数千個ないしはそれ以上の数の画素のマトリックスを備えているが、同図は、そのうちの一部、即ち縦4画素×横6画素の、計24画素のみの部分を示している。
なお、撮像素子は、CMOS(相補性金属酸化膜半導体)などにより実現する。
後述するように、画素の受光部の上に設けられるオンチップカラーフィルターは、画素11の配列に入射する入射光を画素単位で所定の色で変調するものであって、特定の電荷読出回路12に接続された第1画素と第2画素とを同じ色で変調する。
なお、以下において、画素11B,11G,11Rを総称して、画素11と呼ぶ場合がある。画素11の配列全体が画素配列部である。つまり、この画素配列部は、画素を縦および横の二次元に配列した構成を有する。
垂直読出線24は、 電荷読出回路12からの出力電気信号を読出部33に伝えるための線である。垂直読出線24は、画素と画素の間に、垂直方向に引かれている。
また、読出制御信号出力部31は、画素の1行ずつ、または2行ずつ、垂直方向の走査を行うように、画素からの電荷の読み出しを制御する。つまり、読出制御信号出力部31は、垂直方向の走査を行う垂直走査部の機能を兼ね備える。なお、垂直走査を行うタイミングを制御するための信号については、後述する。
なお、図1で説明したように、対を成す2つの画素は、同色(R,G,またはB)の画素である。
また、(B)は、2行1組での走査の開始のタイミングを表す信号である(便宜上、VSCKと呼ぶ)。言い換えれば、このVSCKがHIGHのとき、対を成す2行の読み出しを開始する。このVSCKの周期は2Hである。VSCKは、偶数行(つまり、「ROW 0」、「ROW 2」・・・)における副期間0番のときだけHIGHであり、その他の期間にはLOWである。つまり、単板カラー撮像素子1は、VSCKが示すタイミングに基づいて、2行ずつ垂直走査していく。
以上、「ROW 0」と「ROW 1」の対の例について述べたが、「ROW 2」と「ROW 3」の対や、それ以後の行の対についても同様の動作が繰り返される。単板カラー撮像素子1を動画撮影用に用いる場合、Vは、例えば1/30(三十分の一)秒、1/60秒、1/120秒などである。
即ち、第1に、撮影被写体が暗い場合に、共通画素の加算読出をすることにより、単板カラー撮像素子でも混色なく増感が可能となる。
第2に、加算される2画素の空間位置は、垂直方向でも水平方向でもなく、斜め方向である。仮に垂直方向に画素加算した場合は、単純に垂直解像度が半分に低下する一方で水平解像度は変わらないため、水平・垂直方向の解像度のバランスが崩れるとともに、例えば縦横の細かい縞模様を撮影した場合に偽色が発生しやすくなる。これに対して、本実施形態では斜め方向に画素加算するため、空間的には水平方向と垂直方向にバランスよく混合(加算)が行われ、偽色が発生しにくくなるという利点がある。なお、一般に自然界に存在する被写体は、斜め方向よりも水平・垂直方向に相関を持った縞模様を多く持っている。このことからも、本実施形態の構成が、一般的な被写体とって好ましいものであることは多い。
なお、赤(R)および青(B)においては、水平走査毎にRチャンネル、Bチャンネルの読み出しが切り替わるが、このとき、アンプのゲインを切り替える事により、読み出し回路の先に接続されているADC回路のアナログ入力信号範囲をある程度一定の大きさに制限することができ、ADC回路動作範囲が有効に活用できるようになるが、このような動作を行う場合にも、この水平走査毎にアンプゲインを切り替える頻度を通常の1H毎から2H毎に低減させることができるため、アンプ回路の動作がより安定するという利点がある。
なお、本実施形態による単板カラー撮像素子が、2倍速撮影モードを有するようにしても良い。この2倍速撮影モードにおける動作を、図4に示した動作と対比して説明する。即ち、図4に示したタイミングチャート(通常速モード)では、「ROW 1」,「ROW 3」,「ROW 5」,・・・の期間において、TX0とTX1の両方が、副期間68番の直前でLOWからHIGHに立ち上がり、「ROW 1」の期間における副期間86番の直前でHIGHからLOWに立ち下がっていた。これに対して、2倍速撮影モードでは、「ROW 1」,「ROW 2」,「ROW 3」,・・・の期間において、TX0とTX1の両方が、副期間68番の直前でLOWからHIGHに立ち上がり、「ROW 1」の期間における副期間86番の直前でHIGHからLOWに立ち下がる。これと同時に、垂直走査タイミングも通常の2倍速のタイミングで走査パルスを発生する。これにより、単板カラー撮像素子は、2倍速撮影モードでは、通常速撮影モードに比べて、2倍の速度でフレームを走査する。つまり、2倍速撮影モードでは、フレーム周波数が通常速モードのときの2倍になる。また、2倍速撮影モードでは、通常速モードでの読み出しの場合に比べて、1フレームあたりの電荷蓄積時間は半分となる。一般に、蓄積時間が半分になると、同じ強さの光による蓄積電荷発生量も半分となるため、信号量は半分となる。しかし、このとき2画素加算読み出しを行う事により、2倍速フレーム周波数で半減する電荷量が2画素加算されて、撮影しても信号量が減らずに読み出せる事になる。すなわち、通常の駆動と、2画素加算して2倍速撮影したときで、信号出力強度を同等のレベルに維持できる。
次に、第2実施形態について説明する。
図6は、本実施形態による撮像装置の概略機能構成を示すブロック図である。この撮像装置82が用いる単板カラー撮像素子1は、第1実施形態における単板カラー撮像素子と同一である。本実施形態による撮像装置82は、単板カラー撮像素子1に加えて、画素加算切替判断部62と、光量検出部65と、レンズ71とを含んで構成される。なお、撮像装置82が備える機能のうち、本発明の実施形態と直接の関係を持たない部分については、図示および説明を省略する。
本実施形態では、2画素共有読み出し回路を1画素毎に個別に読み出し動作させる場合は、通常通り斜め画素ストライプ構造の画素信号がそのまま順次走査で読み出すことができる。一方、2画素共有読み出し回路の画素切替スイッチを同時にオンとした場合は、同じ色の画素を同時に読み出す動作が行われる。
図1は、画素の色の配置例を示している。この色の配置を、次のような変形例で置き換えても良い。次に示す変形例は、オンチップカラーフィルターの色の配置のパターンを示す。実際には、このようなパターンの繰り返しで、縦・横それぞれ、数百から数千の数の画素を配置する。なお、下に示す配置のパターンにおいて、「上:」はその行が偶数行であることを示し、「下:」はその行が奇数行であることを示す。「上:」と表示された行と、その直下の「下:」と表示された行とが対を成す。
上:RGBRGBRGBRGBRGBRGBRGB
下:GBRGBRGBRGBRGBRGBRGBR
上:BRGBRGBRGBRGBRGBRGBRG
下:RGBRGBRGBRGBRGBRGBRGB
上:GBRGBRGBRGBRGBRGBRGBR
下:BRGBRGBRGBRGBRGBRGBRG
上:RBGRBGRBGRBGRBGRBGRBG
下:BGRBGRBGRBGRBGRBGRBGR
上:GRBGRBGRBGRBGRBGRBGRB
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右下と左上が対 RGB
上:RBGRBGRBGRBGRBGRBGRBG
下:GRBGRBGRBGRBGRBGRBGRB
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上:RGBGRGBGRGBGRGBGRGBGRGBG
下:GRGBGRGBGRGBGRGBGRGBGRGB
上:BGRGBGRGBGRGBGRGBGRGBGRG
下:GBGRGBGRGBGRGBGRGBGRGBGR
上:RGBGRGBGRGBGRGBGRGBGRGBG
下:GRGBGRGBGRGBGRGBGRGBGRGB
上記の変形例5では、水平方向の色の並びが「RGBG」の繰り返しであり、対となる画素は、左上と右下である。つまり、左上から右下への方向の斜めストライプが並ぶ。
上:RGBGRGBGRGBGRGBGRGBGRGBG
下:GBGRGBGRGBGRGBGRGBGRGBGR
上:BGRGBGRGBGRGBGRGBGRGBGRG
下:GRGBGRGBGRGBGRGBGRGBGRGB
上:RGBGRGBGRGBGRGBGRGBGRGBG
下:GBGRGBGRGBGRGBGRGBGRGBGR
上記の変形例6では、水平方向の色の並びが「RGBG」の繰り返しであり、対となる画素は、右上と左下である。つまり、右上から左下への方向の斜めストライプが並ぶ。
11,11B,11G,11R 画素
12 電荷読出回路(フローティング・ディフュージョン,FD)
21 電荷読出線
22−0,22−1 読出制御線
24 垂直読出線
31 読出制御信号出力部
33 読出部
35 加算読出制御部
41−0,41−1 画素読出スイッチ
43 垂直読出線スイッチ
61,62 画素加算切替判断部
65 光量検出部
71 レンズ
81,82 撮像装置
Claims (4)
- 画素を縦および横の二次元に配列した構成を有する画素配列部と、
前記画素配列部に含まれる画素のうち、特定の第1画素と、平面視において前記第1画素の右下または左下のいずれか一方に配置された第2画素とに接続され、前記第1画素および前記第2画素から受光量に応じた電荷を読み出すとともに、読み出した電荷量に応じた信号値を出力する電荷読出回路と、
前記電荷読出回路が前記第1画素と前記第2画素の各々から異なるタイミングで電荷の読み出しを行うか、前記電荷読出回路が前記第1画素と前記第2画素の両方から同じタイミングで電荷の読み出しを行うか、を制御するための制御信号を出力する読出制御信号出力部と、
前記電荷読出回路から出力される前記信号値を読み出す読出部と、
前記画素配列部に入射する入射光を前記画素配列部に含まれる画素単位で所定の色で変調するカラーフィルターであって、特定の前記電荷読出回路に接続された前記第1画素と前記第2画素とを同じ色で変調するカラーフィルターと、
を具備することを特徴とする撮像素子。 - 請求項1に記載の撮像素子と、
前記読出制御信号出力部に対して、前記第1画素と前記第2画素の各々から異なるタイミングで電荷の読み出しを行うか、前記電荷読出回路が前記第1画素と前記第2画素の両方から同じタイミングで電荷の読み出しを行うか、を制御するための画素加算駆動信号を供給する画素加算切替判断部と、
を具備することを特徴とする撮像装置。 - 前記画素加算切替判断部は、前記撮像素子から出力される画像の信号に基づく判断を行うことによって、前記画素加算駆動信号を供給する、
ことを特徴とする請求項2に記載の撮像装置。 - 前記撮像素子への入射光の光量を検出する光量検出部、をさらに具備し、
前記画素加算切替判断部は、前記光量検出部から出力される光量の信号に基づく判断を行うことによって、前記画素加算駆動信号を供給する、
ことを特徴とする請求項2に記載の撮像装置。
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