JP2014202792A - 携帯端末及び表示パネルドライバ - Google Patents
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Abstract
【解決手段】携帯端末1が、電池3と、液晶表示パネル7と、システムPMIC18と、液晶コントローラドライバ20とを備えている。液晶コントローラドライバ20は、ロジック回路と、ゲート制御駆動回路と、ソース線駆動回路と、レギュレータと、昇圧電源回路とを具備する。ロジック回路は、電源ライン21及び電源ライン23の少なくとも一方の電圧の低下に応答して、液晶表示パネル20に蓄積されている電荷が放電されるようにゲート制御駆動回路と、ソース線駆動回路とを制御するように構成されている。電源ライン21及び電源ライン23の少なくとも一方の電圧の低下が検出されると、スイッチがオン状態になり、電荷が、レギュレータを介してVGH電源ラインからVDD電源ラインに輸送される。
【選択図】図4
Description
図4は、本発明の第1の実施形態における携帯端末1の構成を示すブロック図である。図4には、携帯端末1のうち、液晶表示パネル7の駆動に関連する部分のみが図示されている。
(1)電源ライン23に蓄積されている電荷
(2)バイパスキャパシタ24に蓄積されている電荷
(3)VCI電源ライン37に蓄積されている電荷
(4)昇圧キャパシタ25に蓄積されている電荷
詳細には、電池3からの電力供給が遮断された場合、電源ライン23、バイパスキャパシタ24、VCI電源ライン37、及び、昇圧キャパシタ25に蓄積された電荷は、VGH電源ライン39に運ばれる。ここで、本実施形態では、VGH電源ライン39に運ばれた電荷が、レギュレータ41、スイッチ42及びレギュレータ35によってVDD電源ライン36まで輸送されるから、結果として、上記の(1)〜(4)の電荷をVDD電源ライン36の電圧の維持に利用することができることになる。
図9は、本発明の第2の実施形態における液晶コントローラドライバ20の構成を示すブロック図である。第2の実施形態の液晶コントローラドライバ20の構成は、第1の実施形態の液晶コントローラドライバ20の構成(図5参照)と類似しているが、IOVCC電源ライン34にスイッチ50が追加的に設けられている点で相違している。
図11A、図11Bは、上述された第1及び第2の実施形態の液晶コントローラドライバ20の、より具体的な実装を示すブロック図である。図11A、図11Bに図示された液晶コントローラドライバ20は、大きく分けて、データ駆動回路部(51〜62)、動作制御のための制御回路部(71〜80)、電源系回路部(81〜83)を備えている。
2 :メインボード
3 :電池
4 :マイク
5 :スピーカ
6 :アンテナモジュール
7 :液晶表示パネル
7a :表示部
7b :GIP回路
8 :ゲートドライバIC
11 :音声インターフェース
12 :ベースバンド/アプリケーションプロセッサ
13 :DSP
14 :ASIC
15 :マイクロコンピュータ
16 :高周波インターフェース
17 :メモリ
18 :システムPMIC
20 :液晶コントローラドライバ
21 :電源ライン
22 :バイパスキャパシタ
23 :電源ライン
24 :バイパスキャパシタ
25 :昇圧キャパシタ
26 :電源ライン
27 :バイパスキャパシタ
31 :ロジック回路
32 :ゲート制御駆動回路
33 :ソース駆動回路
34 :IOVCC電源ライン
34a :第1部分
34b :第2部分
35 :レギュレータ
36 :VDD電源ライン
37 :VCI電源ライン
38 :昇圧電源回路
39 :VGH電源ライン
41 :レギュレータ
42 :スイッチ
43 :検出器
44 :検出器
45 :基準電圧発生回路
46、47:レベル調整回路
48、49:検出レベル調整回路
50 :スイッチ
51 :データインターフェース
52 :ライトレジスタ
53 :セレクタ
54 :フレームメモリ
55 :ラッチ回路
56 :セレクタ
57 :スケーリング回路
58 :ラッチ回路
59 :ラッチ回路
60 :ソースドライバ
61 :ガンマ演算回路
62 :階調電圧生成回路
71 :システムインターフェース
72 :コマンドレジスタ
73 :パラメータレジスタ
74 :不揮発性メモリ
75 :アドレスカウンタ
76 :バックライト制御回路
77 :タイミング生成回路
78 :パネルインターフェース回路
79 :発振回路
80 :タッチパネル同期出力回路
81 :液晶駆動電源生成回路
82 :内部ロジック電源レギュレータ
83 :内部参照電圧生成回路
IOVCC:ロジック電源電圧
VDD :ロジック電源電圧
VCI :アナログ電源電圧
VGH :昇圧電源電圧
S1−Sm:ソース駆動信号
SOUT1−SOUTn:ゲート制御信号
G1−Gp:ゲート駆動信号
SDTC1:検出信号
SDTC2:検出信号
Claims (7)
- ソース線とゲート線とを備える表示パネルと、
電力蓄積デバイスと、
前記電力蓄積デバイスから受け取った電力から、アナログ電源電圧と第1ロジック電源電圧を生成し、前記アナログ電源電圧を第1電源ラインに供給し、前記第1ロジック電源電圧を第2電源ラインに供給する電源回路部と、
前記第1電源ラインから前記アナログ電源電圧を受け取り、受け取った前記アナログ電源電圧を昇圧して昇圧電源電圧を生成して第3電源ラインに供給するように構成された昇圧電源回路と、
前記第3電源ラインから前記昇圧電源電圧を受け取って前記ゲート線を駆動するゲート線駆動部と、
前記ソース線を駆動するソース線駆動部と、
前記第1ロジック電源電圧を降圧して第2ロジック電源電圧を生成し、前記第2ロジック電源電圧を第4電源ラインに供給するように構成された第1レギュレータと、
前記第4電源ラインから前記第2ロジック電源電圧を受け取って、前記ゲート線駆動部と前記ソース線駆動部とを制御するように構成されたロジック回路と、
電荷輸送経路
とを具備し、
前記ロジック回路は、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の電圧の低下に応答して、前記表示パネルに蓄積されている電荷が放電されるように前記ソース線駆動部と前記ゲート線駆動部とを制御するように構成され、
前記電荷輸送経路は、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の低下に応答して、前記第3電源ラインから前記第4電源ラインに電荷を輸送するように構成された
携帯端末。 - 請求項1に記載の携帯端末であって、
前記電荷輸送経路は、
前記第3電源ラインから受け取った前記昇圧電源電圧を降圧する第2レギュレータと、
前記第2レギュレータの出力と前記第2電源ラインの間、又は前記第2レギュレータの出力と前記第4電源ラインの間に接続された第1スイッチを具備し、
前記第1スイッチは、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の電圧の低下に応答してオン状態になるように構成された
携帯端末。 - 請求項1又は2に記載の携帯端末であって、
更に、
前記第2電源ラインに挿入された第2スイッチを具備し、
前記第2スイッチは、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の低下に応答してオフ状態になるように構成された
携帯端末。 - 請求項1乃至3のいずれかに記載の携帯端末であって、
前記第1電源ラインと接地端子の間に接続された第1バイパスキャパシタと、
前記第2電源ラインと接地端子の間に接続された第2バイパスキャパシタと、
前記第3電源ラインと接地端子の間に接続された第3バイパスキャパシタ
とを具備する
携帯端末。 - ソース線とゲート線とを備える表示パネルを駆動する表示パネルドライバであって、
アナログ電源電圧を受け取る第1電源ラインと、
第1ロジック電源電圧を受け取る第2電源ラインと、
前記第1電源ラインから前記アナログ電源電圧を受け取り、受け取った前記アナログ電源電圧を昇圧して昇圧電源電圧を生成して第3電源ラインに供給するように構成された昇圧電源回路と、
前記第3電源ラインから前記昇圧電源電圧を受け取って、前記ゲート線を駆動するゲートドライバを制御するゲート制御信号、又は、前記ゲート線を駆動するゲート駆動信号を生成するゲート制御駆動回路と、
前記ソース線を駆動するソース線駆動回路と、
前記第1ロジック電源電圧を降圧して第2ロジック電源電圧を生成し、前記第2ロジック電源電圧を第4電源ラインに供給するように構成された第1レギュレータと、
前記第4電源ラインから前記第2ロジック電源電圧を受け取って、前記ソース線駆動回路と前記ゲート制御駆動回路とを制御するように構成されたロジック回路と、
電荷輸送経路
とを具備し、
前記ロジック回路は、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の電圧の低下に応答して、前記表示パネルに蓄積されている電荷が放電されるように前記ソース線駆動回路と前記ゲート制御駆動回路とを制御するように構成され、
前記電荷輸送経路は、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の低下に応答して、前記第3電源ラインから前記第4電源ラインに電荷を輸送するように構成された
表示パネルドライバ。 - 請求項5に記載の表示パネルドライバであって、
前記電荷輸送経路は、
前記第3電源ラインから受け取った前記昇圧電源電圧を降圧する第2レギュレータと、
前記第2レギュレータの出力と前記第2電源ラインの間、又は前記第2レギュレータの出力と前記第4電源ラインの間に接続された第1スイッチを具備し、
前記第1スイッチは、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の電圧の低下に応答してオン状態になるように構成された
表示パネルドライバ。 - 請求項5又は6に記載の表示パネルドライバであって、
更に、
前記第2電源ラインに挿入された第2スイッチを具備し、
前記第2スイッチは、前記第1電源ライン及び前記第2電源ラインの少なくとも一方の低下に応答してオフ状態になるように構成された
表示パネルドライバ。
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