JP2014143454A - Crystal oscillation circuit - Google Patents

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Abstract

PROBLEM TO BE SOLVED: To provide a crystal oscillation circuit that allows reducing power consumption compared to conventional general crystal oscillators.SOLUTION: A crystal oscillation circuit 100 includes a first inverter 1, a first crystal resonator 2, a second inverter 3, and a second crystal resonator 4. The crystal oscillation circuit 100 has a circuit configuration in which the first inverter 1, the first crystal resonator 2 for clock generation, the second inverter 3, and the second crystal resonator 4 for clock generation are connected in series.

Description

本発明は、水晶振動子を用いた水晶発振回路に関するものである。   The present invention relates to a crystal oscillation circuit using a crystal resonator.

従来の一般的な水晶発振器として、一つには、単段式ピアース発振器(single-stage Pierce
oscillator)が知られている。従来の単段式ピアース発振器300は、図4に示すように、+1.8Vの電圧が印加されたソース電圧線Vssと、接地線GNDとの間に設けられたインバータ301と、該インバータ301に抵抗Rを介して並列に接続されたクロック発生用の水晶振動子302と、インバータ301の入力ノード317と接地線GNDとの間に設けられた充放電用のロードキャパシタ303と、インバータ301の出力ノード318と接地線GNDとの間に抵抗Rを介して設けられた充放電用のロードキャパシタ304と、を備えている。
One common crystal oscillator is a single-stage Pierce oscillator.
oscillator) is known. As shown in FIG. 4, the conventional single-stage Pierce oscillator 300 includes an inverter 301 provided between a source voltage line Vss to which a voltage of +1.8 V is applied and a ground line GND, and an inverter 301. A crystal oscillator 302 for clock generation connected in parallel via a resistor R, a load capacitor 303 for charging / discharging provided between an input node 317 of the inverter 301 and the ground line GND, and an output of the inverter 301 A charge / discharge load capacitor 304 provided between the node 318 and the ground line GND via a resistor R.

従来の一般的な水晶発振器として、もう一つには、二段式ピアース発振器(2-stages Pierce
oscillator)が知られている。従来の二段式ピアース発振器400は、図5に示すように、インバータ、キャパシタ、インバータ、及び、水晶振動子が直列に接続された発振器であって、+1.0Vの電圧が印加されたソース電圧線Vssと、接地線GNDとの間に設けられた第1インバータ401と、第2インバータ402と、第1インバータ401及び第2インバータ402の間に直列接続されたノイズ除去用のブロックキャパシタ403と、第1インバータ401の入力ノード417と接地線GNDとの間に設けられた充放電用のロードキャパシタ404と、第1インバータ401の入力ノード417と第2インバータ402の出力ノード418との間に設けられたクロック発生用の水晶振動子405と、を備えている。なお、インバータ、キャパシタ、及び、水晶振動子が直列接続された発振器の別の一例としては、下記の特許文献1(図1参照)に示す水晶発振器が提案されている。
Another conventional crystal oscillator is the two-stage Pierce oscillator (2-stages Pierce).
oscillator) is known. As shown in FIG. 5, a conventional two-stage Pierce oscillator 400 is an oscillator in which an inverter, a capacitor, an inverter, and a crystal resonator are connected in series, and a source voltage to which a voltage of +1.0 V is applied. A first inverter 401 provided between the line Vss and the ground line GND; a second inverter 402; and a noise removing block capacitor 403 connected in series between the first inverter 401 and the second inverter 402. The charge / discharge load capacitor 404 provided between the input node 417 of the first inverter 401 and the ground line GND, and between the input node 417 of the first inverter 401 and the output node 418 of the second inverter 402. And a crystal oscillator 405 for clock generation provided. As another example of an oscillator in which an inverter, a capacitor, and a crystal resonator are connected in series, a crystal oscillator shown in the following Patent Document 1 (see FIG. 1) has been proposed.

特開2009−124290号公報JP 2009-124290 A

しかしながら、上述した従来の一般的な水晶発振器では、必須の構成要素となる各キャパシタに余分な電荷が蓄積されることにより、消費電力が増加するという問題がある。   However, the above-described conventional general crystal oscillator has a problem in that power consumption increases due to accumulation of extra charges in each capacitor, which is an essential component.

そこで、本発明は、従来の一般的な水晶発振器よりも消費電力を低減することのできる水晶発振回路を提供することを目的とするものである。   Accordingly, an object of the present invention is to provide a crystal oscillation circuit capable of reducing power consumption as compared with a conventional general crystal oscillator.

(1) 本発明の水晶発振回路は、第1の電圧線及び第2の電圧線の間に接続された第1インバータと、一端が前記第1インバータの出力ノードに接続された第1水晶振動子と、入力ノードが前記第1水晶振動子の他端に接続された第2インバータと、一端が前記第2インバータの出力ノードに接続され、他端が前記第1インバータの入力ノードに接続された第2水晶振動子と、を備えるものである。 (1) A crystal oscillation circuit according to the present invention includes a first inverter connected between a first voltage line and a second voltage line, and a first crystal vibration having one end connected to an output node of the first inverter. A second inverter connected to the other end of the first crystal unit, one end connected to the output node of the second inverter, and the other end connected to the input node of the first inverter. And a second crystal resonator.

上記(1)の構成によれば、第1インバータ、第1水晶振動子、第2インバータ、及び、第2水晶振動子を直列に接続することで、従来の一般的な水晶発振器で必須の構成要素となる各キャパシタを用いることなく、水晶発振回路を構成することができる。従って、従来の一般的な水晶発振器のように各キャパシタで余分な電荷が蓄積されることはない。その結果、従来の一般的な水晶発振器よりも消費電力を低減することができる。   According to the configuration of (1) above, the first inverter, the first crystal resonator, the second inverter, and the second crystal resonator are connected in series, so that the configuration is essential for the conventional general crystal oscillator A crystal oscillation circuit can be configured without using each capacitor as an element. Therefore, unlike the conventional general crystal oscillator, no extra charge is accumulated in each capacitor. As a result, power consumption can be reduced as compared with a conventional general crystal oscillator.

(2) 上記(1)の水晶発振回路においては、前記各インバータが、ゲートが入力ノードに接続され、ソースが前記第1電圧線に接続され、ドレインが出力ノードに接続された第1トランジスタと、ゲートが入力ノードに接続され、ソースが前記第2電圧線に接続され、ドレインが出力ノードに接続された第2トランジスタと、一端が入力ノードに接続され、他端が出力ノードに接続されたフィードバック用の抵抗と、を備えることが好ましい。 (2) In the crystal oscillation circuit of (1), each inverter includes a first transistor having a gate connected to the input node, a source connected to the first voltage line, and a drain connected to the output node. A second transistor having a gate connected to the input node, a source connected to the second voltage line, a drain connected to the output node, one end connected to the input node, and the other end connected to the output node And a resistance for feedback.

上記(2)の構成によれば、前記各インバータを、第1トランジスタ、第2トランジスタ、及び、抵抗で構成することにより、従来の一般的な水晶発振器よりも消費電力を低減可能な水晶発振回路を容易に構成することができる。   According to the configuration of (2) above, a crystal oscillation circuit capable of reducing power consumption compared with a conventional general crystal oscillator by configuring each inverter with a first transistor, a second transistor, and a resistor. Can be configured easily.

本発明の一実施形態に係る水晶発振回路100の回路図である。1 is a circuit diagram of a crystal oscillation circuit 100 according to an embodiment of the present invention. 図1に示す水晶発振回路100の一例として、水晶発振回路200のインバータ内部の回路構成を示したブロック図である。FIG. 2 is a block diagram showing a circuit configuration inside an inverter of a crystal oscillation circuit 200 as an example of the crystal oscillation circuit 100 shown in FIG. 1. 水晶発振回路200の試作品を用いたシミュレーション結果を示す説明図である。It is explanatory drawing which shows the simulation result using the prototype of the crystal oscillation circuit. 従来の単段式ピアース発振器300の回路図である。1 is a circuit diagram of a conventional single-stage Pierce oscillator 300. FIG. 従来の二段式ピアース発振器400の回路図である。FIG. 6 is a circuit diagram of a conventional two-stage Pierce oscillator 400.

以下、図1〜図3を参照しながら、本発明の一実施形態に係る水晶発振回路について説明する。   Hereinafter, a crystal oscillation circuit according to an embodiment of the present invention will be described with reference to FIGS.

(水晶発振回路の全体構成)
図1に示すように、本実施形態の水晶発振回路100は、第1インバータ1と、第1水晶振動子2と、第2インバータ3と、第2水晶振動子4と、を備えているものである。水晶発振回路100は、第1インバータ1と、クロック発生用の第1水晶振動子2と、第2インバータ3と、クロック発生用の第2水晶振動子4とが直列に接続された回路構成を有しているものである。
(Whole structure of crystal oscillation circuit)
As shown in FIG. 1, the crystal oscillation circuit 100 according to the present embodiment includes a first inverter 1, a first crystal resonator 2, a second inverter 3, and a second crystal resonator 4. It is. The crystal oscillation circuit 100 has a circuit configuration in which a first inverter 1, a first crystal oscillator 2 for generating a clock, a second inverter 3, and a second crystal oscillator 4 for generating a clock are connected in series. It is what you have.

(水晶発振回路の一例)
図2は、図1に示す水晶発振回路100の一例として、水晶発振回路200のインバータ21,23内部の回路構成を示したブロック図である。なお、図2に示すように、各インバータ21,23は、同じ回路構成であるため、各構成要素に同じ符号を付すものとする。
(Example of crystal oscillation circuit)
FIG. 2 is a block diagram showing a circuit configuration inside inverters 21 and 23 of crystal oscillation circuit 200 as an example of crystal oscillation circuit 100 shown in FIG. As shown in FIG. 2, the inverters 21 and 23 have the same circuit configuration, and therefore the same reference numerals are given to the respective components.

図2に示すように、第1水晶振動子22は、一端が第1インバータ21の出力ノード18に接続され、他端が第2インバータ23の入力ノード17に接続されているものである。同様に、第2水晶振動子24は、一端が第2インバータ23の出力ノード18に接続され、他端が第1インバータ21の入力ノード17に接続されているものである。なお、以下では、第1インバータ21及び第2インバータ23を各インバータと略記することがある。同様に、第1水晶振動子22及び第2水晶振動子24を各水晶振動子と略記することがある。   As shown in FIG. 2, the first crystal resonator 22 has one end connected to the output node 18 of the first inverter 21 and the other end connected to the input node 17 of the second inverter 23. Similarly, the second crystal resonator 24 has one end connected to the output node 18 of the second inverter 23 and the other end connected to the input node 17 of the first inverter 21. Hereinafter, the first inverter 21 and the second inverter 23 may be abbreviated as each inverter. Similarly, the first crystal unit 22 and the second crystal unit 24 may be abbreviated as each crystal unit.

(各インバータの構成)
図2に示すように、第1インバータ21及び第2インバータ23は、第1トランジスタ10と、第2トランジスタ11と、第1ダイオード12と、第2ダイオード13と、第3ダイオード14と、第4ダイオード15と、フィードバック(帰還)用の抵抗16と、を備えているものである。なお、以下では、第1ダイオード12、第2ダイオード13、第3ダイオード14、及び、第4ダイオード15を各ダイオードと略記することがある。
(Configuration of each inverter)
As shown in FIG. 2, the first inverter 21 and the second inverter 23 include the first transistor 10, the second transistor 11, the first diode 12, the second diode 13, the third diode 14, and the fourth transistor. A diode 15 and a feedback resistor 16 are provided. Hereinafter, the first diode 12, the second diode 13, the third diode 14, and the fourth diode 15 may be abbreviated as each diode.

第1トランジスタ10及び第2トランジスタ11は、それぞれ、オン/オフが互いに逆の関係になっているPチャネル型MOSトランジスタ及びNチャネル型MOSトランジスタとして機能するものであって、第1トランジスタ10及び第2トランジスタ11の組み合わせによって、CMOS(Complementary Metal Oxide Semiconductor)回路が構成されている。   The first transistor 10 and the second transistor 11 function as a P-channel MOS transistor and an N-channel MOS transistor whose on / off is opposite to each other. A combination of two transistors 11 constitutes a complementary metal oxide semiconductor (CMOS) circuit.

第1トランジスタ10のゲートは、各インバータの入力ノード17に接続されており、各水晶振動子から入力信号(IN)を受けるものである。第1トランジスタ10のソースは、+1Vの電圧が印加されたソース電圧線Vss(第1電圧線)に接続されているものである。第1トランジスタ10のドレインは、第1トランジスタ10の出力ノード18に接続されており、各水晶振動子に出力信号(OUT)を出力するものである。   The gate of the first transistor 10 is connected to the input node 17 of each inverter and receives an input signal (IN) from each crystal resonator. The source of the first transistor 10 is connected to a source voltage line Vss (first voltage line) to which a voltage of +1 V is applied. The drain of the first transistor 10 is connected to the output node 18 of the first transistor 10 and outputs an output signal (OUT) to each crystal resonator.

第2トランジスタ11のゲートは、各インバータの入力ノード17に接続されており、第2水晶振動子4から入力信号(IN)を受けるものである。第2トランジスタ11のソースは、接地線GND(第2電圧線)に接続されているものである。第2トランジスタ11のドレインは、各インバータの出力ノード18に接続されており、各水晶振動子に出力信号(OUT)を出力するものである。   The gate of the second transistor 11 is connected to the input node 17 of each inverter and receives an input signal (IN) from the second crystal unit 4. The source of the second transistor 11 is connected to the ground line GND (second voltage line). The drain of the second transistor 11 is connected to the output node 18 of each inverter, and outputs an output signal (OUT) to each crystal resonator.

各ダイオード12〜15は、第1トランジスタ10及び第2トランジスタ11が静電気により破壊されることから保護するために設けられているものである。   Each of the diodes 12 to 15 is provided to protect the first transistor 10 and the second transistor 11 from being destroyed by static electricity.

第1ダイオード12は、一端が各インバータの入力ノード17(第1トランジスタ10及び第2トランジスタ11の各ゲート)に接続されており、他端がソース電圧線Vss(第1トランジスタ10のソース)に接続されているものである。これにより、電流は、入力ノード17からソース電圧線Vssに向かう方向のみに流れるものである。   One end of the first diode 12 is connected to the input node 17 (the gates of the first transistor 10 and the second transistor 11) of each inverter, and the other end is connected to the source voltage line Vss (the source of the first transistor 10). It is connected. As a result, current flows only in the direction from the input node 17 toward the source voltage line Vss.

第2ダイオード13は、一端が各インバータの入力ノード17(第1トランジスタ10及び第2トランジスタ11の各ゲート)に接続されており、他端が接地線GND(第2トランジスタ11のソース)に接続されているものである。これにより、電流は、接地線GNDから入力ノード17に向かう方向のみに流れるものである。   One end of the second diode 13 is connected to the input node 17 (the gates of the first transistor 10 and the second transistor 11) of each inverter, and the other end is connected to the ground line GND (the source of the second transistor 11). It is what has been. As a result, the current flows only in the direction from the ground line GND toward the input node 17.

第3ダイオード14は、一端が各インバータの出力ノード18(第1トランジスタ10及び第2トランジスタ11の各ドレイン)に接続されており、他端がソース電圧線Vss(第1トランジスタ10のソース)に接続されているものである。これにより、電流は、出力ノード18からソース電圧線Vssに向かう方向のみに流れるものである。   One end of the third diode 14 is connected to the output node 18 (each drain of the first transistor 10 and the second transistor 11) of each inverter, and the other end is connected to the source voltage line Vss (the source of the first transistor 10). It is connected. Thereby, the current flows only in the direction from the output node 18 toward the source voltage line Vss.

第4ダイオード15は、一端が各インバータの出力ノード18(第1トランジスタ10及び第2トランジスタ11の各ドレイン)に接続されており、他端が接地線GND(第2トランジスタ11のソース)に接続されているものである。これにより、電流は、接地線GNDから出力ノード18に向かう方向のみに流れるものである。   The fourth diode 15 has one end connected to the output node 18 of each inverter (the drains of the first transistor 10 and the second transistor 11), and the other end connected to the ground line GND (the source of the second transistor 11). It is what has been. As a result, the current flows only in the direction from the ground line GND toward the output node 18.

なお、上記各ダイオードの容量は、上記静電気による破壊を保護するための性能を維持するために、少なくとも0.8pF以下であることが好ましい。これにより、従来の一般的な水晶発振器で必須の構成要素となるキャパシタの容量(より具体的には、6pF〜100pF)よりも小さい容量のダイオードを用いて回路を構成できるため、従来の一般的な水晶発振器よりも消費電力を低減することができる。   Note that the capacitance of each diode is preferably at least 0.8 pF or less in order to maintain the performance for protecting the breakdown due to static electricity. As a result, a circuit can be configured using a diode having a capacitance smaller than the capacitance of the capacitor (more specifically, 6 pF to 100 pF), which is an essential component of the conventional general crystal oscillator. Power consumption can be reduced compared to a simple crystal oscillator.

抵抗16は、各インバータの出力信号(OUT)の一部を入力ノード17にフィードバック(帰還)させることにより、規則的な電圧の変動を生じさせるために設けられているものである。   The resistor 16 is provided to cause regular voltage fluctuations by feeding back a part of the output signal (OUT) of each inverter to the input node 17.

抵抗16は、一端が各インバータの入力ノード17(第1トランジスタ10及び第2トランジスタ11の各ゲート)に接続されており、他端が各インバータの出力ノード18(第1トランジスタ10及び第2トランジスタ11の各ドレイン)に接続されているものである。   One end of the resistor 16 is connected to the input node 17 (the gates of the first transistor 10 and the second transistor 11) of each inverter, and the other end is connected to the output node 18 (the first transistor 10 and the second transistor) of each inverter. 11 drains).

次に、実施例により本発明を具体的に説明する。本発明者は、上記図2に示した回路構成について、水晶発振回路200の発振動作のシミュレーションを行った。なお、本発明は、本実施例に限定されるものではない。   Next, the present invention will be described specifically by way of examples. The inventor performed a simulation of the oscillation operation of the crystal oscillation circuit 200 with respect to the circuit configuration shown in FIG. In addition, this invention is not limited to a present Example.

図3は、ソース電圧線Vssに0.9Vの電圧を印加した場合における発振動作のシミュレーション結果を示すものである。図3(a)は、第1インバータ21の出力ノード18から出力される出力信号(OUT)の電圧レベルVOUT(V)を示している。図3(b)は、第1インバータ21の入力ノード17に入力される入力信号(IN)の電圧レベルVIN(V)を示している。 FIG. 3 shows a simulation result of the oscillation operation when a voltage of 0.9 V is applied to the source voltage line Vss. FIG. 3A shows the voltage level V OUT (V) of the output signal (OUT) output from the output node 18 of the first inverter 21. FIG. 3B shows the voltage level V IN (V) of the input signal (IN) input to the input node 17 of the first inverter 21.

本実施形態では、図3(b)に示すように、入力信号(IN)の信号波形を正弦波信号よりも矩形波信号に近づけることができることが判明した。その結果、従来の一般的な水晶発振器よりも、スイッチング速度を低下させる要因となるクローバ電流(Crowbar Current)を低減できるとともに、余分な電流を減らすことなく、高い電力供給電圧で水晶発振回路100を発振動作できることが判明した。また、図3(a)中の矢印に示すように、最大の増幅利得が得られる時点(45.75(ms)付近、及び、45.77(ms)付近)において、正弦波信号よりも立ち上がりが速くなることが判明した。   In the present embodiment, as shown in FIG. 3B, it has been found that the signal waveform of the input signal (IN) can be made closer to a rectangular wave signal than a sine wave signal. As a result, it is possible to reduce a crowbar current that causes a reduction in switching speed as compared with a conventional general crystal oscillator, and it is possible to make the crystal oscillation circuit 100 with a high power supply voltage without reducing excess current. It was found that it can oscillate. Further, as shown by the arrows in FIG. 3A, at the time when the maximum amplification gain is obtained (near 45.75 (ms) and 45.77 (ms)), it rises from the sine wave signal. Turned out to be faster.

(シミュレーション結果を検証するための実験結果)
以下に示す表1は、上記シミュレーション結果の正しさを検証するための実験結果の一例を示しているものである。本発明者は、本実施形態に係る水晶発振回路200の試作品におけるソース電圧線Vssに1.4V〜3.4Vの電圧を印加した場合について発振動作の検証を行った。表1は、ソース電圧線Vssに1.5Vの電圧を印加した場合における実験結果を示すものである。

Figure 2014143454
(Experimental results for verifying simulation results)
Table 1 shown below shows an example of an experimental result for verifying the correctness of the simulation result. The inventor verified the oscillation operation when a voltage of 1.4 V to 3.4 V was applied to the source voltage line Vss in the prototype of the crystal oscillation circuit 200 according to the present embodiment. Table 1 shows experimental results when a voltage of 1.5 V is applied to the source voltage line Vss.
Figure 2014143454

表1中のパラメータの各項目のうち、「振動周波数」,「STD(標準回路)における振動周波数」,「長期間における動作特性の変化(100時間)」,「1.5VでのHC(ハイスピードCMOSタイプ)インバータにおける消費電力」,「水晶振動子のウォーミングアップに要する立ち上がり時間」及び「オフ状態からの立ち上がり時間」については従来の一般的な水晶発振器と同程度であった。   Of each parameter item in Table 1, “vibration frequency”, “vibration frequency in STD (standard circuit)”, “change in operating characteristics over long period (100 hours)”, “HC at 1.5 V (high Speed CMOS type) Inverter power consumption, “rise time required for warming up the crystal unit”, and “rise time from the off state” were similar to those of a conventional general crystal oscillator.

しかしながら、表1中のパラメータの各項目のうち、「インバータの入出力信号における単位電圧当たりの周波数変化率(Frequency voltage coefficient)」については、−10ppm/Vの値を示した。これにより、従来の単段式ピアース発振器300(図4参照)における周波数変化率よりも小さな値に維持できることが判明し、インバータの入出力信号における信号レベルを安定させることができることが判明した。   However, among the items of the parameters in Table 1, the value of “−10 ppm / V” is shown for “Frequency voltage coefficient per unit voltage in the input / output signal of the inverter”. As a result, it has been found that it can be maintained at a value smaller than the frequency change rate in the conventional single-stage Pierce oscillator 300 (see FIG. 4), and it has been found that the signal level in the input / output signal of the inverter can be stabilized.

以下に示す表2は、上記シミュレーション結果の正しさを検証するための実験結果の別の一例を示しているものである。本発明者は、独ファンドリ企業(L Foundry)の構成を用いて、極端に低い消費電力型のRTC(Real Time Clock)におけるソース電圧線Vssに1.0Vの電圧を印加した場合について発振動作の検証を行った。

Figure 2014143454
Table 2 shown below shows another example of the experimental result for verifying the correctness of the simulation result. The present inventor uses the configuration of a German foundry company (L Foundry) to oscillate when a voltage of 1.0 V is applied to the source voltage line Vss in an extremely low power consumption type RTC (Real Time Clock). Was verified.
Figure 2014143454

パラメータの各項目のうち、「1.0Vでの消費電力」については、0.2〜0.5μWの値が得られ、大量生産品の値(>1.35μW)よりも小さい値に抑制できることが判明した。また、他の研究者の報告書で報告されている数値(0.5〜1.0μW)よりも小さい値に抑制できることが判明した。より具体的には、従来の一般的な水晶発振器で消費される電力(1.5μW)の1/5程度の消費電力(0.3μW程度)に抑制することができることが判明した。   Among the parameter items, for “power consumption at 1.0 V”, a value of 0.2 to 0.5 μW is obtained, and can be suppressed to a value smaller than the value of the mass-produced product (> 1.35 μW). There was found. Moreover, it turned out that it can suppress to a value smaller than the numerical value (0.5-1.0 microwatt) reported by the report of another researcher. More specifically, it has been found that the power consumption can be reduced to about 1/5 (about 0.3 μW) of the power consumed by a conventional general crystal oscillator (1.5 μW).

(水晶発振回路の実用上のメリット)
以下に示す表3,4は、ASIC(Application
Specific Integrated Circuit)として実装された本実施形態に係る水晶発振回路200の実用上のメリットを示しているものである。なお、表3,4中の構成要素中に示す「クラス6」とは、プリント回路板(PCB)のうち、最も一般的に使用される0.13mmピッチのプリント回路板(PCB)の設計クラスを示している。

Figure 2014143454
Figure 2014143454
(Practical merit of crystal oscillation circuit)
Tables 3 and 4 below show ASIC (Application
This shows a practical merit of the crystal oscillation circuit 200 according to the present embodiment mounted as a specific integrated circuit). “Class 6” shown in the components in Tables 3 and 4 is the design class of the most commonly used 0.13 mm pitch printed circuit board (PCB) among the printed circuit boards (PCB). Is shown.
Figure 2014143454
Figure 2014143454

表3,4中の構成要素の各項目について、本実施形態に係る水晶発振回路200と、従来の二段式ピアース発振器400(図5参照)とを比較した場合、各項目のうち、「集積回路におけるアクティブ領域の面積(cm)」が0.018(cm)、「集積回路のパッド数/ユニット完成品」が8個であり、従来の二段式ピアース発振器400と同じであった。 Regarding each item of the components in Tables 3 and 4, when the crystal oscillation circuit 200 according to the present embodiment and the conventional two-stage Pierce oscillator 400 (see FIG. 5) are compared, The area of the active region in the circuit (cm 2 ) ”is 0.018 (cm 2 ), and the“ number of integrated circuit pads / unit completed product ”is 8, which is the same as the conventional two-stage Pierce oscillator 400 .

しかしながら、各項目のうち、「ロードキャパシタの個数」及び「DCブロックキャパシタの個数」においては、従来の二段式ピアース発振器400では、いずれも1であり、ロードキャパシタ及びDCブロックキャパシタが必須の構成要素であるのに対して、本実施形態に係る水晶発振回路200では、「ロードキャパシタの個数」及び「DCブロックキャパシタの個数」が、いずれも0であり、ロードキャパシタ及びDCブロックキャパシタは必須の構成要素ではない。従って、ロードキャパシタ及びDCブロックキャパシタの原価を0ドル($)に節約できることが判明した。   However, among the items, “the number of load capacitors” and “the number of DC block capacitors” are both 1 in the conventional two-stage Pierce oscillator 400, and the load capacitor and the DC block capacitor are essential. In contrast, in the crystal oscillation circuit 200 according to the present embodiment, the “number of load capacitors” and the “number of DC block capacitors” are both 0, and the load capacitor and the DC block capacitor are indispensable. It is not a component. Accordingly, it has been found that the cost of the load capacitor and the DC block capacitor can be saved to 0 dollars ($).

また、各項目のうち、「バッテリー容量(10年使用、リチウムイオンバッテリー)」においては、本実施形態に係る水晶発振回路200における容量(エネルギー量)が50mWhであり、従来の単段式ピアース発振器300(図4参照)における容量(エネルギー量)(=0.5Wh)の1/10に低減できるとともに、従来の二段式ピアース発振器400(図5参照)における容量(エネルギー量)(=0.15Wh)の1/3に低減できることが判明した。   Among the items, in “battery capacity (used for 10 years, lithium ion battery)”, the capacity (energy amount) in the crystal oscillation circuit 200 according to the present embodiment is 50 mWh, and the conventional single-stage Pierce oscillator 300 (see FIG. 4), the capacity (energy amount) (= 0.5 Wh) can be reduced to 1/10, and the conventional two-stage Pierce oscillator 400 (see FIG. 5) capacity (energy amount) (= 0. It was found that it can be reduced to 1/3 of 15 Wh).

さらに、各項目のうち、「プリント回路板(PCB)及び組立部品が占める面積(cm、)、クラス6」においては、本実施形態に係る水晶発振回路200における面積が0.4(cm)であり、単段式ピアース発振器300及び二段式ピアース発振器400における面積(5cm)の1/10以下に低減できることで、本実施形態に係る水晶発振回路200におけるプリント回路板(PCB)及び組立部品の原価(0.08ドル)を、単段式ピアース発振器300及び二段式ピアース発振器400におけるプリント回路板(PCB)及び組立部品の原価(1.00ドル)と比べて0.92ドルだけ節約できることが判明した。 Further, among the items, in “area occupied by printed circuit board (PCB) and assembly parts (cm 2 ), class 6”, the area of the crystal oscillation circuit 200 according to the present embodiment is 0.4 (cm 2). And the printed circuit board (PCB) in the crystal oscillation circuit 200 according to the present embodiment can be reduced to 1/10 or less of the area (5 cm 2 ) in the single-stage Pierce oscillator 300 and the two-stage Pierce oscillator 400. $ 0.92 compared to the cost of assembled parts ($ 0.08) compared to the cost of printed circuit boards (PCB) and assembled parts ($ 1.00) in single stage Pierce oscillator 300 and two stage Pierce oscillator 400 It turns out that you can only save.

加えて、各項目のうち、「トータル価格(ドル)」に示されるように、本実施形態に係る水晶発振回路200におけるトータル価格(1.606ドル)は、単段式ピアース発振器300におけるトータル価格(1.896ドル)と比べて0.29ドルだけ低額となり、二段式ピアース発振器400におけるトータル価格(2.111ドル)と比べて0.505ドルだけ低額となった。   In addition, as shown in “total price (dollar)” among the items, the total price ($ 1.606) in the crystal oscillation circuit 200 according to the present embodiment is the total price in the single-stage Pierce oscillator 300. Compared to ($ 1.896), the price was reduced by $ 0.29, and compared with the total price ($ 2.111) in the two-stage Pierce oscillator 400, the price was reduced by $ 0.505.

この結果、本実施形態に係る水晶発振回路200は、バッテリー電源型あるいはエネルギー蓄積型のシステムに適していることが判明した。特に、より長期間の耐久性、安価なLSI(Large Scale Integration)技術、及び、高価なPCB(printed circuit board)技術の組み合わせによって、本実施形態に係る水晶発振回路200の価格を低額に抑えることができることが判明した。また、本実施形態に係る水晶発振回路200は、低消費電力型の発振回路であるため、従来の一般的な水晶発振器と比べてバッテリー寿命を3倍〜6倍に増加できることが判明した。   As a result, it has been found that the crystal oscillation circuit 200 according to the present embodiment is suitable for a battery power supply type or energy storage type system. In particular, the price of the crystal oscillation circuit 200 according to the present embodiment can be kept low by combining long-term durability, inexpensive LSI (Large Scale Integration) technology, and expensive PCB (printed circuit board) technology. Turned out to be possible. Further, since the crystal oscillation circuit 200 according to the present embodiment is a low power consumption type oscillation circuit, it has been found that the battery life can be increased by 3 to 6 times compared to a conventional general crystal oscillator.

(本実施形態に係る水晶発振回路の特徴)
上記構成によれば、第1インバータ1、第1水晶振動子2、第2インバータ3、及び、第2水晶振動子4を直列に接続することで、従来の一般的な水晶発振器で必須の構成要素となる各キャパシタを用いることなく、水晶発振回路100を構成することができる。従って、従来の一般的な水晶発振器300,400(図4,5参照)のように各キャパシタで余分な電荷が蓄積されることはない。その結果、従来の一般的な水晶発振器300,400よりも消費電力を低減することができる。
(Characteristics of crystal oscillation circuit according to this embodiment)
According to the above configuration, the first inverter 1, the first crystal resonator 2, the second inverter 3, and the second crystal resonator 4 are connected in series, so that the configuration is essential for a conventional general crystal oscillator. The crystal oscillation circuit 100 can be configured without using each capacitor as an element. Therefore, unlike the conventional general crystal oscillators 300 and 400 (see FIGS. 4 and 5), no extra charge is accumulated in each capacitor. As a result, power consumption can be reduced as compared with the conventional general crystal oscillators 300 and 400.

また、上記構成によれば、各インバータ21,23を、第1トランジスタ10、第2トランジスタ11、ダイオード12〜15、及び、抵抗16で構成することにより、従来の一般的な水晶発振器よりも消費電力を低減可能な水晶発振回路200を容易に構成することができる。   Further, according to the above configuration, each inverter 21 and 23 is configured by the first transistor 10, the second transistor 11, the diodes 12 to 15, and the resistor 16, so that it consumes more than a conventional general crystal oscillator. The crystal oscillation circuit 200 capable of reducing power can be easily configured.

更に、上記構成によれば、水晶発振回路200の試作品を用いたシミュレーション結果において、「インバータの入出力信号における単位電圧当たりの周波数変化率(Frequency voltage coefficient)」が−10ppm/Vの値を示したことにより、従来の単段式ピアース発振器300(図4参照)における周波数変化率よりも小さな値に維持できる。従って、各インバータ21,23の入出力信号における信号レベルを従来の単段式ピアース発振器300よりも安定させることができる。   Further, according to the above configuration, in the simulation result using the prototype of the crystal oscillation circuit 200, “Frequency voltage coefficient per unit voltage in the input / output signal of the inverter” is −10 ppm / V. As shown, it can be maintained at a value smaller than the frequency change rate in the conventional single-stage Pierce oscillator 300 (see FIG. 4). Therefore, the signal levels of the input / output signals of the inverters 21 and 23 can be made more stable than those of the conventional single-stage Pierce oscillator 300.

加えて、上記構成によれば、前記各インバータ21,23が、従来の一般的な水晶発振器300,400で必須の構成要素となるキャパシタの容量(より具体的には、6pF〜100pF)よりも小さい容量(より具体的には、<1.6pF)のダイオード12〜15を用いて構成されているため、水晶発振回路200において従来の一般的な水晶発振器300,400よりも消費電力を低減することができる。   In addition, according to the above configuration, each of the inverters 21 and 23 is more than the capacitance (more specifically, 6 pF to 100 pF) of the capacitor that is an essential component in the conventional general crystal oscillators 300 and 400. Since it is configured using the diodes 12 to 15 having a small capacity (more specifically, <1.6 pF), the power consumption of the crystal oscillation circuit 200 is reduced as compared with the conventional general crystal oscillators 300 and 400. be able to.

以上、本発明の実施形態について図面に基づいて説明したが、具体的な構成は、これらの実施形態に限定されるものではないと考えられるべきである。本発明の範囲は、上記した実施形態の説明ではなく特許請求の範囲によって示され、さらに特許請求の範囲と均等の意味および範囲内でのすべての変更が含まれる。例えば、図1に示した水晶発振回路100の一例として図2に示した水晶発振回路200を示したが、これに限られず、本発明は、水晶発振回路100と同様の作用効果を奏するように、水晶発振回路100の構成を適宜変更した水晶発振回路であってもよい。   As mentioned above, although embodiment of this invention was described based on drawing, it should be thought that a specific structure is not limited to these embodiment. The scope of the present invention is shown not by the above description of the embodiments but by the scope of claims for patent, and further includes all modifications within the meaning and scope equivalent to the scope of claims for patent. For example, the crystal oscillation circuit 200 shown in FIG. 2 is shown as an example of the crystal oscillation circuit 100 shown in FIG. 1. However, the present invention is not limited to this, and the present invention has the same effects as the crystal oscillation circuit 100. A crystal oscillation circuit in which the configuration of the crystal oscillation circuit 100 is appropriately changed may be used.

1、21 第1インバータ
2、22 第1水晶振動子
3、23 第2インバータ
4、24 第2水晶振動子
10、11 トランジスタ
12〜15 ダイオード
16 抵抗
17、317、417 入力ノード
18、318、418 出力ノード
100、200 水晶発振回路
300 単段式ピアース発振器
301、401、402 インバータ
302、405 水晶振動子
303、304、404 ロードキャパシタ
400 二段式ピアース発振器
403 ブロックキャパシタ
1, 21 1st inverter 2, 22 1st crystal resonator 3, 23 2nd inverter 4, 24 2nd crystal resonator 10, 11 transistor 12-15 diode 16 resistor 17, 317, 417 input node 18, 318, 418 Output node 100, 200 Crystal oscillator circuit 300 Single stage Pierce oscillator 301, 401, 402 Inverter 302, 405 Crystal oscillator 303, 304, 404 Load capacitor 400 Two stage Pierce oscillator 403 Block capacitor

Claims (2)

第1の電圧線及び第2の電圧線の間に接続された第1インバータと、
一端が前記第1インバータの出力ノードに接続された第1水晶振動子と、
入力ノードが前記第1水晶振動子の他端に接続された第2インバータと、
一端が前記第2インバータの出力ノードに接続され、他端が前記第1インバータの入力ノードに接続された第2水晶振動子と、を備えることを特徴とする水晶発振回路。
A first inverter connected between the first voltage line and the second voltage line;
A first crystal resonator having one end connected to the output node of the first inverter;
A second inverter having an input node connected to the other end of the first crystal unit;
And a second crystal resonator having one end connected to an output node of the second inverter and the other end connected to an input node of the first inverter.
前記各インバータが、
ゲートが入力ノードに接続され、ソースが前記第1電圧線に接続され、ドレインが出力ノードに接続された第1トランジスタと、
ゲートが入力ノードに接続され、ソースが前記第2電圧線に接続され、ドレインが出力ノードに接続された第2トランジスタと、
一端が入力ノードに接続され、他端が出力ノードに接続されたフィードバック用の抵抗と、を備えることを特徴とする請求項1に記載の水晶発振回路。
Each inverter is
A first transistor having a gate connected to an input node, a source connected to the first voltage line, and a drain connected to an output node;
A second transistor having a gate connected to the input node, a source connected to the second voltage line, and a drain connected to the output node;
2. The crystal oscillation circuit according to claim 1, further comprising a feedback resistor having one end connected to the input node and the other end connected to the output node.
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