JP2013542651A - 電力ライン通信デバイスのための結合回路 - Google Patents
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Abstract
Description
Claims (20)
- プロセッサ(202、301、402)と、
前記プロセッサに結合される結合回路と、
を含む電力ライン通信(PLC)デバイスであって、
前記結合回路が、
送信パスであって、
第1の増幅器(600)、
前記第1の増幅器(600)に結合される第1のキャパシタ(605)、
前記第1のキャパシタ(605)に結合される第1の変圧器(610)、及び
前記第1の変圧器(610)に結合される複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)であって、前記複数のラインインタフェース結合回路の各々が電力回路の異なるフェーズ(635a〜c)に接続されるように構成される、前記複数のラインインタフェース結合回路、
を含む前記送信パスと、
受信パスであって、
複数のキャパシタ(645a〜c)であって、前記複数のキャパシタの各々が前記複数のラインインタフェース回路(620a〜c、625a〜c、630a〜c)の対応する1つに結合される、前記複数のキャパシタ、
前記複数のキャパシタ(645a〜c)に結合されるフィルタネットワーク(650、655、660、665、670、675)であって、第2の変圧器(660)を含む、前記フィルタネットワーク、及び、
前記フィルタネットワーク(650、655、660、665、670、675)に結合される第2の増幅器(680)、
を含む前記受信パスと、
を含む、PLCデバイス。 - 請求項1に記載のPLCデバイスであって、前記プロセッサ(600)が、デジタル信号プロセッサ(DSP)、特定用途向け集積回路(ASIC)、システムオンチップ(SoC)回路、フィールドプログラマブルゲートアレイ(FPGA)、マイクロプロセッサ、又はマイクロコントローラを含む、PLCデバイス。
- 請求項1に記載のPLCデバイスであって、前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)の各々がハイパスフィルタとして構成される、PLCデバイス。
- 請求項1に記載のPLCデバイスであって、前記複数のキャパシタ(645a〜c)が、前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)を介して受信される信号を線形に組合せるように構成される、PLCデバイス。
- 請求項1に記載のPLCデバイスであって、前記第1の増幅器(605)が、送信動作の間は低インピーダンスモードで、受信動作の間は高インピーダンスモードで、動作するように構成される、PLCデバイス。
- 請求項1に記載のPLCデバイスであって、前記フィルタネットワーク(650、655、660、665、670、675)がバンドパスフィルタとして構成される、PLCデバイス。
- 請求項6に記載のPLCデバイスであって、前記バンドパスフィルタが、選択された動作周波数に対応する周波数帯を選択するように動的に調整可能であるように構成される、PLCデバイス。
- 請求項1に記載のPLCデバイスであって、複数の高電圧スイッチ(700a〜c)を更に含み、前記複数の高電圧スイッチの各々が、前記第1の変圧器(610)と前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)の対応する1つとの間に結合される、PLCデバイス。
- 回路であって、
送信器であって、
第1の増幅器(600)、
前記第1の増幅器(600)に結合される第1のキャパシタ(605)、
前記第1のキャパシタ(605)に結合される第1の変圧器(610)、及び
前記第1の変圧器(610)に結合される複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)であって、前記複数のラインインタフェース結合回路の各々が、電力回路の異なるフェーズ(635a〜c)に接続可能である、前記複数のラインインタフェース結合回路、
を含む前記送信器と、
受信器であって、
複数のキャパシタ(645a〜c)であって、前記複数のキャパシタの各々が、前記複数のラインインタフェース回路(620a〜c、625a〜c、630a〜c)の対応する1つに結合される、前記複数のキャパシタ、
前記複数のキャパシタ(645a〜c)に結合されるフィルタネットワーク(650、655、660、665、670、675)、及び、
前記フィルタネットワーク(650、655、660、665、670、675)に結合される第2の増幅器(680)、
を含む前記受信器と、
を含む回路。 - 請求項9に記載の回路であって、前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)の各々が、ハイパスフィルタを含む、回路。
- 請求項9に記載の回路であって、前記複数のキャパシタ(645a〜c)が、前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)を介して受信される信号を線形に組合せるように構成される、回路。
- 請求項9に記載の回路であって、前記第1の増幅器(600)が、送信動作の間は低インピーダンスモードで、受信動作の間は高インピーダンスモードで動作するように構成される、回路。
- 請求項9に記載の回路であって、前記フィルタネットワーク(650、655、660、665、670、675)がバンドパスフィルタを含む、回路。
- 請求項9に記載の回路であって、複数の高電圧スイッチ(700a〜c)を更に含み、前記複数の高電圧スイッチの各々が、前記第1の変圧器(600)と、前記複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)の対応する1つとの間に結合される、回路。
- 回路であって、
第1の増幅器(600)、
前記第1の増幅器(600)に結合される第1のキャパシタ(605)、
前記第1のキャパシタ(605)に結合される第1の変圧器(610)、
複数の高電圧スイッチ(700a〜c)であって、前記複数の高電圧スイッチの各々が前記第1の変圧器(610)に結合される、前記複数の高電圧スイッチ、及び、
複数のラインインタフェース結合回路(620a〜c、625a〜c、630a〜c)であって、前記複数のラインインタフェース結合回路の各々が、前記複数の高電圧スイッチ(700a〜c)の対応する1つに結合され、前記複数のラインインタフェース結合回路の各々が、電力回路の異なるフェーズ(635a〜c)に結合可能であり、前記複数のラインインタフェース結合回路の各々がハイパスフィルタを含む、前記複数のラインインタフェース結合回路、
を含む回路。 - 請求項15に記載の回路であって、前記複数の高電圧スイッチ(700a〜c)が、前記回路が送信モードで動作するように構成されるという指示に応答して、前記複数の高電圧スイッチの少なくとも1つが開になるように構成される、回路。
- 請求項15に記載の回路であって、
複数のキャパシタ(645a〜c)であって、前記複数のキャパシタの各々が、前記複数のラインインタフェース回路(620a〜c、625a〜c、630a〜c)の対応する1つに結合される、前記複数のキャパシタ、
前記複数のキャパシタ(645a〜c)に結合されるフィルタネットワーク(650、655、660、665、670、675)、及び、
前記フィルタネットワーク(650、655、660、665、670、675)に結合される第2の増幅器(680)、
を更に含む、回路。 - 請求項17に記載の回路であって、前記複数の高電圧スイッチ(700a〜c)が、前記回路が受信モードで動作するように構成されるという指示に応答して、前記複数の高電圧スイッチの1つのみが閉にされるように構成される、回路。
- 請求項17に記載の回路であって、前記フィルタネットワーク(650、655、660、665、670、675)がバンドパスフィルタを含む、回路。
- 請求項19に記載の回路であって、前記バンドパスフィルタが、前記回路が複数の異なる受信モードの1つで動作するように構成されるという指示に応答して、選択される周波数に対応する周波数帯を選択するように動的に調整可能である、回路。
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