JP2013507693A - 不均一ページサイズを有する多チャンネルメモリシステムへのアクセス - Google Patents
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Abstract
Description
ジを開くことは、ページオープン電力を低減することができる。メモリアクセスモニター180は、ページミスに対するページヒットの比が第1のしきい181よりも大きく、第2のしきい183未満であるときは、マスター120〜123の特定のマスターが、中間のページサイズ161を有するチャンネル151をそのマスターに割り当ててもよいと決定してもよい。
101 第1のプロセッサ
102 第2のプロセッサ
103 第3のプロセッサ
104 第nのプロセッサ
106 クロスバー相互接続部
108 メモリコントローラ
110 多チャンネルメモリ
120 第1のマスター
121 第2のマスター
122 第3のマスター
123 第nのマスター
130 第1のスレーブ
131 第2のスレーブ
132 第3のスレーブ
133 第mのスレーブ
140 第1のメモリコントローラ
141 第2のメモリコントローラ
142 第3のメモリコントローラ
143 第mのメモリコントローラ
Claims (43)
- 多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測し、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別し、かつ
前記マスターの前記予測メモリ要件に基づいて、および第1の特定のチャンネルと関連する前記ページサイズに基づいて、前記多チャンネルメモリの前記第1の特定のチャンネルを前記マスターに割り当てるように構成されるクロスバー相互接続部を含む装置。 - 前記マスターの前記メモリ要件は、前記マスターと関連するプロセッサの種類に基づいて予測される、請求項1に記載の装置。
- 前記マスターと関連する前記プロセッサの前記種類は、データ多重化プロセッサ、デジタルシグナルプロセッサ、ビデオプロセッサ、標準的制御プロセッサ、マスター制御プロセッサ、マルチプレクサー-デマルチプレクサー、エンコーダ-デコーダプロセッサ、モデムプロセッサ、表示プロセッサ、およびグラフィックプロセッサのうちの1つである、請求項2に記載の装置。
- 前記クロスバー相互接続部は、
所定の時間間隔後に前記マスターの第2のメモリ要件を予測し、かつ
前記マスターの前記第2のメモリ要件に基づいて前記多チャンネルメモリの第2の特定のチャンネルを前記マスターに割り当てるように構成され、
前記第2の特定のチャンネルは、前記第1の特定のチャンネルとは異なるページサイズを有する、請求項1に記載の装置。 - 前記マスターの前記メモリ要件は、前記マスターのメモリアクセスパターンに基づいて予測される、請求項1に記載の装置。
- 前記クロスバー相互接続部は、前記マスターの前記メモリアクセスパターンの変化を検出することに応答して前記多チャンネルメモリの第2の特定のチャンネルを前記マスターに割り当てるように構成される、請求項5に記載の装置。
- 前記クロスバー相互接続部は、前記マスターの前記メモリアクセスパターンが高アクセス局所性メモリアクセスパターンであると決定するステップの後、前記マスターの前記メモリ要件が大きなページサイズに対応すると予測するように構成される、請求項5に記載の装置。
- 前記マスターの前記メモリアクセスパターンが前記高アクセス局所性メモリアクセスパターンであると決定するステップは、前記マスターが、しきい未満であるページミスに対するページヒットの比を有すると決定するステップを含む、請求項7に記載の装置。
- 前記クロスバー相互接続部は、前記マスターの前記メモリアクセスパターンがランダムメモリアクセスパターンであると決定するステップの後、前記マスターの前記メモリ要件が小さなページサイズに対応すると予測するように構成される、請求項5に記載の装置。
- 前記マスターの前記メモリアクセスパターンが前記ランダムメモリアクセスパターンであると決定するステップは、前記マスターが、しきい以上であるページミスに対するページヒットの比を有すると決定するステップを含む、請求項9に記載の装置。
- 前記クロスバー相互接続部は、メッセージを前記マスターから1つまたは複数のスレーブへ送るように構成され、前記1つまたは複数のスレーブは、少なくとも1つのメモリコントローラを介して前記多チャンネルメモリの一部分にアクセスする、請求項1に記載の装置。
- 前記多チャンネルメモリは、ダブルデータレートランダムアクセスメモリ(DDR RAM)を含む、請求項1に記載の装置。
- 前記多チャンネルメモリは、シリコン貫通積層(TSS)積層化DDR RAMを含む、請求項12に記載の装置。
- 前記TSS積層化DDR RAMは、少なくとも128ビットの幅で入力-出力動作を行う能力がある、請求項13に記載の装置。
- 前記多チャンネルメモリは、垂直積層化メモリを含む、請求項1に記載の装置。
- 前記多チャンネルメモリは、少なくとも1つのシリコン貫通ビア(TSV)を使用して垂直に積層される、請求項15に記載の装置。
- 少なくとも1つの半導体ダイに統合される、請求項1に記載の装置。
- セットトップボックス、音楽プレーヤー、ビデオプレーヤー、娯楽ユニット、ナビゲーションデバイス、通信デバイス、携帯情報端末(PDA)、固定場所データユニット、およびコンピュータから成る群から選択されるデバイスをさらに含み、その中に少なくとも1つの半導体ダイが統合される、請求項17に記載の装置。
- 多チャンネルメモリへのアクセスを有するマスターのページサイズ要件を予測するための手段と、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別するための手段と、
前記マスターの前記ページサイズ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるための手段とを含む装置。 - 少なくとも1つの半導体ダイに統合される、請求項19に記載の装置。
- セットトップボックス、音楽プレーヤー、ビデオプレーヤー、娯楽ユニット、ナビゲーションデバイス、通信デバイス、携帯情報端末(PDA)、固定場所データユニット、およびコンピュータから成る群から選択されるデバイスをさらに含み、その中に少なくとも1つの半導体ダイが統合される、請求項20に記載の装置。
- 複数のマスターの各マスターのメモリアクセスパターンを予測するステップであって、前記複数のマスターは、クロスバー相互接続部を介して多チャンネルメモリへのアクセスを有し、前記多チャンネルメモリは、複数のバンクを有する、ステップと、
前記複数のバンクの各バンクと関連するページサイズを識別するステップと、
各マスターの前記メモリアクセスパターンに基づいて前記複数のバンクの少なくとも1つのバンクを前記複数のマスターの各マスターに割り当てるステップとを含む方法。 - 前記複数のマスターの各マスターの前記メモリアクセスパターンは、前記複数のマスターの各マスターと関連するプロセッサの種類に基づいて予測される、請求項22に記載の方法。
- 前記複数のマスターの各マスターの前記メモリアクセスパターンは、前記複数のマスターの各マスターによってアクセスされるコンテンツの種類に基づいて予測される、請求項22に記載の方法。
- 前記複数のマスターの各マスターの前記メモリアクセスパターンを予測するステップはさらに、
ある期間にわたり前記複数のマスターの各マスターの前記多チャンネルメモリへのアクセスに対応するページヒット数を測定するステップと、
前記期間にわたり前記複数のマスターの各マスターの前記多チャンネルメモリへのアクセスに対応するページミス数を測定するステップと、
前記複数のマスターの各マスターの前記ページヒット数および前記ページミス数に基づいて各マスターについて前記メモリアクセスパターンを予測するステップとを含む、請求項24に記載の方法。 - 前記複数のマスターの1つのマスターは、前記マスターの前記ページヒット数が前記マスターの前記ページミス数未満であるときは、ランダムメモリアクセスパターンを有すると予測するステップをさらに含む、請求項25に記載の方法。
- 前記複数のマスターの1つのマスターは、前記マスターの前記ページヒット数が前記マスターの前記ページミス数以上であるときは、より高いアクセス局所性メモリアクセスパターンを有すると予測するステップをさらに含む、請求項25に記載の方法。
- 前記ページサイズは、大きなページサイズおよび小さなページサイズのうちの1つである、請求項22に記載の方法。
- 前記ページサイズは、大きなページサイズ、中間のページサイズ、および小さなページサイズのうちの1つである、請求項22に記載の方法。
- 前記複数のマスターの各マスターの前記メモリアクセスパターンを予測するステップ、前記複数のバンクの各バンクと関連する前記ページサイズを識別するステップ、および各マスターの前記メモリアクセスパターンに基づいて前記複数のバンクの少なくとも1つのバンクを前記複数のマスターの各マスターに割り当てるステップは、電子デバイスに統合されたプロセッサで行われる、請求項22に記載の方法。
- 多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測するための第1のステップと、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別するための第2のステップと、
前記マスターの前記メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるための第3のステップとを含む方法。 - 前記第1のステップ、前記第2のステップ、および前記第3のステップは、電子デバイスに統合されたプロセッサによって行われる、請求項31に記載の方法。
- コンピュータによって実行可能な命令を保存するコンピュータ可読有形媒体であって、前記命令は、
多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測するために前記コンピュータによって実行可能である命令と、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別するために前記コンピュータによって実行可能である命令と、
前記マスターの前記メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるために前記コンピュータによって実行可能である命令とを含む、コンピュータ可読有形媒体。 - 前記命令は、セットトップボックス、音楽プレーヤー、ビデオプレーヤー、娯楽ユニット、ナビゲーションデバイス、通信デバイス、携帯情報端末(PDA)、固定場所データユニット、およびコンピュータから成る群から選択されるデバイスに統合されたプロセッサによって実行可能である、請求項33に記載のコンピュータ可読有形媒体。
- 半導体デバイスの少なくとも1つの物理的特性を表す設計情報を受け取るステップであって、前記半導体デバイスは、
各チャンネルが少なくとも1つのメモリバンクに接続される、多チャンネルメモリと、
クロスバー相互接続部とを含み、前記クロスバー相互接続部は、
前記多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測し、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別し、かつ
前記マスターの前記予測メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるように構成される、ステップと、
前記設計情報をファイルフォーマットに従って変換するステップと、
前記変換された設計情報を含むデータファイルを生成するステップとを含む方法。 - 前記データファイルは、GDSIIフォーマットを含む、請求項35に記載の方法。
- 半導体デバイスに対応する設計情報を含むデータファイルを受け取るステップおよび前記設計情報に従って前記半導体デバイスを製作するステップを含む方法であって、前記半導体デバイスは、
各チャンネルが少なくとも1つのメモリバンクに接続される、多チャンネルメモリと、
クロスバー相互接続部とを含み、前記クロスバー相互接続部は、
前記多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測し、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別し、かつ
前記マスターの前記予測メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるように構成される、方法。 - 前記データファイルは、GDSIIフォーマットを有する、請求項37に記載の方法。
- 回路基板上でのパッケージ化半導体デバイスの物理的位置決め情報を含む設計情報を受け取るステップを含む方法であって、前記パッケージ化半導体デバイスは、
各チャンネルが少なくとも1つのメモリバンクに接続される、多チャンネルメモリと、
クロスバー相互接続部とを含む半導体構造を含み、前記クロスバー相互接続部は、
前記多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測し、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別し、かつ
前記マスターの前記予測メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるように構成される、方法。 - データファイルは、GERBERフォーマットを有する、請求項39に記載の方法。
- 回路基板上でのパッケージ化半導体デバイスの物理的位置決め情報を含む設計情報を含むデータファイルを受け取るステップと、
前記設計情報に従って前記パッケージ化半導体デバイスを受け取るように構成される前記回路基板を製造するステップとを含む方法であって、前記パッケージ化半導体デバイスは、
各チャンネルが少なくとも1つのメモリバンクに接続される、多チャンネルメモリと、
クロスバー相互接続部とを含み、前記クロスバー相互接続部は、
前記多チャンネルメモリへのアクセスを有するマスターのメモリ要件を予測し、
前記多チャンネルメモリの各チャンネルと関連するページサイズを識別し、かつ
前記マスターの前記予測メモリ要件に基づいておよび1つのチャンネルと関連する前記ページサイズに基づいて前記多チャンネルメモリの前記チャンネルを前記マスターに割り当てるように構成される、方法。 - 前記データファイルは、GERBERフォーマットを有する、請求項41に記載の方法。
- 前記回路基板を、セットトップボックス、音楽プレーヤー、ビデオプレーヤー、娯楽ユニット、ナビゲーションデバイス、通信デバイス、携帯情報端末(PDA)、固定場所データユニット、およびコンピュータから成る群から選択されるデバイスに統合するステップをさらに含む、請求項41に記載の方法。
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