JP2011530723A - チップ駆動機構を内蔵しているディスプレイデバイス - Google Patents
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Abstract
Description
ディスプレイデバイスであって、
a)基板と、
b)前記基板上に配置される1つ又は複数のピクセルであって、各ピクセルは制御電極を含む、1つ又は複数のピクセルと、
c)前記基板上に配置される配線層であって、該配線層は、その中に形成される連続線及び不連続パススルー線を有する、配線層と、
d)前記基板上に配置され、第1の接続パッド、第2の接続パッド、第3の接続パッド及び制御接続パッドを含む少なくとも1つのチップレットであって、
i)前記制御接続パッドを前記制御電極に電気的に接続する制御線と、
ii)前記第1の接続パッドに接続される前記不連続パススルー線の第1の端部及び前記第2の接続パッドに接続される前記不連続パススルー線の第2の端部と、
iii)前記第1の接続パッド及び前記第2の接続パッドを電気的に接続する回路部と、
iv)前記第3の接続パッドに電気的に接続される連続線であって、該連続線は前記チップレットの両側に延在する、連続線と、
を含む、チップレットと、
を備える、ディスプレイデバイスによって満たされる。
式2: 全間隔幅 =パッド数+1
式3: 全幅 =全パッド幅+全間隔幅
式4: 全面積 =全幅(長い寸法)×全幅(短い寸法)
10 基板
12 接着剤及び平坦化材料
16 バイア
20 配線層
22 パススルー線
23 パススルー線
22A 一端
22B 一端
23A 一端
23B 一端
24 制御線
26 連続線
28 連続線
30 第1の接続パッド
32 第2の接続パッド
34 制御接続パッド
36 第3の接続パッド
38 第3の接続パッド
40 チップレット
40A 長い辺
40B 長い辺
40C 短い辺
40D 短い辺
42 回路部
44 回路部
50 ピクセル
51 制御電極
Claims (20)
- ディスプレイデバイスであって、
a)基板と、
b)前記基板上に配置される1つ又は複数のピクセルであって、各ピクセルは制御電極を含む、1つ又は複数のピクセルと、
c)前記基板上に配置される配線層であって、該配線層は、その中に形成される連続線及び不連続パススルー線を有する、配線層と、
d)前記基板上に配置され、第1の接続パッド、第2の接続パッド、第3の接続パッド及び制御接続パッドを含む少なくとも1つのチップレットであって、
i)前記制御接続パッドを前記制御電極に電気的に接続する制御線と、
ii)前記第1の接続パッドに接続される前記不連続パススルー線の第1の端部及び前記第2の接続パッドに接続される前記不連続パススルー線の第2の端部と、
iii)前記第1の接続パッド及び前記第2の接続パッドを電気的に接続する回路部と、
iv)前記第3の接続パッドに電気的に接続される連続線であって、該連続線は前記チップレットの両側に延在する、連続線と、
を含む、チップレットと、
を備える、ディスプレイデバイス。 - 前記チップレットのサイズは前記接続パッドのサイズ及び数によって制限される、請求項1に記載のアクティブマトリックスデバイス。
- 信号及び電力を分配するためのバス線をさらに含み、該バス線は全て前記配線層内に形成される、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは20ミクロン未満の厚みを有する、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、長い寸法及び短い寸法をそれぞれ決定する、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記パススルー線は前記チップレットの前記長い寸法と揃えられる、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記チップレットは前記基板上で、第1の接続パッドが前記短い辺のうちの一方に対し任意の他の接続パッドと同程度に又はそれよりも近く、かつ前記第2の接続パッドが前記短い辺のうちの他方に対し任意の他の接続パッドと同程度に又はそれよりも近いように配向される、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、長い寸法及び短い寸法をそれぞれ決定する、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記チップレットは前記基板上で、前記連続線が前記チップレットの前記短い寸法と揃えられるように配向される、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、長い寸法及び短い寸法をそれぞれ決定する、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記チップレットは前記基板上で、前記第3の接続パッドが前記チップレットの前記短い辺にではなく、中心に近いように、又は前記第3の接続パッドが前記短い寸法若しくは前記長い寸法のいずれかにおいて前記チップレットの中心にあるように、又は前記第3の接続パッドが前記短い寸法及び前記長い寸法の両方において前記チップレットの中心にあるように配向される、請求項1に記載のアクティブマトリックスデバイス。
- 前記パススルー線の数は前記連続線の数以下である、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、長い寸法及び短い寸法をそれぞれ決定する、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記チップレットは前記短い寸法において2つの接続パッドのみを有し、前記長い寸法において2つの接続パッド行を形成する、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは長方形であり、長い寸法及び短い寸法をそれぞれ決定する、2つの向かい合う相対的に長い辺及び2つの向かい合う相対的に短い辺を有し、前記チップレットは前記短い寸法において1つの接続パッドのみを有し、前記長い寸法において1つの接続パッド行を形成する、請求項1に記載のアクティブマトリックスデバイス。
- 前記パススルー線は前記連続線に直交する、請求項1に記載のアクティブマトリックスデバイス。
- 前記チップレットは前記配線層と前記基板との間に位置する、請求項1に記載のアクティブマトリックスデバイス。
- 前記配線層は前記チップレットと前記基板との間に位置する、請求項1に記載のアクティブマトリックスデバイス。
- 前記制御接続パッドは前記第1の接続パッドと前記第3の接続パッドとの間にあるか、又は前記第2の接続パッドと前記第3の接続パッドとの間にある、請求項1に記載のアクティブマトリックスデバイス。
- 前記連続線のうちの1つは電力線である、請求項1に記載のアクティブマトリックスデバイス。
- 前記連続線はデータ信号を搬送し、前記パススルー線は選択信号を搬送するか、又は前記連続線は選択信号を搬送し、前記パススルー線はデータ信号を搬送する、請求項1に記載のアクティブマトリックスデバイス。
- 前記ピクセルは有機若しくは無機発光ダイオード、感光ダイオード、又は感光トランジスタを含む、請求項1に記載のアクティブマトリックスデバイス。
- 前記制御電極は前記配線層内にある、請求項1に記載のアクティブマトリックスデバイス。
- 前記制御電極は前記配線層とは異なる層内にある、請求項1に記載のアクティブマトリックスデバイス。
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