JP2011071787A - 演算増幅器 - Google Patents
演算増幅器 Download PDFInfo
- Publication number
- JP2011071787A JP2011071787A JP2009221810A JP2009221810A JP2011071787A JP 2011071787 A JP2011071787 A JP 2011071787A JP 2009221810 A JP2009221810 A JP 2009221810A JP 2009221810 A JP2009221810 A JP 2009221810A JP 2011071787 A JP2011071787 A JP 2011071787A
- Authority
- JP
- Japan
- Prior art keywords
- transistor
- adjustment
- operational amplifier
- circuit
- transistors
- Prior art date
- Legal status (The legal status is an assumption and is not a legal conclusion. Google has not performed a legal analysis and makes no representation as to the accuracy of the status listed.)
- Granted
Links
Images
Landscapes
- Amplifiers (AREA)
Abstract
【解決手段】演算増幅器1は、差動入力回路3と、電流−電圧変換部5と、オフセット調整回路7とを備える。差動入力回路3は、ソース同士が接続され各ゲートが入力端子となる入力用トランジスタM2,M3を有している。オフセット調整回路7は、ソース同士が接続された調整用トランジスタM5,M6と、調整用トランジスタM5,M6のゲートに接続されたデジタル−アナログ変換部7aとを有する。調整用トランジスタM5と入力用トランジスタM2とはドレイン同士が接続され、調整用トランジスタM6と入力用トランジスタM2とはドレイン同士が接続されている。デジタル−アナログ変換部7aの出力に基づいたオフセット電圧分に対応する電流が調整用トランジスタM5,M6に流れる。これにより、オフセット電圧が調整される。
【選択図】図1
Description
3,33 差動入力回路
5,35 電流−電圧変換部
7,37 第1のオフセット調整回路(オフセット調整回路)
7a,9a デジタル−アナログ変換部
9,39 第2のオフセット調整回路(オフセット調整回路)
M1,M11 第1の定電流トランジスタ
M2,M3,M12,M13 入力用トランジスタ
M4,M7,M14,M17 第2の定電流トランジスタ
M5,M6,M8,M9,M15,M16,M18,M19 調整用トランジスタ
Claims (10)
- ソース同士が互いに接続された2つの入力用トランジスタを有し、前記2つの入力用トランジスタのそれぞれのゲートが入力端子となる差動入力回路と、
ソース同士が互いに接続された2つの調整用トランジスタを有し、前記2つの調整用トランジスタの一方が、前記2つの入力用トランジスタの一方に接続されており、かつ、前記2つの調整用トランジスタの他方が、前記2つの入力用トランジスタの他方に接続されたオフセット調整回路と、
前記一方の入力用トランジスタ及びそれに接続された調整用トランジスタのそれぞれのドレイン−ソース間に流れる電流と、前記他方の入力用トランジスタ及びそれに接続された調整用トランジスタのそれぞれのドレイン−ソース間に流れる電流とに基づいて出力電圧を出力する電流−電圧変換部とを備え、
前記オフセット調整回路は、入力されたデジタル信号に基づいた電圧を出力するデジタル−アナログ変換部を有し、
前記デジタル−アナログ変換部の出力が、前記2つの調整用トランジスタのそれぞれのゲートのうち少なくとも一方に入力されている、演算増幅器。 - 前記デジタル−アナログ変換部は、プラス側及びマイナス側の2系統の出力を有し、入力されたデジタル信号に応じてプラス側の出力の電圧値とマイナス側の出力の電圧値との差分が変化する差動出力型のものであり、
前記2系統の出力のうち一方が前記2つの調整用トランジスタのそれぞれのゲートのうち一方に接続されており、前記2系統の出力のうち他方が前記2つの調整用トランジスタのそれぞれのゲートのうち他方に接続されている、請求項1に記載の演算増幅器。 - 前記差動入力回路は、そのドレインが前記入力用トランジスタのソースに接続された第1の定電流トランジスタを有し、
前記オフセット調整回路は、そのドレインが前記調整用トランジスタのソースに接続された第2の定電流トランジスタを有し、
前記第1の定電流トランジスタのゲート及び第2の定電流トランジスタのゲートは、所定のバイアス電圧に接続されている、請求項1又は2に記載の演算増幅器。 - 前記演算増幅器は、前記オフセット調整回路を2以上有する、請求項1から3のいずれかに記載の演算増幅器。
- 前記2以上のオフセット調整回路のそれぞれに用いられている調整用トランジスタの電気的特性は、他のオフセット調整回路に用いられている調整用トランジスタの電気的特性とは異なる、請求項4に記載の演算増幅器。
- 前記2以上のオフセット調整回路のそれぞれに用いられている調整用トランジスタのチャネル幅をチャネル長で除した値は、他のオフセット調整回路に用いられている調整用トランジスタのチャネル幅をチャネル長で除した値とは異なる、請求項4又は5に記載の演算増幅器。
- 前記2以上のオフセット調整回路のそれぞれに用いられている第2の定電流トランジスタの電気的特性は、他のオフセット調整回路に用いられている第2の定電流トランジスタの電気的特性とは異なる、請求項4から6のいずれかに記載の演算増幅器。
- 前記2以上のオフセット調整回路のそれぞれに用いられている第2の定電流トランジスタのチャネル幅をチャネル長で除した値は、他のオフセット調整回路に用いられている第2の定電流トランジスタのチャネル幅をチャネル長で除した値とは異なる、請求項4から7のいずれかに記載の演算増幅器。
- 前記2以上のオフセット調整回路のそれぞれに用いられているデジタル−アナログ変換部の出力特性は、他のオフセット調整回路に用いられているデジタル−アナログ変換部の出力特性とは異なる、請求項4から8のいずれかに記載の演算増幅器。
- 前記差動入力回路と、前記オフセット調整回路と、前記電流−電圧変換部とを同一のICチップ内に集積してなる、請求項1から9のいずれかに記載の演算増幅器。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009221810A JP5384272B2 (ja) | 2009-09-28 | 2009-09-28 | 演算増幅器 |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2009221810A JP5384272B2 (ja) | 2009-09-28 | 2009-09-28 | 演算増幅器 |
Publications (2)
Publication Number | Publication Date |
---|---|
JP2011071787A true JP2011071787A (ja) | 2011-04-07 |
JP5384272B2 JP5384272B2 (ja) | 2014-01-08 |
Family
ID=44016616
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2009221810A Expired - Fee Related JP5384272B2 (ja) | 2009-09-28 | 2009-09-28 | 演算増幅器 |
Country Status (1)
Country | Link |
---|---|
JP (1) | JP5384272B2 (ja) |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8994436B2 (en) | 2012-08-13 | 2015-03-31 | Kabushiki Kaisha Toshiba | Semiconductor device and receiver |
JP2018124550A (ja) * | 2017-02-03 | 2018-08-09 | 株式会社半導体エネルギー研究所 | 半導体装置、表示パネル、表示装置、入出力装置、情報処理装置 |
Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05210811A (ja) * | 1992-01-30 | 1993-08-20 | Hitachi Ltd | 磁気ヘッド用回路 |
JPH07193442A (ja) * | 1993-12-27 | 1995-07-28 | Hitachi Ltd | 演算増幅器およびそれを用いたda変換装置と電圧比較器 |
JP2004088742A (ja) * | 2002-06-25 | 2004-03-18 | Matsushita Electric Ind Co Ltd | オフセット制御回路及び信号処理装置 |
JP2009081749A (ja) * | 2007-09-27 | 2009-04-16 | Hitachi Ltd | 低オフセット入力回路 |
-
2009
- 2009-09-28 JP JP2009221810A patent/JP5384272B2/ja not_active Expired - Fee Related
Patent Citations (4)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JPH05210811A (ja) * | 1992-01-30 | 1993-08-20 | Hitachi Ltd | 磁気ヘッド用回路 |
JPH07193442A (ja) * | 1993-12-27 | 1995-07-28 | Hitachi Ltd | 演算増幅器およびそれを用いたda変換装置と電圧比較器 |
JP2004088742A (ja) * | 2002-06-25 | 2004-03-18 | Matsushita Electric Ind Co Ltd | オフセット制御回路及び信号処理装置 |
JP2009081749A (ja) * | 2007-09-27 | 2009-04-16 | Hitachi Ltd | 低オフセット入力回路 |
Cited By (2)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US8994436B2 (en) | 2012-08-13 | 2015-03-31 | Kabushiki Kaisha Toshiba | Semiconductor device and receiver |
JP2018124550A (ja) * | 2017-02-03 | 2018-08-09 | 株式会社半導体エネルギー研究所 | 半導体装置、表示パネル、表示装置、入出力装置、情報処理装置 |
Also Published As
Publication number | Publication date |
---|---|
JP5384272B2 (ja) | 2014-01-08 |
Similar Documents
Publication | Publication Date | Title |
---|---|---|
JP4796927B2 (ja) | クロック信号出力回路 | |
US7940036B2 (en) | Voltage comparison circuit, and semiconductor integrated circuit and electronic device having the same | |
US8537043B1 (en) | Digital-to-analog converter with controlled gate voltages | |
US7557743B2 (en) | D/A converter | |
JP2009291057A (ja) | 電流検出回路及びその電流検出回路を備えたスイッチングレギュレータ | |
US9209822B2 (en) | A/D converter and semiconductor integrated circuit | |
JP2007249384A (ja) | 半導体装置 | |
US9477251B2 (en) | Reference voltage circuit | |
US8368429B2 (en) | Hysteresis comparator | |
EP2933910B1 (en) | A multiple output offset comparator | |
US7417492B2 (en) | Regulator | |
JP2008152632A (ja) | 基準電圧発生回路 | |
JP5384272B2 (ja) | 演算増幅器 | |
US20090128120A1 (en) | Reference voltage generation circuit, ad converter, da converter, and image processor | |
WO2009096192A1 (ja) | バッファ回路及びそれを備えたイメージセンサチップ並びに撮像装置 | |
JP4473627B2 (ja) | 定電流源、その定電流源を使用した増幅回路及び定電圧回路 | |
US8149019B2 (en) | Chopper type comparator and A/D converter | |
JP2005044051A (ja) | 基準電圧発生回路 | |
CN110785925B (zh) | 跨导放大器和芯片 | |
US9136854B1 (en) | Current switching digital-to-analog converter with hybrid current switching circuit having low-memory effect | |
JP5849585B2 (ja) | 過電流検出回路 | |
JP5310856B2 (ja) | 定電流回路、および半導体集積回路 | |
US9729113B2 (en) | Constant transconductance bias circuit | |
JP5520192B2 (ja) | 電圧電流変換回路 | |
JP2012244558A (ja) | 差動増幅回路 |
Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20120920 |
|
A977 | Report on retrieval |
Free format text: JAPANESE INTERMEDIATE CODE: A971007 Effective date: 20130611 |
|
A131 | Notification of reasons for refusal |
Free format text: JAPANESE INTERMEDIATE CODE: A131 Effective date: 20130618 |
|
A521 | Written amendment |
Free format text: JAPANESE INTERMEDIATE CODE: A523 Effective date: 20130815 |
|
TRDD | Decision of grant or rejection written | ||
A01 | Written decision to grant a patent or to grant a registration (utility model) |
Free format text: JAPANESE INTERMEDIATE CODE: A01 Effective date: 20130903 |
|
A61 | First payment of annual fees (during grant procedure) |
Free format text: JAPANESE INTERMEDIATE CODE: A61 Effective date: 20131002 |
|
R150 | Certificate of patent or registration of utility model |
Free format text: JAPANESE INTERMEDIATE CODE: R150 |
|
LAPS | Cancellation because of no payment of annual fees |