JP2009211371A - 検査システム、検査用バックプレーン、検査方法及び製造方法 - Google Patents
検査システム、検査用バックプレーン、検査方法及び製造方法 Download PDFInfo
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Abstract
【解決手段】検査システム50は、二重化モジュールの各モジュール11〜14を検査する。検査用のバックプレーン30は、4個の前記モジュール11〜14と同時接続可能で、接続されたモジュール11〜14の出力信号を入力する。バックプレーン30には、異なるモジュールからの出力信号を入力して比較する比較器であって、比較するモジュールの組み合わせがそれぞれ異なる3個の比較器221〜223が設けられている。比較器221〜223の比較結果を見れば、不良なモジュールを特定することができる。
【選択図】図1
Description
次に、本発明の第1の実施形態について図面を参照して詳細に説明する。
次に、本発明の第2の実施形態について説明する。図4には、本実施形態に係る検査システム51の構成が示されている。図4に示されるように、検査システム51には、検査用のバックプレーン31が設けられている。バックプレーン31は、表示部231〜233が新たに設けられている点が、上記第1の実施形態にかかる検査システム50と異なっている。
次に、本発明の第3の実施形態について説明する。図5には、本実施形態に係る検査システム52の構成が示されている。図5に示されるように、検査システム52には、検査用のバックプレーン32が設けられている。バックプレーン32は、比較器223に、モジュール13からの比較用信号と、モジュール14の比較用信号を入力し、それらが一致するか否かを示す信号を出力している点が、上記各実施形態に係るバックプレーン30、31と異なっている。
次に、本発明の第4の実施形態について説明する。図7には、本実施形態に係る検査システム53の構成が示されている。この検査システム53は、上記各実施形態に係る検査システム53を一般化したものとなっており、この検査システム53は、二重化モジュールだけでなく、三重化又はそれ以上の多重化モジュールの各モジュールの検査にも適用可能な検査システムである。
次に、本発明の第5の実施形態について説明する。図8には、本実施形態に係る検査システム54の概略的な構成が模式的に示されている。上記各実施形態に係る検査システム50〜53では、モジュールの接続数nよりも1だけ小さいn−1個の比較器が設けられていたが、本実施形態に係る検査システム54のバックプレーン34には、n−1個の比較器22が、n組設けられている。すなわち、(n−1)×n個の比較器が設けられている。
次に、本発明の第6の実施形態について説明する。本実施形態では、多重化モジュールの製造方法について説明する。
2 筐体
3 バックプレーン
111〜11n CPU
121〜12n FT制御回路
131、132 比較器
211〜21n 接続部
221〜22n-1、22 比較器
231〜23n-1 表示部
30、31、32、33、34 バックプレーン
40 表示装置
50、51、52、53、54 検査システム
100 FTコンピュータ
Claims (12)
- 同期して動作するm(mは2以上の整数)個のモジュールを有するm重化モジュールの各モジュールを検査する検査システムにおいて、
mより多いn個の前記モジュールと同時接続可能で、接続された前記モジュールの出力信号を入力するバックプレーンを備え、
前記バックプレーンは、
異なる前記モジュールからの出力信号を入力して比較する比較部であって、比較するモジュールの組み合わせがそれぞれ異なる少なくともn−1個の比較部を備えることを特徴とする検査システム。 - 前記各比較部の比較結果を表示する表示部をさらに備えることを特徴とする請求項1に記載の検査システム。
- 前記モジュールとの同時接続数nは、mの倍数であることを特徴とする請求項1又は2に記載の検査システム。
- 前記比較部の数が、
n−1個であることを特徴とする請求項1乃至3のいずれか一項に記載の検査システム。 - n個の前記モジュールのうちのいずれか1つのモジュールからの出力信号が、n−1個の比較部に入力されていることを特徴とする請求項4に記載の検査システム。
- 同期して動作するm(mは2以上の整数)個のモジュールを有するm重化モジュールの各モジュールの検査に用いられる検査用バックプレーンにおいて、
mより多いn個の前記モジュールと同時接続可能で、接続された前記モジュールの出力信号を入力する接続部と、
前記接続部に接続された異なる前記モジュールからの出力信号を入力して比較する比較部であって、比較するモジュールの組み合わせがそれぞれ異なる少なくともn−1個の比較部と、を備えることを特徴とする検査用バックプレーン。 - 前記各比較部の比較結果を表示する表示部をさらに備えることを特徴とする請求項6に記載の検査用バックプレーン。
- 前記モジュールとの同時接続数nが、mの倍数であることを特徴とする請求項6又は7に記載の検査用バックプレーン。
- 前記比較部の数が、
n−1個であることを特徴とする請求項6乃至8のいずれか一項に記載の検査用バックプレーン。 - n個の前記モジュールのうちのいずれか1つのモジュールからの出力信号が、n−1個の比較部に入力されていることを特徴とする請求項9に記載の検査用バックプレーン。
- 同期して動作するm(mは2以上の整数)個のモジュールを有するm重化モジュールの各モジュールを検査する検査方法において、
mより多いn個の前記モジュールと同時接続されたバックプレーンに、各モジュールの出力信号を入力する第1の工程と、
異なる前記モジュールからの出力信号を入力して比較するために前記バックプレーンに設けられた比較器であって、比較するモジュールの組み合わせがそれぞれ異なる少なくとも1つの比較器を用いて、異なる前記モジュールからの出力信号を比較する第2の工程と、
前記各比較器の比較結果を、表示装置を用いて表示する第3の工程と、を含むことを特徴とする検査方法。 - 同期して動作するm(mは2以上の整数)個のモジュールを有するm重化モジュールを製造する製造方法において、
前記m重化モジュールを構成する各モジュールを製造する製造工程と、
請求項11に記載の検査方法を用いて、mより多いn個の前記各モジュールを検査する検査工程と、
前記検査工程において検査された前記モジュールを用いて、前記m重化モジュールを組み立てる組み立て工程と、を含むことを特徴とする製造方法。
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---|---|---|---|---|
JPS63174141A (ja) * | 1987-01-14 | 1988-07-18 | Nippon Telegr & Teleph Corp <Ntt> | 情報処理装置の試験診断方式 |
JPH02201546A (ja) * | 1989-01-31 | 1990-08-09 | Nec Corp | 論理カード拡張機構 |
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JP2006172391A (ja) * | 2004-12-20 | 2006-06-29 | Nec Corp | フォールト・トレラント・コンピュータ・リセット方法及びそのシステム |
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