JP2007156824A5 - - Google Patents

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Claims (12)

  1. タスクに対応したオブジェクトを登録するメモリ領域と、
    前記メモリ領域に登録されたオブジェクトの実行スケジュールを管理し、新規のタスクを受け取った際に前記新規のタスクに対応した新規のオブジェクトを前記メモリ領域に追加格納すると共に、前記新規のオブジェクトを含めてスケジューリングを実行するスケジューラと、
    前記スケジューラによって決定されたオブジェクトを実行するプロセッサと
    を具備する
    プロセッサシステム。
  2. 請求項１に記載のプロセッサシステムであって、
    前記スケジューラは、前記新規のオブジェクトが前記メモリ領域に登録されたことに対応して、前記メモリ領域に登録された前記新規のオブジェクトを含む複数のオブジェクトに対してスケジューリングを実行する
    プロセッサシステム。
  3. 請求項２に記載のプロセッサシステムであって、
    前記スケジューラは、前記新規のオブジェクトが前記メモリ領域に登録された際、実行中のオブジェクトをスケジューリングのために停止させることなく、前記新規のオブジェクトを含めてスケジューリングを実行する
    プロセッサシステム。
  4. 請求項１又は２に記載のプロセッサシステムであって、
    前記プロセッサに対して実行すべき前記新規のタスクを指示する汎用処理装置
    を更に具備し、
    前記汎用処理装置は、
    ＣＰＵと、
    プロセッサエレメントと、
    キャッシュメモリと
    を含む
    プロセッサシステム。
  5. 請求項１又は２に記載のプロセッサシステムであって、
    対称型マルチプロセッサ（ＳＭＰ）であり、前記プロセッサに対して実行すべき前記新規のタスクを指示する汎用処理装置
    を更に具備し、
    前記汎用処理装置は、
    複数のプロセッサエレメントと、
    スヌープキャッシュと
    を含む
    プロセッサシステム。
  6. 請求項１に記載のプロセッサシステムであって、
    前記メモリ領域は、前記プロセッサと同一のチップに搭載された内部メモリに割り当てられている
    プロセッサシステム。
  7. 請求項１に記載のプロセッサシステムであって、
    前記メモリ領域は、前記プロセッサとバスを介して接続された外部メモリに割り当てられている
    プロセッサシステム。
  8. 請求項１に記載のプロセッサシステムであって、
    前記スケジューラは、前記メモリ領域に登録されたオブジェクトの優先順位に基づいてスケジューリングを実行する
    プロセッサシステム。
  9. 請求項１に記載のプロセッサシステムであって、
    前記スケジューラは、実行中のタスクに対する終了指示を受け取った際に前記実行中のタスクに対応したオブジェクトを前記メモリ領域から削除した後にスケジューリングを実行する
    プロセッサシステム。
  10. 新規タスク実行の指示に基づいて前記新規タスクに対応した少なくとも１つのオブジェクトファイルをメモリ領域に格納するステップと、
    前記新規タスクをスケジューラに登録すると共に、前記新規タスクに対応して新規に登録されたオブジェクトと過去に登録されたオブジェクトとに基づいてスケジューリングをやり直すステップと、
    前記スケジューリングされたオブジェクトを実行するステップと
    を含む
    タスク制御方法。
  11. 請求項１０に記載のタスク制御方法であって、
    前記スケジューリングをやり直すステップは、前記オブジェクトが新規に登録された際、既に実行中である１つ乃至複数の他オブジェクトを停止させずに前記スケジューリングされたオブジェクトを実行するステップ
    を含む
    タスク制御方法。
  12. 請求項１０に記載のタスク制御方法であって、
    実行中のタスク終了の指示に基づいて前記実行中のタスクに対応したオブジェクトファ
    イルをメモリ領域から削除するステップ
    を更に含む
    タスク制御方法。
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