JP2007047796A - プラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置 - Google Patents
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Abstract
【課題】 発光効率及び永久残像を改善することが可能な新構造のプラズマディスプレイパネルについての駆動方法及びプラズマディスプレイ装置を提供する。
【解決手段】 互いに離隔して配置される第1及び第2基板と、第1及び第2基板と放電セルを区画する隔壁と、互いに交差して伸長する第1及び第2電極と、放電セル内に配置される蛍光体層と、放電ガスと、を備えるプラズマディスプレイパネルを駆動するために、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは相異なる階調加重値を持ちリセット、アドレス及び維持期間に分けられ、単位フレームの最初のサブフィールドのリセット期間には全体放電セルにリセット放電が行われ、二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法。
【選択図】 図3
【解決手段】 互いに離隔して配置される第1及び第2基板と、第1及び第2基板と放電セルを区画する隔壁と、互いに交差して伸長する第1及び第2電極と、放電セル内に配置される蛍光体層と、放電ガスと、を備えるプラズマディスプレイパネルを駆動するために、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは相異なる階調加重値を持ちリセット、アドレス及び維持期間に分けられ、単位フレームの最初のサブフィールドのリセット期間には全体放電セルにリセット放電が行われ、二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法。
【選択図】 図3
Description
本発明は、プラズマディスプレイパネル(Plasma Display Panel、以下、PDP)に係り、より詳細には、発光効率及び永久残像が改善される新構造のPDPについての駆動方法及びこれにより駆動されるプラズマディスプレイ装置に関する。
従来の陰極線管ディスプレイ装置を代えるものとして最近注目されているPDPは、複数個の電極が形成された二つの基板間に放電ガスが封入された後に放電電圧が加えられ、これによって発生する紫外線により所定のパターンで形成された蛍光体が励起されて所望の画像を得る装置である。
図1は、従来技術による3電極面放電方式のPDPの部分分離斜視図であり、図2は、図1のPDPをII−II線に沿って切り取った平面図である。以下で、図1、図2を参照して説明する。
図1及び図2のPDP1は、第1パネル110及び第2パネル120を備える。
上記第1パネル110は、第1基板111と、第1基板の背面で走査電極ライン112及び維持電極ライン113を覆うように配置される第1誘電体層115と、第1誘電体層115を保護するための第1保護膜116と、を備える。走査電極ライン112及び維持電極ライン113は対をなして維持電極対114を構成し、伝導度を高めるための金属性材質のバス電極112a、113aと、ITO(Indium Tin Oxide)のような透明な導電性材質の透明電極112b、113bと、を備える。
上記第2パネル120は、第2基板121と、上記走査電極ライン112及び維持電極ライン113が延びる方向と直交する方向に形成されるアドレス電極ライン122を覆うように、第2基板の前面で第1基板方向に配置される第2誘電体層123と、上記第2誘電体層123の上部に放電セルを区画する隔壁124と、上記隔壁124によって限定される空間内に配置された蛍光体層125と、上記蛍光体層125を保護するために蛍光体層125の前面に第2保護膜128と、を備える。上記隔壁124により限定される空間の放電セル(Ce)には放電ガスが注入される。
図1及び図2に示す従来の3電極PDPは、フレームが複数個のサブフィールドに分けられ、各サブフィールドはリセット期間、アドレス期間及び維持期間に分けられて画像をディスプレイした。しかし、従来の3電極PDP1は、次のような問題点を持つ。
第1に、蛍光層128から発散された可視光線が、第1基板110の下に配置された維持電極ライン113、走査電極ライン112、この電極ライン112、113を覆う第1誘電層115、及び第1保護膜116によって相当部分(約40%)吸収されることによって、発光効率が低くなるという問題点がある。
第2に、上記のような従来のPDP1が長時間同じ画像を表示している場合、蛍光層128が放電ガスの荷電粒子によりイオンスパッタリングされることで、永久的な残像を引き起こす。
このように、従来のプラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置によれば、発光効率が低く、残像が残るという問題がある。
そこで、本発明は、このような問題に鑑みてなされたもので、その目的は、発光効率を高くし、残像が残ることを改善することが可能な、新規かつ改良されたプラズマディスプレイパネルの駆動方法及びプラズマディスプレイ装置を提供することにある。
上記課題を解決するために、本発明のある観点によれば、プラズマディスプレイパネルの駆動方法において:互いに離隔して配置される第1基板及び第2基板と、上記第1基板及び上記第2基板と共に放電空間である放電セルを区画する隔壁と、上記隔壁内に配置され、互いに交差して伸長する第1電極及び第2電極と、上記放電セル内に配置される蛍光体層と、上記放電セル内にある放電ガスと、を備え、上記駆動方法は、画像を表示する単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、上記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、上記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電を行う維持期間と、に分けられ、上記単位フレームの最初のサブフィールドのリセット期間には全体放電セルが初期化されるようにリセット放電が行われ、上記単位フレームの二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみ初期化されるようにリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法が提供される。
また、上記最初のサブフィールドのリセット期間では、上記第1電極に上昇パルス及び下降パルスが印加されてもよく、上記二番目サブフィールド以降のリセット期間では、上記第1電極に下降パルスが印加されてもよい。
また、上記上昇パルス及び上記下降パルスは、ランプパルスであってもよい。
また、上記各サブフィールドのリセット期間において、上記下降パルスが印加される間に上記第2電極にはバイアス電圧が印加されてもよい。
また、上記各サブフィールドのアドレス期間において、上記第1電極の各々はハイレベルを維持して、順次ローレベルをもつ走査バルスが印加され、上記第2電極には上記走査パルスのローレベルに合せて表示データ信号が印加されてもよい。
また、上記各サブフィールドの維持期間において、上記第1電極にはハイレベル及びローレベルを交互に持つ維持パルスが印加されてもよく、上記第2電極には上記維持パルスのハイレベルとローレベル間の中間レベルが印加されてもよい。
上記課題を解決するために、本発明の別の観点によれば、プラズマディスプレイパネルの駆動方法において:互いに離隔して配置される第1基板及び第2基板と、上記第1基板及び上記第2基板と共に放電空間の放電セルを区画する隔壁と、上記隔壁内に配置されるが、一方向に延びる第1電極及び第2電極と、上記隔壁内に配置されるが、上記第1電極及び上記第2電極に交差して延びる第3電極と、上記放電セル内に配置される蛍光体層と、上記放電セル内にある放電ガスと、を備え、上記駆動方法は、画像を表示する単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、上記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、上記ターンオンされるべきセルとして選択された放電セルで、各サブフィールド別に割り当てられた階調加重値によって維持放電を行う維持期間と、に分けられ、上記単位フレームの最初のサブフィールドのリセット期間には、全体放電セルが初期化されるようにリセット放電が行われ、上記単位フレームの二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみ初期化されるようにリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法が提供される。
また、上記最初のサブフィールドのリセット期間において、上記第1電極に上昇パルス及び下降パルスが印加されてもよく、上記二番目サブフィールド以降のリセット期間において、上記第1電極に下降パルスが印加されてもよい。
また、上記上昇パルス及び上記下降パルスは、ランプパルスであってもよい。
また、上記各サブフィールドのリセット期間において、上記下降パルス印加時から上記第2電極にはバイアス電圧が印加されてもよい。
また、上記各サブフィールドのアドレス期間において、上記第1電極の各々にはハイレベルを維持して、順次ローレベルをもつ走査バルスが印加されてもよく、上記第3電極には上記走査パルスのローレベルに合せて表示データ信号が印加されてもよく、上記第2電極にはバイアス電圧が印加されてもよい。
また、上記各サブフィールドの維持期間では、上記第1電極及び上記第2電極には維持パルスが印加されてもよく、上記第1電極の上記維持パルスのハイレベルと上記第2電極の上記維持パルスのハイレベルは交互に印加されてもよい。ここで維持パルスとは、ハイレベルとローレベルが交互に印加されるパルス波形のことをさす。
上記課題を解決するために、本発明の別の観点によれば、互いに離隔して配置される第1基板及び第2基板と、上記第1基板及び上記第2基板と共に放電空間である放電セルを区画する隔壁と、上記隔壁内に配置されるが、互いに交差して延びる第1電極及び第2電極と、上記放電セル内に配置される蛍光体層と、上記放電セル内にある放電ガスと、を備えるプラズマディスプレイパネルと;上記プラズマディスプレイパネルを駆動するように、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、上記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、上記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電が行われる維持期間と、に分けられ、上記リセット、アドレス及び維持期間に分けられる駆動信号を上記各電極に印加する駆動部と;を備え、上記駆動部は、上記第1電極に駆動信号を印加する第1駆動部と、上記第2電極に駆動信号を印加する第2駆動部とに分けられ、上記第1駆動部は、最初のサブフィールドのリセット期間に上昇パルス及び下降パルスを印加し、二番目サブフィールドのリセット期間以降は下降パルスを印加することを特徴とするプラズマディスプレイ装置が提供される。
また、上記上昇パルス及び下降パルスはランプパルスであってもよい。
また、上記第2駆動部は、上記各サブフィールドのリセット期間において、上記下降パルスが印加される間にバイアス電圧を印加してもよい。
また、上記各サブフィールドのアドレス期間において、上記第1駆動部は、上記第1電極の各々にハイレベルを維持させ、順次ローレベルをもつ走査バルスを印加してもよく、上記第2駆動部は、上記走査パルスのローレベルに合せて表示データ信号を印加してもよい。
また、上記各サブフィールドの維持期間で、上記第1駆動部は、ハイレベル及びローレベルを交互に持つ維持パルスを印加してもよく、上記第2駆動部は、上記維持パルスのハイレベルとローレベルとの中間レベルを印加してもよい。
上記課題を解決するために、本発明の別の観点によれば、互いに離隔して配置される第1基板及び第2基板と、上記第1基板及び第2基板と共に放電空間の放電セルを区画する隔壁と、上記隔壁内に配置されるが、一方向に延びる第1電極及び第2電極と、上記隔壁内に配置されるが、上記第1電極及び第2電極に交差して延びる第3電極と、上記放電セル内に配置される蛍光体層と、上記放電セル内にある放電ガスと、を備えるプラズマディスプレイパネルと、上記プラズマディスプレイパネルを駆動するように、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは放電セルを初期化するリセット期間、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間、及び上記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電が行われる維持期間に分けられ、上記リセット、アドレス及び維持期間に分けられる駆動信号を上記各電極に印加する駆動部と、を備え、上記駆動部は、上記第1電極に駆動信号を印加する第1駆動部と、上記第2電極に駆動信号を印加する第2駆動部と、上記第3電極に駆動信号を印加する第3駆動部とに分けられ、上記第1駆動部は、上記最初のサブフィールドのリセット期間で上昇パルス及び下降パルスを印加し、上記二番目サブフィールドからのリセット期間で下降パルスを印加することを特徴とするプラズマディスプレイ装置が提供される。
また、上記上昇パルス及び下降パルスはランプパルスであってもよい。
また、上記第2駆動部は、上記各サブフィールドのリセット期間で上記下降パルス印加時からバイアス電圧を印加してもよい。
また、上記各サブフィールドのアドレス期間で、上記第1駆動部は、上記第1電極の各々にハイレベルを維持させ、順次ローレベルをもつ走査バルスを印加してもよく、上記第3駆動部は、上記走査パルスのローレベルに合せて表示データ信号を印加してもよく、上記第2駆動部はバイアス電圧を印加してもよい。
また、上記各サブフィールドの維持期間で、上記第1駆動部及び第2駆動部は、上記第1電極及び上記第2電極に維持パルスを印加してもよく、上記第1電極の上記維持パルスのハイレベルと上記第2電極の上記維持パルスのハイレベルは交互に印加されていてもよい。
以上説明したように、本発明によれば、発光効率を向上させ、永久残像を改善させることができる。
以下に、添付した図面を参照しながら、本発明の好適な実施の形態について詳細に説明する。なお、本明細書及び図面において、実質的に同一の機能構成を有する発明特定事項については、同一の符号を付することにより重複説明を省略する。
以下、添付された図面を参照して本発明の実施形態について詳細に説明する。
図3は、本発明のPDPの駆動方法により駆動される発光効率及び永久残像が改善されたPDPの第1実施形態であり、図4は、IV−IV線に沿って切り取った断面図であり、図5は、図3及び図4に示した放電セル及び電極構造を示す配置図である。
図3〜図5を参照して説明すれば、PDP200は、第1基板210、第2基板220、隔壁214、第1電極212、第2電極213、蛍光体層225、第1保護膜216、放電ガスを備える。
第1基板210及び第2基板220は、互いに対向して離隔して配置される。
隔壁214は、図面のように一体に形成でき、分離されて第1基板210及び第2基板220にそれぞれ付着される形態(前方隔壁及び後方隔壁)に形成されてもよい。隔壁214は、第1基板210及び第2基板220と共に放電が行われる空間の放電セル(Ce)を形成する。図面のように、放電セル(Ce)は、隔壁214内の円形の横断面を持つ開口部で形成されてもよいが、これに限定されるものではなく、三角形、四角形、五角形、または楕円形などの横断面を持つ放電セル(Ce)らが形成されてもよい。また、図面には隔壁214が放電セル(Ce)をマトリックス形態に区画すると図示されているが、これに限定されるものではなく、複数の放電空間を形成できるかぎり、多様なパターンで、例えばワッフル、デルタ状に区画することもできる。
隔壁214内には、第1電極212及び第2電極213が互いに離隔して配置される。第1電極212及び第2電極213は、図面のように放電セル(Ce)を完全に取り囲むように形成できるが、これに限定されず放電セルの一部のみを取り囲むように形成されることも可能である。第1電極212及び第2電極213は、それぞれx方向及びy方向に延びる。例えば、図5を参照すると、第1電極212の輪が連結された方向(延長された方向)はy方向であり、第2電極213の輪が連結された方向はx方向である。一方、図面では第1基板から第2基板方向(−z方向)に順に第2電極213と第1電極212とが配置されると図示されるが、これに限定されない。
放電セル(Ce)を形成する隔壁214の外側面には、MgOなどからなる第1保護膜216が形成されることが望ましい。第1保護膜216は、放電時に第1電極212及び第2電極213と、これを覆う誘電体から形成された隔壁214とを保護し、放電時に2次電子を放出して放電を容易に引き起こすことができる。
蛍光体層225は、第1基板210上に、詳細には第2基板方向に第1基板上に形成された溝210aに形成される。蛍光体層225の位置は図面に図示されたところに限定されず、第1基板方向に第2基板上に形成された溝(図示せず。)に形成されてもよく、第1基板及び第2基板上にいずれも形成されてもよい。
放電セル(Ce)の内部には放電ガスが充填され、放電ガスとしては、10%前後のキセノン(Xe)ガスを含むネオン(Ne)、ヘリウム(He)、またはアルゴン(Ar)のうちいずれか一つあるいはそれらのうち二つ以上の混合ガスであってもよい。
第1基板210及び第2基板220は、ガラスを主成分とする透光性に優れた素材で製造される。第2基板220は、第1基板210から離隔して対向して位置する。第1基板210と第2基板220とは実質的に同じ材料を使用して形成されることが望ましく、この場合、第1基板210の熱膨張率と第2基板220の熱膨張率とが同一になるという長所がある。
隔壁214は、放電時に第1電極212及び第2電極213が直接通電されることを防止し、荷電粒子が第1電極212及び第2電極213に直接衝突してそれらを損傷させることを防止し、荷電粒子を誘導して壁電荷を蓄積できる誘電体として形成されるが、このような誘電体としてはPbO、B2O3、SiO2などがある。
第1電極212及び第2電極213は、放電が行われるように所定電圧がそれぞれ印加されるので、電気伝導率の高いAg、Cu、Cr等で形成されることが望ましい。
蛍光体層225は、赤色発光蛍光体、緑色発光蛍光体、青色発光蛍光体のうちいずれか一つの蛍光体、ソルベント、及びバインダーが混合された蛍光体ペーストが第1基板の溝210aに塗布された後に乾燥及び焼成工程を経ることによって形成される。上記赤色発光蛍光体としてはY(V、P)O4:Euなどがあり、緑色発光蛍光体としてはZnSi04:Mn、YBO3:Tbなどがあり、青色発光蛍光体としてはBAM:Euなどがある。
一方、蛍光体層225の前面(−z方向)にはMgOからなる第2保護膜(図示せず。)が形成できる。第2保護膜は、放電セル(Ce)内で放電が発生する時、放電粒子の衝突によって蛍光体層225の劣化を防止し、2次電子を放出して上記放電が容易に起きるようにする。
図3〜図5に示したPDP200は、従来のPDP1に比べて次のような長所を持つ。
第1に、第1電極212及び第2電極213のための別途の誘電層を必要とせず、電極が隔壁内に、すなわち、放電セルの側面に配置されるので、放電空間セル(Ce)での放電により発生する可視光線が第1基板210または/及び第2基板220を通じて直接放出されて発光効率が高くなり、従来に比べてITOのような透明電極が不要になる。
第2に、第1電極212及び第2電極213が隔壁内に形成されるが、放電セルの周囲に形成されて電界が放電セル(Ce)の中央で集中し、PDP200が長時間同じ画像を表示していても、蛍光層225が放電ガスの荷電粒子によりイオンスパッタリングされないので、永久的な残像が防止できる。また、放電セル(Ce)のあらゆる空間で放電が起きることができるので、応答速度及び放電効率が高くなる。
つまり、図1に図示されている従来のPDP構造では走査電極112と維持電極113間で放電が起きる場合、電界が放電セルの上部に集中される反面、図3−5のPDP構造では第1電極と第2電極が側壁に形成されている電界が放電セルの中央に集中することができる。また、図3−5のPDP構造では第1電極及び第2電極が輪模様で側壁全体に形成されている電界が放電セルの中央のすべての空間で起きることができる。
図6は、図3のPDPを駆動するための駆動方法を簡略に示すタイミング図である。
画像を表示する単位フレームは複数個のサブフィールドに分けられ、各サブフィールドは、リセット期間、アドレス期間及び維持期間に分けられる。リセット期間は、全体放電セルを初期化する期間であり、アドレス期間は、全体放電セルのうちターンオンされるべき放電セルとターンオンされてはならない放電セルとを区分する期間であり、維持期間は、ターンオンされるべき放電セルと選択された放電セルで各サブフィールド毎に割り当てられた階調加重値によって維持放電を行う期間である。PDPは、上記のようにサブフィールド別にリセット、アドレス及び維持期間による駆動信号を印加する時分割駆動方法により駆動される。
図面では、単位フレームを8個のサブフィールドSF1〜SF8に分け、各サブフィールドはリセット期間(図示せず。)、アドレス期間PA1〜PA8及び維持期間PS1〜PS8に分けられ、各サブフィールドの階調加重値を第1サブフィールドから第8サブフィールドまで1T、2T、…、128Tのように割り当てたが、これは一例に過ぎず、これに限定されない。すなわち、単位フレームのサブフィールド数は8より少ないか、または多く、サブフィールド別階調加重値の割り当ても例示されたものとは異なって設計仕様によって変更できる。
図7は、図3のPDP及びそれを駆動するための駆動装置を示すプラズマディスプレイ装置の簡略なブロック図である。
図3のPDP200の構造は、隔壁内に配置される電極が配置される新電極構造であって、2電極構造になっている。したがって、図7のプラズマディスプレイ装置701は、従来の3電極構造のプラズマディスプレイ装置に比べて簡単に構成される。
図3〜図8を参照して説明すれば、図7のプラズマディスプレイ装置701は、映像処理部700、論理制御部702、Y駆動部704、A駆動部706及びプラズマ表示パネル200を備える。本実施形態において第1駆動部はY駆動部のことであり、第2駆動部はA駆動部のことである。
映像処理部700は、外部からPC信号、DVD信号、ビデオ信号、TV信号などの外部映像信号を入力されてアナログ信号をデジタル信号に変換し、デジタル信号を映像処理して内部映像信号として出力する。内部映像信号は、それぞれ8ビットの赤色(R)、緑色(G)、及び青色(B)映像データ、クロック信号、垂直及び水平同期信号である。
論理制御部702は、映像処理部700からの内部映像信号を入力されてガンマ補正、APC(Automatic Power Control)ステップなどを経てそれぞれ、Y駆動制御信号SYと、A駆動制御信号SAとを出力する。
Y駆動部704は、論理制御部702からのY駆動制御信号SYを入力されて第1電極(図3の212)に駆動信号を印加し、A駆動部706は、論理制御部702からのA駆動制御信号SAを入力されて第2電極(図3の213)に駆動信号を印加する。以下では、第1電極をY電極、第2電極をA電極とも記述する。
Y駆動部704は、複数個のサブフィールドを備える単位フレームのうち最初のサブフィールドSF1のリセット期間PR1では、全体放電セルが初期化されるようにY電極に上昇パルス及び下降パルスを印加し、単位フレームのうち二番目サブフィールド以後SF2〜SF8のリセット期間PR2〜PR8では、リセット期間PR2〜PR8直前の維持期間PS1〜PS7で維持放電が行われた放電セルにのみ初期化されるようにY電極に下降パルスを印加する。
ここで、上昇パルス及び下降パルスはランプパルスであり、または瞬間勾配の大きさが経時的に減少する放物線状のパルスでありうる。上記のように最初のサブフィールドのリセット期間PR1にのみ上昇パルス及び下降パルスを印加すれば、全体放電セルでは上昇パルスの印加によってY電極の周囲に壁電荷が溜まりつつリセット放電が行われ、下降パルスの印加によってY電極の周囲に壁電荷が消去されつつリセット放電が行われる。
二番目サブフィールド以後のリセット期間PR2〜PR8に下降パルスのみを印加すれば、リセット期間前の維持期間PS1〜PS7で維持放電が行われた放電セルは既に壁電荷が溜まっているので、下降パルスのみを印加しても溜まっていた壁電荷が消去され始めつつリセット放電が行われるが、リセット期間前の維持期間PS1〜PS7で維持放電が行われていない放電セルでは溜まっている壁電荷がないので、下降パルスのみを印加しても壁電荷消去及びリセット放電が行われない。すなわち、維持放電の実行如何によってリセット放電が選択的に行われる。
このような本発明の特徴によれば、二番目サブフィールド以後のリセット期間PR2〜PR8を最初のサブフィールドのリセット期間PR1より短縮することができ、さらに高画質のPDPの趨勢によってアドレス期間が増加するしかない場合に、アドレス期間をさらに確保することもできる。また不要なリセット光が発生しないので、コントラスト向上に役に立つ。一方、Y駆動部704は、アドレス期間PA1〜PA8に走査パルスを印加し、維持期間PS1〜PS8に維持パルスを印加する。
A駆動部706は、アドレス期間PA1〜PA8に上記走査パルスに合せて表示データ信号を印加する。表示データ信号及び走査パルスによりアドレス期間PA1〜PA8でアドレス放電が行われる。
図8は、本願発明の第1実施形態の駆動方法であって、図3のPDPを駆動する駆動信号を示す図面である。
図3〜図8を参照して説明すれば、リセット期間PR1〜PR8は、放電セルを初期化させる期間であって、最初のサブフィールドのリセット期間PR1にY電極には上昇パルス及び下降パルスが印加され、二番目サブフィールド以後のリセット期間PR2〜PR8にY電極には下降パルスが印加され、あらゆるサブフィールドのリセット期間PR1〜PR8にA電極にはローレベルの電圧、例えば、接地電圧Vgが印加されるが、下降パルス印加中にはバイアス電圧Vb1が印加される。
上昇パルスは、維持放電電圧Vs1から上昇して上昇最高電圧(Vs1+Vset1)に到達し、下降パルスは、維持放電電圧Vs1から下降して下降最低電圧Vnf1まで下降する。最初のサブフィールドのリセット期間PR1では上昇パルスの印加によって、放電セル内のY電極の周囲に負極性の壁電荷が溜まりつつY電極とA電極との間にリセット放電が発生する。下降パルスの印加によって、放電セル内のY電極の周囲に溜まっていた負極性の壁電荷が消去されつつY電極とA電極との間にリセット放電が行われる。
二番目サブフィールド以後のリセット期間PR2〜PR8で下降パルスを印加する場合に、リセット期間以前の維持期間PS1〜PS7で維持放電が行われた放電セルでは、壁電荷が放電セル内の各電極付近、特にY電極付近に溜まっているので、下降パルスの印加によって壁電荷が消去されつつY電極とA電極との間でリセット放電が行われる。上記リセット放電によって、放電セル内の壁電荷状態が初期化され、アドレス期間のアドレス放電に適した壁電荷状態が組成される。リセット期間以前の維持期間PS1〜PS7で維持放電が行われていない放電セルでは壁電荷がY電極付近に溜まっていないので、下降パルスが印加されても消去する壁電荷がないのでリセット放電も行われない。すなわち、放電セルの初期化状態が既に形成されているので、再び放電セルを初期化する必要がなくなる。
結局、本発明の駆動信号によりリセット期間PR1〜PR8後にはアドレス放電の実行に適した壁電荷状態が放電セル内に組成される。このような本発明の特徴によれば、二番目サブフィールド以後のリセット期間PR2〜PR8を最初のサブフィールドのリセット期間PR1より短くでき、さらに、高画質のPDPの趨勢によってアドレス期間が増加せざるを得ない場合に、アドレス期間をさらに確保することもできる。また不要なリセット光が発生しないのでコントラスト向上に役に立つ。
アドレス期間PA1〜PA8は、ターンオンされるべき放電セルとターンオンされてはならない放電セルとを区分する期間であって、図面では書き込み放電方式、すなわち、ターンオンされるべき放電セルでのみアドレス放電を行う方式を図示しているが、これに限定されず、選択消去方式、すなわち、全体放電セルでアドレス放電が行われ、ターンオンされてはならない放電セルでのみ消去放電を行う方式も可能である。
図8で図示されたように、書き込み放電方式によれば、Y電極にハイレベルの電位Vsch1及びローレベルの電位Vscl1を持つ走査パルスを順次印加し、走査パルスのローレベルの電位Vscl1に合せて正極性の電位Va1を持つ表示データ信号をA電極に印加する。走査パルス及び表示データ信号の印加によって放電セル内のY電極とA電極との間にはアドレス放電が行われ、アドレス放電後にY電極の周囲には正極性の壁電荷が、A電極の周囲には負極性の壁電荷が溜まる。
維持期間PS1〜PS8は、ターンオンされるべきセルと選択された放電セルで割り当てられた階調加重値によって維持放電が行われる期間であって、Y電極にハイレベルVs1及びローレベル−Vs1を交互に持つ維持パルスが印加され、A電極には、維持パルスのハイレベルVs1及びローレベル−Vs1の中間電位Vgが印加される。維持パルスのハイレベル電位は維持放電電圧Vs1ともいう。
維持パルスの数は、階調加重値に比例して印加される。すなわち、維持放電の回数により割り当てられた階調加重値ほど階調が表現される。まず、Y電極に維持パルスのハイレベルの電位Vs1が印加されれば、放電セル内のY電極の周囲に溜まっていた正極性の壁電荷と、A電極の周囲に溜まっていた負極性の壁電荷と、Y電極に印加される電位Vs1及びA電極に印加される電位Vgにより維持放電が行われ、維持放電終了後にA電極の周囲には正極性の壁電荷が、Y電極の周囲には負極性の壁電荷が溜まる。
次いで、Y電極に維持パルスのローレベルの電位−Vs1が印加されれば、放電セル内のY電極の周囲に溜まっていた負極性の壁電荷と、A電極の周囲に溜まっていた正極性の壁電荷と、Y電極に印加される電位−Vs1と、A電極に印加される電位Vgとにより維持放電が行われ、維持放電終了後にA電極の周囲には負極性の壁電荷が、Y電極の周囲には正極性の壁電荷が溜まる。上記のような方式により、階調加重値による維持パルスの数によって維持放電が行われ続ける。
図9は、本発明のPDPの駆動方法により駆動される発光効率及び永久残像が改善されたPDPの第2実施形態であり、図10は、X−X線に沿って切り取った断面図であり、図11は、図9及び図12に示した放電セル及び電極構造を示す配置図である。
図9〜図11のPDP300は、図3〜図5に示したPDP200と類似しているが、その差異点としては、図3〜図5に示したPDPは2電極構造である一方、図9〜図11のPDPは3電極構造を持つという点である。以下では、その差異点を中心に記述する。
図9〜図11を参照して説明すれば、PDP300は、第1基板310、第2基板320、隔壁314、第1電極312、第2電極313、第3電極322、蛍光体層325、第1保護膜316、放電ガスを備える。
第1基板310、第2基板320、隔壁314、蛍光体層3325、第1保護膜316、放電ガスについての説明は、図3〜図5に関する説明があるので省略する。
第1電極312、第2電極313及び第3電極322は、隔壁314内に互いに離隔して配置される。第1電極312、第2電極313及び第3電極322は、図面のように放電セル(Ce)を完全に取り囲むように形成できるが、これに限定されず、放電セル(Ce)の一部のみを取り囲むように形成されることもできる。第1電極312及び第2電極313は一方向(x方向)に延び、第3電極322は第1電極312及び第2電極313が延びる方向と交差する方向(y方向)に延びる。一方、図面では、第1基板から第2基板方向(−z方向)に第2電極313、第3電極322、第1電極312の順に配列されているが、これに限定されず、設計仕様によって多様に配置できる。
図9〜図11に示したPDP300は、図3〜図5に示したPDPの長所と同じ長所を持つ。
図12は、図9のPDP及びこれを駆動するための駆動装置を示すプラズマディスプレイ装置の簡略なブロック図である。
図12のプラズマディスプレイ装置1201は、図7のプラズマディスプレイ装置701と類似しているので、その差異点を中心に説明する。
図9〜図13を参照して説明すれば、図12のプラズマディスプレイ装置1201は、映像処理部1200、論理制御部1202、Y駆動部1204、A駆動部1206、X駆動部1208及びプラズマ表示パネル300を備える。本実施形態において第1駆動部はY駆動部のことであり、第2駆動部はX駆動部のことであり、第3駆動部はA駆動部のことである。
映像処理部1200は、図7での映像処理部700と同じ機能を行う。
論理制御部1202は、映像処理部1200からの内部映像信号を入力されてガンマ補正、APC(Automatic Power Control)ステップなどを経てそれぞれ、Y駆動制御信号SYと、A駆動制御信号SA及びX駆動制御信号SXを出力する。
Y駆動部1204は、論理制御部1202からのY駆動制御信号SYを入力されて第1電極(図9の312)に駆動信号を印加し、X駆動部1208は、論理制御部1202からのX駆動制御信号SXを入力されて第2電極(図9の313)に駆動信号を印加し、A駆動部1206は、論理制御部1202からのA駆動制御信号SAを入力されて第3電極(図9の322)に駆動信号を印加する。以下では、第1電極をY電極、第2電極をX電極、第3電極をA電極とも記述する。
Y駆動部1204は、複数個のサブフィールドを備える単位フレームのうち最初のサブフィールドSF1のリセット期間PR1には、全体放電セルが初期化されるようにY電極に上昇パルス及び下降パルスを印加し、単位フレームのうち二番目サブフィールド以後SF2〜SF8のリセット期間PR2〜PR8には、リセット期間PR2〜PR8直前の維持期間PS1〜PS7で維持放電が行われた放電セルのみ初期化されるようにY電極に下降パルスを印加する。
ここで、上昇パルス及び下降パルスはランプパルスであってもよい。または、瞬間勾配の大きさが経時的に減少する放物線状のパルスであってもよい。上記のように最初のサブフィールドのリセット期間PR1にのみ上昇パルス及び下降パルスを印加すれば、全体放電セルでは上昇パルスの印加によってY電極の周囲に壁電荷が溜まりつつリセット放電が行われ、下降パルスの印加によってY電極の周囲に壁電荷が消去されつつリセット放電が行われる。
二番目サブフィールド以後のリセット期間PR2〜PR8に下降パルスのみを印加すれば、リセット期間前の維持期間PS1〜PS7で維持放電が行われた放電セルは既に壁電荷が溜まっているので、下降パルスのみを印加しても溜まっていた壁電荷が消去され始めつつリセット放電が行われるが、リセット期間前の維持期間PS1〜PS7で維持放電が行われていない放電セルでは溜まってイル壁電荷がないので、下降パルスのみを印加しても壁電荷消去及びリセット放電が行われない。
すなわち、維持放電の実行如何によってリセット放電が選択的に行われる。このような本発明の特徴によれば、二番目サブフィールド以後のリセット期間PR2〜PR8を最初のサブフィールドのリセット期間PR1より短くすることができ、さらに、高画質のPDPの趨勢によってアドレス期間が増加するしかない場合に、アドレス期間をさらに確保することもできる。また不要なリセット光が発生しないのでコントラスト向上に役に立つ。
また、Y駆動部1204は、アドレス期間PA1〜PA8にハイレベルVsch2を維持していて順次ローレベルVscl2を持つ走査パルスを印加し、維持期間PS1〜PS8にハイレベルVs2及びローレベルVgを交互に持つ維持パルスを印加する。
X駆動部1208は、リセット期間の下降パルスの印加時からアドレス期間までバイアス電圧Vb2を印加し、維持期間にハイレベルVs2及びローレベルVgを交互に持つ維持パルスを印加する。Y駆動部1204から出力される維持パルスとX駆動部1208から出力される維持パルスとは互いに交互し、これにより放電セル内で維持放電が行われる。
A駆動部1206は、アドレス期間に上記走査パルスに合せて表示データ信号を印加する。表示データ信号及び走査パルスによりアドレス期間でアドレス放電が行われる。
図13は、本願発明の第2実施形態の駆動方法であって、図9のPDPを駆動する駆動信号を示す図面である。
図9の駆動方法は時分割階調表現方式により、これは図6に示した方法による。一方、図13の駆動信号は、図8の駆動信号と類似しているので、その差異点を中心として説明する。
図9〜図13を参照して説明すれば、リセット期間PR1〜PR8は、放電セルを初期化させる期間であって、最初のサブフィールドのリセット期間PR1にY電極には上昇パルス及び下降パルスが印加され、二番目サブフィールド以後のリセット期間PR2〜PR8にY電極には下降パルスが印加され、あらゆるサブフィールドのリセット期間PR1〜PR8にX電極にはローレベルの電圧、例えば、接地電圧Vgが印加されるが、下降パルスの印加中にはバイアス電圧Vb2が印加され、Y電極にはローレベルの電圧Vgが印加される。上昇パルスは、維持放電電圧Vs2から上昇して上昇最高電圧Vs2+Vset2に到達し、下降パルスは、維持放電電圧Vs2から下降して下降最低電圧Vnf2まで下降する。
最初のサブフィールドのリセット期間PR1では上昇パルスの印加によって、放電セル内のY電極の周囲に負極性の壁電荷が溜まりつつY電極とA電極との間及びY電極とX電極との間にリセット放電が発生する。下降パルスの印加によって、放電セル内のY電極の周囲に溜まっていた負極性の壁電荷が消去されつつ、Y電極とA電極との間及びY電極とX電極との間にリセット放電が行われる。
二番目サブフィールド以後のリセット期間PR2〜PR8で下降パルスを印加する場合に、リセット期間以前の維持期間PS1〜PS7で維持放電が行われた放電セルでは、壁電荷が放電セル内の各電極付近、特にY電極付近に溜まっているので、下降パルスの印加によって壁電荷が消去されつつY電極とA電極との間及びY電極とX電極との間でリセット放電が行われる。
上記リセット放電によって、放電セル内の壁電荷状態が初期化され、アドレス期間のアドレス放電に適した壁電荷状態が組成される。リセット期間以前の維持期間PS1〜PS7で維持放電が行われていない放電セルでは壁電荷がY電極付近に溜まっていないので、下降パルスが印加されても消去する壁電荷がないのでリセット放電も行われない。すなわち、放電セルの初期化状態が既に形成されているので、再び放電セルを初期化する必要がなくなる。結局、本発明の駆動信号により、リセット期間PR1〜PR8後にはアドレス放電の実行に適した壁電荷状態が放電セル内に組成される。
このような本実施形態の特徴によれば、二番目サブフィールド以後のリセット期間PR2〜PR8を最初のサブフィールドのリセット期間PR1より短くすることができ、さらに、高画質のPDPの趨勢によってアドレス期間が増加するしかない場合に、アドレス期間をさらに確保することもできる。また不要なリセット光が発生しないのでコントラスト向上に役に立つ。
アドレス期間PA1〜PA8は、ターンオンされるべき放電セルとターンオンされてはならない放電セルとを区分する期間であって、図面では書き込み放電方式、すなわちターンオンされるべき放電セルでのみアドレス放電を行う方式を図示しているが、これに限定されず、選択消去方式、すなわち、全体放電セルでアドレス放電が行われ、ターンオンされてはならない放電セルでのみ消去放電を行う方式も可能である。
図面で図示されたように、書き込み放電方式によれば、Y電極にハイレベル電位Vsch2及びローレベルの電位Vscl2を持つ走査パルスを順次印加し、走査パルスのローレベルの電位Vscl2に合せてハイレベルVa2を持つ表示データ信号をA電極に印加し、X電極にはバイアス電圧Vb2を印加し続ける。走査パルス及び表示データ信号の印加によって放電セル内のY電極とA電極との間にはアドレス放電が行われ、アドレス放電後にY電極の周囲には正極性の壁電荷が、A電極の周囲には負極性の壁電荷が、X電極の周囲には負極性の壁電荷が溜まる。
維持期間PS1〜PS8は、ターンオンされるべきセルと選択された放電セルで割り当てられた階調加重値によって維持放電が行われる期間であって、Y電極及びX電極にハイレベルVs2及びローレベルVgを交代に持つ維持パルスが交互に印加され、A電極にはローレベルの電位Vgが印加される。維持パルスのハイレベル電位は維持放電電圧Vs2ともいう。維持パルスの数は階調加重値に比例して印加される。すなわち、維持放電の回数により割り当てられた階調加重値ほど階調が表現される。
まず、Y電極に維持パルスのハイレベルの電位Vs2が印加されれば、放電セル内のY電極の周囲に溜まっていた正極性の壁電荷と、X電極の周囲に溜まっていた負極性の壁電荷と、Y電極に印加される電位Vs2及びX電極に印加される電位Vgにより維持放電が行われ、維持放電終了後にX電極の周囲には正極性の壁電荷が、Y電極の周囲には負極性の壁電荷が溜まる。次いで、X電極に維持パルスのハイレベルの電位Vs2が印加されれば、放電セル内のY電極の周囲に溜まっていた負極性の壁電荷と、X電極の周囲に溜まっていた正極性の壁電荷と、Y電極に印加される電位Vgと、X電極に印加される電位Vs2とにより維持放電が行われ、維持放電終了後にX電極の周囲には負極性の壁電荷が、Y電極の周囲には正極性の壁電荷が溜まる。上記のような方式により、階調加重値による維持パルスの数によって維持放電が行われ続ける。
このように、新構造のPDPについての本発明の駆動方法によれば、最初のサブフィールドのリセット期間では全体放電セルでリセット放電が行われるが、二番目サブフィールドからのリセット期間では、リセット期間前の維持期間で維持放電が行われた放電セルでのみリセット放電が行われる。
そして、維持期間の維持放電によってリセット放電が選択的に行われるので、不要なリセット光を減らすことができてコントラストが向上する。
さらに、実質的に二番目サブフィールドからのリセット期間は、初めての(一番目の)サブフィールドのリセット期間より短くできるので、短縮されたリセット期間の長さをアドレス期間に割り当てることができて、安定的にアドレッシングを行える。
以上、添付図面を参照しながら本発明の好適な実施形態について説明したが、本発明はかかる例に限定されない。当業者であれば、特許請求の範囲に記載された技術的思想の範疇内において、各種の変更例または修正例に想到し得ることは明らかであり、それらについても当然に本発明の技術的範囲に属するものと了解される。
本発明は、プラズマディスプレイ装置の関連技術分野に好適に用いられる。
コメント、細かいことですが、今後修正するときは、下記ひながたをご参考ください
従来技術による3電極面放電方式のPDPの部分分離斜視図である。
図1のPDPをII−II線に沿って切り取った平面図である。
本発明の第1実施形態にかかるPDPを示す図面である。
図3においてIV−IV線に沿って切り取った断面図である。
図3及び図4に示した放電セル及び電極構造を示す配置図である。
図3のPDPを駆動するための駆動方法を簡略に示すタイミング図である。
図3のPDP及びこれを駆動するための駆動装置を示すプラズマディスプレイ装置の簡略なブロック図である。
本発明の第1実施形態にかかるPDPを駆動する駆動信号を示す図面である。
本発明のPDPの駆動方法により駆動される発光効率及び永久残像が改善されたPDPの他の例を示す図面である。
図9においてX−X線に沿って切り取った断面図である。
図9及び図12に示した放電セル及び電極構造を示す配置図である。
図9のPDP及びこれを駆動するための駆動装置を示すプラズマディスプレイ装置の簡略なブロック図である。
本発明の第2実施形態にかかるPDPを駆動する駆動信号を示す図面である。
200 PDP
210 第1基板
210a 溝
212 第1電極
213 第2電極
214 隔壁
216 第1保護膜
220 第2基板
225 蛍光体層
210 第1基板
210a 溝
212 第1電極
213 第2電極
214 隔壁
216 第1保護膜
220 第2基板
225 蛍光体層
Claims (22)
- プラズマディスプレイパネルの駆動方法において:
互いに離隔して配置される第1基板及び第2基板と、前記第1基板及び前記第2基板と共に放電空間である放電セルを区画する隔壁と、前記隔壁内に配置され、互いに交差して延設された第1電極及び第2電極と、前記放電セル内に配置される蛍光体層と、前記放電セル内にある放電ガスと、を備え、
前記駆動方法は、画像を表示する単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、前記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、前記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電を行う維持期間と、に分けられ、
前記単位フレームの最初のサブフィールドのリセット期間には全体放電セルが初期化されるようにリセット放電が行われ、前記単位フレームの二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみ初期化されるようにリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法。 - 前記最初のサブフィールドのリセット期間では、前記第1電極に上昇パルス及び下降パルスが印加され、
前記二番目サブフィールド以降のリセット期間では、前記第1電極に下降パルスが印加されることを特徴とする、請求項1に記載のプラズマディスプレイパネルの駆動方法。 - 前記上昇パルス及び前記下降パルスは、ランプパルスであることを特徴とする、請求項2に記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドのリセット期間において、前記下降パルスが印加される間に前記第2電極にはバイアス電圧が印加されることを特徴とする、請求項2または3に記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドのアドレス期間において、前記第1電極はハイレベルを維持して、前記第1電極の各々に順次ローレベルをもつ走査バルスが印加され、前記第2電極には前記走査パルスのローレベルに合せて表示データ信号が印加されることを特徴とする、請求項1〜4のいずれかに記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドの維持期間において、前記第1電極にはハイレベル及びローレベルを交互に持つ維持パルスが印加され、前記第2電極には前記維持パルスのハイレベルとローレベル間の中間レベルが印加されることを特徴とする、請求項1〜5のいずれかに記載のプラズマディスプレイパネルの駆動方法。
- プラズマディスプレイパネルの駆動方法において:
互いに離隔して配置される第1基板及び第2基板と、前記第1基板及び前記第2基板と共に放電空間の放電セルを区画する隔壁と、前記隔壁内に配置されるが、一方向に延びる第1電極及び第2電極と、前記隔壁内に配置されるが、前記第1電極及び前記第2電極に交差して延びる第3電極と、前記放電セル内に配置される蛍光体層と、前記放電セル内にある放電ガスと、を備え、
前記駆動方法は、画像を表示する単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、前記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、前記ターンオンされるべきセルとして選択された放電セルで、各サブフィールド別に割り当てられた階調加重値によって維持放電を行う維持期間と、に分けられ、
前記単位フレームの最初のサブフィールドのリセット期間には、全体放電セルが初期化されるようにリセット放電が行われ、前記単位フレームの二番目サブフィールド以降のリセット期間には、リセット期間以前の維持期間で維持放電が行われた放電セルのみ初期化されるようにリセット放電が行われることを特徴とするプラズマディスプレイパネルの駆動方法。 - 前記最初のサブフィールドのリセット期間において、前記第1電極に上昇パルス及び下降パルスが印加され、
前記二番目サブフィールド以降のリセット期間において、前記第1電極に下降パルスが印加されることを特徴とする、請求項7に記載のプラズマディスプレイパネルの駆動方法。 - 前記上昇パルス及び前記下降パルスは、ランプパルスであることを特徴とする、請求項8に記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドのリセット期間において、前記下降パルス印加時から前記第2電極にはバイアス電圧が印加されることを特徴とする、請求項8または9に記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドのアドレス期間において、前記第1電極はハイレベルを維持して、前記第1電極の各々に順次ローレベルをもつ走査バルスが印加され、前記第3電極には前記走査パルスのローレベルに合せて表示データ信号が印加され、前記第2電極にはバイアス電圧が印加されることを特徴とする、請求項7〜10のいずれかに記載のプラズマディスプレイパネルの駆動方法。
- 前記各サブフィールドの維持期間では、前記第1電極及び前記第2電極には、交互にハイレベルの維持パルスが印加されることを特徴とする、請求項8に記載のプラズマディスプレイパネルの駆動方法。
- 互いに離隔して配置される第1基板及び第2基板と、前記第1基板及び前記第2基板と共に放電空間である放電セルを区画する隔壁と、前記隔壁内に配置されるが、互いに交差して延びる第1電極及び第2電極と、前記放電セル内に配置される蛍光体層と、前記放電セル内にある放電ガスと、を備えるプラズマディスプレイパネルと;
前記プラズマディスプレイパネルを駆動するように、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは、前記放電セルを初期化するリセット期間と、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間と、前記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電が行われる維持期間と、に分けられ、前記リセット、アドレス及び維持期間に分けられる駆動信号を前記各電極に印加する駆動部と;を備え、
前記駆動部は、前記第1電極に駆動信号を印加する第1駆動部と、前記第2電極に駆動信号を印加する第2駆動部とに分けられ、
前記第1駆動部は、最初のサブフィールドのリセット期間に上昇パルス及び下降パルスを印加し、二番目サブフィールドのリセット期間以降は下降パルスを印加することを特徴とするプラズマディスプレイ装置。 - 前記上昇パルス及び下降パルスはランプパルスであることを特徴とする、請求項13に記載のプラズマディスプレイ装置。
- 前記第2駆動部は、前記各サブフィールドのリセット期間において、前記下降パルスが印加される間にバイアス電圧を印加することを特徴とする、請求項13または14のいずれかに記載のプラズマディスプレイ装置。
- 前記各サブフィールドのアドレス期間において、前記第1駆動部は、前記第1電極の各々にハイレベルを維持させ、順次ローレベルをもつ走査バルスを印加し、前記第2駆動部は、前記走査パルスのローレベルに合せて表示データ信号を印加することを特徴とする、請求項13〜15のいずれかに記載のプラズマディスプレイ装置。
- 前記各サブフィールドの維持期間で、前記第1駆動部は、ハイレベル及びローレベルを交互に持つ維持パルスを印加し、前記第2駆動部は、前記維持パルスのハイレベルとローレベルとの中間レベルを印加することを特徴とする、請求項13〜16のいずれかに記載のプラズマディスプレイ装置。
- 互いに離隔して配置される第1基板及び第2基板と、前記第1基板及び第2基板と共に放電空間の放電セルを区画する隔壁と、前記隔壁内に配置されるが、一方向に延びる第1電極及び第2電極と、前記隔壁内に配置されるが、前記第1電極及び第2電極に交差して延びる第3電極と、前記放電セル内に配置される蛍光体層と、前記放電セル内にある放電ガスと、を備えるプラズマディスプレイパネルと、
前記プラズマディスプレイパネルを駆動するように、単位フレームが複数個のサブフィールドに分けられ、各サブフィールドは放電セルを初期化するリセット期間、ターンオンされるべきセルとターンオンされてはならないセルとを区分するアドレス期間、及び前記ターンオンされるべきセルとして選択された放電セルで各サブフィールド別に割り当てられた階調加重値によって維持放電が行われる維持期間に分けられ、前記リセット、アドレス及び維持期間に分けられる駆動信号を前記各電極に印加する駆動部と、を備え、
前記駆動部は、前記第1電極に駆動信号を印加する第1駆動部と、前記第2電極に駆動信号を印加する第2駆動部と、前記第3電極に駆動信号を印加する第3駆動部とに分けられ、
前記第1駆動部は、前記最初のサブフィールドのリセット期間で上昇パルス及び下降パルスを印加し、前記二番目サブフィールドからのリセット期間で下降パルスを印加することを特徴とするプラズマディスプレイ装置。 - 前記上昇パルス及び下降パルスはランプパルスであることを特徴とする、請求項18に記載のプラズマディスプレイ装置。
- 前記第2駆動部は、前記各サブフィールドのリセット期間で前記下降パルス印加時からバイアス電圧を印加することを特徴とする、請求項18または19に記載のプラズマディスプレイ装置。
- 前記各サブフィールドのアドレス期間で、前記第1駆動部は、前記第1電極の各々にハイレベルを維持させ、順次ローレベルをもつ走査バルスを印加し、前記第3駆動部は、前記走査パルスのローレベルに合せて表示データ信号を印加し、前記第2駆動部はバイアス電圧を印加することを特徴とする、請求項18〜20のいずれかに記載のプラズマディスプレイ装置。
- 前記各サブフィールドの維持期間で、前記第1駆動部及び第2駆動部は、前記第1電極及び前記第2電極に交互にハイレベルの維持パルスを印加することを特徴とする、請求項18〜21のいずれかに記載のプラズマディスプレイ装置。
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