JP2006525726A - 利得ブロックとスイッチとを備えるミキサー・システム - Google Patents
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- 230000010355 oscillation Effects 0.000 claims abstract description 22
- 230000001939 inductive effect Effects 0.000 claims description 16
- 230000006698 induction Effects 0.000 claims description 12
- 238000000034 method Methods 0.000 claims description 4
- 230000008878 coupling Effects 0.000 abstract description 8
- 238000010168 coupling process Methods 0.000 abstract description 8
- 238000005859 coupling reaction Methods 0.000 abstract description 8
- 238000010586 diagram Methods 0.000 description 4
- 230000003071 parasitic effect Effects 0.000 description 4
- 230000014509 gene expression Effects 0.000 description 3
- 230000005669 field effect Effects 0.000 description 2
- 230000000903 blocking effect Effects 0.000 description 1
- 230000021615 conjugation Effects 0.000 description 1
- 230000001419 dependent effect Effects 0.000 description 1
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- H03D7/1458—Double balanced arrangements, i.e. where both input signals are differential
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- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
- H03D2200/00—Indexing scheme relating to details of demodulation or transference of modulation from one carrier to another covered by H03D
- H03D2200/0001—Circuit elements of demodulators
- H03D2200/0007—Dual gate field effect transistors
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- H03D—DEMODULATION OR TRANSFERENCE OF MODULATION FROM ONE CARRIER TO ANOTHER
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- H03D2200/0001—Circuit elements of demodulators
- H03D2200/0025—Gain control circuits
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- Engineering & Computer Science (AREA)
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Abstract
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- 利得ブロックと、スイッチとを備え、第1、第2、第3、および第4の利得ブロックの制御電極は、データ入力信号を誘導するためのデータ入力を構成し、前記第1および第3の利得ブロックの第1の主電極は、互いに結合されるとともに第1のインピーダンスに結合され、前記第2および第4の利得ブロックの第1の主電極は、互いに結合されるとともに、出力信号を誘導するための出力を構成するために第2のインピーダンスに結合され、前記第1および第2の利得ブロックの第2の主電極は、第1のスイッチを介して互いに結合され、前記第3および第4の利得ブロックの第2の主電極は、第2のスイッチを介して互いに結合され、前記スイッチの制御電極は、発振信号を誘導するための発振入力を構成するミキサー・システム。
- 各スイッチが、少なくとも1つのスイッチ・トランジスタを備え、各利得ブロックが、少なくとも1つの利得ブロック・トランジスタを備える、請求項1に記載のミキサー・システム。
- 前記第1のスイッチの第1の主電極は、第3のインピーダンスを介して、前記第1の利得ブロックの前記第2の主電極に結合され、前記第1のスイッチの第2の主電極は、第4のインピーダンスを介して、前記第2の利得ブロックの前記第2の主電極に結合され、前記第2のスイッチの第1の主電極は、第5のインピーダンスを介して、前記第4の利得ブロックの前記第2の主電極に結合され、前記第2のスイッチの第2の主電極は、第6のインピーダンスを介して、前記第3の利得ブロックの前記第2の主電極に結合され、前記第2および第3の利得ブロックの前記制御電極は、第7のインピーダンスを介して、電圧誘導端子に結合される、請求項2に記載のミキサー・システム。
- 前記第1のスイッチの第1の主電極は、第3のインピーダンスを介して、前記第1の利得ブロックの前記第2の主電極に結合され、前記第1のスイッチの第2の主電極は、直接、前記第2の利得ブロックの前記第2の主電極に結合され、前記第2のスイッチの第1の主電極は、第5のインピーダンスを介して、前記第4の利得ブロックの前記第2の主電極に結合され、前記第2のスイッチの第2の主電極は、直接、前記第3の利得ブロックの前記第2の主電極に結合され、前記第2および第3の利得ブロックの前記制御電極は、直接、電圧誘導端子に結合される、請求項2に記載のミキサー・システム。
- 前記第1のスイッチに対して並列な第3のスイッチと、前記第2のスイッチに対して並列な第4のスイッチとを備え、前記第3および第4のスイッチの制御電極は、さらなる発振信号を誘導するためのさらなる発振入力を構成する、請求項2に記載のミキサー・システム。
- 前記第3のスイッチの第1の主電極は、第8のインピーダンスを介して、前記第1の利得ブロックの前記第2の主電極に結合され、前記第3のスイッチの第2の主電極は、第9のインピーダンスを介して、前記第2の利得ブロックの前記第2の主電極に結合され、前記第4のスイッチの第1の主電極は、第10のインピーダンスを介して、前記第4の利得ブロックの前記第2の主電極に結合され、前記第4のスイッチの第2の主電極は、第11のインピーダンスを介して、前記第3の利得ブロックの前記第2の主電極に結合され、前記第2および第3の利得ブロックの前記制御電極は、第7のインピーダンスを介して、電圧誘導端子に結合される、請求項5に記載のミキサー・システム。
- 前記第3のスイッチの第1の主電極は、第8のインピーダンスを介して、前記第1の利得ブロックの前記第2の主電極に結合され、前記第3のスイッチの第2の主電極は、直接、前記第2の利得ブロックの前記第2の主電極に結合され、前記第4のスイッチの第1の主電極は、第10のインピーダンスを介して、前記第4の利得ブロックの前記第2の主電極に結合され、前記第4のスイッチの第2の主電極は、直接、前記第3の利得ブロックの前記第2の主電極に結合され、前記第2および第3の利得ブロックの前記制御電極は、直接、電圧誘導端子に結合される、請求項5に記載のミキサー・システム。
- 各スイッチが、少なくとも1つのスイッチ・トランジスタを備え、各利得ブロックが、第1、第2、第3、第4、および第5の利得ブロック・トランジスタを少なくとも備え、前記第1の利得ブロック・トランジスタの制御電極は、前記利得ブロックの制御入力を構成し、前記第1の利得ブロック・トランジスタの第1の主電極は、前記第2の利得ブロック・トランジスタの第1の主電極および制御電極と、前記第3の利得ブロック・トランジスタの制御電極とに結合され、前記第2の利得ブロック・トランジスタの第2の主電極は、前記第3の利得ブロック・トランジスタの第2の主電極と、電圧誘導端子とに結合され、前記第1の利得ブロック・トランジスタの第2の主電極は、前記第4の利得ブロック・トランジスタの第2の主電極と、電流誘導端子とに結合され、前記第4の利得ブロック・トランジスタの制御電極は、前記利得ブロックの第2の主電極を構成し、前記第5の利得ブロック・トランジスタの第2の主電極に結合され、前記第4の利得ブロック・トランジスタの第1の主電極は、前記第5の利得ブロック・トランジスタの制御電極と、前記第3の利得ブロック・トランジスタの第1の主電極と、に結合され、前記第5の利得ブロック・トランジスタの第1の主電極は、前記利得ブロックの第1の主電極を構成する、請求項1に記載のミキサー・システム。
- 利得ブロックと、スイッチとを備えるミキサー・システムで用いられる利得ブロック・システムであって、第1、第2、第3、および第4の利得ブロックの制御電極は、データ入力信号を誘導するためのデータ入力を構成し、前記第1および第3の利得ブロックの第1の主電極は、互いに結合されるとともに、第1のインピーダンスに結合され、前記第2および第4の利得ブロックの第1の主電極は、互いに結合されるとともに、出力信号を誘導するための出力を構成するために第2のインピーダンスに結合され、前記第1および第2の利得ブロックの第2の主電極は、第1のスイッチを介して互いに結合され、前記第3および第4の利得ブロックの第2の主電極は、第2のスイッチを介して互いに結合され、前記スイッチの制御電極は、発振信号を誘導するための発振入力を構成し、利得ブロック・システムは、前記第1、第2、第3、および第4の利得ブロックを備える利得ブロック・システム。
- 利得ブロックと、スイッチとを備えるミキサー・システムで用いられるミキサーであって、第1、第2、第3、および第4の利得ブロックの制御電極は、データ入力信号を誘導するためのデータ入力を構成し、前記第1および第3の利得ブロックの第1の主電極は、互いに結合されるとともに、第1のインピーダンスに結合され、前記第2および第4の利得ブロックの第1の主電極は、互いに結合されるとともに、出力信号を誘導するための出力を構成するために第2のインピーダンスに結合され、前記第1および第2の利得ブロックの第2の主電極は、第1のスイッチを介して互いに結合され、前記第3および第4の利得ブロックの第2の主電極は、第2のスイッチを介して互いに結合され、前記スイッチの制御電極は、発振信号を誘導するための発振入力を構成し、ミキサーは、前記第1および第2のスイッチを備えるミキサー。
- ミキサー・システムで用いられ、少なくとも第1、第2、第3、第4、および第5の利得ブロック・トランジスタを備える利得ブロックであって、前記第1の利得ブロック・トランジスタの制御電極は、前記利得ブロックの制御入力を構成し、前記第1の利得ブロック・トランジスタの第1の主電極は、前記第2の利得ブロック・トランジスタの第1の主電極および制御電極と、前記第3の利得ブロック・トランジスタの制御電極とに結合され、前記第2の利得ブロック・トランジスタの第2の主電極は、前記第3の利得ブロック・トランジスタの第2の主電極と、電圧誘導端子と、に結合され、前記第1の利得ブロック・トランジスタの第2の主電極は、前記第4の利得ブロック・トランジスタの第2の主電極と、電流誘導端子とに結合され、前記第4の利得ブロック・トランジスタの制御電極は、前記利得ブロックの第2の主電極を構成し、前記第5の利得ブロック・トランジスタの第2の主電極に結合され、前記第4の利得ブロック・トランジスタの第1の主電極は、前記第5の利得ブロック・トランジスタの制御電極と、前記第3の利得ブロック・トランジスタの第1の主電極とに結合され、前記第5の利得ブロック・トランジスタの第1の主電極は、前記利得ブロックの第1の主電極を構成する利得ブロック。
- 利得ブロックと、スイッチとを含むミキサー・システムを備える装置であって、第1、第2、第3、および第4の利得ブロックの制御電極は、データ入力信号を誘導するためのデータ入力を構成し、前記第1および第3の利得ブロックの第1の主電極は、互いに結合されるとともに、第1のインピーダンスに結合され、前記第2および第4の利得ブロックの第1の主電極は、互いに結合されるとともに、出力信号を誘導するための出力を構成するために第2のインピーダンスに結合され、前記第1および第2の利得ブロックの第2の主電極は、第1のスイッチを介して互いに結合され、前記第3および第4の利得ブロックの第2の主電極は、第2のスイッチを介して互いに結合され、前記スイッチの制御電極は、発振信号を誘導するための発振入力を構成する装置。
- データ入力信号と発振信号とを利得ブロックとスイッチとを介して混合するための方法であって、第1、第2、第3、および第4の利得ブロックの制御電極においてデータ入力信号を誘導するステップと、互いに結合されるとともに、第1のインピーダンスに結合される前記第1および第3の利得ブロックの第1の主電極と、互いに結合されるとともに、第2のインピーダンスに結合される前記第2および第4の利得ブロックの第1の主電極とにおいて、出力信号を誘導するステップと、第1および第2のスイッチの制御電極において発振信号を誘導するステップと、を備え、前記第1および第2の利得ブロックの第2の主電極は、前記第1のスイッチを介して互いに結合され、前記第3および第4の利得ブロックの第2の主電極は、前記第2のスイッチを介して互いに結合される方法。
Applications Claiming Priority (2)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
EP03101180 | 2003-04-29 | ||
PCT/IB2004/050524 WO2004098043A2 (en) | 2003-04-29 | 2004-04-27 | Mixer-system with gain-blocks and switches |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2006525726A true JP2006525726A (ja) | 2006-11-09 |
Family
ID=33395954
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2006506906A Ceased JP2006525726A (ja) | 2003-04-29 | 2004-04-27 | 利得ブロックとスイッチとを備えるミキサー・システム |
Country Status (7)
Country | Link |
---|---|
US (2) | US7282982B2 (ja) |
EP (1) | EP1620941B1 (ja) |
JP (1) | JP2006525726A (ja) |
KR (1) | KR20060009276A (ja) |
CN (1) | CN100492883C (ja) |
AT (1) | ATE531123T1 (ja) |
WO (1) | WO2004098043A2 (ja) |
Families Citing this family (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
KR101387499B1 (ko) * | 2007-01-09 | 2014-04-21 | 엘지전자 주식회사 | 주파수도약을 적용하는 데이터 송신 방법 및주파수도약방식용 부대역 결정 방법 |
Family Cites Families (19)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
US4594555A (en) * | 1984-10-29 | 1986-06-10 | Hewlett-Packard Company | Frequency selective sampling detector |
US4937516A (en) * | 1987-11-13 | 1990-06-26 | U.S. Philips Corporation | Balanced voltage-current converter and double-balanced mixer circuit comprising such a converter |
US5151625A (en) | 1990-11-08 | 1992-09-29 | The Ohio State University | High frequency BiMOS linear V-I converter, voltage multiplier, mixer |
US5334949A (en) * | 1992-02-27 | 1994-08-02 | Nec Corporation | Differential amplifiers |
EP0565299A1 (en) | 1992-04-07 | 1993-10-13 | Hughes Aircraft Company | Double-balanced active mixer with single-ended-to-differential voltage-current conversion circuits |
US6026286A (en) * | 1995-08-24 | 2000-02-15 | Nortel Networks Corporation | RF amplifier, RF mixer and RF receiver |
KR100204591B1 (ko) | 1996-11-18 | 1999-06-15 | 정선종 | 복제 전압-전류 변환기를 사용한 혼합기 |
EP1067673A3 (de) * | 1999-06-30 | 2001-08-29 | Infineon Technologies AG | Mischer mit einstellbarer Linearität |
GB9915919D0 (en) * | 1999-07-08 | 1999-09-08 | Mitel Semiconductor Ltd | Radio frequency amplifier |
US6975838B1 (en) * | 1999-10-21 | 2005-12-13 | Broadcom Corporation | Adaptive radio transceiver with noise suppression |
EP1128546A1 (en) * | 2000-02-28 | 2001-08-29 | Deutsche Thomson-Brandt Gmbh | Upconverter mixer circuit |
US6965655B1 (en) * | 2000-06-20 | 2005-11-15 | Texas Instruments Incorporated | Apparatus for and method of optimizing the performance of a radio frequency receiver in the presence of interference |
US6807406B1 (en) * | 2000-10-17 | 2004-10-19 | Rf Micro Devices, Inc. | Variable gain mixer circuit |
WO2002045253A1 (fr) | 2000-12-01 | 2002-06-06 | Mitsubishi Denki Kabushiki Kaisha | Amplificateur haute fréquence |
JP2003060441A (ja) * | 2001-08-10 | 2003-02-28 | Toshiba Corp | ダブルバランスミキサー回路とそれを用いた直交復調回路 |
WO2004057768A1 (ja) * | 2002-12-20 | 2004-07-08 | Renesas Technology Corp. | 送信回路およびそれを用いた送受信機 |
US7107025B2 (en) * | 2003-04-25 | 2006-09-12 | Broadcom Corporation | High gain, highly linear mixer |
US7161406B1 (en) * | 2004-04-15 | 2007-01-09 | Xilinx, Inc. | Method and apparatus for providing non 2:1 Gilbert cell mixer |
US7116172B2 (en) * | 2004-11-03 | 2006-10-03 | Texas Instruments Incorporated | High-swing folded cascode having a novel gain-boost amplifier |
-
2004
- 2004-04-27 AT AT04729693T patent/ATE531123T1/de not_active IP Right Cessation
- 2004-04-27 CN CNB2004800115226A patent/CN100492883C/zh not_active Expired - Fee Related
- 2004-04-27 KR KR1020057020399A patent/KR20060009276A/ko not_active Application Discontinuation
- 2004-04-27 WO PCT/IB2004/050524 patent/WO2004098043A2/en active Application Filing
- 2004-04-27 JP JP2006506906A patent/JP2006525726A/ja not_active Ceased
- 2004-04-27 US US10/554,529 patent/US7282982B2/en not_active Expired - Lifetime
- 2004-04-27 EP EP04729693A patent/EP1620941B1/en not_active Expired - Lifetime
-
2007
- 2007-10-12 US US11/871,338 patent/US7856223B2/en not_active Expired - Fee Related
Also Published As
Publication number | Publication date |
---|---|
CN100492883C (zh) | 2009-05-27 |
EP1620941B1 (en) | 2011-10-26 |
EP1620941A2 (en) | 2006-02-01 |
US7282982B2 (en) | 2007-10-16 |
ATE531123T1 (de) | 2011-11-15 |
US20070052469A1 (en) | 2007-03-08 |
KR20060009276A (ko) | 2006-01-31 |
WO2004098043A2 (en) | 2004-11-11 |
US7856223B2 (en) | 2010-12-21 |
CN1781243A (zh) | 2006-05-31 |
US20080032657A1 (en) | 2008-02-07 |
WO2004098043A3 (en) | 2005-01-06 |
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Legal Events
Date | Code | Title | Description |
---|---|---|---|
A621 | Written request for application examination |
Free format text: JAPANESE INTERMEDIATE CODE: A621 Effective date: 20070425 |
|
A711 | Notification of change in applicant |
Free format text: JAPANESE INTERMEDIATE CODE: A711 Effective date: 20080619 |
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A761 | Written withdrawal of application |
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A131 | Notification of reasons for refusal |
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AA92 | Notification that decision to refuse application was cancelled |
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AA92 | Notification that decision to refuse application was cancelled |
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