JP2006245500A - Semiconductor device and its manufacturing method - Google Patents
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Abstract
Description
本発明は、半導体製造技術に関し、特に、高周波モジュールに適用して有効な技術に関する。 The present invention relates to a semiconductor manufacturing technique, and more particularly to a technique effective when applied to a high-frequency module.
高周波用電力増幅器は、ガラスを主成分とする多層基板と、基板内に形成されたストリップ線路と、基板上に実装された接続導体を介してストリップ線路に電気的に接続された電力用トランジスタならびにチップ部品と、基板の側面に設けられた凹部に形成されストリップ線路に電気的に接続された端子電極と、電力用トランジスタ下部に形成された放熱用ビアホールとを具備している(例えば、特許文献1参照)。
携帯用通信機器などに組み込まれる高周波用のモジュール(半導体装置)の一例として、RFモジュールと呼ばれる半導体パッケージが知られている。近年、RFモジュールでは、モジュールの複合化の要求が高まっている。例えば、パワーアンプモジュールとアンテナスイッチモジュールの複合モジュールなどであり、このような複合モジュールでは、同一基板上にそれぞれのモジュールが形成されて1モジュール化された構造となっている。 As an example of a high-frequency module (semiconductor device) incorporated in a portable communication device or the like, a semiconductor package called an RF module is known. In recent years, in the RF module, there has been an increasing demand for module combination. For example, it is a composite module of a power amplifier module and an antenna switch module. In such a composite module, each module is formed on the same substrate to form a single module.
したがって、複合モジュールとしての電気的特性は1モジュール化された構造にて出さなければならず、1モジュール化後の電気的特性検査で不具合が発生した際に、同一基板上での2種類のモジュールに対しての不具合箇所の特定などは非常に困難であり、その結果、特性評価に時間がかかって開発期間が長くなるという問題が起こる。 Therefore, the electrical characteristics as a composite module must be produced in a single-module structure, and two types of modules on the same substrate when a malfunction occurs in the electrical characteristics inspection after the single-module construction. However, it is very difficult to identify a defective part, and as a result, it takes time to evaluate the characteristics, resulting in a long development period.
さらに、個々のモジュールでは配線の層数が異なったそれぞれの基板にて各モジュールを形成しているが、複合モジュールでは同一基板上に2種類のモジュールを形成するため、必然的に層数の多い方に合わせた多層配線基板を用いることになる。 In addition, each module is formed on each substrate with a different number of wiring layers in each module. However, in a composite module, two types of modules are formed on the same substrate, which inevitably has a large number of layers. A multilayer wiring board suitable for each direction is used.
これにより、層数の異なった2種類の多層配線基板を用いてそれぞれのモジュールを形成する場合に比較してコストが高くなるという問題が発生する。 As a result, there arises a problem that the cost increases compared to the case where each module is formed using two types of multilayer wiring boards having different numbers of layers.
本発明の目的は、開発期間の短縮化を図ることができる技術を提供することにある。 An object of the present invention is to provide a technique capable of shortening the development period.
また、本発明の他の目的は、コストの低減化を図ることができる技術を提供することにある。 Another object of the present invention is to provide a technique capable of reducing the cost.
本発明の前記ならびにその他の目的と新規な特徴は、本明細書の記述および添付図面から明らかになるであろう。 The above and other objects and novel features of the present invention will be apparent from the description of this specification and the accompanying drawings.
本願において開示される発明のうち、代表的なものの概要を簡単に説明すれば、以下のとおりである。 Of the inventions disclosed in this application, the outline of typical ones will be briefly described as follows.
すなわち、本発明は、半導体チップが搭載された第1多層配線基板と、前記第1多層配線基板の係合部に設けられた第1接続用端子とを有する第1構造体と、電子部品が搭載された第2多層配線基板と、前記第1接続用端子と電気的に接続されかつ前記第2多層配線基板の係合部に設けられた第2接続用端子とを有する第2構造体と、前記第1および第2多層配線基板に設けられた複数の外部端子とを有し、前記第1多層配線基板と前記第2多層配線基板とがそれぞれの前記係合部で接続し、前記第1多層配線基板の層数と前記第2多層配線基板の層数とが異なっているものである。 That is, according to the present invention, there is provided a first structure having a first multilayer wiring board on which a semiconductor chip is mounted, a first connection terminal provided at an engaging portion of the first multilayer wiring board, and an electronic component. A second structure having a second multilayer wiring board mounted thereon and a second connection terminal electrically connected to the first connection terminal and provided at an engaging portion of the second multilayer wiring board; A plurality of external terminals provided on the first and second multilayer wiring boards, wherein the first multilayer wiring board and the second multilayer wiring board are connected by the respective engaging portions, and The number of layers of one multilayer wiring board is different from the number of layers of the second multilayer wiring board.
また、本発明は、係合部を有する第1多層配線基板に半導体チップを搭載して第1構造体を形成する工程と、係合部を有する第2多層配線基板に電子部品を搭載して第2構造体を形成する工程と、前記第1構造体において前記半導体チップを封止する工程と、前記第2構造体において前記電子部品を封止する工程と、前記第1構造体の特性検査を行う工程と、前記第2構造体の特性検査を行う工程と、それぞれ前記特性検査で良品と判定された前記第1および第2構造体において、前記第1多層配線基板の係合部に設けられた第1接続用端子と前記第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で前記第1構造体と第2構造体を結合する工程とを有するものである。 The present invention also includes a step of mounting a semiconductor chip on a first multilayer wiring board having an engaging portion to form a first structure, and mounting an electronic component on a second multilayer wiring board having an engaging portion. A step of forming a second structure, a step of sealing the semiconductor chip in the first structure, a step of sealing the electronic component in the second structure, and a characteristic inspection of the first structure And a step of performing a characteristic inspection of the second structure, and a first structure and a second structure determined to be non-defective by the characteristic inspection, respectively, provided in the engaging portion of the first multilayer wiring board. The first connection terminal and the second connection terminal provided at the engagement portion of the second multilayer wiring board are electrically connected to each other, and the first structure and the second structure are respectively connected at the engagement portions. And a step of joining the bodies.
本願において開示される発明のうち、代表的なものによって得られる効果を簡単に説明すれば、以下のとおりである。 Of the inventions disclosed in the present application, effects obtained by typical ones will be briefly described as follows.
第1多層配線基板に半導体チップを搭載して第1構造体を形成し、さらに第2多層配線基板に電子部品を搭載して第2構造体を形成し、第1構造体の特性検査と第2構造体の特性検査をそれぞれ別々に行った後、第1多層配線基板の係合部に設けられた第1接続用端子と第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で第1構造体と第2構造体を結合することにより、それぞれ単体の構造体(モジュール)で検査や評価を行って特性の切り分けができてからそれぞれの構造体を結合するため、1モジュール化後の特性出しを容易に行うことができる。その結果、複合モジュールの製品開発の期間の短縮化を図ることができる。 A semiconductor chip is mounted on the first multilayer wiring board to form a first structure, and an electronic component is further mounted on the second multilayer wiring board to form a second structure. After performing the characteristic inspection of the two structures separately, the first connection terminal provided in the engaging portion of the first multilayer wiring board and the second connection provided in the engaging portion of the second multilayer wiring board By electrically connecting the terminals and coupling the first structure and the second structure at the respective engaging portions, it is possible to perform inspection and evaluation with each single structure (module) to separate the characteristics. Then, since the respective structures are coupled together, it is possible to easily obtain the characteristics after one module. As a result, the product development period of the composite module can be shortened.
以下の実施の形態では特に必要なとき以外は同一または同様な部分の説明を原則として繰り返さない。 In the following embodiments, the description of the same or similar parts will not be repeated in principle unless particularly necessary.
さらに、以下の実施の形態では便宜上その必要があるときは、複数のセクションまたは実施の形態に分割して説明するが、特に明示した場合を除き、それらはお互いに無関係なものではなく、一方は他方の一部または全部の変形例、詳細、補足説明などの関係にある。 Further, in the following embodiment, when it is necessary for the sake of convenience, the description will be divided into a plurality of sections or embodiments, but they are not irrelevant to each other unless otherwise specified. The other part or all of the modifications, details, supplementary explanations, and the like are related.
また、以下の実施の形態において、要素の数など(個数、数値、量、範囲などを含む)に言及する場合、特に明示した場合および原理的に明らかに特定の数に限定される場合などを除き、その特定の数に限定されるものではなく、特定の数以上でも以下でも良いものとする。 Also, in the following embodiments, when referring to the number of elements (including the number, numerical value, quantity, range, etc.), particularly when clearly indicated and when clearly limited to a specific number in principle, etc. Except, it is not limited to the specific number, and it may be more or less than the specific number.
以下、本発明の実施の形態を図面に基づいて詳細に説明する。なお、実施の形態を説明するための全図において、同一の機能を有する部材には同一の符号を付し、その繰り返しの説明は省略する。 Hereinafter, embodiments of the present invention will be described in detail with reference to the drawings. Note that components having the same function are denoted by the same reference symbols throughout the drawings for describing the embodiments, and the repetitive description thereof will be omitted.
(実施の形態)
図1は本発明の実施の形態の半導体装置(高周波複合モジュール)の構造の一例を示す斜視図、図2は図1に示す半導体装置の構造の一例を示す側面図、図3は図1に示すA−A線に沿って切断した構造の一例を示す断面図、図4は図1に示すB−B線に沿って切断した構造の一例を示す断面図、図5は図1に示す半導体装置を形成するパワーアンプモジュール(第1構造体)の構造の一例を示す斜視図、図6は図5に示すパワーアンプモジュールの構造の一例を示す側面図、図7は図5に示すA−A線に沿って切断した構造の一例を示す断面図、図8は図5に示すパワーアンプモジュールの構造の一例を示す裏面図、図9は図1に示す半導体装置を形成するアンテナスイッチモジュール(第2構造体)の構造の一例を示す斜視図、図10は図9に示すアンテナスイッチモジュールの構造の一例を示す側面図、図11は図9に示すA−A線に沿って切断した構造の一例を示す断面図、図12は図9に示すアンテナスイッチモジュールの構造の一例を示す平面図、図13は図9に示すアンテナスイッチモジュールの構造の一例を示す裏面図、図14は本発明の実施の形態の変形例の半導体装置(高周波複合モジュール)の組み立てにおける樹脂封止前の構造を示す断面図、図15は図14に示す変形例の半導体装置(高周波複合モジュール)の組み立てにおける樹脂封止後の構造を示す断面図である。
(Embodiment)
1 is a perspective view showing an example of the structure of a semiconductor device (high frequency composite module) according to an embodiment of the present invention, FIG. 2 is a side view showing an example of the structure of the semiconductor device shown in FIG. 1, and FIG. FIG. 4 is a cross-sectional view showing an example of the structure cut along the line BB shown in FIG. 1, and FIG. 5 is a cross-sectional view showing an example of the structure cut along the line BB shown in FIG. FIG. 6 is a perspective view showing an example of the structure of a power amplifier module (first structure) forming the apparatus, FIG. 6 is a side view showing an example of the structure of the power amplifier module shown in FIG. 5, and FIG. FIG. 8 is a rear view showing an example of the structure of the power amplifier module shown in FIG. 5, and FIG. 9 is an antenna switch module (FIG. 9) forming the semiconductor device shown in FIG. FIG. 10 is a perspective view showing an example of the structure of the (second structure). 9 is a side view showing an example of the structure of the antenna switch module shown in FIG. 9, FIG. 11 is a sectional view showing an example of the structure cut along the line AA shown in FIG. 9, and FIG. FIG. 13 is a back view showing an example of the structure of the antenna switch module shown in FIG. 9, and FIG. 14 is a diagram illustrating the assembly of a semiconductor device (high frequency composite module) according to a modification of the embodiment of the present invention. FIG. 15 is a cross-sectional view showing the structure after resin sealing in the assembly of the semiconductor device (high frequency composite module) of the modification shown in FIG.
図1〜図4に示す本実施の形態の半導体装置は、主に、携帯用通信機器などに組み込まれる高周波の半導体パッケージであり、本実施の形態では前記半導体装置の一例として、パワーアンプモジュールとアンテナスイッチモジュールを結合したRFモジュールである高周波複合モジュールを取り上げて説明する。 The semiconductor device of the present embodiment shown in FIGS. 1 to 4 is mainly a high-frequency semiconductor package incorporated in a portable communication device or the like. In the present embodiment, a power amplifier module is used as an example of the semiconductor device. A high-frequency composite module that is an RF module combined with an antenna switch module will be described.
高周波複合モジュール12の構成について説明すると、図2および図3に示すように、主面4a上に複数の半導体チップ1が搭載された第1多層配線基板4とこの基板の係合部である段差部4eに設けられた第1接続用端子4dとを有する第1構造体である図5に示すパワーアンプモジュール7と、主面5a上に複数のチップ部品(電子部品)2が搭載された第2多層配線基板5とこの基板の係合部である段差部5eに設けられた第2接続用端子5dとを有する第2構造体である図9に示すアンテナスイッチモジュール8と、第1多層配線基板4および第2多層配線基板5のそれぞれの主面4a,5a上に形成された封止体3と、図8および図13に示すように第1多層配線基板4および第2多層配線基板5のそれぞれの裏面4b,5bに設けられた複数の外部端子11とからなる。
The configuration of the high-
さらに、図4に示すように、それぞれの基板の段差部4e,5eにおいて第1接続用端子4dと第2接続用端子5dとが半田材などの導電性接着材10を介して電気的に接続されている。
Further, as shown in FIG. 4, the
すなわち、本実施の形態の高周波複合モジュール12は、それぞれ別個に組み立てたパワーアンプモジュール7とアンテナスイッチモジュール8において、それぞれのモジュールの電気的特性検査を行って特性出し・評価を行った後に、それぞれの良品を結合することによって1モジュール化したものである。
In other words, the high-
したがって、第1多層配線基板4と第2多層配線基板5は、それぞれ端部に厚さが基板の1/2程度に薄く形成された段差部4e,5eを有しており、パワーアンプモジュール7の第1多層配線基板4の段差部4eの下面4cには、図6、図8に示すように、他のモジュールと接続可能な接続専用の複数の第1接続用端子4dが設けられており、一方、図10、図12に示すように、アンテナスイッチモジュール8の第2多層配線基板5の段差部5eの上面5cには、第1接続用端子4dと同様の配列で他のモジュールと接続可能な接続専用の複数の第2接続用端子5dが設けられている。
Therefore, each of the first
この構造により、パワーアンプモジュール7とアンテナスイッチモジュール8は、第1多層配線基板4と第2多層配線基板5のそれぞれの段差部4e,5eにおいて、図4に示すように導電性接着材10を介して第1接続用端子4dと第2接続用端子5dとが、電気的かつ機械的に接続されている。
With this structure, the
さらに、パワーアンプモジュール7とアンテナスイッチモジュール8を結合した際に形成された両者間の隙間には、図2〜図4に示すようにアンダーフィル樹脂9が埋め込まれている。
Further, an
なお、高周波複合モジュール12の外部端子11は、ランドであるため、図1〜図4に示す本実施の形態の高周波複合モジュール12は、LGA(Land Grid Array)型の半導体装置である。
Since the
また、高周波複合モジュール12では、それぞれのモジュールが別個に組み立てられ、それぞれの電気的特性検査後に両者を結合した構造であるため、第1多層配線基板4の層数と第2多層配線基板5の層数とを合わせる必要がなく、両基板の層数はそれぞれの必要層数に応じた層数となっている。
In the high-
アンテナスイッチモジュール8では、コンデンサ等を内部に配置した方がより良好な電気的特性が得られるため、層数を増やした方が好ましく、本実施の形態の高周波複合モジュール12では、アンテナスイッチモジュール8の第2多層配線基板5の層数の方が、パワーアンプモジュール7の第1多層配線基板4の層数より多くなっている。ただし、両者の電気的特性が良好に得られるのであれば、第1多層配線基板4と第2多層配線基板5の層数は同じであってもよい。
In the
高周波複合モジュール12における第1構造体であるパワーアンプモジュール7には、図3および図7に示すように、半導体チップ1、さらにコンデンサ、抵抗およびコイルなどの複数のチップ部品2が第1多層配線基板4の主面4aの部品用端子4f上に搭載されている。半導体チップ1は、金線などのワイヤ6によって第1多層配線基板4の部品用端子4fと電気的に接続されており、また、チップ部品2は、半田14によって部品用端子4fと電気的に接続されている。
As shown in FIGS. 3 and 7, the
一方、高周波複合モジュール12における第2構造体であるアンテナスイッチモジュール8には、図3および図11に示すように、ダイオード13などの電子部品、さらにコンデンサ、抵抗およびコイルなどの複数のチップ部品2が第2多層配線基板5の主面5aの部品用端子5f上に半田14などを介して搭載されている。
On the other hand, the
なお、第1多層配線基板4および第2多層配線基板5は、例えば、セラミック材やガラス入りエポキシ樹脂材などからなる基板である。
The first
また、第1多層配線基板4および第2多層配線基板5に形成された第1接続用端子4dや第2接続用端子5d、さらに外部端子11や部品用端子4f,5fは、例えば、銅合金や銀を含む合金などからなる。
Further, the
また、封止体3は、例えば、シリコーン樹脂などの低弾性の柔らかな樹脂が好ましく、さらにチョコレートブレーク可能な樹脂が好ましい。
Moreover, the sealing
なお、封止体3は、例えば、印刷による樹脂封止によって形成されたものである。
The sealing
次に、本実施の形態の半導体装置の製造方法について説明する。 Next, a method for manufacturing the semiconductor device of the present embodiment will be described.
まず、図7に示すように端部に段差部4eを有し、かつこの段差部4eの下面4cに複数の第1接続用端子4dが設けられた第1多層配線基板4を準備し、その後、この第1多層配線基板4の主面4a上に半導体チップ1やチップ部品2を搭載する。
First, as shown in FIG. 7, a first
半導体チップ1やチップ部品2は第1多層配線基板4の部品用端子4fに半田付けなどで実装する。
The
その後、ワイヤボンディングを行って半導体チップ1と部品用端子4fとをワイヤ6で電気的に接続する。
Thereafter, wire bonding is performed to electrically connect the
その後、半導体チップ1およびチップ部品2を印刷により樹脂封止して第1多層配線基板4上に封止体3を形成し、これにより、図6に示すようなパワーアンプモジュール(第1構造体)7の組み立てを完了する。
Thereafter, the
その後、パワーアンプモジュール7の電気的特性検査を行って良品のパワーアンプモジュール7を取得する。
Thereafter, the electrical characteristics of the
一方、図11に示すように、端部に段差部5eを有し、かつこの段差部5eの上面5cに複数の第2接続用端子5dが設けられた第2多層配線基板5を準備し、その後、この第2多層配線基板5の主面5a上の部品用端子5fにダイオード13やチップ部品2を半田付けなどで実装する。
On the other hand, as shown in FIG. 11, a second
その後、半導体チップ1およびチップ部品2を印刷により樹脂封止して第2多層配線基板5上に封止体3を形成し、これにより、図10に示すようなアンテナスイッチモジュール(第2構造体)8の組み立てを完了する。
Thereafter, the
その後、アンテナスイッチモジュール8の電気的特性検査を行って良品のアンテナスイッチモジュール8を取得する。
Thereafter, the electrical characteristics of the
その後、それぞれ前記電気的特性検査で良品と判定されたパワーアンプモジュール7およびアンテナスイッチモジュール8において、それぞれの段差部4eと段差部5eを重ね合わせ、かつ第1多層配線基板4の段差部4eに設けられた第1接続用端子4dと第2多層配線基板5の段差部5eに設けられた第2接続用端子5dとを、図3および図4に示すように半田材などの導電性接着材10を介して電気的に接続して、図2に示すようにそれぞれの段差部4e,5eでパワーアンプモジュール7とアンテナスイッチモジュール8を結合する。
Thereafter, in each of the
また、パワーアンプモジュール7とアンテナスイッチモジュール8を結合した際に形成された両者間の隙間には、図2に示すようにアンダーフィル樹脂9を充填させ、これによって、高周波複合モジュール12の組み立てを完了する。
Further, the gap formed between the
なお、アンテナスイッチモジュール8では、コンデンサ等を内部に配置した方がより良好な電気的特性が得られるため、層数を増やした方が好ましく、したがって、本実施の形態では、アンテナスイッチモジュール8の第2多層配線基板5の層数の方が、パワーアンプモジュール7の第1多層配線基板4の層数より多くなっている。
In the
本実施の形態の半導体装置およびその製造方法によれば、第1多層配線基板4に半導体チップ1やチップ部品2を搭載してパワーアンプモジュール7を形成し、さらに第2多層配線基板5にダイオード13やチップ部品2を搭載してアンテナスイッチモジュール8を形成し、パワーアンプモジュール7の電気的特性検査とアンテナスイッチモジュール8の電気的特性検査をそれぞれ別々に行い、前記電気的特性検査後に、第1多層配線基板4の段差部4eに設けられた第1接続用端子4dと、第2多層配線基板5の段差部5eに設けられた第2接続用端子5dとを電気的に接続してそれぞれの段差部4e,5eでパワーアンプモジュール7とアンテナスイッチモジュール8を結合して高周波複合モジュール12を形成することにより、それぞれ単体のモジュールで検査や評価を行って特性の切り分けができてからそれぞれのモジュールを結合するため、1モジュール化後の高周波複合モジュール12における特性出しを容易に行うことができる。
According to the semiconductor device and the manufacturing method thereof of the present embodiment, the
これにより、高周波複合モジュール12の製品開発の期間の短縮化を図ることができる。
As a result, the product development period of the high-
また、種々の特性の単体のモジュールをそれぞれの特性切り分けを行ってから組み合わせて製造可能なため、多数の品種に展開することができ、例えば、少量多品種のRFモジュールなどに適用することがより有効である。 In addition, since individual modules having various characteristics can be combined and manufactured after being separated from each other, it can be applied to a large number of varieties, for example, to be applied to a small quantity and a wide variety of RF modules. It is valid.
また、高周波複合モジュール12において、パワーアンプモジュール7の第1多層配線基板4とアンテナスイッチモジュール8の第2多層配線基板5とがそれぞれの段差部4e,5eで接続するとともに、第1多層配線基板4の層数と第2多層配線基板5の層数とが異なっていることにより、層数の多い方に合わせた1種類の多層配線基板を用いて高周波複合モジュール12を組み立てることが不要になり、層数が異なった2種類の多層配線基板を用いて高周波複合モジュール12を形成することができる。
In the high-
これにより、多層配線基板のコストが高くなることを抑制でき、高周波複合モジュール12のコストの低減化を図ることができる。
Thereby, it can suppress that the cost of a multilayer wiring board becomes high, and the reduction of the cost of the high frequency
次に、本実施の形態の変形例の半導体装置について説明する。 Next, a semiconductor device according to a modification of the present embodiment will be described.
図14および図15に示す変形例の半導体装置は、高周波複合モジュール12の組み立てにおいて、パワーアンプモジュール7の電気的特性検査とアンテナスイッチモジュール8の電気的特性検査をそれぞれ樹脂封止工程前に別々に行い、前記電気的特性検査後で、かつ樹脂封止工程前に、図14に示すように第1多層配線基板4の段差部4eに設けられた第1接続用端子4dと、第2多層配線基板5の段差部5eに設けられた第2接続用端子5dとを電気的に接続してそれぞれの段差部4e,5eでパワーアンプモジュール7とアンテナスイッチモジュール8を結合し、さらに前記結合後に、一括して印刷による樹脂封止を行って図15に示すような一括封止体15を形成して高周波複合モジュール12を形成するものである。
14 and 15, in the assembly of the high frequency
このようにパワーアンプモジュール7とアンテナスイッチモジュール8を結合した後に、一括して印刷による樹脂封止を行うことにより、アンダーフィル樹脂9の充填が基板部分だけとなり、樹脂封止工程後のアンダーフィル樹脂9の注入工程を省略することができる。
After the
以上、本発明者によってなされた発明を発明の実施の形態に基づき具体的に説明したが、本発明は前記発明の実施の形態に限定されるものではなく、その要旨を逸脱しない範囲で種々変更可能であることは言うまでもない。 Although the invention made by the present inventor has been specifically described based on the embodiments of the invention, the present invention is not limited to the embodiments of the invention, and various modifications can be made without departing from the scope of the invention. It goes without saying that it is possible.
例えば、前記実施の形態では、半導体装置である高周波複合モジュール12がLGA型の半導体装置の場合について説明したが、前記半導体装置の外部端子11はボール電極であってもよい。
For example, in the above embodiment, the case where the high-
また、前記実施の形態では、複合モジュール(半導体装置)がパワーアンプモジュール7とアンテナスイッチモジュール8を組み合わせたモジュールの場合を説明したが、前記複合モジュールは、例えば、パワーアンプモジュール7とローパスフィルタモジュールなどを組み合わせたモジュール製品であってもよい。
In the embodiment, the case where the composite module (semiconductor device) is a module in which the
本発明は、電子装置および半導体装置の製造方法に好適である。 The present invention is suitable for an electronic device and a method for manufacturing a semiconductor device.
1 半導体チップ
2 チップ部品(電子部品)
3 封止体
4 第1多層配線基板
4a 主面
4b 裏面
4c 下面
4d 第1接続用端子
4e 段差部(係合部)
4f 部品用端子
5 第2多層配線基板
5a 主面
5b 裏面
5c 上面
5d 第2接続用端子
5e 段差部(係合部)
5f 部品用端子
6 ワイヤ
7 パワーアンプモジュール(第1構造体)
8 アンテナスイッチモジュール(第2構造体)
9 アンダーフィル樹脂
10 導電性接着材
11 外部端子
12 高周波複合モジュール(半導体装置)
13 ダイオード(電子部品)
14 半田
15 一括封止体
3 Sealing
5f Terminal for
8 Antenna switch module (second structure)
9
13 Diode (electronic component)
14
Claims (5)
電子部品が搭載された第2多層配線基板と、前記第1接続用端子と電気的に接続されか
つ前記第2多層配線基板の係合部に設けられた第2接続用端子とを有する第2構造体と、
前記第1および第2多層配線基板に設けられた複数の外部端子とを有し、
前記第1多層配線基板と前記第2多層配線基板とがそれぞれの前記係合部で接続し、前記第1多層配線基板の層数と前記第2多層配線基板の層数とが異なっていることを特徴とする半導体装置。 A first structure having a first multilayer wiring board on which a semiconductor chip is mounted; and a first connection terminal provided at an engaging portion of the first multilayer wiring board;
A second multilayer wiring board on which an electronic component is mounted; and a second connection terminal electrically connected to the first connection terminal and provided at an engaging portion of the second multilayer wiring board. A structure,
A plurality of external terminals provided on the first and second multilayer wiring boards,
The first multilayer wiring board and the second multilayer wiring board are connected by the respective engaging portions, and the number of layers of the first multilayer wiring board is different from the number of layers of the second multilayer wiring board. A semiconductor device characterized by the above.
係合部を有する第2多層配線基板に電子部品を搭載して第2構造体を形成する工程と、
前記第1構造体において前記半導体チップを封止する工程と、
前記第2構造体において前記電子部品を封止する工程と、
前記第1構造体の特性検査を行う工程と、
前記第2構造体の特性検査を行う工程と、
それぞれ前記特性検査で良品と判定された前記第1および第2構造体において、前記第1多層配線基板の係合部に設けられた第1接続用端子と前記第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で前記第1構造体と第2構造体を結合する工程とを有することを特徴とする半導体装置の製造方法。 Mounting a semiconductor chip on a first multilayer wiring board having an engaging portion to form a first structure;
Mounting the electronic component on the second multilayer wiring board having the engaging portion to form the second structure;
Sealing the semiconductor chip in the first structure;
Sealing the electronic component in the second structure;
Performing a characteristic inspection of the first structure;
Performing a characteristic inspection of the second structure;
In each of the first and second structures determined to be non-defective items by the characteristic inspection, a first connection terminal provided in an engagement portion of the first multilayer wiring board and an engagement portion of the second multilayer wiring board A method of manufacturing a semiconductor device, comprising: a step of electrically connecting a second connection terminal provided on the first connection body and connecting the first structure body and the second structure body at respective engaging portions. .
係合部を有する第2多層配線基板に電子部品を搭載して第2構造体を形成する工程と、
前記第1構造体において前記半導体チップを封止する工程と、
前記第2構造体において前記電子部品を封止する工程と、
前記第1構造体の特性検査を行う工程と、
前記第2構造体の特性検査を行う工程と、
それぞれ前記特性検査で良品と判定された前記第1および第2構造体において、前記第1多層配線基板の係合部に設けられた第1接続用端子と前記第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で前記第1構造体と第2構造体を結合する工程とを有し、
前記第1多層配線基板の層数と前記第2多層配線基板の層数とが異なっていることを特徴とする半導体装置の製造方法。 Mounting a semiconductor chip on a first multilayer wiring board having an engaging portion to form a first structure;
Mounting the electronic component on the second multilayer wiring board having the engaging portion to form the second structure;
Sealing the semiconductor chip in the first structure;
Sealing the electronic component in the second structure;
Performing a characteristic inspection of the first structure;
Performing a characteristic inspection of the second structure;
In each of the first and second structures determined to be non-defective items by the characteristic inspection, a first connection terminal provided in an engagement portion of the first multilayer wiring board and an engagement portion of the second multilayer wiring board Electrically connecting a second connection terminal provided on the first connection body and joining the first structure body and the second structure body at each engaging portion,
A method of manufacturing a semiconductor device, wherein the number of layers of the first multilayer wiring board is different from the number of layers of the second multilayer wiring board.
係合部を有する第2多層配線基板に電子部品を搭載して第2構造体であるアンテナスイッチモジュールを形成する工程と、
前記パワーアンプモジュールにおいて前記半導体チップを封止する工程と、
前記アンテナスイッチモジュールにおいて前記電子部品を封止する工程と、
前記パワーアンプモジュールの電気的特性検査を行う工程と、
前記アンテナスイッチモジュールの電気的特性検査を行う工程と、
それぞれ前記電気的特性検査で良品と判定された前記パワーアンプモジュールおよびアンテナスイッチモジュールにおいて、前記第1多層配線基板の係合部に設けられた第1接続用端子と前記第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で前記パワーアンプモジュールと前記アンテナスイッチモジュールを結合する工程とを有することを特徴とする半導体装置の製造方法。 Forming a power amplifier module as a first structure by mounting a semiconductor chip on a first multilayer wiring board having an engaging portion;
Mounting an electronic component on a second multilayer wiring board having an engaging portion to form an antenna switch module as a second structure;
Sealing the semiconductor chip in the power amplifier module;
Sealing the electronic component in the antenna switch module;
A step of performing electrical characteristic inspection of the power amplifier module;
Performing an electrical characteristic test of the antenna switch module;
In each of the power amplifier module and the antenna switch module determined to be non-defective products in the electrical characteristic inspection, the first connection terminal provided in the engaging portion of the first multilayer wiring board and the second multilayer wiring board are related to each other. And a step of electrically connecting a second connection terminal provided at the joint and coupling the power amplifier module and the antenna switch module at each engagement portion. Method.
係合部を有する第2多層配線基板に電子部品を搭載して第2構造体を形成する工程と、
前記第1構造体の特性検査を行う工程と、
前記第2構造体の特性検査を行う工程と、
それぞれ前記特性検査で良品と判定された前記第1および第2構造体において、前記第1多層配線基板の係合部に設けられた第1接続用端子と前記第2多層配線基板の係合部に設けられた第2接続用端子とを電気的に接続してそれぞれの係合部で前記第1構造体と第2構造体を結合する工程と、
前記第1および第2構造体を結合する工程の後、前記第1および前記第2構造体において前記半導体チップと前記電子部品を一括して封止する工程とを有することを特徴とする半導体装置の製造方法。 Mounting a semiconductor chip on a first multilayer wiring board having an engaging portion to form a first structure;
Mounting the electronic component on the second multilayer wiring board having the engaging portion to form the second structure;
Performing a characteristic inspection of the first structure;
Performing a characteristic inspection of the second structure;
In each of the first and second structures determined to be non-defective items by the characteristic inspection, a first connection terminal provided in an engagement portion of the first multilayer wiring board and an engagement portion of the second multilayer wiring board Electrically connecting a second connection terminal provided on the first connection body and coupling the first structure body and the second structure body with each engaging portion;
And a step of collectively sealing the semiconductor chip and the electronic component in the first and second structures after the step of joining the first and second structures. Manufacturing method.
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Application Number | Priority Date | Filing Date | Title |
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JP2005062748A JP2006245500A (en) | 2005-03-07 | 2005-03-07 | Semiconductor device and its manufacturing method |
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