JP2006129593A - 電源制御用半導体集積回路および電源装置を有するシステム - Google Patents
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Abstract
【解決手段】 スイッチング・レギュレータのパワートランジスタ(M1)を駆動する制御信号を生成する駆動制御回路(22)を備えたスイッチング電源制御用ICもしくはそれを用いたスイッチング電源装置において、パワートランジスタを駆動する制御信号のスルーレートすなわち立ち上がり時間と立ち下がり時間を、ノイズの影響を受け易い装置の稼動状態を示す信号に基づいて切替え可能に構成した。
【選択図】 図3
Description
この発明の他の目的は、電力効率が高くかつ発生するスイッチングノイズの少ない小型の直流電源装置を実現するのに好適なスイッチング電源制御用半導体集積回路を提供することにある。
この発明の前記ならびにそのほかの目的と新規な特徴については、本明細書の記述および添付図面から明らかになるであろう。
すなわち、スイッチング・レギュレータのパワートランジスタを駆動する制御信号を生成する駆動制御回路を備えたスイッチング電源制御用ICもしくはそれを用いたスイッチング電源装置において、パワートランジスタを駆動する制御信号のスルーレートすなわち立ち上がり時間と立ち下がり時間を、例えばチューナのようなノイズの影響を受け易い装置の稼動状態を示す信号に基づいて切替え可能に構成したものである。
すなわち、本発明に従うと、電力効率が高くかつ発生するスイッチングノイズの少ない車載用に適した直流電源装置を実現することができる。
図1は、本発明を適用した電源制御用ICを用いた電源装置および車載用オーディオ&ナビゲーションシステムの第1の実施例を示す。なお、特に制限されるものでないが、この実施例においては、図1において一点鎖線で囲まれた部分の回路SRGは、スイッチング・レギュレータであり、本実施例では降圧型のレギュレータとして構成されている。
この実施例のシステムと図1のシステムとの違いは、図1のシステムではGPS装置33が設けられているのに対し、図5のシステムではGPS装置33がなく代わりに比較的消費電力の大きなDSPインタフェース40が設けられている点と、これに伴い電源制御用IC20にはスイッチング・レギュレータ用コントローラドライバ22a,22bが設けられて2つのスイッチング・レギュレータSRG1,SRG2が構成されている点と、シリーズ・レギュレータ21c,21dがなくチューナ32と制御用マイコン31とでレギュレータ21bを共用している点と、内部電源回路24を備えている点である。DSPインタフェース40は、グラフィックイコライザのための演算処理を行なったり、LCDなどの表示パネルへの画像データの演算処理を行なったりするDSPコントローラ36ほぼ同等の機能を有し、DSPコントローラ36よりも高い電源電圧を必要とするデバイスである。
20 電源制御用IC
21 リニア型直流電源(シリーズ・レギュレータ)
22 スイッチング・レギュレータのコントロール回路
23 電源スイッチ
24 内部電源回路
25 昇圧回路
SRG スイッチング・レギュレータ
ER−AMP 誤差アンプ
CMP コンパレータ
Claims (13)
- 電圧変換用のインダクタに流れる電流を制御するトランジスタおよび該トランジスタをオン・オフ駆動する制御信号を生成する駆動制御回路を備えた電源制御用半導体集積回路であって、
前記トランジスタを駆動する制御信号の立ち上がり時間と立ち下がり時間が、ノイズの影響を受け易い装置の稼動状態を示す第1の信号に基づいて切替え可能に構成されていることを特徴とする電源制御用半導体集積回路。 - 前記駆動制御回路は、前記トランジスタを駆動する第1の制御信号を生成する第1の駆動回路と、該第1の駆動回路により生成される前記第1の制御信号よりも立ち上がり時間と立ち下がり時間が長い第2の制御信号を生成する第2の駆動回路とを備え、前記第1の信号に基づいて、ノイズの影響を受け易い前記装置が稼動している場合には第2の駆動回路が動作され、ノイズの影響を受け易い前記装置が稼動していない場合には第1の駆動回路が動作されるように構成されていることを特徴とする請求項1に記載の電源制御用半導体集積回路。
- ノイズの影響を受け易い前記装置は無線通信の信号の受信または受信および送信を行なう装置であることを特徴とする請求項2に記載の電源制御用半導体集積回路。
- 少なくとも1個のリニア型直流電源と、2以上のスイッチング・レギュレータ用の駆動制御回路とが1個の半導体基板上に形成されていることを特徴とする電源制御用半導体集積回路。
- 前記2以上のスイッチング・レギュレータ用の駆動制御回路のうち少なくともひとつは、スイッチング・トランジスタを駆動する制御信号の立ち上がり時間と立ち下がり時間が切替え可能に構成されていることを特徴とする請求項4に記載の電源制御用半導体集積回路。
- 前記2以上のスイッチング・レギュレータ用の駆動制御回路は、互いに位相が異なるクロック信号によって動作してそれぞれのスイッチング・トランジスタをオン・オフ駆動する制御信号を生成するように構成されていることを特徴とする請求項4に記載の電源制御用半導体集積回路。
- 前記駆動制御回路を動作させる第1のクロック信号を生成可能な発振回路および前記駆動制御回路を動作させるため外部より供給される第2のクロック信号を入力するための第1の外部端子を備え、該外部端子に入力されている前記第2のクロック信号が不所望の信号である場合に前記発振回路を動作させて前記第1のクロック信号を前記駆動制御回路に供給するように構成されていることを特徴とする請求項4に記載の電源制御用半導体集積回路。
- 前記第1の外部端子に入力されている前記第2のクロック信号が所望の信号であるか否かを監視する回路と、前記第2のクロック信号が不所望の信号である場合に前記第2のクロック信号が異常であることを示す信号を第2の外部端子より出力するように構成されていることを特徴とする請求項7に記載の電源制御用半導体集積回路。
- 前記半導体基板の温度を監視する回路と、前記半導体基板の温度が所定の温度以上となった場合に基板温度が異常であることを示す信号を前記第2の外部端子より出力するように構成されていることを特徴とする請求項8に記載の電源制御用半導体集積回路。
- 外部の制御装置との間でデータの送受信を行なうシリアル・インタフェース回路を備えることを特徴とする請求項4に記載の電源制御用半導体集積回路。
- 前記シリアル・インターフェイス回路とデータの送受信を行うべき前期外部の制御装置のインターフェイスの駆動電圧に基づいて、前記外部の制御装置と前記シリアル・インターフェイス回路との信号経路を切り替えるための入出力切替え回路を有することを特徴とする請求項10に記載の電源制御用半導体集積回路。
- 上記駆動制御回路のうちの一つは光ディスクのコンテンツ情報を復号し再生するプレーヤーのためのものであり、もう一つはグラフィックイコライザのための演算処理を行なったり、表示パネルへの画像データの演算処理を行なったりするための演算回路のためのものであることを特徴とする請求項4に記載の電源制御用半導体集積回路。
- 少なくとも1個のリニア型直流電源と、スイッチング・レギュレータ用の第一及び第二の駆動制御回路とが1個の半導体基板上に形成されていて、 前記第一の駆動制御回路に制御されるスイッチング・トランジスタを駆動する第一の制御信号の立ち上がり時間と立ち下がり時間が切替え可能に構成されている電源制御用半導体集積回路と、
前記スイッチング・トランジスタと、
前記第一の駆動制御回路によって生成された前記第一の制御信号によって制御される前記スイッチング・トランジスタのスイッチング動作によって生成された電圧を変換するためのインダクタと、
前記インダクタからの出力電圧を出力するための出力端子と電源装置の基準電位点との間に接続され前記出力電圧を平滑する容量素子と、
を有する前記電源装置と、
前記出力端子からの出力電圧を電源電圧として動作するよう構成された電子装置と、
前記リニア型直流電源からの電源電圧の供給を受けて動作する無線通信装置とを備え、
前記無線通信装置が動作する間に前記第一の駆動制御回路は前記スイッチング・トランジスタを駆動する前記第一の制御信号の立ち上がり時間と立ち下がり時間が長くされ、前記無線通信装置が動作しない期間は前記スイッチング・レギュレータを駆動する前記第一の駆動制御回路は前記第一の制御信号の立ち上がり時間と立ち下がり時間が短くされることを特徴とするシステム。
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- 2004-10-28 JP JP2004313464A patent/JP2006129593A/ja active Pending
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