JP2006066632A - Circuit board and its inspection method - Google Patents

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JP2006066632A JP2004247215A JP2004247215A JP2006066632A JP 2006066632 A JP2006066632 A JP 2006066632A JP 2004247215 A JP2004247215 A JP 2004247215A JP 2004247215 A JP2004247215 A JP 2004247215A JP 2006066632 A JP2006066632 A JP 2006066632A
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insulating
insulating layer
layer
circuit board
conductor pattern
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JP2004247215A
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Japanese (ja)
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Tomoyuki Miyagawa
知之 宮川
Masaaki Mizuno
正章 水野
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YAMAGISHI-AIC Inc
Denso Corp
Lincstech YGA Co Ltd
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YAMAGISHI-AIC Inc
Denso Corp
Yamagishi AIC Inc
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  • Testing Of Short-Circuits, Discontinuities, Leakage, Or Incorrect Line Connections (AREA)
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Abstract

<P>PROBLEM TO BE SOLVED: To provide a structure and an inspection method therefor, the structure surely inspecting insulation characteristics difficult to be done only with visual observation as for insulating layers of a circuit board equipped with a jumper structure. <P>SOLUTION: The circuit board (printed wiring board ) equipped with a copper foil layer formed on at least one surface thereof includes the jumper structure in a part of a conductor pattern on the surface thereof, and further includes a confirmation mark 300 independently of the conductor pattern and the insulating layers on a part of the surface of a base member. Insulating layers are formed on the surface of the confirmation mark corresponding to the formation of a plurality of the insulating layers. Thereafter, electric characteristics of the insulating layers are measured by bringing an inspection terminal of a check device into contact therewith. Consequently, the electric characteristics including insulation characteristics together with information of missing of any insulating layer of the plurality of the insulating layers are automatically inspected additionally to inspection by visual inspection. <P>COPYRIGHT: (C)2006,JPO&NCIPI

Description

本発明は、絶縁材の表面に導体層を形成してなる基材の表面に所定の導体パターンを形
成した後、更に、その表面に絶縁体を塗布して絶縁層を形成してその表面に導体層を形成
した、所謂、ジャンパ構造を備えた回路基板(プリント配線板)と、かかる回路基板の検
査方法に関する。
In the present invention, after a predetermined conductor pattern is formed on the surface of a base material formed by forming a conductor layer on the surface of an insulating material, an insulator is further applied to the surface to form an insulating layer. The present invention relates to a circuit board (printed wiring board) having a so-called jumper structure in which a conductor layer is formed, and a method for inspecting the circuit board.

従来、例えば、その片面又は両面に銅箔が形成されたガラスエポキシ基板、紙フェノー
ル基板等、所謂、絶縁基板(基材)において、その表面の銅箔をエッチングなどにより取
り除いて導体(又は、回路)パターンを形成し、その表面に更に、ソルダレジスト(半田
レジスト)などを含む絶縁体を塗布して絶縁層を形成し、その表面に導電性の塗料を用い
て導電パターン(ジャンパ)を形成する印刷回路基板は、既に例えば、以下の特許文献1
により知られている。
Conventionally, for example, in a so-called insulating substrate (base material) such as a glass epoxy substrate or a paper phenol substrate on which one side or both sides of a copper foil is formed, the copper foil on the surface is removed by etching or the like (or a circuit) ) A pattern is formed, and further an insulator including a solder resist (solder resist) is applied to the surface to form an insulating layer, and a conductive pattern (jumper) is formed on the surface using a conductive paint. The printed circuit board has already been disclosed, for example, in Patent Document 1 below.
Is known by.

また、上記の導電パターン(ジャンパ)を形成する際、絶縁層の印刷ズレや工程抜けを
チェックする方法として、当該絶縁層を形成する絶縁インクの色を変えることにより、そ
の検査を容易にする構造や方法が、以下の特許文献2により、既に知られている。
特開平6−140788号公報 特開平9−331138号公報
In addition, when forming the conductive pattern (jumper), as a method for checking printing deviation of the insulating layer and missing process, a structure that makes the inspection easy by changing the color of the insulating ink forming the insulating layer And the method are already known from Patent Document 2 below.
JP-A-6-140788 JP-A-9-331138

すなわち、上記特許文献2においても指摘されるように、銅箔回路パターンの上に印刷
抵抗体等の印刷電子素子又は導電パターンを形成する場合、その高密度化を図るため、銅
箔回路部分の上に半田レジスト層や絶縁層を介して印刷電子素子や導体パターン(所謂、
ジャンパ)を形成する場合がある。その場合、この形成した半田レジスト層や絶縁層の厚
みが薄かったりすると、上記銅箔回路パターンと印刷電子素子や導電パターンとの間で短
絡が生じる恐れがある。そこで、この絶縁層を多層化し、もって、この絶縁層の厚みを確
保することが行なわれているが、しかしながら、この絶縁層を複数の層で形成した場合に
は、そのための印刷工程が増大するだけではなく、更には、形成された絶縁層の形成状態
を確認する必要がある。
That is, as pointed out in Patent Document 2, when a printed electronic element such as a printed resistor or a conductive pattern is formed on a copper foil circuit pattern, in order to increase the density, Printed electronic elements and conductor patterns (so-called, via a solder resist layer and an insulating layer)
A jumper) may be formed. In that case, if the thickness of the formed solder resist layer or insulating layer is thin, a short circuit may occur between the copper foil circuit pattern and the printed electronic element or conductive pattern. In view of this, the insulating layer is formed in multiple layers, so that the thickness of the insulating layer is ensured. However, when the insulating layer is formed of a plurality of layers, the number of printing steps for that increase. Furthermore, it is necessary to confirm the formation state of the formed insulating layer.

そこで、上記の特許文献2においては、特に、上記絶縁層の各層の印刷ズレや抜けを、
所謂、目視によって検査することを容易にするため、印刷塗布する絶縁層の一部を透明性
の部材で形成すると共に、他の絶縁層の部材についても、互いに区別可能な色を有する材
料とした印刷回路基板が提案されている。
Therefore, in the above-mentioned Patent Document 2, in particular, printing misalignment or omission of each layer of the insulating layer,
In order to facilitate inspection by so-called visual inspection, a part of the insulating layer to be printed is formed of a transparent member, and other insulating layer members are also made of materials having colors that are distinguishable from each other. Printed circuit boards have been proposed.

しかしながら、上記の特許文献2により知られる印刷回路基板では、目視による検査を
可能にするため、形成される絶縁層の各層に多少の印刷ズレが生じることを前提としてい
る。そのため、これら複数の層が高密度化を図るために高精度で各層の上に形成された場
合には(特に、有色の層の下に形成された層との間で)、その目視による検査が困難にな
るという問題があった。また、目視による検査だけでは、形成される絶縁層の抜けを含め
、特に、形成された絶縁層の電気的な特性、即ち、形成された絶縁層の各層における厚さ
を含む形成状態にも起因する絶縁性などについて、これを確実に確認することは困難であ
った。加えて、形成された絶縁層の各層を、透明を含めて互いに区別可能な色にし、かつ
、それらを塗布する順序を確実に制御することは、プリント配線板の製造工程での絶縁イ
ンクの管理を複雑にし、更には、その絶縁特性にも影響を与えてしまうことから、実際の
製造工程で採用することは困難を生じることが多い。
However, in the printed circuit board known from the above-mentioned Patent Document 2, it is premised that some printing deviation occurs in each layer of the insulating layer to be formed in order to enable visual inspection. Therefore, when these multiple layers are formed on each layer with high accuracy in order to increase the density (especially between the layers formed below the colored layer), visual inspection thereof is performed. There was a problem that became difficult. In addition, only by visual inspection, including the missing of the formed insulating layer, in particular, due to the electrical characteristics of the formed insulating layer, that is, the formation state including the thickness of each layer of the formed insulating layer. It has been difficult to reliably confirm the insulation properties. In addition, it is possible to control the insulating ink in the manufacturing process of the printed wiring board by making each layer of the formed insulating layer a color that can be distinguished from each other including transparent and surely controlling the order of applying them. In addition, since it also affects the insulation characteristics, it is often difficult to adopt it in an actual manufacturing process.

そこで、本発明では、上述した従来技術における問題点に鑑み、回路基板の導体パター
ン上に複数の絶縁層を形成し、その表面に形成される導体層(所謂、ジャンパ)を備えて
なるプリント配線基板において、複数の絶縁層の形成抜けを含め、従来の目視による検査
だけでは困難な、例えば、その電気的な特性である絶縁特性等を含めて、前記複数の絶縁
層の形成を確実に確認することを可能にすることが可能な回路基板と、かかる回路基板の
ための検査方法を提供することをその目的とする。
Therefore, in the present invention, in view of the above-described problems in the prior art, a printed wiring comprising a plurality of insulating layers formed on a conductor pattern of a circuit board and a conductor layer (so-called jumper) formed on the surface thereof. Confirmation of the formation of multiple insulation layers on a substrate, including the formation of multiple insulation layers, including the insulation characteristics that are difficult to achieve by conventional visual inspection alone, such as the insulation properties. It is an object of the present invention to provide a circuit board capable of making it possible and an inspection method for such a circuit board.

すなわち、上述した本発明の目的を達成するため、本発明によって提供されるのは、ま
ず、絶縁基板と、前記絶縁基板の少なくとも一方の表面に形成された導体パターンとを備
えると共に、更に、前記絶縁基板の表面上に形成した前記導体パターンの一部の表面には
絶縁層を形成ししてなる回路基板であって、更に、前記絶縁基板の表面に形成された前記導体パタ
ーン及び前記絶縁層とは独立して、前記絶縁基板の一部に、前記複数の絶縁層の形成を確
認するための確認マークを備え、前記確認マークは、前記絶縁層の形成と対応して、それぞれの表面に絶縁層が個別に形成される所定形状の導体層を備え、その間を電気的に接続して構成される回路基板が提供される。
That is, in order to achieve the above-described object of the present invention, the present invention provides an insulating substrate and a conductor pattern formed on at least one surface of the insulating substrate. A circuit board in which an insulating layer is formed on a part of the surface of the conductor pattern formed on the surface of the insulating substrate, and further the conductor pattern and the insulating layer formed on the surface of the insulating substrate. Independently, a confirmation mark for confirming formation of the plurality of insulating layers is provided on a part of the insulating substrate, and the confirmation mark is formed on each surface corresponding to the formation of the insulating layer. A circuit board is provided that includes a conductor layer having a predetermined shape in which an insulating layer is individually formed and is electrically connected therebetween.

また、本発明によれば、絶縁基板と、前記絶縁基板の少なくとも一方の表面に形成された導体パターンとを備えると共に、更に、前記絶縁基板の表面上に形成した前記導体パターンの一部の表面には絶縁層を形成し、当該絶縁層の表面に導体層を形成してなる回路基板であって、前記絶縁層は複数の層から形成されており、更に、前記絶縁基板の表面に形成された前記導体パターン及び前記絶縁層とは独立して、前記絶縁基板の一部に、前記複数の絶縁層の形成を確認するための確認マークを備えており、前記確認マークは、前記複数の絶縁層の形成と対応して、それぞれの表面に絶縁層が個別に形成される所定形状の導体層を、複数備え、その間を電気的に接続して構成されている回路基板が提供される。   According to the present invention, there is provided an insulating substrate and a conductor pattern formed on at least one surface of the insulating substrate, and further, a part of the surface of the conductor pattern formed on the surface of the insulating substrate. Is a circuit board formed by forming an insulating layer and forming a conductor layer on the surface of the insulating layer, wherein the insulating layer is formed of a plurality of layers and further formed on the surface of the insulating substrate. Independently of the conductor pattern and the insulating layer, a confirmation mark for confirming the formation of the plurality of insulating layers is provided on a part of the insulating substrate, and the confirmation mark includes the plurality of insulating layers. Corresponding to the formation of the layers, there is provided a circuit board that includes a plurality of conductor layers having a predetermined shape, each of which has an insulating layer individually formed on each surface, and is electrically connected therebetween.

なお、本発明によれば、前記に記載した回路基板において、前記確認マークは、前記複
数の絶縁層の形成と対応して、それぞれの表面に絶縁層が個別に形成される所定形状の導
体層を、複数備え、その間を電気的に接続して構成されており、又は、前記確認マークは
、その捨て基板部分に形成している。
According to the present invention, in the circuit board described above, the confirmation mark is a conductor layer having a predetermined shape in which an insulating layer is individually formed on each surface corresponding to the formation of the plurality of insulating layers. Are provided and are electrically connected to each other, or the confirmation mark is formed on the discarded substrate portion.

更に、本発明によれば、前記に記載した回路基板のための検査方法であって、前記導体
パターン及び前記絶縁層とは独立して前記絶縁基板の一部に形成された前記確認マークの
表面に、前記複数の絶縁層の形成に対応してそれぞれの表面に絶縁層を個別に形成した後
、検査端子を接触してその電気的特性を計測することにより、前記導体パターンの一部に
形成された前記複数の絶縁層の電気的特性を検査する回路基板のための検査方法が提供さ
れる。
Furthermore, according to the present invention, there is provided an inspection method for a circuit board as described above, wherein the surface of the confirmation mark formed on a part of the insulating substrate independently of the conductor pattern and the insulating layer. In addition, after forming the insulating layers individually on the respective surfaces in correspondence with the formation of the plurality of insulating layers, the contact terminals are contacted and the electrical characteristics are measured to form a part of the conductor pattern. An inspection method for a circuit board for inspecting electrical characteristics of the plurality of insulating layers is provided.

なお、本発明によれば、前記に記載した回路基板のための検査方法において、前記複数
の絶縁層の電気的特性を検査する方法が導体パターンの回路導通チェックと同時に検査し
てもよい。
According to the present invention, in the inspection method for a circuit board described above, the method for inspecting the electrical characteristics of the plurality of insulating layers may be inspected simultaneously with the circuit continuity check of the conductor pattern.

すなわち、上記の本発明によれば、上述した回路基板の一部に形成される確認マークを
利用することにより、ジャンパ構造を形成するために導体パターンの上に形成される複数
の絶縁層について、目視による検査だけでは困難な電気的な特性である絶縁特性をも含め
、上述の検査方法によって、確実にかつ自動的に、そして、効率良く検査することが可能
となる。
That is, according to the present invention described above, by using the confirmation mark formed on a part of the circuit board described above, a plurality of insulating layers formed on the conductor pattern to form a jumper structure, With the above-described inspection method, it is possible to inspect reliably, automatically, and efficiently, including the insulation characteristic that is an electrical characteristic that is difficult only by visual inspection.

以下、本発明の実施の形態について、添付の図面を用いて詳細に説明する。   Hereinafter, embodiments of the present invention will be described in detail with reference to the accompanying drawings.

まず、添付の図1は、本発明の一実施の形態になる回路基板(又は、プリント配線板と
も言う)を形成するために用いられる基材である、その片面又は両面に銅箔(例えば、厚
さ35μm程度)などの導電層が形成された、ガラスエポキシ基板、紙フェノール基板等
、所謂、絶縁基板(基材)100が示されている。なお、この図からも明らかなように、
この絶縁基板(基材)100では、以下に詳述するように、図の破線により取り囲まれた
内部において、その片面又は両面に付着された金属箔を所定のパターンで、例えば、エッ
チングすること等によって除去し、所望の回路(導体)パターンを形成する。更には、そ
の表面の回路(導体)パターンの一部の表面には、例えばソルダレジストを含み、絶縁体
(絶縁インク)を印刷・塗布することにより絶縁層を形成すると共に、その表面に導体層
(所謂、ジャンパ)を形成し、もって、所謂、ジャンパ構造を有するプリント配線板を形
成する。
First, attached FIG. 1 is a base material used for forming a circuit board (or a printed wiring board) according to an embodiment of the present invention, and a copper foil (for example, A so-called insulating substrate (base material) 100 such as a glass epoxy substrate, a paper phenol substrate, or the like on which a conductive layer having a thickness of about 35 μm is formed is shown. As is clear from this figure,
In this insulating substrate (base material) 100, as will be described in detail below, the metal foil attached to one or both surfaces thereof is etched in a predetermined pattern, for example, in the inside surrounded by the broken line in the figure, etc. To form a desired circuit (conductor) pattern. Furthermore, a part of the surface of the circuit (conductor) pattern on the surface includes, for example, a solder resist, and an insulating layer is formed by printing and applying an insulator (insulating ink), and the conductor layer is formed on the surface. (So-called jumper) is formed, and thus a printed wiring board having a so-called jumper structure is formed.

なお、所望の回路(導体)パターンが形成された絶縁基板(基材)100は、図の破線
部分で切断されてプリント配線板(製品)200、200となるものである。一方、上記
破線の外側の部分は、上記絶縁基板(基材)100を保持するためのフレーム部を形成す
ると共に、上記プリント配線板の上に素子が実装された後に取り除かれるものであり、一
般に、捨て基板(製品部以外で除去される部分)150と呼ばれるものである。なお、図
の破線部分のプリント配線板200、200は同一形状でなく、互いに異なる形状のプリ
ント配線板の組み合わせでもよい。
The insulating substrate (base material) 100 on which a desired circuit (conductor) pattern is formed is cut into broken printed wiring boards (products) 200 and 200 in the drawing. On the other hand, the portion outside the broken line forms a frame portion for holding the insulating substrate (base material) 100 and is removed after an element is mounted on the printed wiring board. This is called a discarded substrate (a portion to be removed except for the product portion) 150. In addition, the printed wiring boards 200 and 200 in the broken line portion in the figure may not be the same shape, but may be a combination of printed wiring boards having different shapes.

そして、本発明によれば、上記絶縁基板(基材)100の表面の一部には、以下に詳述
する確認マーク300が形成されている。なお、この確認マーク300は、上記の図1に
も示すように、例えば、上記基材100の捨て基板150と呼ばれる部分に形成してもよ
く、又は、図に点線で示すように、上記破線で示したプリント配線板(製品)200、2
00の内部に形成されてもよい。なお、プリント配線板200内部に形成される場合、こ
の確認マーク300は、製品に実用的に形成される導体パターンや絶縁層等とは、例えば
、電気的にも物理的にも、独立して形成されることとなる。
And according to this invention, the confirmation mark 300 explained in full detail below is formed in a part of surface of the said insulated substrate (base material) 100. FIG. Note that the confirmation mark 300 may be formed, for example, in a portion called the discarded substrate 150 of the base material 100 as shown in FIG. 1 or the broken line as shown by a dotted line in the drawing. Printed wiring board (product) 200, 2
It may be formed inside 00. When formed inside the printed wiring board 200, the confirmation mark 300 is independent of a conductor pattern, an insulating layer, or the like that is practically formed on the product, for example, electrically or physically. Will be formed.

また、上記確認マーク300のパターン形状の一例を、添付の図2に示す。これらの図
からも明らかなように、確認マーク300は、例えば、上記基材100の一部(例えば、
上記捨て基板150と呼ばれる部分)に、エッチングなどにより余分の銅箔を取り除くこ
とにより、複数(この場合には3個)の円形のランド301、302、303を形成する
と共に、その間を細い導体路304、304により電気的に接続することにより構成され
ている。なお、より具体的に、本例では、例えば、ランド301及び303を、径1.6
φとし、他方、ランド302を、径1.3φとして形成している。また、導体路304の
幅は、例えば、0.3mmとしている。そして、上記の大径(1.6φ)のランド301
及び303の表面上は、後にも述べるが、上記プリント配線板(製品)200、200の
内部にソルダレジストなどの絶縁体を塗布して絶縁層を形成する際に、同時に、当該絶縁
層が、例えば径1.3φの外域部分に形成されることとなる。
An example of the pattern shape of the confirmation mark 300 is shown in FIG. As is clear from these drawings, the confirmation mark 300 is, for example, a part of the substrate 100 (for example,
Excess copper foil is removed by etching or the like in the portion called the discard substrate 150) to form a plurality of (in this case, three) circular lands 301, 302, 303 and a thin conductor path between them. 304 and 304 are electrically connected. More specifically, in this example, for example, the lands 301 and 303 have a diameter of 1.6.
On the other hand, the land 302 is formed with a diameter of 1.3φ. Further, the width of the conductor path 304 is, for example, 0.3 mm. Then, the land 301 having the large diameter (1.6φ) described above.
And 303, the surface of the printed wiring board (product) 200, 200 is coated with an insulator such as a solder resist to form an insulating layer. For example, it will be formed in the outer region with a diameter of 1.3φ.

次に、添付の図3により、上記に説明した絶縁基板(基材)100を用いて、プリント
配線板200、200を形成すると共に、形成したソルダレジストなどの絶縁層の電気的
特性である絶縁特性を検査する方法を含めたプリント配線板の製造方法について説明する
Next, referring to FIG. 3 attached, the printed circuit boards 200 and 200 are formed using the insulating substrate (base material) 100 described above, and the insulating property that is an electrical characteristic of the formed insulating layer such as a solder resist is formed. A method for manufacturing a printed wiring board including a method for inspecting characteristics will be described.

この図3において、まず、上記の絶縁基板(基材)100を得るため、その片面又は両
面に銅箔が形成・付着された、ガラスエポキシ基板や紙フェノール基板等の大面積の材料
を切断し、所定の大きさ形状の材料を得(工程S10)、さらに、その端面を処理する(
工程S11)。続いて、その片面又は両面に形成された銅箔上に、上記プリント配線板2
00を形成するための導電パターンと共に、上記確認マーク300(ランド301、30
2、303と導体路304)を形成するため、エッチング用レジストのパターン印刷を施
し(工程S12)、その後、エッチング処理により余分な銅箔を取り除いて絶縁基板上に
所望の導体パターンを形成し、これにより、上記の図1にも示した絶縁基板(基材)10
0を得る。さらに、必要に応じて、ソルダレジストをその表面に印刷するためのレジスト
印刷を行なう(工程S13)。
In FIG. 3, first, in order to obtain the insulating substrate (base material) 100, a large-area material such as a glass epoxy substrate or a paper phenol substrate on which a copper foil is formed and attached on one side or both sides thereof is cut. Then, a material having a predetermined size and shape is obtained (step S10), and the end face is further processed (step S10).
Step S11). Subsequently, the printed wiring board 2 is formed on the copper foil formed on one side or both sides.
Along with the conductive pattern for forming 00, the confirmation mark 300 (land 301, 30
2 and 303 and the conductor path 304), a pattern printing of an etching resist is performed (step S12), and then an unnecessary copper foil is removed by an etching process to form a desired conductor pattern on the insulating substrate. As a result, the insulating substrate (base material) 10 shown in FIG.
Get 0. Further, if necessary, resist printing for printing a solder resist on the surface is performed (step S13).

続いて、銅箔回路部分の上にソルダレジスト層を介して導体パターン(所謂、ジャンパ
)を形成するための複数層の絶縁層を形成するため、アンダーコート印刷I(工程S14
)及びアンダーコート印刷II(工程S15)からなるアンダーコート印刷を行なう。なお
、この時、本発明では、上記確認マーク300を利用しながら上記のアンダーコート印刷
を行なうこととなる。
Subsequently, undercoat printing I (step S14) is performed in order to form a plurality of insulating layers for forming a conductor pattern (so-called jumper) via a solder resist layer on the copper foil circuit portion.
) And undercoat printing II (step S15). At this time, in the present invention, the undercoat printing is performed using the confirmation mark 300.

ここで、添付の図4の一部拡大断面図により、上記絶縁基板(基材)100上に形成さ
れるプリント配線板200のジャンパ構造について説明する。このジャンパ構造とは、絶
縁基板(基材)100上にエッチングによって形成された(残された)導体パターンであ
る銅箔201、202、203において、図の中央部に示す導体パターンの一部202を
越えて、その両側の導体パターン201と203とを電気的に接続する構造である。具体
的には、まず、ソルダレジスト層204が、上記導体パターン202を含めてプリント配
線板の表面に形成される。なお、図中の符号204は、上記レジスト印刷(工程S13)
により形成されたソルダレジスト層を示している。なお、ソルダレジスト膜204を絶縁
層数として計数(カウント)することも出来る。更に、以下にも説明するように、アンダ
ーコート印刷により形成される第1の絶縁層205及び第2の絶縁層206が、その表面
に、順次、形成される。その後、その表面には、両側の導体パターン201と203を覆
うように導体層207が導電性ペーストで形成され、更に、その上にオーバーコート20
8を形成し、もって、ジャンパ構造が完成される。なお、これら絶縁層や導体層の印刷に
は、例えば、スクリーン印刷などの一般の印刷技術を採用することにより実現することが
出来る。
Here, a jumper structure of the printed wiring board 200 formed on the insulating substrate (base material) 100 will be described with reference to a partially enlarged sectional view of FIG. This jumper structure is a portion of a conductor pattern 202 shown in the center of the figure in copper foils 201, 202, and 203, which are conductor patterns formed (remained) on an insulating substrate (base material) 100 by etching. The conductor patterns 201 and 203 on both sides thereof are electrically connected to each other. Specifically, first, a solder resist layer 204 including the conductor pattern 202 is formed on the surface of the printed wiring board. In addition, the code | symbol 204 in a figure is the said resist printing (process S13).
The soldering resist layer formed by is shown. The solder resist film 204 can be counted (counted) as the number of insulating layers. Furthermore, as will be described below, a first insulating layer 205 and a second insulating layer 206 formed by undercoat printing are sequentially formed on the surface. Thereafter, a conductor layer 207 is formed on the surface with a conductive paste so as to cover the conductor patterns 201 and 203 on both sides, and an overcoat 20 is further formed thereon.
8 is formed, thereby completing the jumper structure. The insulating layer and the conductor layer can be printed by adopting a general printing technique such as screen printing, for example.

ここで、再び、図3に戻り、上記ソルダレジスト層204の表面には、第1の絶縁層2
05を形成するためのアンダーコート印刷Iが行なわれ(工程S14)る。そして、この
印刷が行なわれると同時に、さらに、上記確認マーク300の上にも、アンダーコート印
刷Iが行なわれる。すなわち、本例では、添付の図5(A)に示すように、上記確認マー
ク300を構成する一方の円形のランド301上にも、上記アンダーコート印刷Iが行な
われる(符号305を参照)。また、同様にして、第2の絶縁層206を形成するための
アンダーコート印刷IIが行なわれる(工程S15)と同時に、上記確認マーク300の他
方の円形のランド303の上にも行なわれる。本例では、添付の図5(B)に示すように
、上記確認マーク300を構成する他方にある円形のランド303上に、上記アンダーコ
ート印刷IIが行なわれる(符号306を参照)。なお、こられ確認マーク300上へのア
ンダーコート印刷は、上記アンダーコート印刷I及びIIを実行すると同時に、上記確認マ
ーク300の位置に対応した部分に所定の形状(なお、本例では、径1.3φの円形)で
印刷することによって実現される。
Here, returning to FIG. 3 again, the surface of the solder resist layer 204 is covered with the first insulating layer 2.
Undercoat printing I for forming 05 is performed (step S14). At the same time as this printing is performed, undercoat printing I is also performed on the confirmation mark 300. That is, in this example, as shown in FIG. 5A, the undercoat printing I is performed on one circular land 301 constituting the confirmation mark 300 (see reference numeral 305). Similarly, undercoat printing II for forming the second insulating layer 206 is performed (step S15) and at the same time on the other circular land 303 of the confirmation mark 300. In this example, as shown in FIG. 5B, the undercoat printing II is performed on the circular land 303 on the other side of the confirmation mark 300 (see reference numeral 306). Note that undercoat printing on the confirmation mark 300 is performed at the same time as the undercoat printing I and II are performed, and at a portion corresponding to the position of the confirmation mark 300 (in this example, a diameter 1). This is realized by printing with a 3φ circle.

さらに、導電性ペーストを所定の形状で印刷することにより(工程S16)、例えば、
上記図4において符号207で示すように、中央部の導体パターン202を越えてその両
側の導体パターン201と203とを電気的に接続する、所謂、ジャンパ構造が形成され
ることとなる。なお、実際のプリント配線板の製造方法では、本発明とは直接的には関連
しないが、その後、形成した導体層207を被覆するようにオーバーコートを印刷し(工
程S17:上記図4の符号208を参照)、更に、その外形を加工するためにプレス加工
を行なう(工程S18)。
Furthermore, by printing the conductive paste in a predetermined shape (step S16), for example,
As shown by the reference numeral 207 in FIG. 4, a so-called jumper structure is formed which electrically connects the conductor patterns 201 and 203 on both sides beyond the conductor pattern 202 at the center. The actual printed wiring board manufacturing method is not directly related to the present invention, but thereafter, an overcoat is printed so as to cover the formed conductor layer 207 (step S17: symbol in FIG. 4 above). 208), and further, press working is performed to process the outer shape (step S18).

その後、以上のようにして完成したプリント配線板は(但し、上記絶縁基材100から
切り離された状態、あるいは、未だ切り離されずに上記捨て基板150と一緒の状態でも
よい)、上記のアンダーコート印刷I(工程S14)及びアンダーコート印刷II(工程S
15)においてその表面にアンダーコート層(絶縁層)305、306が形成された上記
の確認マーク300を利用して、その電気的特性が検査を含めて、同時に同一チェック装
置で回路導通チェックが行なわれる(工程S19)。
Thereafter, the printed wiring board completed as described above (however, it may be separated from the insulating base material 100 or may be in a state where it is not separated yet and the discarded substrate 150), I (step S14) and undercoat printing II (step S)
15) Using the above-mentioned confirmation mark 300 having the undercoat layers (insulating layers) 305 and 306 formed on the surface thereof in 15), the electrical characteristics of the circuit including the inspection are simultaneously checked with the same checking device. (Step S19).

より具体的には、この時、上記確認マーク300を利用することによれば、例えば、図
5(A)及び(B)にも示すように、確認マーク300を構成する近傍に個別に形成する
円形のランド301及び303と、それぞれの表面上に個別に印刷・形成されたアンダー
コートI層305及びアンダーコートII層306とを目視により比較して印刷パターンと
プリント配線板上の回路パターンとのズレを確認することが出来る。すなわち、上記確認
マーク300の円形のランド301又は303の中心と、アンダーコートI層305又は
アンダーコートII層306の中心とが一致していれば良く、これらの位置がズレている場
合には、印刷パターンとプリント配線板上の回路パターンとの間にズレが生じていること
となる。なお、このランド301又は303の形状としては、上記のズレが生じているか
否か、及び/又は、そのズレがどの方向に生じているかを判定する場合には、特に、円形
に形成することが好ましい。
More specifically, at this time, if the confirmation mark 300 is used, for example, as shown in FIGS. 5A and 5B, the confirmation mark 300 is individually formed in the vicinity. By comparing the circular lands 301 and 303 with the undercoat I layer 305 and the undercoat II layer 306 individually printed and formed on the respective surfaces, the printed pattern and the circuit pattern on the printed wiring board are compared. The deviation can be confirmed. That is, it is sufficient that the center of the circular land 301 or 303 of the confirmation mark 300 and the center of the undercoat I layer 305 or the undercoat II layer 306 coincide with each other. There is a deviation between the printed pattern and the circuit pattern on the printed wiring board. Note that the land 301 or 303 may be formed in a circular shape when determining whether or not the above-described misalignment is occurring and / or in which direction the misalignment is occurring. preferable.

加えて、上記の確認マーク300を利用することによれば、添付の図6(A)及び(B
)に示すように、上記確認マーク300の円形のランド301、302、303の表面に
、チェック装置(例えば、オープン/ショートチェッカ)の検査端子401、402、4
03を接触することにより、上述した目視によるチェックに依存することなく、自動的に
、近傍の別々の円形ランド301、303に形成したアンダーコートI層305及びアン
ダーコートII層306についての電気的な特性、即ち、その絶縁性能を、電気的に、かつ
、自動的にチェックすることが可能となる。なお、上記の検査端子401、402、40
3は、上記回路導通チェック(工程S19)において、プリント配線板200又は絶縁基
材100の上に形成された上記確認マーク300と対応する位置であって、それぞれ、上
記確認マーク300の円形のランド301、302、303の形成位置に対応した位置(
中心位置が好ましい)に予め配置されており、例えば、完成したプリント配線板200又
は絶縁基材100が検査位置に導入されると同時に、それらとの接触が自動的に行なわれ
る。
In addition, according to the use of the confirmation mark 300, the attached FIGS.
), Check terminals 401, 402, 4 of the check device (for example, open / short checker) are formed on the surfaces of the circular lands 301, 302, 303 of the confirmation mark 300.
03, the electrical characteristics of the undercoat I layer 305 and the undercoat II layer 306 formed on the separate circular lands 301 and 303 in the vicinity automatically without depending on the visual check described above. It is possible to check the characteristic, that is, the insulation performance electrically and automatically. The inspection terminals 401, 402, and 40 described above are used.
Reference numeral 3 denotes a position corresponding to the confirmation mark 300 formed on the printed wiring board 200 or the insulating substrate 100 in the circuit continuity check (step S19). Positions corresponding to the formation positions of 301, 302, and 303 (
For example, the completed printed wiring board 200 or the insulating base material 100 is introduced into the inspection position at the same time as the contact with them is automatically performed.

上記の説明からも明らかなように、上記の確認マーク300と、上記検査端子401、
402、403を備えたチェッカとによれば、それら検査端子401、402、403間
の抵抗値を測定することによって、プリント配線板200上の導体パターンである回路部
分の一部の上に(又は、飛び越えて)ジャンパ構造の導体層207を形成するために印刷
・形成された複数の絶縁層であるアンダーコートI層305及びアンダーコートII層30
6の絶縁特性を計測することが可能となる。すなわち、検査端子401と402との間の
抵抗値を計測することにより、上記アンダーコートI層305からなる第1の絶縁層の絶
縁特性が、他方、検査端子402と403との間の抵抗値を計測することにより、上記ア
ンダーコートII層306からなる第2の絶縁層の絶縁特性が分かることとなる。すなわち
、これら複数の絶縁層に関して、その形成の欠陥(工程の抜けを含む)や、ジャンパ構造
を形成するために十分な厚さで形成されたか否かを、目視によらず、自動的に、かつ、確
実にチェックすることが可能となる。
As is clear from the above description, the confirmation mark 300, the inspection terminal 401,
According to the checker provided with 402, 403, by measuring the resistance value between the inspection terminals 401, 402, 403, or on a part of the circuit portion which is a conductor pattern on the printed wiring board 200 (or The undercoat I layer 305 and the undercoat II layer 30, which are a plurality of insulating layers printed and formed to form a jumper-structured conductor layer 207.
6 can be measured. That is, by measuring the resistance value between the inspection terminals 401 and 402, the insulation characteristic of the first insulating layer made of the undercoat I layer 305 is on the other hand, the resistance value between the inspection terminals 402 and 403. By measuring the above, the insulating characteristics of the second insulating layer made of the undercoat II layer 306 can be understood. That is, regarding the plurality of insulating layers, whether or not they are formed with a sufficient thickness for forming a jumper structure, including defects in formation (including missing process), automatically, And it becomes possible to check reliably.

なお、本例では、上記の回路導通チェック(工程S19)が実行された後、製品として
(上記絶縁基材100から切り離された状態、あるいは、未だ切り離されずに上記捨て基
板150と一緒の状態でもよい)出荷されることとなる(工程S20)。
In this example, after the above-described circuit continuity check (step S19) is executed, the product (in a state where it is separated from the insulating base material 100 or in a state where it has not been separated yet and is still with the discarded substrate 150). Good) will be shipped (step S20).

なお、以上に詳述した説明では、確認マーク300は、例えば、3個の円形のランド3
01、302、303を形成すると共に、その間を細い導体路304、304により電気
的に接続することにより構成として説明した。すなわち、プリント配線板200上にジャ
ンパ構造を形成するための2層の絶縁層である、アンダーコートI層305及びアンダー
コートII層306に対応して、2個のランド301、303を形成すると共に、上記検査
端子を接触するためのランド302を加え、3個としている。換言すれば、これらランド
の形成数は、(検査対象となる絶縁層の数)+(端子接触用ランド)=3として表すこと
が出来る。
In the above detailed description, the confirmation mark 300 is, for example, three circular lands 3.
The configuration has been described by forming 01, 302, and 303 and electrically connecting them between the thin conductor paths 304 and 304. That is, two lands 301 and 303 are formed corresponding to the undercoat I layer 305 and the undercoat II layer 306, which are two insulating layers for forming a jumper structure on the printed wiring board 200. The land 302 for contacting the inspection terminal is added to obtain three. In other words, the number of lands formed can be expressed as (number of insulating layers to be inspected) + (terminal contact land) = 3.

しかしながら、本発明は、上記の実施の形態に限定されることなく、例えば、ランドの
形成数を上記の検査対象となる絶縁層の数(ランドの形成数=検査対象となる絶縁層の数
)として、具体的には、上記の例では、2個の円形のランド301、303とし、その間
に形成される細い導体路304の一部を、上記検査端子との接触のために使用してもよい
。または、添付の図7に示すように、アンダーコートI層305及びアンダーコートII層306を形成するランド301、303を並べて配置し、その一方の端部に、検査端子を接触するためのランド302を形成してもよく、更には、それらを単一のランドとして形成し、その一部に、プリント配線板200での絶縁層の形成に対応して絶縁層を形成し、残りの部分を検査端子を接触するために使用することも可能である。
However, the present invention is not limited to the above-described embodiment. For example, the number of land formations is the number of insulating layers to be inspected (the number of land formations = the number of insulating layers to be inspected). Specifically, in the above example, two circular lands 301 and 303 are used, and a part of the thin conductor path 304 formed between them may be used for contact with the inspection terminal. Good. Alternatively, as shown in FIG. 7 attached, lands 301 and 303 for forming the undercoat I layer 305 and the undercoat II layer 306 are arranged side by side, and a land 302 for contacting the inspection terminal at one end thereof. Furthermore, they are formed as a single land, an insulating layer is formed on a part of the land corresponding to the formation of the insulating layer on the printed wiring board 200, and the remaining part is inspected. It can also be used to contact the terminals.

また、上記の実施の形態では、上記確認マーク300を構成するランド301、303
(ランド302を含む)について、特に、その形状を円形として説明したが、本発明では
それのみに限定されることなく、その他、例えば、四角形、三角形等の多角形、その他の
形状でもよい。しかしながら、特に、上記ランド301、303の形状については、上記
プリント配線板(製品)200の内部にソルダレジストを塗布する際、同時に、その表面
にもソルダレジストが塗布されることから、上記プリント配線板(製品)200内のソル
ダレジストのズレを目視により検査する場合(すなわち、どちらの方向にどの程度ズレて
いるかを確認する)に都合がよく、より円形に近い形状であることが好ましい。
In the above embodiment, the lands 301 and 303 constituting the confirmation mark 300 are also described.
In particular, the shape (including the land 302) has been described as a circular shape, but in the present invention, the shape is not limited thereto, and other shapes such as a polygon such as a quadrangle and a triangle may be used. However, in particular, with respect to the shape of the lands 301 and 303, when the solder resist is applied to the inside of the printed wiring board (product) 200, the solder resist is also applied to the surface at the same time. This is convenient for visually inspecting the deviation of the solder resist in the plate (product) 200 (that is, confirming how much the deviation is in which direction), and preferably has a more circular shape.

本発明の一実施の形態になる回路基板(プリント配線板)を形成するために用いられる基材である絶縁基板(基材)の外観の一例を示す斜視図である。It is a perspective view which shows an example of the external appearance of the insulated substrate (base material) which is a base material used in order to form the circuit board (printed wiring board) which becomes one embodiment of this invention. 上記絶縁基板(基材)の一部に形成される確認マークの一例を示す平面図である。It is a top view which shows an example of the confirmation mark formed in a part of said insulating substrate (base material). 上記絶縁基板(基材)により回路基板(プリント配線板)を製造する方法の一例について説明する工程図である。It is process drawing explaining an example of the method of manufacturing a circuit board (printed wiring board) with the said insulated substrate (base material). 上記回路基板(プリント配線板)に形成されるジャンパ構造の一例を説明するための一部拡大断面図である。It is a partially expanded sectional view for demonstrating an example of the jumper structure formed in the said circuit board (printed wiring board). 確認マークの利用方法、即ち、確認マークの上に形成される第1及び第2の絶縁層との関係を説明するための図である。It is a figure for demonstrating the utilization method of a confirmation mark, ie, the relationship with the 1st and 2nd insulating layer formed on a confirmation mark. 上記確認マークとチェック装置の検査端子との関係を説明するための図である。It is a figure for demonstrating the relationship between the said confirmation mark and the test | inspection terminal of a check apparatus. 上記確認マークの変形例の一例を示す平面図である。It is a top view which shows an example of the modification of the said confirmation mark.

符号の説明Explanation of symbols

100 絶縁基板(基材)
200 プリント配線板
201、202、203 銅箔(導体パターン)
205 第1の絶縁層(アンダーコートI)
206 第2の絶縁層(アンダーコートII)
207 導体層
300 確認マーク
301、302、303 ランド
305 アンダーコートI層
306 アンダーコートII層
401、402、403 検査端子。

100 Insulating substrate (base material)
200 Printed wiring board 201, 202, 203 Copper foil (conductor pattern)
205 First insulating layer (undercoat I)
206 Second insulating layer (undercoat II)
207 Conductor layer 300 Confirmation mark 301, 302, 303 Land 305 Undercoat I layer 306 Undercoat II layer 401, 402, 403 Inspection terminal.

Claims (5)

絶縁基板と、前記絶縁基板の少なくとも一方の表面に形成された導体パターンとを備え
ると共に、更に、前記絶縁基板の表面上に形成した前記導体パターンの一部の表面には絶
縁層を形成してなる回路基板であって、更に、前記絶縁基板の表面に形成された前記導体パターン及び前記絶縁層とは独立して、前記絶縁基板の一部に、前記絶縁層の形成を確認するための確認マークを備え、前記確認マークは、前記の絶縁層の形成と対応して、それぞれの表面に絶縁層が個別に形成される所定形状の導体層を備え、その間を電気的に接続して構成されていることを特徴とする回路基板。
An insulating substrate and a conductor pattern formed on at least one surface of the insulating substrate; and an insulating layer is formed on a part of the surface of the conductor pattern formed on the surface of the insulating substrate. And a confirmation for confirming the formation of the insulating layer on a part of the insulating substrate independently of the conductor pattern and the insulating layer formed on the surface of the insulating substrate. Corresponding to the formation of the insulating layer, the confirmation mark includes a conductor layer having a predetermined shape on which the insulating layer is individually formed, and is electrically connected therebetween. A circuit board characterized by the above.
絶縁基板と、前記絶縁基板の少なくとも一方の表面に形成された導体パターンとを備え
ると共に、更に、前記絶縁基板の表面上に形成した前記導体パターンの一部の表面には絶
縁層を形成し、当該絶縁層の表面に導体層を形成してなる回路基板であって、前記絶縁層
は複数の層から形成されており、更に、前記絶縁基板の表面に形成された前記導体パター
ン及び前記絶縁層とは独立して、前記絶縁基板の一部に、前記複数の絶縁層の形成を確認
するための確認マークを備えており、前記確認マークは、前記複数の絶縁層の形成
と対応して、それぞれの表面に絶縁層が個別に形成される所定形状の導体層を、複数備え
、その間を電気的に接続して構成されていることを特徴とする回路基板。
In addition to providing an insulating substrate and a conductor pattern formed on at least one surface of the insulating substrate, and further forming an insulating layer on a part of the surface of the conductor pattern formed on the surface of the insulating substrate, A circuit board formed by forming a conductor layer on the surface of the insulating layer, wherein the insulating layer is formed of a plurality of layers, and further, the conductor pattern and the insulating layer formed on the surface of the insulating substrate Independently, a confirmation mark for confirming the formation of the plurality of insulating layers is provided on a part of the insulating substrate, the confirmation mark corresponding to the formation of the plurality of insulating layers, A circuit board comprising a plurality of conductor layers having a predetermined shape, each having an insulating layer formed individually on each surface, and electrically connected therebetween.
前記請求項1又は請求項2に記載した回路基板において、前記確認マークは、その捨て基
板部分に形成したことを特徴とする回路基板。
3. The circuit board according to claim 1, wherein the confirmation mark is formed on a discarded board portion.
前記請求項1〜3の何れかに記載した回路基板のための検査方法であって、前記導体パタ
ーン及び前記絶縁層とは独立して前記絶縁基板の一部に形成された前記確認マークの表面
に、前記複数の絶縁層の形成に対応してそれぞれの表面に絶縁層を個別に形成した後、検
査端子を接触してその電気的特性を計測することにより、前記導体パターンの一部に形成
された前記複数の絶縁層の電気的特性を検査することを特徴とする回路基板のための検査
方法。
The inspection method for a circuit board according to any one of claims 1 to 3, wherein the surface of the confirmation mark is formed on a part of the insulating substrate independently of the conductor pattern and the insulating layer. In addition, after forming the insulating layers individually on the respective surfaces in correspondence with the formation of the plurality of insulating layers, the contact terminals are contacted and the electrical characteristics are measured to form a part of the conductor pattern. An inspection method for a circuit board, comprising: inspecting electrical characteristics of the plurality of insulating layers.
前記請求項4に記載した回路基板のための検査方法において、前記複数の絶縁層の電気的
特性を検査する方法が導体パターンの回路導通チェックと同時に検査することを特徴とす
る回路基板のための検査方法。

5. The inspection method for a circuit board according to claim 4, wherein the method for inspecting the electrical characteristics of the plurality of insulating layers is performed simultaneously with the circuit continuity check of the conductor pattern. Inspection method.

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* Cited by examiner, † Cited by third party
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KR101298514B1 (en) * 2012-07-18 2013-08-22 대덕지디에스 주식회사 Method for detecting reinforcement of fpcb

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