JP2006065704A - 追い越し判定装置、データ転送システム - Google Patents
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Abstract
【課題】 非同期クロック間でのデータ転送においてもクロック乗せ換え回路を必要としない追い越し判定回路、及びこの追い越し判定回路を備えるデータ転送システムを提供すること。
【解決手段】 デュアルポートメモリ3に接続されている書き込み側回路2が書き込んだデータに対する読み出し側回路4による読み出しが、書き込み側回路2による書き込みを追い越していないことを判定する追い越し判定回路5に、書き込み側回路2が次にデータを書き込む、デュアルポートメモリ3内のアドレスを算出する予測カウンタ52と、予測カウンタ52により算出されたアドレスに書き込み側回路2によりデータが書き込まれる時期を予測する周期換算部51と、予測カウンタ52により算出された書き込みアドレスと、読み出し側回路4が読み出すアドレスとを比較して、読み出しアドレスが書き込みアドレスを追い越していないことを判定する比較部53とを備える。
【選択図】 図2
【解決手段】 デュアルポートメモリ3に接続されている書き込み側回路2が書き込んだデータに対する読み出し側回路4による読み出しが、書き込み側回路2による書き込みを追い越していないことを判定する追い越し判定回路5に、書き込み側回路2が次にデータを書き込む、デュアルポートメモリ3内のアドレスを算出する予測カウンタ52と、予測カウンタ52により算出されたアドレスに書き込み側回路2によりデータが書き込まれる時期を予測する周期換算部51と、予測カウンタ52により算出された書き込みアドレスと、読み出し側回路4が読み出すアドレスとを比較して、読み出しアドレスが書き込みアドレスを追い越していないことを判定する比較部53とを備える。
【選択図】 図2
Description
本発明は、デュアルポートメモリを用いてデータ転送を行う場合に、書き込み側装置による転送データの書き込みを、読み出し側装置によるその転送データの読み出しが追い越さないように判定する追い越し判定装置、及びこの追い越し判定装置を備えるデータ転送システムに関する。
従来、デュアルポートメモリ(デュアルポートRAM(ランダムアクセスメモリ))を用いて2つの回路間でデータ転送を行うデータ転送方法がある。この方法において、転送データを書き込む側の回路と読み出す側の回路において効率よくデータ転送を行うための発明として、例えば下記特許文献1においては、ビデオデータをLCD(液晶ディスプレイ)に表示する形式のデータに変換する回路において、読み出し速度を上げつつ、書き込みと読み出しの順序が入れ替わらないように、読み出しが一巡する時間が、書き込みが一巡する時間より必ず短くなるように調整する機構を備える方法について記載されている。
画像形成装置の画像データ生成部分の回路においても、デュアルポートメモリを用いたデータ転送が頻繁に使われている。例えば、レーザーを用いたページプリンタにおいて、いくつかの画像処理を行う処理速度の異なる回路間の接続に1ライン分のデュアルポートメモリを設け、前段の回路が処理結果をデュアルポートメモリに順次書き込み、後段の回路がそのデータを順次読み出すことで双方の動作速度の違いを吸収する仕組みなどがある。
このようなデータ転送では、読み出し側回路の読み出しが書き込み側回路の書き込みを追い越さないように、通常、追い越し判定回路が用いられている。従来の追い越し判定回路は、書き込み側回路が現在書き込みを行っているアドレスを書き込み側回路から入力するとともに、読み出し側回路が読み出すアドレスを読み出し側回路から入力して両者を比較することにより、読み出しが書き込みを追い越さないことを判定していた。
特許第3259694号公報
しかしながら、上記のデータ転送の方式において、書き込み側回路と読み出し側回路とが異なるクロックで動作している場合には、非同期クロック間でデータ参照を行うためのクロック乗せ替え回路が必要となっていた。クロック乗せ換え回路は、同期設計を基本方針としている最近のデジタル回路設計において設計上の注意を必要とするものであり、設計ミスが起こりやすく設計の難易度が高いので、使用しないことが望ましい。
本発明は、上記問題点に鑑みて成されたもので、非同期クロック間でのデータ転送においてもクロック乗せ換え回路を必要としない追い越し判定回路、及びこの追い越し判定回路を備えるデータ転送システムを提供することを目的とする。
請求項1に係る追い越し判定装置は、デュアルポートメモリに書き込み側装置が書き込んだデータに対する、読み出し側装置による読み出しが、前記書き込み側装置による書き込みを追い越していないことを判定する追い越し判定装置において、前記書き込み側装置が、前記デュアルポートメモリ内の次にデータを書き込むアドレスを算出する書き込みアドレス算出手段と、前記書き込みアドレス算出手段により算出されたアドレスに前記書き込み側装置によりデータが書き込まれる時期を予測する書き込み時期予測手段と、前記書き込みアドレス算出手段により算出された書き込みアドレスと、前記読み出し側装置が読み出す読み出しアドレスとを比較して、前記読み出しアドレスが前記書き込みアドレスを追い越していないと判定した場合には、前記読み出し側装置に対し読み出しを許可する判定手段とを備えるものである。
この構成によれば、書き込み側装置が書き込むアドレスを参照することなく、現在書き込み側装置が書き込んでいるアドレスを算出できるので、書き込み側装置の動作するクロックと読み出し側装置の動作するクロックとが異なる場合においても、クロック乗せ換え回路を用いる必要がない。
請求項2に係る追い越し判定装置は、請求項1に記載の追い越し判定装置であって、前記書き込みアドレス算出手段は、前記書き込み側装置がデータの書き込みを開始する開始アドレスを記憶する開始アドレス記憶手段と、前記書き込み側装置が今回データを書き込んだアドレスと次にデータを書き込むアドレスとの間のアドレス増分を記憶する増分記憶手段と、前記書き込み側装置が今回データを書き込んだアドレスに前記アドレス増分を加算して次にデータを書き込むアドレスを算出する書き込みアドレス算出手段とを備え、前記書き込み時期予測手段は、当該読込側装置の動作クロックで表した書き込み周期を記憶する書き込み周期記憶手段とを備えるものである。
この構成によれば、書き込み側装置が書き込むアドレスを参照することなく、現在書き込み側装置が書き込んでいるアドレスを算出できるので、書き込み側装置の動作するクロックと読み出し側装置の動作するクロックとが異なる場合においても、クロック乗せ換え回路を用いる必要がない。
請求項3に係るデータ転送システムは、請求項1又は2に記載の追い越し判定装置と、前記書き込み側装置と、前記デュアルポートメモリと、前記読み出し側装置とを備えるものである。
この構成によれば、請求項1又は2の効果を奏するデータ転送システムを提供することができる。
請求項1、2又は3に記載の発明によれば、書き込み側装置が書き込むアドレスを参照することなく、現在書き込み側装置が書き込んでいるアドレスを算出できるので、書き込み側装置の動作するクロックと読み出し側装置の動作するクロックとが異なる場合においても、クロック乗せ換え回路を用いる必要がない。このため、回路設計の難易度が高くなることを回避でき、設計ミスを軽減することができる。
以下、本発明の一実施形態における追い越し判定装置を備える、デュアルポートメモリを用いたデータ転送システムについて図面を参照しながら説明する。図1は、本発明の一実施形態に係るデータ転送システムの構成を概略的に示すブロック図である。データ転送システム1は、書き込み側回路2、デュアルポートメモリ3、読み出し側回路4、追い越し判定回路5を備える。データ転送システム1は、書き込み側回路2から読み出し側回路4にデータを転送するシステムである。
デュアルポートメモリ3は、2方向からのアクセスを可能にするために2つのポートを有するメモリ、例えばRAM(ランダムアクセスメモリ)である。デュアルポートメモリ3は、例えば、複写機等の画像形成装置において、1ライン分の画像(画素)データを格納するためのラインバッファメモリである。
書き込み側回路2は、読み出し側回路4に転送するデータをデュアルポートメモリ3に書き込むものである。書き込み側回路2は、デュアルポートメモリ3の例えば最初のアドレスから順次書き込みアドレスを所定の増分ずつずらしながら(増加させながら)、所定の周期(例えば3クロックごと)でデータを書き込む。書き込み側回路2は、書き込みアドレス線(w_Address)にデータを書き込むアドレスを出力し、データ線(w_Data)にデータを出力した後、ライト線(WE)をオンにすることによりデュアルポートメモリ3の所望のアドレスにデータを書き込む。書き込み側回路2は、書き込みクロック線(wCLK)から入力される所定のクロック(書き込み側クロック)、例えば20[MHz]により動作する。
読み出し側回路4は、書き込み側回路2から転送されるデータをデュアルポートメモリ3から読み出すものである。読み出し側回路4も、書き込み側回路2と同様に、デュアルポートメモリ3の例えば最初のアドレスから順次読み出しアドレスを(書き込み側回路2と同じ)所定の増分ずつずらしながら(増加させながら)、書き込み側回路2が転送データを書き込んだ後にそのアドレスからデータを読み出す。読み出し側回路4は、読み出しアドレス線(r_Address)にデータを読み出すアドレスを出力した後、読み出し制御線(rCtl)がオンになったときに、リード線(RD)をオンにすることによりデュアルポートメモリ3の所望のアドレスからデータを読み出す。読み出し側回路4は、読み出しクロック線(rCLK)から入力される、書き込み側クロックとは異なる所定のクロック(読み出し側クロック)、例えば33[MHz]により動作する。
追い越し判定回路5は、読み出し側回路4が読み出し予定のアドレスからデータを読み出しても、書き込み側回路2による書き込みを追い越さない(書き込み側回路2が書き込む前に読み出していない)と判定した場合に、読み出し側回路4に読み出しを許可するものである。追い越し判定回路5は、読み出しアドレス線(r_Address)から入力されているアドレス(次に読み出すアドレス)に対するデータの書き込みが終了したと予測したときに、読み出し制御線(rCtl)をオンにする。
図2は、追い越し判定回路5の構成を示すブロック図である。追い越し判定回路5は、周期換算部51、予測カウンタ52及び比較部53を備える。周期換算部51は、書き込み側回路2がデュアルポートメモリ3にデータを書き込む周期を読み出し側クロック数で表した書き込み周期換算クロック数を予め記憶しておく。この書き込み周期換算クロック数は、例えば書き込み側回路2の動作クロックが20[MHz]、読み出し側回路4の動作クロックが33[MHz]で、書き込み側回路2の書き込み周期が3クロックごとである場合には5クロックである。周期換算部51は、読み出しクロック線(rCLK)により入力される読み出し側クロックが書き込み周期換算クロック数、例えば5クロックを数えるごとにカウントパルス線(CntEn)をオンにする。予測カウンタ52は、書き込み開始アドレスと、書き込みアドレスを順次ずらすときの(アドレスの)増分を予め記憶しておく。また、予測カウンタ52は、算出した書き込み予測アドレスを記憶する。予測カウンタ52は、クリア線(clr)がオンされたときに書き込み開始アドレスを書き込み予測アドレスに代入する。予測カウンタ52は、カウントパルス線(CntEn)がオンされたときに、書き込み予測アドレスに増分を加算して新たな書き込み予測アドレスとし、この書き込み予測アドレスをアドレス出力線(AddrOut)に出力する。比較部53は、読み出しアドレス線(r_Address)から入力されている読み出しアドレスとアドレス出力線(AddrOut)から入力されている書き込み予測アドレスとを比較し、読み出しアドレスが書き込み予測アドレスより小さい場合には読み出し制御線(rCtl)をオンにする。
図3は、データ転送システム1の動作の一例を示すタイミングチャートである。線S1は、書き込みクロック線(wCLK)の書き込み側クロックで、例えば20[MHz]のクロックである。書き込み側回路2は、書き込み側クロックで例えば3クロックごとの時刻T1、T2、T3、T4において3クロックの時間を要してデュアルポートメモリ3にデータを書き込む。線S2は、読み出しクロック線(rCLK)の読み出し側クロックで、例えば33[MHz]のクロックである。書き込み側クロックの3クロックが読み出し側クロックの5クロックに相当する。
線S3は、アドレス出力線(AddrOut)に出力されている(予測カウンタ52で算出される書き込み側回路2の書き込み)アドレス値を示しており、例えば時刻T1からT2の間には、アドレス値0x0000が出力されており、時刻T2からT3の間には、アドレス値0x0010が出力されている。線S4は、読み出しアドレス線(r_Address)に出力されている(読み出し側回路4が次に読み出す)アドレス値を示しており、例えば時刻T11からT31の間には、アドレス値0x0000が出力されており、時刻T31以降は、アドレス値0x0010が出力されている。線S5は、読み出し制御線(rCtl)に出力されている読み出し制御信号を示しており、線S5がハイレベルになったときが読み出し制御信号がオンになったことを示している。書き込みの終了していないアドレスを読み出そうとした場合(例えば0x0000の場合)には、書き込みが終了したとき(時刻T2)の次のクロックの立ち上がり(時刻T22)において、読み出し制御信号がオンになる。書き込みの終了しているアドレスを読み出そうとした場合(例えば0x0010の場合)には、読み出しアドレス線(r_Address)にアドレス値が出力されたとき(時刻T31)の次のクロックの立ち上がり(時刻T32)において、読み出し制御信号がオンになる。それぞれ読み出し制御信号がオンになったことを受けて読み出し側回路4は、読み出しアドレス線(r_Address)に出力されているデュアルポートメモリのアドレスからデータを読み出す。
このように本実施形態によれば、追い越し判定回路5において、書き込み側回路2が書き込むアドレスを参照せずに、そのアドレスを算出し、書き込み側回路2が転送データを書き込んだ後で読み出し側回路4がその転送データの書き込まれたアドレスからデータを読み出すので、書き込み側回路と読み出し側回路が異なるクロックで動作している場合でも、デュアルポートメモリを用いてデータ転送をクロック乗せ換え回路なしに行うことができる。
なお、本発明は、上記実施形態のものに限定されるものではなく、以下に述べる態様を採用することができる。本実施形態においては、周期換算部51に、書き込み側回路2がデュアルポートメモリ3にデータを書き込む周期を読み出し側クロック数で表した書き込み周期換算クロック数を予め記憶しておいたが、例えば書き込み側回路2の動作クロック、書き込み側回路2の書き込み周期、及び読み出し側回路4の動作クロックを周期換算部51に記憶、又は入力してそれらから書き込み周期換算クロック数を周期換算部51において算出するようにしてもよい。
本実施形態においては、書き込み側回路2の書き込み周期が読み出し側回路4の動作クロックの整数個分、例えば5クロックとなる場合について説明したが、これが整数個分にならない場合、例えば書き込み側回路2の書き込み周期が読み出し側回路4の動作クロックで5.5クロックである場合には、書き込み周期以後で書き込み周期に最も近い読み出し側回路4の動作クロック(例えば交互に6クロックと5クロックごと)でカウントパルス線(CntEn)をオンにすればよい。
1 データ転送システム
2 書き込み側回路(書き込み側装置)
3 デュアルポートメモリ
4 読み出し側回路(読み出し側装置)
5 追い越し判定回路(追い越し判定装置)
51 周期換算部(書き込み時期予測手段)
52 予測カウンタ(アドレス算出手段)
53 比較部(判定手段)
2 書き込み側回路(書き込み側装置)
3 デュアルポートメモリ
4 読み出し側回路(読み出し側装置)
5 追い越し判定回路(追い越し判定装置)
51 周期換算部(書き込み時期予測手段)
52 予測カウンタ(アドレス算出手段)
53 比較部(判定手段)
Claims (3)
- デュアルポートメモリに書き込み側装置が書き込んだデータに対する、読み出し側装置による読み出しが、前記書き込み側装置による書き込みを追い越していないことを判定する追い越し判定装置において、
前記書き込み側装置が、前記デュアルポートメモリ内の次にデータを書き込むアドレスを算出する書き込みアドレス算出手段と、
前記書き込みアドレス算出手段により算出されたアドレスに前記書き込み側装置によりデータが書き込まれる時期を予測する書き込み時期予測手段と、
前記書き込みアドレス算出手段により算出された書き込みアドレスと、前記読み出し側装置が読み出す読み出しアドレスとを比較して、前記読み出しアドレスが前記書き込みアドレスを追い越していないと判定した場合には、前記読み出し側装置に対し読み出しを許可する判定手段と
を備える追い越し判定装置。 - 前記書き込みアドレス算出手段は、前記書き込み側装置がデータの書き込みを開始する開始アドレスを記憶する開始アドレス記憶手段と、前記書き込み側装置が今回データを書き込んだアドレスと次にデータを書き込むアドレスとの間のアドレス増分を記憶する増分記憶手段と、前記書き込み側装置が今回データを書き込んだアドレスに前記アドレス増分を加算して次にデータを書き込むアドレスを算出する書き込みアドレス算出手段とを備え、前記書き込み時期予測手段は、当該読み出し側装置の動作クロックで表した書き込み周期を記憶する書き込み周期記憶手段とを備える請求項1に記載の追い越し判定装置。
- 請求項1又は2に記載の追い越し判定装置と、前記書き込み側装置と、前記デュアルポートメモリと、前記読み出し側装置とを備えるデータ転送システム。
Priority Applications (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004249409A JP2006065704A (ja) | 2004-08-30 | 2004-08-30 | 追い越し判定装置、データ転送システム |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
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JP2004249409A JP2006065704A (ja) | 2004-08-30 | 2004-08-30 | 追い越し判定装置、データ転送システム |
Publications (1)
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JP2006065704A true JP2006065704A (ja) | 2006-03-09 |
Family
ID=36112126
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
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JP2004249409A Pending JP2006065704A (ja) | 2004-08-30 | 2004-08-30 | 追い越し判定装置、データ転送システム |
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JP (1) | JP2006065704A (ja) |
Cited By (1)
Publication number | Priority date | Publication date | Assignee | Title |
---|---|---|---|---|
JP2012137379A (ja) * | 2010-12-27 | 2012-07-19 | Rigaku Corp | X線検出器 |
-
2004
- 2004-08-30 JP JP2004249409A patent/JP2006065704A/ja active Pending
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