JP2005339323A - ストレージシステム、計算機システムおよびインタフェースモジュール - Google Patents
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Abstract
【解決手段】 外部伝送路に接続されるシリアル信号送受信部11と、上記送受信部に接続されたインタフェース処理部10とからなり、上記インタフェース処理部が、直並列変換部13と、符号化復号化部14と、選択可能な少なくとも2種類のプロトコル処理機能を有するプロトコル処理部15と、上記プロトコル処理機能の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替える通信モード切替え回路18とを備えたインタフェースモジュール。
【選択図】 図1
Description
本発明の他の目的は、同一の入出力ポートで通信プロトコルの異なる複数の回線に選択的に接続可能なストレージシステムおよび計算機システムを提供することにある。
本発明の他の目的は、ホスト計算機上とストレージシステムとの通信プロトコルを選択的に切替え可能な計算機システムを提供することにある。
上記インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記外部伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替える通信モード切替え手段とを備えたことを特徴とする。
上記各インタフェース処理部が、上述した少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、通信モード切替え手段とを備え、上記通信モード切替え手段が、上記管理端末からの指令に応じて、上記プロトコル処理とクロック周波数の切替えを実行することを特徴とする。
ストレージシステムは、記憶制御装置20と、それぞれが通信プロトコルの異なる2種類の伝送路CH−iA、CH−iBに接続可能な複数のインタフェースモジュール1−i(i=1〜n)と、記憶制御装置20によって制御される複数のストレージ(図示せず)からなり、各インタフェースモジュール1−iは、OSI参照モデルにおける物理層やデータリンク層に相当する信号処理機能をもつインタフェース処理部10を含んでいる。各インタフェースモジュール1−iは、記憶制御装置20の筐体に内蔵されていてもよいし、筐体の外部に設置されていてもよい。
インタフェース処理部10は、図1に示したセレクタ12に接続される直並列変換部(SERDES:Serializer/Deserializer)13と、SERDES13に接続されたデータ符号化復号化部14と、データ符号化復号化部14に接続されたプロトコル処理部15と、セレクタ17を介してSERDES13に選択的に接続される2つの発振器16A、16Bと、モード切替え回路18とからなる。プロトコル処理部15は、ファイバチャネル用プロトコル処理機能部150Aと、ギガビットイーサネット用プロトコル処理機能部150Bとを備え、そのうちの一方がセレクタ151で選択され、符号化復号化部14と記憶制御装置20との間で所定のプロトコル処理動作を行う。
データセンタは、ホスト計算機50と、管理端末60と、ストレージシステムとからなり、ストレージシステムは、記憶制御装置20Aと、ストレージ200Aと、インタフェースモジュール1A−1、1A−2からなっている。ホスト計算機50は、ファイバチャネル用の伝送路CH1を介して、インタフェースモジュール1A−1に接続されている。一方、ミラーサイトのストレージシステムは、記憶制御装置20Bと、ストレージ200Bと、インタフェースモジュール1B−1、1B−2とからなっている。
本実施例では、ホスト計算機50と記憶制御装置20の双方に本発明のインタフェースモジュール1C、1Dを適用し、管理端末60からの指令によって、ホスト計算機50と記憶制御装置20との通信プロトコルを適宜切替え可能にしたことを特徴とする。
12、17、151:セレクタ、10:インタフェース処理部、13:SERDES、
14:符号化復号化部、15:プロトコル処理部、16A、16B:発振器、
150A:ファイバチャネルプロトコル処理部、151:ギガビットイーサネットプロトコル処理部、20:記憶制御装置、50:ホスト計算機、60:管理端末。
Claims (12)
- 外部伝送路に接続されるシリアル信号送受信部と、上記送受信部に接続されたインタフェース処理部とからなり、
上記インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記外部伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替える通信モード切替え手段とを備えたことを特徴とするインタフェースモジュール。 - 外部伝送路に接続される少なくとも2つのシリアル信号送受信部と、インタフェース処理部と、上記シリアル信号送受信部のうちの1つを上記インタフェース処理部に選択的に接続するためのセレクタとからなり、
上記インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記外部伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替える通信モード切替え手段とを備えたことを特徴とするインタフェースモジュール。 - 前記通信モード切替え手段が、前記セレクタによる送受信部の切替えに連動して、前記プロトコル処理部で実行するプロトコル処理と、前記基本クロック周波数を切替えることを特徴とする請求項2に記載のインタフェースモジュール。
- 前記プロトコル処理部が、ファイバチャネル用の第1プロトコル処理部と、ギガビットイーサネット用の第2プロトコル処理部を有し、
前記通信モード切替え手段が、第1プロトコル処理部の選択時に106.25MHz、第2プロトコル処理部の選択時に125MHzのクロックを前記直並列変換部に供給することを特徴とする請求項1〜請求項3の何れかに記載のインタフェースモジュール。 - 外部装置と接続するための複数のインタフェースモジュールと、記憶制御装置と、該記憶制御装置に収容された少なくとも1つの記憶装置とからなるストレージシステムにおいて、
上記インタフェースモジュールのうちの少なくとも1つが、外部伝送路に接続されるシリアル信号送受信部と、上記送受信部と上記記憶制御装置との間に接続されるインタフェース処理部とからなり、
上記インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記外部伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替えるための通信モード切替え手段とを備えたことを特徴とするストレージシステム。 - 外部装置と接続するための複数のインタフェースモジュールと、記憶制御装置と、該記憶制御装置に収容された少なくとも1つの記憶装置とからなり、
上記インタフェースモジュールのうちの少なくとも1つが、外部伝送路に接続される少なくとも2つのシリアル信号送受信部と、上記記憶制御装置に接続されるインタフェース処理部と、上記シリアル信号送受信部のうちの1つを上記インタフェース処理部に選択的に接続するためのセレクタとからなり、
上記インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記外部伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替えるための通信モード切替え手段とを備えたことを特徴とするストレージシステム。 - 前記通信モード切替え手段が、前記セレクタによる送受信部の切替えに連動して、前記プロトコル処理部で実行するプロトコル処理と、前記基本クロック周波数を切替えることを特徴とする請求項6に記載のストレージシステム。
- 前記記憶制御装置が、前記各インタフェースモジュールと対応して通信モード指定情報を記憶するための手段を有し、該通信モード指定情報に従って、前記通信モード切替え手段に前記プロトコル処理と基本クロック周波数の切替えを指令することを特徴とする請求項5〜請求項7の何れかに記載のストレージシステム。
- 前記プロトコル処理部が、ファイバチャネル用の第1プロトコル処理部と、ギガビットイーサネット用の第2プロトコル処理部とからなり、
前記通信モード切替え手段が、第1プロトコル処理部の選択時に106.25MHz、第2プロトコル処理部の選択時に125MHzのクロックを前記直並列変換部に供給することを特徴とする請求項5〜請求項7の何れかに記載のストレージシステム。 - 伝送路を介して通信するホスト計算機および記憶制御装置と、上記ホスト計算機と記憶制御装置に接続された管理端末とからなる計算機システムにおいて、
上記ホスト計算機と記憶制御装置が、それぞれ上記伝送路に接続されたシリアル信号送受信部と、上記送受信部に接続されたインタフェース処理部とからなるインタフェースモジュールを備え、
上記各インタフェース処理部が、上記送受信部から受信したシリアル信号をパラレル信号に変換すると共に、上記伝送路に送信すべきパラレル信号をシリアル信号に変換して上記送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、少なくとも2種類のプロトコル処理を選択的に実行するプロトコル処理部と、上記プロトコル処理の切替えに連動して、上記直並列変換部に供給する基本クロック周波数を切替えるための通信モード切替え手段とを備え、
上記通信モード切替え手段が、上記管理端末からの指令に応じて、上記プロトコル処理とクロック周波数の切替えを実行することを特徴とする計算機システム。 - 第1伝送路を介して接続されたホスト計算機および第1の記憶制御装置と、第2伝送路を介して上記第1の記憶制御装置に接続された第2の記憶制御装置とからなる計算機システムにおいて、
上記第1の記憶制御装置が、上記第1の伝送路に接続される第1のシリアル信号送受信部と、上記第2の伝送路に接続される第2のシリアル信号送受信部と、インタフェース処理部と、上記第1、第2のシリアル信号送受信部のうちの1つを上記インタフェース処理部に選択的に接続するためのセレクタとからなるインタフェースモジュールを有し、
上記インタフェース処理部が、上記第1または第2の送受信部から受信したシリアル信号をパラレル信号に変換すると共に、外部に送信すべきパラレル信号をシリアル信号に変換して上記第1または第2送受信部に出力する直並列変換部と、上記直並列変換部に接続された符号化復号化部と、上記符号化復号化部に接続され、第1、第2のプロトコル処理を選択的に実行するプロトコル処理部と、上記セレクタによる送受信部の選択に連動して、上記第1、第2プロトコル処理の切替えと上記直並列変換部に供給する基本クロック周波数の切替えを行う通信モード切替え手段とを備えたことを特徴とする計算機システム。 - 前記通信モード切替え手段が、前記ホスト計算機に付随する管理端末からの指令に応答して、前記プロトコル処理および基本クロック周波数の切替えを実行することを特徴とする請求項11に記載の計算機システム。
Priority Applications (4)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004159093A JP2005339323A (ja) | 2004-05-28 | 2004-05-28 | ストレージシステム、計算機システムおよびインタフェースモジュール |
US10/893,912 US7411947B2 (en) | 2004-05-28 | 2004-07-20 | Storage system, computer system and interface module |
EP05006410A EP1601125A3 (en) | 2004-05-28 | 2005-03-23 | Storage system, computer system and interface module |
US12/176,516 US8098654B2 (en) | 2004-05-28 | 2008-07-21 | Storage system, computer system and interface module |
Applications Claiming Priority (1)
Application Number | Priority Date | Filing Date | Title |
---|---|---|---|
JP2004159093A JP2005339323A (ja) | 2004-05-28 | 2004-05-28 | ストレージシステム、計算機システムおよびインタフェースモジュール |
Publications (1)
Publication Number | Publication Date |
---|---|
JP2005339323A true JP2005339323A (ja) | 2005-12-08 |
Family
ID=34934469
Family Applications (1)
Application Number | Title | Priority Date | Filing Date |
---|---|---|---|
JP2004159093A Pending JP2005339323A (ja) | 2004-05-28 | 2004-05-28 | ストレージシステム、計算機システムおよびインタフェースモジュール |
Country Status (3)
Country | Link |
---|---|
US (2) | US7411947B2 (ja) |
EP (1) | EP1601125A3 (ja) |
JP (1) | JP2005339323A (ja) |
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Date | Code | Title | Description |
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A621 | Written request for application examination |
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RD02 | Notification of acceptance of power of attorney |
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A977 | Report on retrieval |
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A131 | Notification of reasons for refusal |
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