JP2005318122A - チャージポンプ回路及びこのチャージポンプ回路を用いたpll回路 - Google Patents
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Abstract
【課題の解決手段】チャージポンプ回路6は、位相比較・ロック検出回路4の出力に応じて制御信号を発生する制御回路5の制御信号が入力するものであって、4つの電流源61,62,63,64と、3つのPチャネルMOSトランジスタP1,P2,P3と、3つのNチャネルトランジスタN1,N2,N3を備え、位相比較・ロック検出回路4のアップ信号でトランジスタP1をオン、オフし、ダウン信号でトランジスタN1オン、オフし、制御回路5の制御信号に基づいて各トランジスタP2,P3,N2,N3をオン、オフすることによって、VCO制御端子65からの出力信号をローパスフィルタ7を介してVCO8に入力する一方、チャージポンプ回路6には常時電流が流れるようにする。
【選択図】 図1
Description
2 Rカウンタ
3 Nカウンタ
4 位相比較・ロック検出回路
5 制御回路
6 チャージポンプ回路
7 ローパスフィルタ
8 VCO
61,62,63,64 電流源
65 VCO制御端子
66 第2出力端子
71 抵抗
72,73 容量
P1,P2,P3 PチャネルMOSトランジスタ
N1,N2,N3 NチャネルMOSトランジスタ
Claims (4)
- 電源端子と第1PチャネルMOSトランジスタのソース端子との間に第1電流源を接続し、接地端子と第1NチャネルMOSトランジスタのソース端子との間に第2電流源を接続し、電源端子と第2NチャネルMOSトランジスタのドレイン端子との間に第3電流源を接続し、接地端子と第2PチャネルMOSトランジスタのドレイン端子との間に第4電流源を接続し、前記第1PチャネルMOSトランジスタと前記第1NチャネルMOSトランジスタの各ドレイン端子を出力端子に接続し、前記第1PチャネルMOSトランジスタと前記第2PチャネルMOSトランジスタのソース端子同士を接続し、前記第1NチャネルMOSトランジスタと前記第2NチャネルMOSトランジスタのソース端子同士を接続し、前記第1PチャネルMOSトランジスタと前記第2PチャネルMOSトランジスタの各ゲート端子には、互いに反転関係にある信号が入力し、前記第1NチャネルMOSトランジスタと前記第2NチャネルMOSトランジスタの各ゲート端子にも、互いに反転関係にある信号が入力するよう構成した
ことを特徴とするチャージポンプ回路。 - 第1出力端子と接地間に、前記第1出力端子側から順に直列に接続した抵抗及び第1容量と、前記第1出力端子と接地間に、この抵抗と第1容量に対して並列に接続した第2容量を有するローパスフィルタに前記第1出力端子を介して出力するチャージポンプ回路であって、
電源端子と第1PチャネルMOSトランジスタのソース端子との間に第1電流源を接続し、接地端子と第1NチャネルMOSトランジスタのソース端子との間に第2電流源を接続し、電源端子と第3PチャネルMOSトランジスタのソース端子との間に第3電流源を接続し、接地端子と第3NチャネルMOSトランジスタのソース端子との間に第4電流源を接続し、前記第1PチャネルMOSトランジスタと前記第1NチャネルMOSトランジスタの各ドレイン端子を、前記第1出力端子に接続し、前記第3PチャネルMOSトランジスタと前記第3NチャネルMOSトランジスタの各ドレイン端子を、前記ローパスフィルタの抵抗と第2容量とに接続した第1出力端子に接続し、前記第3PチャネルMOSトランジスタと前記第3NチャネルMOSトランジスタの各ドレイン端子を、前記ローパスフィルタの抵抗と第1容量との間に接続した第2出力端子に接続し、前記第1PチャネルMOSトランジスタと前記第3PチャネルMOSトランジスタの各ゲート端子には、互いに同一の信号が入力し、前記第1NチャネルMOSトランジスタと前記第3NチャネルMOSトランジスタの各ゲート端子にも、互いに同一の信号が入力するよう構成した
ことを特徴とするチャージポンプ回路。 - 位相比較・ロック検出回路の出力に応じて制御信号を発生する制御回路の制御信号が入力するチャージポンプ回路であって、
前記チャージポンプ回路は、電源端子と第1PチャネルMOSトランジスタのソース端子との間に第1電流源を接続し、接地端子と第1NチャネルMOSトランジスタのソース端子との間に第2電流源を接続し、電源端子と第2NチャネルMOSトランジスタのドレイン端子との間に第3電流源を接続し、接地端子と第2PチャネルMOSトランジスタのドレイン端子との間に第4電流源を接続し、前記第3電流源と前記第2NチャネルMOSトランジスタのドレイン端子とに第3PチャネルMOSトランジスタのソース端子を接続し、前記第4電流源と前記第2PチャネルMOSトランジスタのドレイン端子とに第3NチャネルMOSトランジスタのソース端子を接続し、前記第3PチャネルMOSトランジスタと前記第3NチャネルMOSトランジスタの各ドレイン端子を第2出力端子に接続し、前記第1PチャネルMOSトランジスタと前記第1NチャネルMOSトランジスタの各ドレイン端子を第1出力端子に接続し、前記第1PチャネルMOSトランジスタと前記第2PチャネルMOSトランジスタのソース端子同士を接続し、前記第1NチャネルMOSトランジスタと前記第2NチャネルMOSトランジスタのソース端子同士を接続し、前記第1Pチャネルトランジスタのゲート端子は前記位相比較・ロック検出回路のアップ信号出力端子に接続し、前記第1Nチャネルトランジスタのゲート端子は前記位相比較・ロック検出回路のダウン信号出力端子に接続して構成し、前記制御回路は、前記位相比較・ロック検出回路のアップ信号が入力する第1入力端子と、前記位相比較・ロック検出回路のダウン信号が入力する第2入力端子と、前記位相比較・ロック検出回路のロック検出信号が入力する第3入力端子とを有する一方、ロック検出信号が入力している間アップ信号を反転した信号を出力する第1出力端子と、ロック検出信号が入力していない間アップ信号と同じ信号を出力する第2出力端子と、ロック検出信号が入力していない間ダウン信号と同じ信号を出力する第3出力端子と、ロック検出信号が入力している間ダウン信号を反転した信号を出力する第4出力端子を有し、前記第1出力端子は前記第2PチャネルMOSトランジスタのゲート端子に接続し、前記第2出力端子は前記第3PチャネルMOSトランジスタのゲート端子に接続し、前記第3出力端子は前記第3NチャネルMOSトランジスタのゲート端子に接続し、前記第4出力端子は前記第2NチャネルMOSトランジスタのゲート端子に接続した
ことを特徴とするチャージポンプ回路。 - 入力信号の電圧レベルに応じた発振信号を出力する電圧制御発振回路と、基準信号を発する基準信号源と、基準信号を分周する分周回路であるRカウンタと、前記電圧制御発振回路の発振信号を分周する分周回路であるNカウンタと、これら両カウンタの出力信号の位相及び周波数を比較してアップ信号、ダウン信号を出力するとともに、ロック状態を検出してロック検出信号を出力する位相比較・ロック検出回路と、この位相比較・ロック検出回路の出力信号に応じた制御信号を出力する制御回路と、この制御回路及び前記位相比較・ロック検出回路の出力信号に応じた電流を出力する、請求項1〜請求項3のいずれか1項に記載のチャージポンプ回路と、このチャージポンプ回路の出力信号の高周波成分を減衰させて低周波成分だけを前記電圧制御発信回路に出力するローパスフィルタとからなる
ことを特徴とするPLL回路。
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