JP2005260769A - キャリア再生回路 - Google Patents
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Abstract
【解決手段】 コスタス回路4の後段に位相制御回路5を追加することで、制御可能な周波数範囲を広げる。位相制御回路5は、コスタス回路4から出力されたコスタス電圧を入力として受け、送信側の局部発振周波数に対して受信側の局部発振周波数が進んでいるのか、遅れているのか判断する周波数制御方向判定回路と、周波数制御方向判定回路の出力信号を平均化する平均化回路と、平均化回路の出力信号を計数する計数回路と、計数回路の計数値とコスタス電圧とに基づき、VCOからなる受信側局部発振器6の出力局部発振周波数を制御するための制御電圧を生成する制御電圧生成回路とから構成されている。
【選択図】 図1
Description
2 送信側局部発振器
3 直交復調器
4 コスタス回路
5 位相制御回路
6 受信側局部発振器
8 書換可能なゲートアレー(FPGA)
9 D/A変換器
10 伝送路
11 A/D変換器
51 周波数制御方向判定回路
52 平均化回路
53 計数回路
54 制御電圧生成回路
521、522 4ビットカウンタ
531、532 8ビットアップダウンカウンタ
541 14ビットアップダウンカウンタ
542 加算器
Claims (6)
- 受信した直交変調波を再生キャリアに基づき復調する直交復調器から出力される同相信号及び直交信号を入力として受け、前記直交復調器へ前記再生キャリアを供給するキャリア再生回路において、
復調された前記同相信号及び直交信号から、前記直交変調波の送信側キャリアとの誤差を補正するための位相情報を出力するコスタス回路と、
前記コスタス回路から出力された位相情報に基づき、現在の再生キャリアの周波数制御方向に応じてその周波数制御範囲を拡大する位相制御を行うための制御信号を出力する位相制御回路と、
前記位相制御回路から出力された制御信号に基づき、前記再生キャリアとなる発振周波数が可変制御される受信側可変周波数発振器と
を有することを特徴とするキャリア再生回路。 - 送信側局部発振器から出力されたキャリアに基づき、同相信号と直交信号とを直交変調器で直交変調して得られた直交変調波を送信し、送信された前記直交変調波を受信し直交復調器で再生キャリアに基づいて復調して前記同相信号と直交信号の復調出力を得る送受信システムに適用されるキャリア再生回路であって、
前記直交復調器で復調された前記同相信号及び直交信号から、前記直交変調波の送信側キャリアとの誤差を補正するための位相情報を出力するコスタス回路と、
前記コスタス回路から出力された位相情報に基づき、現在の再生キャリアの周波数制御方向に応じてその周波数制御範囲を拡大する位相制御を行うための制御信号を出力する位相制御回路と、
前記位相制御回路から出力された制御信号に基づき、前記再生キャリアとなる発振周波数が可変制御される受信側可変周波数発振器と
を有し、前記直交変調器、前記送信側局部発振器及び前記直交復調器と共に同一のゲートアレーに組み込まれてなることを特徴とするキャリア再生回路。 - 前記位相制御回路は、前記コスタス回路から出力された位相情報に基づき、送信側のキャリア周波数に対して再生キャリア周波数が進んでいるのか、遅れているのか判断する周波数制御方向判定回路と、前記周波数制御方向判定回路の出力判定信号を平均化する平均化回路と、前記平均化回路の出力信号を計数する計数回路と、前記計数回路の計数値と前記コスタス回路から出力された位相情報とに基づき、前記受信側可変周波数発振器の出力再生キャリア周波数を制御するための前記制御信号を生成する制御信号生成回路とからなることを特徴とする請求項1又は2記載のキャリア再生回路。
- 前記コスタス回路から出力される位相情報は、前記再生キャリアの周波数制御方向を示す極性ビットと位相情報を示すデータビットからなり、前記周波数制御方向判定回路は、前記極性ビットの値により前記周波数制御方向を判定し、判定した周波数制御方向がプラスのときは第1の論理値の判定信号を出力し、判定した周波数制御方向がマイナスのときは第2の論理値の判定信号を出力する回路であることを特徴とする請求項3記載のキャリア再生回路。
- 前記平均化回路は、前記周波数制御方向判定回路から出力される前記第1の論理値の判定信号が所定期間連続したときに第1の論理値の平均化信号を出力し、前記第2の論理値の判定信号が前記所定期間連続したときに第2の論理値の平均化信号を出力する回路であり、
前記計数回路は、前記第1の論理値の平均化信号により加算計数を行い、かつ、前記第2の論理値の平均化信号により減算計数を行い、計数値が所定値になったときに第1の計数信号を出力する第1のアップダウンカウンタと、前記第1の論理値の平均化信号により減算計数を行い、かつ、前記第2の論理値の平均化信号により加算計数を行い、計数値が前記所定値になったときに第2の計数信号を出力する第2のアップダウンカウンタとを含み、
前記制御信号生成回路は、前記第1の計数信号がアップ端子に供給され、前記第2の計数信号がダウン端子に供給される第3のアップダウンカウンタと、該第3のアップダウンカウンタの計数値と、前記コスタス回路からの位相情報とを加算して前記制御信号を生成する加算器とからなることを特徴とする請求項3又は4記載のキャリア再生回路。 - 前記平均化回路は、前記周波数制御方向判定回路から出力される前記第1の論理値の判定信号が所定期間連続したときに第1の論理値の平均化信号を出力する第1のカウンタと、前記第2の論理値の判定信号が前記所定期間連続したときに第2の論理値の平均化信号を出力する第2のカウンタと、前記第1の論理値の平均化信号又は前記第2の論理値の平均化信号が出力されたときに前記第1のカウンタ及び第2のカウンタを同時にクリアする第1の論理回路とからなり、
前記計数回路は、前記第1及び第2のアップダウンカウンタと、前記第1の計数信号又は前記第2の計数信号が出力されたときに前記第1及び第2のアップダウンカウンタを同時にクリアする第2の論理回路とからなることを特徴とする請求項5記載のキャリア再生回路。
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