JP2005209999A - Semiconductor device and lead frame, and method for manufacturing semiconductor device - Google Patents

Semiconductor device and lead frame, and method for manufacturing semiconductor device Download PDF

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Abstract

<P>PROBLEM TO BE SOLVED: To provide a low cost semiconductor device and a lead frame capable of enhancing a solder adhesive property of the tip of a lead, and to provide a method for manufacturing the semiconductor device. <P>SOLUTION: A plurality of leads 3 are provided at the side surface of a sealing resin 1. The tip 3a of the lead 3 is bent upward by a half blanking construction method, and a step 3c is formed on the lower surface 3b of the lead 3. A sag surface 3e, a shearing surface 3f, a fracturing surface 3g, and a cutting burr 3h are formed on the tip surface of the lead 3 from the lower surface 3b side to the upper surface 3d side in this order. A plating coat is formed on the lower surface 3b including the step 3c, the upper surface 3d, the side surface, and the sag surface 3e of the lead 3. The solder connection of the lead 3 and an electrode of a packaging substrate forms a solder fillet on the lower surface 3b including the step 3c and the side surface of the lead. <P>COPYRIGHT: (C)2005,JPO&NCIPI

Description

本発明は半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置及びその半導体装置に用いられるリードフレーム、並びにそのリードフレームを用いた半導体装置の製造方法に関するものである。   The present invention relates to a sealing resin for sealing a semiconductor chip, a semiconductor device having a plurality of leads on the outer edge of the sealing resin, a lead frame used in the semiconductor device, and a semiconductor device using the lead frame It relates to a manufacturing method.

半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置として、例えば封止樹脂から突出したリード部分が短いリードレスタイプ(SON;JEITA ED−7311−13Aや、FQN;JEITA ED−7311−22など)と呼ばれるICパッケージや、封止樹脂から水平方向に突出したリードが下方に折り曲げられ、さらに水平方向に折り曲げられたガルウィングタイプのICパッケージなどがある。   As a semiconductor device provided with a sealing resin for sealing a semiconductor chip and a plurality of leads at the outer edge of the sealing resin, for example, a leadless type (SON; JEITA ED-7311 having a short lead portion protruding from the sealing resin) IC package called -13A, FQN; JEITA ED-7111-22, etc., or a gull wing type IC package in which the lead protruding horizontally from the sealing resin is bent downward and further bent horizontally. is there.

このような半導体装置の製造方法では、リードフレーム上に半導体チップを搭載し、半導体チップの樹脂封止処理を行なった後、封止樹脂バリの除去やはんだメッキなどの外装処理を行ない、その後、リードフレームのリード先端部に対応する部分を切断して半導体装置をリードフレームから切り離す。ガルウィングタイプの半導体装置では、さらにリードを所定の形状に折り曲げるフォーミング工程を行なう。   In such a method of manufacturing a semiconductor device, after mounting a semiconductor chip on a lead frame and performing a resin sealing process on the semiconductor chip, an exterior process such as removal of a sealing resin burr and solder plating is performed. A portion of the lead frame corresponding to the lead tip is cut to separate the semiconductor device from the lead frame. In the gull wing type semiconductor device, a forming process for bending the lead into a predetermined shape is further performed.

このように、半導体装置をリードフレームから切り離す前にリードへのはんだメッキ処理を行なうので、半導体装置をリードフレームから切り離した後のリード先端面にはメッキ被膜が形成されておらず、半導体装置を基板などに実装する際にリード先端部のはんだ濡れ性が悪いという問題があった。このような問題はリードレスタイプの半導体装置において特に問題になる。   As described above, since the solder plating process is performed on the leads before the semiconductor device is separated from the lead frame, no plating film is formed on the leading end surface of the lead after the semiconductor device is separated from the lead frame. When mounted on a substrate or the like, there was a problem that the solder wettability of the lead tip was poor. Such a problem is particularly a problem in a leadless type semiconductor device.

このような問題に対してリード先端部にメッキ被膜を形成すべく、種々の従来技術が開示されている。
例えば、特許文献1には、図24に示すように、リード形成時にアウターリード51の先端となる部分にそのリード厚さの2/3程度の深さ及び1mm程度の幅の底部を有する凹部53を設け、切断位置55でアウターリード51を切断することにより、そのリード先端部となる切断面にメッキが付着されるようにした半導体装置用リードフレームが開示されている。図24は切断前のアウターリードの側面図である。アウターリードの先端となる部分に凹部を形成する方法として、エッチング又はコイニングが挙げられている。
Various conventional techniques have been disclosed in order to form a plating film on the leading end portion of the lead for such a problem.
For example, in Patent Document 1, as shown in FIG. 24, a concave portion 53 having a bottom portion having a depth of about 2/3 of the lead thickness and a width of about 1 mm at a tip portion of the outer lead 51 at the time of lead formation. A lead frame for a semiconductor device is disclosed in which the outer lead 51 is cut at the cutting position 55 so that plating is attached to the cut surface that is the lead tip. FIG. 24 is a side view of the outer lead before cutting. Etching or coining is mentioned as a method of forming a recess in a portion that becomes the tip of the outer lead.

また、特許文献2には、リード加工前のリードフレーム素材に、リードの端子になる部分で、かつ基板実装面側に、溝を形成する第1の工程と、この溝を形成したリードフレームの素材の表、裏及び側面に、はんだメッキを形成する第2の工程と、はんだメッキされたリードフレームの溝で切断し、リード形状に加工する第3の工程とを備えたことを特徴とする樹脂封止型半導体装置の製造方法が開示されている。上記溝を形成する方法として、ハーフエッチングが挙げられている。   Further, Patent Document 2 discloses a first step of forming a groove in a lead frame material before lead processing at a portion to be a terminal of a lead and on the board mounting surface side, and a lead frame formed with this groove. A second step of forming solder plating on the front, back, and side surfaces of the material, and a third step of cutting the lead-plated lead frame groove into a lead shape are provided. A method for manufacturing a resin-encapsulated semiconductor device is disclosed. Half etching is mentioned as a method of forming the groove.

しかし、特許文献1及び2に示されたように、エッチング(ハーフエッチングを含む)によってリードに凹部又は溝を形成するには、リードを厚み方向に選択的に除去する領域を画定するためのレジスト塗布処理や露光処理、現像処理などの工数がかかり、製造コストの上昇を招くという問題があった。
また、コイニングによってリードに凹部を形成すると凹部形成部分のリード幅が太くなり、リード間でショートしやすくなるという問題があった。
However, as shown in Patent Documents 1 and 2, in order to form a recess or groove in a lead by etching (including half-etching), a resist for defining a region for selectively removing the lead in the thickness direction There is a problem that man-hours such as coating processing, exposure processing, and development processing are required, resulting in an increase in manufacturing cost.
In addition, when concave portions are formed in the leads by coining, there is a problem that the lead width of the concave portion forming portion is increased and short-circuiting between the leads is easily caused.

また、特許文献3には、図25に示すように、リード57の先端部が連結部材(図示は省略)をもって相互に連結されているリードフレームのステージ上に半導体チップを搭載して樹脂封止した後、連結部材を切断除去してリード57を曲げ形成する工程を有する半導体装置の製造方法であって、連結部材を切断除去する際に、リード57の先端部57aを細くカットし((A)参照)、リード57を曲げ成形する際に、リード57の先端部57aをプレスして薄くする((B)及び(C)参照)方法が開示されている。図25はリード先端部を示し、(A)はプレス処理前の平面図、(B)はプレス処理後の平面図、(C)はプレス処理後の側面図である。
しかし、プレスによりリードの先端部を薄く加工すると、リードの先端位置が正確には定まらないという問題があった。
Further, in Patent Document 3, as shown in FIG. 25, a semiconductor chip is mounted on a stage of a lead frame in which leading ends of leads 57 are connected to each other with a connecting member (not shown), and sealed with resin. Then, the semiconductor device manufacturing method includes a step of bending and forming the lead 57 by cutting and removing the connecting member. When the connecting member is cut and removed, the leading end portion 57a of the lead 57 is thinly cut ((A )), And bending the lead 57, the tip 57a of the lead 57 is pressed and thinned (see (B) and (C)). FIG. 25 shows a lead tip, (A) is a plan view before press processing, (B) is a plan view after press processing, and (C) is a side view after press processing.
However, when the tip of the lead is thinly processed by pressing, there is a problem that the tip position of the lead cannot be accurately determined.

また、特許文献4には、予め外部リードの先端に当たる部分に上方より溝を形成したリードフレームを用いるか、又ははんだメッキ前に外部リードの先端にあたる部分に上方より溝を形成するという工程を経ることにより、半導体装置の外部リード先端上方面にはんだメッキされている部分を形成するように形成している。上記溝を形成する方法として、ハーフエッチングと、Vノッチ加工用のパンチを付加した金型を用いる方法が挙げられている。
しかし、上述のように、ハーフエッチングにより上記溝を形成する工程を含むと製造コストの上昇を招くという問題があった。
また、Vノッチ加工用のパンチを付加した金型を用いると、V型の溝の形成位置が正確に定まらないという問題があった。
Further, in Patent Document 4, a lead frame in which a groove is previously formed in a portion corresponding to the tip of the external lead is used, or a groove is formed in a portion corresponding to the tip of the external lead from above before solder plating. Thus, a solder-plated portion is formed on the upper surface of the tip of the external lead of the semiconductor device. As a method for forming the groove, a method using half-etching and a die added with a punch for V-notch processing is cited.
However, as described above, when the step of forming the groove by half etching is included, there is a problem in that the manufacturing cost increases.
In addition, when a mold having a punch for V-notch processing is used, there is a problem that the formation position of the V-shaped groove cannot be accurately determined.

また、特許文献5には、図26に示すように、リード59の一側面59aにリード59の厚み方向に切れ込み部61を設け、メッキ処理後に切れ込み部61を切断(一点鎖線参照)してリードの先端部とする半導体装置の製造方法が開示されている。図26は切断前のリードの平面図である。切れ込み部61の形成方法として、エッチング又はプレスが挙げられている。
しかし、切れ込み部を形成するための方法としてエッチングを用いると、上述のように製造コストの上昇を招くという問題があった。
また、プレスにより上記切れ込み部を形成すると、リードの変形や切断が起こり、リード間のショートやリードの短絡などを招くという問題があった。
Further, in Patent Document 5, as shown in FIG. 26, a notch 61 is provided on one side surface 59a of the lead 59 in the thickness direction of the lead 59, and the notch 61 is cut after plating (refer to a one-dot chain line). A method of manufacturing a semiconductor device having a front end portion is disclosed. FIG. 26 is a plan view of the lead before cutting. As a method for forming the cut portion 61, etching or pressing is cited.
However, when etching is used as a method for forming the cut portion, there is a problem in that the manufacturing cost increases as described above.
In addition, when the cut portion is formed by pressing, there is a problem that the lead is deformed or cut to cause a short between leads or a short between leads.

また、特許文献6には、リードの先端に対応する位置にV型のノッチが形成された、樹脂封止終了後のリードフレームに外装処理を施したのち、規定のカッティングラインよりも外側の領域でリードフレームからアウターリードを切り離し、次いで、アウターリードを所定の形状に形成する前又は形成した後に、カッティングライン上のリードした面にノッチ部を形成する。その後、カッティングラインに沿ってアウターリードを切断することにより、リード先端面にノッチ痕によるメッキ被膜を残す半導体装置のリード加工方法が開示されている。
このリード加工方法によれば、リード先端面の形成位置も精密で、かつ安価に形成することができるが、V型のノッチを形成するための金型においてV型のノッチに対応する部分が鋭角に形成されているために金型の寿命が短く、ひいては製造コストの上昇を招くという問題があった。
Further, in Patent Document 6, a V-shaped notch is formed at a position corresponding to the tip of the lead, and after the exterior treatment is performed on the lead frame after the resin sealing is finished, an area outside the prescribed cutting line is disclosed. Then, the outer lead is separated from the lead frame, and then, before or after the outer lead is formed into a predetermined shape, a notch portion is formed on the leaded surface on the cutting line. Thereafter, a lead processing method for a semiconductor device is disclosed in which an outer lead is cut along a cutting line to leave a plating film due to a notch mark on a lead tip surface.
According to this lead processing method, the formation position of the lead tip surface can be formed precisely and inexpensively, but the portion corresponding to the V-shaped notch in the mold for forming the V-shaped notch has an acute angle. Therefore, there is a problem that the life of the mold is short, and as a result, the manufacturing cost increases.

また、特許文献7には、図27に示すように、専用金型で切断されガルウィング形状に曲げ形成された外部接続用のアウターリード63の、パッドに載置される載置部に、先端の切断面のリード厚を小さくするための傾斜状面65が形成されている半導体装置が開示されている。図27はアウターリード先端部の側面図である。特許文献7では、傾斜状面65を形成する方法としてハーフエッチングが挙げられている。
しかし、上述のように、ハーフエッチングにより上記溝を形成する工程を含むと製造コストの上昇を招くという問題があった。
特許第2936769号公報 特開平6−334090号公報 特開平5−144988号公報 特開平7−30042号公報 特開平7−30043号公報 特開平8−172153号公報 特開平9−232499号公報
Further, in Patent Document 7, as shown in FIG. 27, the tip of the outer connection outer lead 63 cut by a dedicated die and bent into a gull wing shape is placed on the placement portion placed on the pad. A semiconductor device is disclosed in which an inclined surface 65 for reducing the lead thickness of the cut surface is formed. FIG. 27 is a side view of the distal end portion of the outer lead. In Patent Document 7, half etching is cited as a method of forming the inclined surface 65.
However, as described above, when the step of forming the groove by half etching is included, there is a problem in that the manufacturing cost increases.
Japanese Patent No. 2936769 JP-A-6-334090 Japanese Patent Laid-Open No. 5-144988 Japanese Patent Laid-Open No. 7-30042 Japanese Patent Laid-Open No. 7-30043 JP-A-8-172153 Japanese Patent Laid-Open No. 9-232499

本発明は、安価で、かつリード先端のはんだ付着性を向上させることができる半導体装置及びリードフレーム、並びに半導体装置の製造方法を提供することを目的とするものである。   An object of the present invention is to provide a semiconductor device, a lead frame, and a method for manufacturing a semiconductor device that are inexpensive and can improve solder adhesion at the tip of a lead.

本発明の半導体装置の第1態様は、半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置であって、上記リードの先端部が半抜き工法により上方へ折り曲げられているものである。
本発明の半導体装置の第2態様は、上記リードの先端部が半抜き工法により下方へ折り曲げられているものである。
本願特許請求の範囲及び本明細書において、半抜き工法とは穴抜きを途中で止めた状態にして凸形状を作る工法をいう。半抜き工法では凸部形成領域の上面から見た面積は加工前と加工後でほぼ同じになる。
A first aspect of the semiconductor device of the present invention is a semiconductor device comprising a sealing resin for sealing a semiconductor chip and a plurality of leads on the outer edge of the sealing resin, wherein the leading end of the lead is half-punched It is bent upward by the construction method.
According to a second aspect of the semiconductor device of the present invention, the leading end of the lead is bent downward by a half punching method.
In the claims of the present application and in the present specification, the half punching method refers to a method of making a convex shape with the hole being stopped halfway. In the half punching method, the area viewed from the upper surface of the convex portion forming region is substantially the same before and after the processing.

本発明の半導体装置の上記リードの先端面において、上面側にダレ面が形成されていてもよいし、下面側にダレ面が形成されていてもよい。
本発明の半導体装置が適用される半導体装置として、例えばリードレスタイプを挙げることができる。ただし、本発明が適用される半導体装置はリードレスタイプに限定されるものではなく、例えばガルウィングタイプの半導体装置など、他の半導体装置にも適用することができる。
In the tip surface of the lead of the semiconductor device of the present invention, a sagging surface may be formed on the upper surface side, or a sagging surface may be formed on the lower surface side.
An example of a semiconductor device to which the semiconductor device of the present invention is applied is a leadless type. However, the semiconductor device to which the present invention is applied is not limited to the leadless type, and can also be applied to other semiconductor devices such as a gull-wing type semiconductor device.

本発明のリードフレームは、半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置に用いられるものであって、切断後のリードの先端に対応する部分が半抜き工法により上方又は下方へ凸状に形成されているものである。   The lead frame of the present invention is used in a semiconductor device having a sealing resin for sealing a semiconductor chip and a plurality of leads on the outer edge of the sealing resin, and corresponds to the leading end of the lead after cutting. The part to be formed is formed in a convex shape upward or downward by a half punching method.

本発明の半導体装置の製造方法は、半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置を製造するための製造方法であって、切断後のリードの先端に対応する部分が半抜き工法により上方又は下方へ凸状に形成されているリードフレームを用い、半導体チップを上記リードフレームに搭載して樹脂封止処理及びメッキ処理を施した後、上記リードフレームの凸状部分を切断して半導体装置をリードフレームから切り離す工程を含む。   A manufacturing method of a semiconductor device of the present invention is a manufacturing method for manufacturing a semiconductor device having a sealing resin for sealing a semiconductor chip and a plurality of leads on an outer edge portion of the sealing resin, after cutting After using a lead frame in which a portion corresponding to the tip of the lead is formed in a convex shape upward or downward by a half-punch method, a semiconductor chip is mounted on the lead frame and subjected to resin sealing treatment and plating treatment And cutting the protruding portion of the lead frame to separate the semiconductor device from the lead frame.

本発明の半導体装置の製造方法において、上記凸状部分を切断する際に、切断位置に対して封止樹脂側に刃厚をもつ第1切断刃と上記切断位置に対して封止樹脂とは反対側に刃厚をもつ第2切断刃を用い、上記リードフレームに対して上記第1切断刃を裏面側から、上記第2切断刃を上面側から押し当てて上記凸状部分を切断する例を挙げることができる。   In the method of manufacturing a semiconductor device of the present invention, when cutting the convex portion, the first cutting blade having a blade thickness on the sealing resin side with respect to the cutting position and the sealing resin with respect to the cutting position An example in which a second cutting blade having a blade thickness on the opposite side is used and the first cutting blade is pressed against the lead frame from the back surface side and the second cutting blade is pressed from the top surface side to cut the convex portion. Can be mentioned.

本発明の半導体装置の第1態様ではリードの先端部が半抜き工法により上方へ折り曲げられているようにし、第2態様ではリードの先端部が半抜き工法により下方へ折り曲げられているようにしたので、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。さらに、リードの先端は半抜き工法により折り曲げられているので、リードの先端の上面から見た面積は折り曲げられる前とほぼ同じであり、プレスにより薄くした場合のようにはリードの先端の面積が大きくなっておらず、隣り合うリード間のショート等が起こるという不具合は発生しない。さらに、半抜き工法で用いる金型はV型ノッチ形成用の金型のようには細い刃(鋭角部分)を備えていなくてもよいので、消耗が少なく、生産性が高い。
さらに、第2態様ではリードの先端部が下方へ折り曲げられているようにしたので、第2態様をリードレスタイプの半導体装置に適用した場合にリード先端部をパッケージ底面よりも下方側に配置することができ、半導体装置の実装時にパッケージ下に小さなゴミなどが入ってもはんだ付けに影響が出ないようにすることができる。
In the first aspect of the semiconductor device of the present invention, the leading end of the lead is bent upward by a half punching method, and in the second aspect, the leading end of the lead is bent downward by a half punching method. Therefore, the plating film formation area at the lead tip can be increased, and the solder adhesion at the lead tip can be improved. Furthermore, since the tip of the lead is bent by a half-punch method, the area seen from the top surface of the lead tip is almost the same as before being bent, and the lead tip area is the same as when it is thinned by pressing. It does not become large, and there is no problem of short circuit between adjacent leads. Further, the mold used in the half-cutting method does not have to have a thin blade (acute angle portion) like a mold for forming a V-shaped notch, so that consumption is low and productivity is high.
Furthermore, in the second aspect, since the leading end of the lead is bent downward, when the second aspect is applied to a leadless type semiconductor device, the leading end of the lead is disposed below the bottom of the package. It is possible to prevent the soldering from being affected even if a small dust or the like enters the package when the semiconductor device is mounted.

本発明の半導体装置のリードの先端面において上面側にダレ面が形成されているようにすれば、リードフレームから半導体装置を切り離す際に、切断位置に対して封止樹脂側に刃厚をもち、リードの裏面側から押し当てられる第1切断刃と、上記切断位置に対して封止樹脂とは反対側に刃厚をもち、リードの上面側から押し当てられる第2切断刃を用いてリードの先端面を形成することができる。これにより、特にリードレスタイプの半導体装置をリードフレームから切り離す際にリードの上面側から押し当てる切断刃として刃厚が薄いものを用いなくてもよいので、切断刃の刃厚を厚くして切断刃の寿命を長くすることができ、製造コストの低減を図ることができる。   If a sag surface is formed on the upper surface side of the leading end surface of the lead of the semiconductor device of the present invention, when the semiconductor device is separated from the lead frame, a blade thickness is provided on the sealing resin side with respect to the cutting position. Lead using a first cutting blade pressed from the back side of the lead and a second cutting blade having a blade thickness on the side opposite to the sealing resin with respect to the cutting position and pressed from the upper surface side of the lead Can be formed. As a result, it is not necessary to use a thin cutting blade as a cutting blade that presses from the upper surface side of the lead when cutting a leadless type semiconductor device from the lead frame. The life of the blade can be extended, and the manufacturing cost can be reduced.

また、本発明の半導体装置のリードの先端面において下面側にダレ面が形成されているようにすれば、ダレ面表面に残存するメッキによりリード先端部のはんだ濡れ性を向上させることができる。   Further, if a sag surface is formed on the lower surface side of the lead end surface of the lead of the semiconductor device of the present invention, the solder wettability of the lead end portion can be improved by plating remaining on the surface of the sag surface.

また、本発明の半導体装置をリードレスタイプの半導体装置に適用した場合であっても、安価で、かつリード先端のはんだ付着性を向上させることができる。   Further, even when the semiconductor device of the present invention is applied to a leadless type semiconductor device, it is inexpensive and can improve solder adhesion at the tip of the lead.

本発明のリードフレームでは切断後のリードの先端に対応する部分が半抜き工法により上方又は下方へ凸状に形成されているようにしたので、本発明の半導体装置に用いることができ、安価で、かつリード先端のはんだ付着性を向上させた半導体装置を実現できる。   In the lead frame of the present invention, the portion corresponding to the leading end of the lead after cutting is formed in a convex shape upward or downward by a half punching method, so that it can be used for the semiconductor device of the present invention and is inexpensive. In addition, a semiconductor device with improved solder adhesion at the tip of the lead can be realized.

本発明の半導体装置の製造方法では、本発明のリードフレームを用い、半導体チップをリードフレームに搭載して樹脂封止処理及びメッキ処理を施した後、リードフレームの凸状部分を切断して半導体装置をリードフレームから切り離す工程を含むようにしたので、リード先端のはんだ付着性を向上させた本発明の半導体装置を安価に製作することができる。   In the method for manufacturing a semiconductor device of the present invention, the lead frame of the present invention is used, a semiconductor chip is mounted on the lead frame, subjected to resin sealing treatment and plating treatment, and then the convex portion of the lead frame is cut to obtain a semiconductor. Since the step of separating the device from the lead frame is included, the semiconductor device of the present invention with improved solder adhesion at the lead tip can be manufactured at low cost.

さらに、本発明の半導体装置の製造方法において、上記凸状部分を切断する際に、切断位置に対して封止樹脂側に刃厚をもつ第1切断刃と上記切断位置に対して封止樹脂とは反対側に刃厚をもつ第2切断刃を用い、リードフレームに対して第1切断刃を裏面側から、第2切断刃を上面側から押し当てて上記凸状部分を切断するようにすれば、特にリードレスタイプの半導体装置をリードフレームから切り離す際にリードフレームの上面側に押し当てる切断刃として刃厚が薄いものを用いなくてもよいので、切断刃の刃厚を厚くして切断刃の寿命を長くすることができ、製造コストの低減を図ることができる。   Furthermore, in the manufacturing method of the semiconductor device of the present invention, when cutting the convex portion, the first cutting blade having a blade thickness on the sealing resin side with respect to the cutting position and the sealing resin with respect to the cutting position A second cutting blade having a blade thickness on the opposite side is used, the first cutting blade is pressed against the lead frame from the back surface side, and the second cutting blade is pressed from the top surface side to cut the convex portion. In particular, when cutting a leadless type semiconductor device from the lead frame, it is not necessary to use a thin cutting blade that presses against the upper surface of the lead frame. The lifetime of the cutting blade can be extended, and the manufacturing cost can be reduced.

図1は半導体装置の一実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。この実施例では本発明の半導体装置の第1態様をリードレスタイプのSONに適用した。   1A and 1B are diagrams showing an embodiment of a semiconductor device, where FIG. 1A is a plan view, FIG. 1B is a side view seen from the A direction, FIG. 1C is a side view seen from the B direction, and FIG. FIG. 5E is an enlarged view of a portion surrounded by a broken-line circle in FIG. In this embodiment, the first embodiment of the semiconductor device of the present invention is applied to a leadless type SON.

半導体チップを封止するための封止樹脂1の側面に複数のリード3が設けられている。リード3の一部は封止樹脂1の底面に露出している。例えば、リード3の厚みは0.13mm(ミリメートル)、幅寸法は0.2mm、封止樹脂1からの突出長さは0.2mmであり、隣り合うリード3,3間の距離は0.3mmである。リード3の先端部3aは半抜き工法により例えばリード3の厚みの半分の寸法だけ上方へ折り曲げられており、リード3の下面3bに段差部3cが形成されている。先端部3aの厚み及び幅寸法はリード3の基端部とほぼ同じ、すなわちリード3を半抜き工法により折り曲げる前とほぼ同じである。   A plurality of leads 3 are provided on the side surface of the sealing resin 1 for sealing the semiconductor chip. A part of the lead 3 is exposed on the bottom surface of the sealing resin 1. For example, the thickness of the lead 3 is 0.13 mm (millimeter), the width dimension is 0.2 mm, the protruding length from the sealing resin 1 is 0.2 mm, and the distance between the adjacent leads 3 is 3 mm. It is. The tip 3 a of the lead 3 is bent upward by, for example, half the thickness of the lead 3 by a half-cutting method, and a step 3 c is formed on the lower surface 3 b of the lead 3. The thickness and the width dimension of the distal end portion 3a are substantially the same as the base end portion of the lead 3, that is, substantially the same as before the lead 3 is bent by the half punching method.

リード3の先端面には、下面3b側から上面3d側へ順にダレ面3e、せん断面3f、破断面3g、切断バリ3hが形成されている。リード3において、段差部3cを含む下面3b、上面3d、側面、及びダレ面3eにメッキ被膜(図示は省略)が形成されている。せん断面3fにはメッキ被膜が形成されている場合と形成されていない場合がある。また、切断バリ3hは形成されている場合と形成されていない場合がある。   A sag surface 3e, a shear surface 3f, a fracture surface 3g, and a cutting burr 3h are formed on the tip surface of the lead 3 in order from the lower surface 3b side to the upper surface 3d side. In the lead 3, a plating film (not shown) is formed on the lower surface 3b, the upper surface 3d, the side surface, and the sag surface 3e including the step portion 3c. The shearing surface 3f may or may not be formed with a plating film. Further, the cutting burr 3h may or may not be formed.

図2はこの実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。
実装基板5上にSONを搭載してリード3と実装基板5の電極(図示は省略)をはんだ接続すると、リード3の段差部3cを含む下面3b及び側面にはんだフィレット7が形成される((A)及び(B)参照)。また、(B)に示すように、リード3の先端面のせん断面3fにメッキ被膜が形成されている場合にはせん断面3fにもはんだフィレット7が形成される。
FIG. 2 is a cross-sectional view showing a lead portion in a state where this embodiment is mounted on a mounting substrate. FIG. 2A shows a lead tip surface when a plating film is not formed on the shearing surface of the lead tip surface. The case where a plating film is formed on the shearing surface is shown.
When the SON is mounted on the mounting substrate 5 and the lead 3 and the electrode (not shown) of the mounting substrate 5 are soldered, solder fillets 7 are formed on the lower surface 3b and the side surface including the stepped portion 3c of the lead 3 (( A) and (B)). Further, as shown in (B), when a plating film is formed on the shearing surface 3f of the tip surface of the lead 3, the solder fillet 7 is also formed on the shearing surface 3f.

このように、リード3の先端部3aが上方へ折り曲げられてリード3の下面3bに段差部3cが形成されていることにより、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。
さらに、この実施例では、リード3の先端面においてダレ面3eが下面3b側に形成されているので、リード先端におけるメッキ被膜形成面積をさらに大きくすることができる。
さらに、リード3の先端面において切断バリ3hが上面3d側に形成されているので、実装高さのばらつきを抑制することができる。
As described above, the tip 3a of the lead 3 is bent upward and the step 3c is formed on the lower surface 3b of the lead 3, thereby increasing the plating film formation area at the lead tip. Solder adhesion can be improved.
Further, in this embodiment, since the sag surface 3e is formed on the lower surface 3b side at the leading end surface of the lead 3, the plating film forming area at the leading end of the lead can be further increased.
Furthermore, since the cutting burr 3h is formed on the upper surface 3d side at the tip surface of the lead 3, variation in the mounting height can be suppressed.

図3はリードフレームの一実施例を示す図であり、(A)平面図、(B)は(A)のA−A位置での断面図である。図4は製造方法の一実施例を説明するための概略工程断面図であり、図3に示したリードフレームを用いて図1に示した半導体装置を製作する工程を示している。まず、図3を参照してリードフレームの実施例について説明する。   3A and 3B are diagrams showing an embodiment of the lead frame, in which FIG. 3A is a plan view and FIG. 3B is a cross-sectional view taken along the line AA in FIG. FIG. 4 is a schematic process cross-sectional view for explaining an embodiment of the manufacturing method, and shows a process of manufacturing the semiconductor device shown in FIG. 1 using the lead frame shown in FIG. First, an embodiment of the lead frame will be described with reference to FIG.

リードフレーム9には、半導体チップを搭載するためのダイパッド11と、ダイパッド11に近接して設けられた複数のリード3からなる組が複数形成されている。リード3において、切断後のリードの先端に対応する部分が半抜き工法により上方へ凸状に形成されて裏面3bに凹部13が形成されている。(A)において、凹部13に対応する凸部の図示は省略している。
凹部13の形成領域において、上面から見た面積は加工前と加工後でほぼ同じであり、凹部と凸部の体積はほぼ同じである。この実施例では例えばリード3の厚みの半分の寸法だけ上方へ折り曲げられて凹部13が形成されている。
The lead frame 9 is formed with a plurality of sets each including a die pad 11 for mounting a semiconductor chip and a plurality of leads 3 provided close to the die pad 11. In the lead 3, a portion corresponding to the leading end of the lead after cutting is formed in a convex shape upward by a half punching method, and a concave portion 13 is formed in the back surface 3b. In (A), illustration of the convex part corresponding to the recessed part 13 is abbreviate | omitted.
In the formation region of the recess 13, the area viewed from the upper surface is substantially the same before and after processing, and the volume of the recess and the protrusion is approximately the same. In this embodiment, for example, the concave portion 13 is formed by bending upward by a half dimension of the thickness of the lead 3.

図4を参照して製造方法の実施例について説明する。
図3を参照して説明したリードフレーム9のダイパッド11上に半導体チップ15を搭載し、半導体チップ15の電極パッド(図示は省略)とリード3をボンディングワイヤ17により電気的に接続する((a)参照)。
半導体チップ15及びボンディングワイヤ17を封止樹脂1により樹脂封止した後、封止樹脂バリの除去やはんだメッキなどの外装処理を行なう((b)参照)。このとき、リードフレーム9の凹部13の内壁にもメッキ被膜が形成される。
An embodiment of the manufacturing method will be described with reference to FIG.
The semiconductor chip 15 is mounted on the die pad 11 of the lead frame 9 described with reference to FIG. 3, and the electrode pad (not shown) of the semiconductor chip 15 and the lead 3 are electrically connected by the bonding wire 17 ((a )reference).
After the semiconductor chip 15 and the bonding wire 17 are resin-sealed with the sealing resin 1, exterior processing such as removal of the sealing resin burr and solder plating is performed (see (b)). At this time, a plating film is also formed on the inner wall of the recess 13 of the lead frame 9.

リード3の凹部13に対応する切断位置に対して封止樹脂1側に刃厚をもつオス型切断刃19と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃21を用い、リードフレーム9に対してオス型切断刃19を上面側から、メス型切断刃21を裏面側から押し当てて凹部13を切断してSONをリードフレーム9から切り離す((c)参照)。図5はリード3近傍及び切断刃を拡大して示す断面図である。
これにより、図1を参照して説明した、リード3の先端部3aが上方へ折り曲げられてリード3の下面3bに段差部3cが形成され、かつ、リード3の先端面においてダレ面3eが下面3b側に形成されたSONを製作することができる。
A male cutting blade 19 having a blade thickness on the sealing resin 1 side with respect to the cutting position corresponding to the recess 13 of the lead 3 and a female having a blade thickness on the opposite side of the sealing resin 1 with respect to the cutting position. Using the mold cutting blade 21, the male cutting blade 19 is pressed against the lead frame 9 from the upper surface side and the female cutting blade 21 is pressed from the back surface side to cut the recess 13 to separate the SON from the lead frame 9 (( c)). FIG. 5 is an enlarged sectional view showing the vicinity of the lead 3 and the cutting blade.
As a result, the tip portion 3 a of the lead 3 described above with reference to FIG. 1 is bent upward to form a stepped portion 3 c on the lower surface 3 b of the lead 3, and the sag surface 3 e is the lower surface of the tip surface of the lead 3. The SON formed on the 3b side can be manufactured.

図6は半導体装置の他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。この実施例では本発明の半導体装置の第1態様をリードレスタイプのSONに適用した。図1と同じ部分には同じ符号を付す。   6A and 6B are diagrams showing another embodiment of the semiconductor device, wherein FIG. 6A is a plan view, FIG. 6B is a side view seen from the A direction, FIG. 6C is a side view seen from the B direction, and FIG. A bottom view, (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). In this embodiment, the first embodiment of the semiconductor device of the present invention is applied to a leadless type SON. The same parts as those in FIG.

この実施例のSONにおいて、封止樹脂1の側面に複数のリード23が設けられている。リード23の一部は封止樹脂1の底面に露出している。リード23の寸法及び配置は例えば図1を参照して説明した実施例と同じである。リード23の先端部23aは半抜き工法により例えばリード23の厚みの半分の寸法だけ上方へ折り曲げられており、リード23の下面23bに段差部23cが形成されている。先端部23aの厚み及び幅寸法はリード23の基端部とほぼ同じ、すなわちリード23を半抜き工法により折り曲げる前とほぼ同じである。   In the SON of this embodiment, a plurality of leads 23 are provided on the side surface of the sealing resin 1. A part of the lead 23 is exposed on the bottom surface of the sealing resin 1. The dimensions and arrangement of the leads 23 are the same as in the embodiment described with reference to FIG. The leading end portion 23 a of the lead 23 is bent upward by, for example, half the thickness of the lead 23 by a half punching method, and a stepped portion 23 c is formed on the lower surface 23 b of the lead 23. The thickness and width dimension of the distal end portion 23a are substantially the same as the base end portion of the lead 23, that is, substantially the same as before the lead 23 is bent by the half-punch method.

リード23の先端面には、上面23d側から下面23b側へ順にダレ面23e、せん断面23f、破断面23g、切断バリ23hが形成されている。リード23において、段差部23cを含む下面23b、上面23d、側面、及びダレ面23eにメッキ被膜(図示は省略)が形成されている。せん断面23fにはメッキ被膜が形成されている場合と形成されていない場合がある。また、切断バリ23hは形成されている場合と形成されていない場合がある。   A sag surface 23e, a shear surface 23f, a fracture surface 23g, and a cutting burr 23h are formed on the leading end surface of the lead 23 in this order from the upper surface 23d side to the lower surface 23b side. In the lead 23, a plating film (not shown) is formed on the lower surface 23b, the upper surface 23d, the side surface, and the sag surface 23e including the step portion 23c. The shearing surface 23f may or may not be provided with a plating film. Further, the cutting burr 23h may or may not be formed.

図7は図6に示した実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード下面の段差部にはんだフィレットが形成されている場合、(B)はリード下面の段差部から先端部にわたってはんだフィレットが形成されている場合を示す。
実装基板5上にSONを搭載してリード23と実装基板5の電極(図示は省略)をはんだ接続すると、(A)に示すようにリード23の段差部23cを含む下面23b及び側面に先端部23aを除いてはんだフィレット7が形成される場合と、(B)に示すように先端部23aを含んでリード23の段差部23cを含む下面23b及び側面にはんだフィレット7が形成される場合がある。
7 is a cross-sectional view showing a lead portion in a state where the embodiment shown in FIG. 6 is mounted on a mounting substrate. FIG. 7A shows a case where a solder fillet is formed in a step portion on the lower surface of the lead, and FIG. The case where the solder fillet is formed from the step part on the lower surface of the lead to the tip part is shown.
When the SON is mounted on the mounting substrate 5 and the lead 23 and the electrode (not shown) of the mounting substrate 5 are soldered, the lower surface 23b including the stepped portion 23c of the lead 23 and the tip portion on the side surface are shown in FIG. In some cases, the solder fillet 7 is formed except for 23a, and in other cases, the solder fillet 7 is formed on the lower surface 23b and the side surface including the stepped portion 23c of the lead 23 including the tip 23a as shown in FIG. .

このように、リード23の先端部23aが上方へ折り曲げられてリード23の下面23bに段差23cが形成されていることにより、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。   As described above, the tip 23a of the lead 23 is bent upward and the step 23c is formed on the lower surface 23b of the lead 23, whereby the plating film forming area at the lead tip can be increased, and the solder at the lead tip can be increased. Adhesion can be improved.

図8は製造方法の他の実施例を説明するための概略工程断面図であり、図3に示したリードフレームを用いて図7に示した半導体装置を製作する工程を示している。図8では図3に示したリードフレームの符号3に替えて符号23を付している。図8を参照して製造方法の実施例について説明する。   FIG. 8 is a schematic process sectional view for explaining another embodiment of the manufacturing method, and shows a process of manufacturing the semiconductor device shown in FIG. 7 using the lead frame shown in FIG. In FIG. 8, reference numeral 23 is attached instead of reference numeral 3 of the lead frame shown in FIG. An embodiment of the manufacturing method will be described with reference to FIG.

図4を参照して説明した上記製造方法の実施例において図4(a)及び(b)を参照して説明した工程と同様にして、リードフレーム9のダイパッド11上に半導体チップ15を搭載し、ボンディングワイヤ17及び封止樹脂1の形成を行なった後、封止樹脂バリの除去やはんだメッキなどの外装処理を行なう((a)及び(b)参照)。   In the embodiment of the manufacturing method described with reference to FIG. 4, the semiconductor chip 15 is mounted on the die pad 11 of the lead frame 9 in the same manner as the process described with reference to FIGS. 4 (a) and 4 (b). After the bonding wire 17 and the sealing resin 1 are formed, exterior processing such as removal of the sealing resin burr and solder plating is performed (see (a) and (b)).

リード23の凹部13に対応する切断位置に対して封止樹脂1側に刃厚をもつオス型切断刃25(第1切断刃)と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃27(第2切断刃)を用い、リードフレーム9に対してオス型切断刃25を裏面側から、メス型切断刃27を上面側から押し当てて凹部13を切断してSONをリードフレーム9から切り離す((c)参照)。図9はリード23近傍及び切断刃を拡大して示す断面図である。   A male-type cutting blade 25 (first cutting blade) having a blade thickness on the sealing resin 1 side with respect to the cutting position corresponding to the recess 13 of the lead 23, and the side opposite to the sealing resin 1 with respect to the cutting position A female cutting blade 27 (second cutting blade) having a blade thickness is used, the male cutting blade 25 is pressed against the lead frame 9 from the back surface side, and the female cutting blade 27 is pressed from the top surface side to form the recess 13. Cut the SON from the lead frame 9 (see (c)). FIG. 9 is an enlarged sectional view showing the vicinity of the lead 23 and the cutting blade.

これにより、図6を参照して説明した、リード23の先端部23aが上方へ折り曲げられてリード23の下面23bに段差23cが形成されたSONを製作することができる。
さらに、SONをリードフレーム9から切り離すための切断刃として、封止樹脂1側に刃厚をもつオス型切断刃25と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃27を用いているので、図4を参照して説明した製造方法の実施例で用いたオス型切断刃19に比べてオス型切断刃25及びメス型切断刃27の刃厚を厚くすることができる。例えばリードの突出長さが0.2mmのSONを製作する場合に、図4に示したオス型切断刃19として刃厚が0.2mmよりも薄いものを用いる必要があり、オス型切断刃19が折れやすく、かつ磨耗しやすいという問題があったが、この実施例によればオス型切断刃25及びメス型切断刃27の刃厚を厚くすることができるので、切断刃の寿命を長くすることができ、製造コストの低減を図ることができる。
Thereby, the SON in which the tip 23a of the lead 23 is bent upward and the step 23c is formed on the lower surface 23b of the lead 23 described with reference to FIG. 6 can be manufactured.
Further, as a cutting blade for separating the SON from the lead frame 9, a male cutting blade 25 having a blade thickness on the sealing resin 1 side and a blade thickness on the opposite side of the sealing resin 1 with respect to the cutting position. Since the female cutting blade 27 is used, the blade thicknesses of the male cutting blade 25 and the female cutting blade 27 compared to the male cutting blade 19 used in the embodiment of the manufacturing method described with reference to FIG. Can be thickened. For example, when manufacturing a SON having a lead protrusion length of 0.2 mm, it is necessary to use a male cutting blade 19 having a blade thickness thinner than 0.2 mm as shown in FIG. However, according to this embodiment, since the thickness of the male cutting blade 25 and the female cutting blade 27 can be increased, the life of the cutting blade is extended. Therefore, the manufacturing cost can be reduced.

図10は半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。この実施例では本発明の半導体装置の第2態様をリードレスタイプのSONに適用した。図1と同じ部分には同じ符号を付す。   10A and 10B are views showing still another embodiment of the semiconductor device, wherein FIG. 10A is a plan view, FIG. 10B is a side view seen from the A direction, FIG. 10C is a side view seen from the B direction, and FIG. Is a bottom view, and (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). In this embodiment, the second embodiment of the semiconductor device of the present invention is applied to a leadless type SON. The same parts as those in FIG.

この実施例のSONにおいて、封止樹脂1の側面に複数のリード31が設けられている。リード31の一部は封止樹脂1の底面に露出している。リード31の寸法及び配置は例えば図1及び図6を参照して説明した実施例と同じである。リード31の先端部31aは半抜き工法により例えばリード31の厚みの半分の寸法だけ下方へ折り曲げられており、リード31の下面31bに段差部31cが形成されている。先端部31aの厚み及び幅寸法はリード31の基端部とほぼ同じ、すなわちリード31を半抜き工法により折り曲げる前とほぼ同じである。   In the SON of this embodiment, a plurality of leads 31 are provided on the side surface of the sealing resin 1. A part of the lead 31 is exposed on the bottom surface of the sealing resin 1. The dimensions and arrangement of the lead 31 are the same as those of the embodiment described with reference to FIGS. 1 and 6, for example. The tip 31a of the lead 31 is bent downward by, for example, half the thickness of the lead 31 by a half punching method, and a step portion 31c is formed on the lower surface 31b of the lead 31. The thickness and width dimension of the distal end portion 31a are substantially the same as the proximal end portion of the lead 31, that is, substantially the same as before the lead 31 is bent by the half-punch method.

リード31の先端面には、下面31b側から上面31d側へ順にダレ面31e、せん断面31f、破断面31g、切断バリ31hが形成されている。リード31において、段差部31cを含む下面31b、上面31d、側面、及びダレ面31eにメッキ被膜(図示は省略)が形成されている。せん断面31fにはメッキ被膜が形成されている場合と形成されていない場合がある。また、切断バリ31hは形成されている場合と形成されていない場合がある。   A sag surface 31e, a shear surface 31f, a fracture surface 31g, and a cutting burr 31h are formed on the tip surface of the lead 31 in order from the lower surface 31b side to the upper surface 31d side. In the lead 31, a plating film (not shown) is formed on the lower surface 31b, the upper surface 31d, the side surface, and the sag surface 31e including the step portion 31c. The shearing surface 31f may or may not be formed with a plating film. Further, the cutting burr 31h may or may not be formed.

図11は図10に示した実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。
実装基板5上にSONを搭載してリード31と実装基板5の電極(図示は省略)をはんだ接続すると、リード31の段差部31cを含む下面31b及び側面にはんだフィレット7が形成される((A)及び(B)参照)。また、(B)に示すように、リード31の先端面のせん断面31fにメッキ被膜が形成されている場合にはせん断面31fにもはんだフィレット7が形成される。
さらに、リード31の先端部31aは下方に折り曲げられているので、SONを実装基板5上に搭載した状態で封止樹脂1の下面と実装基板5の表面との間に例えば10〜100μm(マイクロメートル)の間隔が形成される。
11 is a cross-sectional view showing a lead portion in a state where the embodiment shown in FIG. 10 is mounted on a mounting substrate. FIG. 11A shows a case where a plating film is not formed on the shearing surface of the lead tip surface. Indicates a case where a plating film is formed on the shearing surface of the lead tip surface.
When the SON is mounted on the mounting substrate 5 and the lead 31 and the electrode (not shown) of the mounting substrate 5 are solder-connected, the solder fillet 7 is formed on the lower surface 31b and the side surface including the step portion 31c of the lead 31 (( A) and (B)). Further, as shown in (B), when a plating film is formed on the shearing surface 31f of the tip surface of the lead 31, the solder fillet 7 is also formed on the shearing surface 31f.
Furthermore, since the tip portion 31a of the lead 31 is bent downward, for example, 10 to 100 μm (micrometer) between the lower surface of the sealing resin 1 and the surface of the mounting substrate 5 with the SON mounted on the mounting substrate 5. Meter) spacing is formed.

このように、リード31の先端部31aが下方へ折り曲げられてリード31の下面31bに段差部31cが形成されていることにより、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。
さらに、この実施例では、リード31の先端面においてダレ面31eが下面31b側に形成されているので、リード先端におけるメッキ被膜形成面積をさらに大きくすることができる。
さらに、SONを実装基板5上に搭載した状態で封止樹脂1の下面と実装基板5の表面との間に間隔を形成することができるので、封止樹脂1下に小さなゴミ33などが入ってもはんだ付けに影響が出ないようにすることができる。
As described above, the tip 31a of the lead 31 is bent downward and the step portion 31c is formed on the lower surface 31b of the lead 31, thereby increasing the plating film formation area at the lead tip. Solder adhesion can be improved.
Furthermore, in this embodiment, since the sag surface 31e is formed on the lower surface 31b side at the front end surface of the lead 31, the plating film formation area at the front end of the lead can be further increased.
Furthermore, since a space can be formed between the lower surface of the sealing resin 1 and the surface of the mounting substrate 5 in a state where the SON is mounted on the mounting substrate 5, small dust 33 or the like enters under the sealing resin 1. However, it is possible to prevent the soldering from being affected.

図12はリードフレームの他の実施例を示す図であり、(A)平面図、(B)は(A)のB−B位置での断面図である。図13は製造方法のさらに他の実施例を説明するための概略工程断面図であり、図12に示したリードフレームを用いて図10に示した半導体装置を製作する工程を示している。まず、図12を参照してリードフレームの実施例について説明する。   12A and 12B are views showing another embodiment of the lead frame, in which FIG. 12A is a plan view and FIG. 12B is a cross-sectional view taken along the line BB in FIG. FIG. 13 is a schematic process cross-sectional view for explaining still another embodiment of the manufacturing method, and shows a process of manufacturing the semiconductor device shown in FIG. 10 using the lead frame shown in FIG. First, an embodiment of the lead frame will be described with reference to FIG.

リードフレーム35には、半導体チップを搭載するためのダイパッド11と、ダイパッド11に近接して設けられた複数のリード31からなる組が複数形成されている。リード31において、切断後のリードの先端に対応する部分が半抜き工法により下方へ凸状に形成されて裏面31bに凸部37が形成されている。(A)において、凸部37に対応する凹部の図示は省略している。
凸部37の形成領域において、上面から見た面積は加工前と加工後でほぼ同じであり、凹部と凸部の体積はほぼ同じである。この実施例では例えばリード31の厚みの半分の寸法だけ下方へ折り曲げられて凸部37が形成されている。
The lead frame 35 is formed with a plurality of sets each including a die pad 11 for mounting a semiconductor chip and a plurality of leads 31 provided close to the die pad 11. In the lead 31, a portion corresponding to the leading end of the lead after cutting is formed in a convex shape downward by a half punching method, and a convex portion 37 is formed on the back surface 31b. In (A), illustration of the recessed part corresponding to the convex part 37 is abbreviate | omitted.
In the formation region of the convex portion 37, the area viewed from the upper surface is substantially the same before and after processing, and the volume of the concave portion and the convex portion is substantially the same. In this embodiment, for example, the convex portion 37 is formed by being bent downward by a half dimension of the thickness of the lead 31.

図13を参照して製造方法の実施例について説明する。
図4を参照して説明した上記製造方法の実施例において図4(a)及び(b)を参照して説明した工程と同様にして、リードフレーム35のダイパッド11上に半導体チップ15を搭載し、ボンディングワイヤ17及び封止樹脂1の形成を行なった後、封止樹脂バリの除去やはんだメッキなどの外装処理を行なう((a)及び(b)参照)。
An embodiment of the manufacturing method will be described with reference to FIG.
In the embodiment of the manufacturing method described with reference to FIG. 4, the semiconductor chip 15 is mounted on the die pad 11 of the lead frame 35 in the same manner as the process described with reference to FIGS. 4 (a) and 4 (b). After the bonding wire 17 and the sealing resin 1 are formed, exterior processing such as removal of the sealing resin burr and solder plating is performed (see (a) and (b)).

リード31の凸部37に対応する切断位置に対して封止樹脂1側に刃厚をもつオス型切断刃19と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃21を用い、リードフレーム9に対してオス型切断刃19を上面側から、メス型切断刃21を裏面側から押し当てて凸部37を切断してSONをリードフレーム9から切り離す((c)参照)。図14はリード31近傍及び切断刃を拡大して示す断面図である。
これにより、図10を参照して説明した、リード31の先端部31aが下方へ折り曲げられてリード31の下面31bに段差部31cが形成され、かつ、リード31の先端面においてダレ面31eが下面31b側に形成されたSONを製作することができる。
A male cutting blade 19 having a blade thickness on the sealing resin 1 side with respect to the cutting position corresponding to the convex portion 37 of the lead 31 and a blade thickness on the opposite side of the sealing resin 1 with respect to the cutting position. Using the female cutting blade 21, the male cutting blade 19 is pressed against the lead frame 9 from the upper surface side, and the female cutting blade 21 is pressed from the rear surface side to cut the convex portion 37 to separate the SON from the lead frame 9. (See (c)). FIG. 14 is an enlarged sectional view showing the vicinity of the lead 31 and the cutting blade.
As a result, the tip 31 a of the lead 31 described with reference to FIG. 10 is bent downward to form a stepped portion 31 c on the lower surface 31 b of the lead 31, and the sag surface 31 e is the lower surface on the tip of the lead 31. The SON formed on the 31b side can be manufactured.

図15は半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。この実施例では本発明の半導体装置の第2態様をリードレスタイプのSONに適用した。図1と同じ部分には同じ符号を付す。   15A and 15B are views showing still another embodiment of the semiconductor device, wherein FIG. 15A is a plan view, FIG. 15B is a side view seen from the A direction, FIG. 15C is a side view seen from the B direction, and FIG. Is a bottom view, and (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). In this embodiment, the second embodiment of the semiconductor device of the present invention is applied to a leadless type SON. The same parts as those in FIG.

この実施例のSONにおいて、封止樹脂1の側面に複数のリード39が設けられている。リード39の一部は封止樹脂1の底面に露出している。リード39の寸法及び配置は例えば図1を参照して説明した実施例と同じである。リード39の先端部39aは半抜き工法により例えばリード39の厚みの半分の寸法だけ上方へ折り曲げられており、リード39の下面39bに段差部39cが形成されている。先端部39aの厚み及び幅寸法はリード39の基端部とほぼ同じ、すなわちリード39を半抜き工法により折り曲げる前とほぼ同じである。   In the SON of this embodiment, a plurality of leads 39 are provided on the side surface of the sealing resin 1. A part of the lead 39 is exposed on the bottom surface of the sealing resin 1. The dimensions and arrangement of the leads 39 are the same as those of the embodiment described with reference to FIG. The leading end 39a of the lead 39 is bent upward by, for example, half the thickness of the lead 39 by a half punching method, and a stepped portion 39c is formed on the lower surface 39b of the lead 39. The thickness and the width dimension of the distal end portion 39a are substantially the same as the base end portion of the lead 39, that is, substantially the same as before the lead 39 is bent by the half punching method.

リード39の先端面には、上面39d側から下面39b側へ順にダレ面39e、せん断面39f、破断面39g、切断バリ39hが形成されている。リード39において、段差部39cを含む下面39b、上面39d、側面、及びダレ面39eにメッキ被膜(図示は省略)が形成されている。せん断面39fにはメッキ被膜が形成されている場合と形成されていない場合がある。また、切断バリ39hは形成されている場合と形成されていない場合がある。   A sag surface 39e, a shear surface 39f, a fracture surface 39g, and a cutting burr 39h are formed on the leading end surface of the lead 39 in this order from the upper surface 39d side to the lower surface 39b side. In the lead 39, a plating film (not shown) is formed on the lower surface 39b, the upper surface 39d, the side surface, and the sag surface 39e including the step portion 39c. The shearing surface 39f may or may not be provided with a plating film. Further, the cutting burr 39h may or may not be formed.

図16は図15に示した実施例を実装基板に実装した状態のリード部分を示す断面図である。
実装基板5上にSONを搭載してリード39と実装基板5の電極(図示は省略)をはんだ接続すると、リード39の段差部39cを含む下面39b及び側面にはんだフィレット7が形成される。
さらに、リード39の先端部39aは下方に折り曲げられているので、SONを実装基板5上に搭載した状態で封止樹脂1の下面と実装基板5の表面との間に例えば10〜100μmの間隔が形成される。
16 is a cross-sectional view showing a lead portion in a state where the embodiment shown in FIG. 15 is mounted on a mounting board.
When the SON is mounted on the mounting substrate 5 and the lead 39 and the electrode (not shown) of the mounting substrate 5 are soldered, the solder fillet 7 is formed on the lower surface 39b and the side surface including the stepped portion 39c of the lead 39.
Furthermore, since the tip 39a of the lead 39 is bent downward, a distance of, for example, 10 to 100 μm is provided between the lower surface of the sealing resin 1 and the surface of the mounting substrate 5 in a state where the SON is mounted on the mounting substrate 5. Is formed.

このように、リード39の先端部39aが下方へ折り曲げられてリード39の下面39bに段差部39cが形成されていることにより、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。
さらに、SONを実装基板5上に搭載した状態で封止樹脂1の下面と実装基板5の表面との間に間隔を形成することができるので、封止樹脂1下に小さなゴミ33などが入ってもはんだ付けに影響が出ないようにすることができる。
As described above, the tip 39a of the lead 39 is bent downward and the step 39c is formed on the lower surface 39b of the lead 39, so that the plating film formation area at the tip of the lead can be increased. Solder adhesion can be improved.
Furthermore, since a space can be formed between the lower surface of the sealing resin 1 and the surface of the mounting substrate 5 in a state where the SON is mounted on the mounting substrate 5, small dust 33 or the like enters under the sealing resin 1. However, it is possible to prevent the soldering from being affected.

図17は製造方法のさらに他の実施例を説明するための概略工程断面図であり、図12に示したリードフレームを用いて図15に示した半導体装置を製作する工程を示している。図17では図15に示したリードフレームの符号31に替えて符号39を付している。図17を参照して製造方法の実施例について説明する。   FIG. 17 is a schematic process cross-sectional view for explaining still another embodiment of the manufacturing method, and shows a process of manufacturing the semiconductor device shown in FIG. 15 using the lead frame shown in FIG. In FIG. 17, a reference numeral 39 is attached instead of the reference numeral 31 of the lead frame shown in FIG. An embodiment of the manufacturing method will be described with reference to FIG.

図4を参照して説明した上記製造方法の実施例において図4(a)及び(b)を参照して説明した工程と同様にして、リードフレーム35のダイパッド11上に半導体チップ15を搭載し、ボンディングワイヤ17及び封止樹脂1の形成を行なった後、封止樹脂バリの除去やはんだメッキなどの外装処理を行なう((a)及び(b)参照)。   In the embodiment of the manufacturing method described with reference to FIG. 4, the semiconductor chip 15 is mounted on the die pad 11 of the lead frame 35 in the same manner as the process described with reference to FIGS. 4 (a) and 4 (b). After the bonding wire 17 and the sealing resin 1 are formed, exterior processing such as removal of the sealing resin burr and solder plating is performed (see (a) and (b)).

リード39の凸部37に対応する切断位置に対して封止樹脂1側に刃厚をもつオス型切断刃25(第1切断刃)と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃27(第2切断刃)を用い、リードフレーム35に対してオス型切断刃25を裏面側から、メス型切断刃27を上面側から押し当てて凸部37を切断してSONをリードフレーム35から切り離す((c)参照)。図18はリード39近傍及び切断刃を拡大して示す断面図である。   The male cutting blade 25 (first cutting blade) having a blade thickness on the sealing resin 1 side with respect to the cutting position corresponding to the convex portion 37 of the lead 39 and the sealing resin 1 opposite to the cutting position. Using a female cutting blade 27 (second cutting blade) having a blade thickness on the side, the male cutting blade 25 is pressed against the lead frame 35 from the back surface, and the female cutting blade 27 is pressed from the top surface to project 37 is cut to disconnect the SON from the lead frame 35 (see (c)). FIG. 18 is an enlarged sectional view showing the vicinity of the lead 39 and the cutting blade.

これにより、図15を参照して説明した、リード39の先端部39aが下方へ折り曲げられてリード39の下面39bに段差39cが形成されたSONを製作することができる。
さらに、図6を参照して説明した上記製造方法の実施例と同様に、SONをリードフレーム35から切り離すための切断刃として、封止樹脂1側に刃厚をもつオス型切断刃25と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃27を用いているので、オス型切断刃25及びメス型切断刃27の刃厚を厚くして切断刃の寿命を長くすることができ、製造コストの低減を図ることができる。
Accordingly, the SON described with reference to FIG. 15 in which the tip 39a of the lead 39 is bent downward and the step 39c is formed on the lower surface 39b of the lead 39 can be manufactured.
Further, similarly to the embodiment of the manufacturing method described with reference to FIG. 6, as a cutting blade for separating SON from the lead frame 35, a male cutting blade 25 having a blade thickness on the sealing resin 1 side, Since the female cutting blade 27 having a blade thickness on the side opposite to the sealing resin 1 with respect to the cutting position is used, the cutting blades having the male cutting blade 25 and the female cutting blade 27 are made thicker. The lifetime of the battery can be extended, and the manufacturing cost can be reduced.

上記実施例では本発明をSONに適用しているが、本発明はこれに限定されるものではなく、例えばQFNなど、SON以外のリードレスタイプの半導体装置や、ガルウィングタイプの半導体装置に適用することができる。以下に、本発明をガルウィングタイプの半導体装置に適用した実施例を説明する。   In the above-described embodiments, the present invention is applied to the SON. However, the present invention is not limited to this. For example, the present invention is applied to a leadless type semiconductor device other than the SON, such as QFN, and a gull wing type semiconductor device. be able to. Embodiments in which the present invention is applied to a gull wing type semiconductor device will be described below.

図19は半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)は側面図、(C)は(B)の破線円で囲まれた部分の拡大図である。この実施例では本発明の半導体装置の第1態様をガルウィングタイプの半導体装置に適用した。   19A and 19B are diagrams showing still another embodiment of the semiconductor device, wherein FIG. 19A is a plan view, FIG. 19B is a side view, and FIG. 19C is an enlarged view of a portion surrounded by a broken-line circle in FIG. . In this embodiment, the first embodiment of the semiconductor device of the present invention is applied to a gull-wing type semiconductor device.

半導体チップを封止するための封止樹脂1の側面に複数のリード41が設けられている。リード41は封止樹脂1の側面から水平方向に突出して設けられ、先端部が下方に折り曲げられ、さらに水平方向に折り曲げられている。リード41の先端部41aは、図1を参照して説明した実施例のリード3の先端部3aと同様の構成を備えており、半抜き工法により例えばリード41の厚みの半分の寸法だけ上方へ折り曲げられてリード41の下面41bに段差部41cを備え、リード41の先端面に下面41b側から上面41d側へ順にダレ面41e、せん断面41f、破断面41g、切断バリ41hを備えている。先端部41aの厚み及び幅寸法はリード41の基端部とほぼ同じ、すなわちリード41を半抜き工法により折り曲げる前とほぼ同じである。   A plurality of leads 41 are provided on the side surface of the sealing resin 1 for sealing the semiconductor chip. The lead 41 is provided so as to protrude in the horizontal direction from the side surface of the sealing resin 1, and the tip is bent downward and further bent in the horizontal direction. The tip portion 41a of the lead 41 has the same configuration as the tip portion 3a of the lead 3 of the embodiment described with reference to FIG. 1, and is moved upward by, for example, half the thickness of the lead 41 by a half punching method. The step 41c is provided on the lower surface 41b of the lead 41 by bending, and the tip surface of the lead 41 is provided with a sag surface 41e, a shear surface 41f, a fracture surface 41g, and a cutting burr 41h in order from the lower surface 41b side to the upper surface 41d side. The thickness and width dimension of the distal end portion 41a are substantially the same as the base end portion of the lead 41, that is, substantially the same as before the lead 41 is bent by the half-punch method.

図20は図19に示した実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。
実装基板5上に半導体装置を搭載してリード41と実装基板5の電極(図示は省略)をはんだ接続すると、リード41の段差部41cを含む下面41b及び側面にはんだフィレット7が形成される((A)及び(B)参照)。また、(B)に示すように、リード41の先端面のせん断面41fにメッキ被膜が形成されている場合にはせん断面41fにもはんだフィレット7が形成される。
20 is a cross-sectional view showing a lead portion in a state where the embodiment shown in FIG. 19 is mounted on a mounting substrate. FIG. 20A shows a case where a plating film is not formed on the shear surface of the lead tip surface. Indicates a case where a plating film is formed on the shearing surface of the lead tip surface.
When the semiconductor device is mounted on the mounting substrate 5 and the lead 41 and the electrode (not shown) of the mounting substrate 5 are solder-connected, the solder fillet 7 is formed on the lower surface 41 b and the side surface including the stepped portion 41 c of the lead 41 ( (See (A) and (B)). Further, as shown in (B), when a plating film is formed on the shearing surface 41f of the tip surface of the lead 41, the solder fillet 7 is also formed on the shearing surface 41f.

このように、ガルウィングタイプの半導体装置においても、上記SONの実施例と同様に、リード41の先端部41aが上方へ折り曲げられてリード41の下面41bに段差部41cが形成されていることにより、リード先端におけるメッキ被膜形成面積を大きくすることができ、リード先端のはんだ付着性を向上させることができる。
さらに、この実施例では、リード41の先端面においてダレ面41eが下面41b側に形成されているので、リード先端におけるメッキ被膜形成面積をさらに大きくすることができる。
さらに、リード41の先端面において切断バリ41hが上面41d側に形成されているので、実装高さのばらつきを抑制することができる。
Thus, in the gull wing type semiconductor device, similarly to the SON embodiment, the tip 41a of the lead 41 is bent upward and the step 41c is formed on the lower surface 41b of the lead 41. The plating film formation area at the lead tip can be increased, and the solder adhesion at the lead tip can be improved.
Further, in this embodiment, since the sag surface 41e is formed on the lower surface 41b side at the tip surface of the lead 41, the plating film formation area at the lead tip can be further increased.
Furthermore, since the cutting burr 41h is formed on the upper surface 41d side at the tip surface of the lead 41, variations in the mounting height can be suppressed.

図21はリードフレームのさらに他の実施例を示す図であり、(A)平面図、(B)は(A)のC−C位置での断面図である。図22は製造方法の一実施例を説明するための概略工程断面図であり、図21に示したリードフレームを用いて図19に示した半導体装置を製作する工程を示している。まず、図21を参照してリードフレームの実施例について説明する。   21A and 21B are views showing still another embodiment of the lead frame, in which FIG. 21A is a plan view and FIG. 21B is a cross-sectional view taken along the line CC in FIG. FIG. 22 is a schematic process cross-sectional view for explaining an embodiment of the manufacturing method, and shows a process of manufacturing the semiconductor device shown in FIG. 19 using the lead frame shown in FIG. First, an example of a lead frame will be described with reference to FIG.

リードフレーム43には、半導体チップを搭載するためのダイパッド11と、ダイパッド11に近接して設けられた複数のリード41と、リード41のダイパッド11近傍の端部を支持するためのタイバー45からなる組が複数形成されている。リード41において、切断後のリードの先端に対応する部分が半抜き工法により上方へ凸状に形成されて裏面41bに凹部47が形成されている。(A)において、凹部47に対応する凸部の図示は省略している。
凹部47の形成領域において、上面から見た面積は加工前と加工後でほぼ同じであり、凹部と凸部の体積はほぼ同じである。この実施例では例えばリード41の厚みの半分の寸法だけ上方へ折り曲げられて凹部47が形成されている。
The lead frame 43 includes a die pad 11 for mounting a semiconductor chip, a plurality of leads 41 provided close to the die pad 11, and a tie bar 45 for supporting an end portion of the lead 41 near the die pad 11. A plurality of sets are formed. In the lead 41, a portion corresponding to the tip of the lead after cutting is formed in a convex shape upward by a half punching method, and a concave portion 47 is formed in the back surface 41b. In (A), illustration of the convex part corresponding to the concave part 47 is omitted.
In the region where the recess 47 is formed, the area viewed from above is substantially the same before and after processing, and the volume of the recess and the protrusion is approximately the same. In this embodiment, for example, the concave portion 47 is formed by bending upward by a half dimension of the thickness of the lead 41.

図22を参照して製造方法の実施例について説明する。
図4を参照して説明した上記製造方法の実施例において図4(a)及び(b)を参照して説明した工程と同様にして、リードフレーム43のダイパッド11上に半導体チップ15を搭載し、ボンディングワイヤ17及び封止樹脂1の形成を行なった後、封止樹脂バリの除去やはんだメッキなどの外装処理を行なう((a)及び(b)参照)。
An embodiment of the manufacturing method will be described with reference to FIG.
In the embodiment of the manufacturing method described with reference to FIG. 4, the semiconductor chip 15 is mounted on the die pad 11 of the lead frame 43 in the same manner as the process described with reference to FIGS. 4 (a) and 4 (b). After the bonding wire 17 and the sealing resin 1 are formed, exterior processing such as removal of the sealing resin burr and solder plating is performed (see (a) and (b)).

リード41の凹部47に対応する切断位置に対して封止樹脂1側に刃厚をもつオス型切断刃49と、上記切断位置に対して封止樹脂1とは反対側に刃厚をもつメス型切断刃50を用い、リードフレーム43に対してオス型切断刃49を上面側から、メス型切断刃50を裏面側から押し当てて凹部47を切断して半導体装置をリードフレーム43から切り離す((c)参照)。図23はリード41近傍及び切断刃を拡大して示す断面図である。図示は省略するが、切断刃49,50には図21に示したタイバー45を切断するための刃も設けられており、リード41の切断と同時にタイバー45も切断される。ここで、ガルウィングタイプの半導体装置の場合はSONの場合とは異なり切断位置が封止樹脂1とは十分な間隔をもって設けられているので、オス型切断刃49として、図4を参照して説明した上記製造方法の実施例で用いたオス型切断刃19よりも刃厚が厚いものを用いることができる。   A male cutting blade 49 having a blade thickness on the sealing resin 1 side with respect to the cutting position corresponding to the recess 47 of the lead 41, and a female having a blade thickness on the opposite side of the sealing resin 1 with respect to the cutting position. Using the die cutting blade 50, the male cutting blade 49 is pressed against the lead frame 43 from the upper surface side, and the female cutting blade 50 is pressed from the back surface side to cut the recess 47 to separate the semiconductor device from the lead frame 43 ( (See (c)). FIG. 23 is an enlarged sectional view showing the vicinity of the lead 41 and the cutting blade. Although not shown, the cutting blades 49 and 50 are also provided with a blade for cutting the tie bar 45 shown in FIG. 21, and the tie bar 45 is cut simultaneously with the cutting of the lead 41. Here, in the case of a gull-wing type semiconductor device, unlike the case of SON, the cutting position is provided with a sufficient distance from the sealing resin 1, so that the male cutting blade 49 will be described with reference to FIG. What has a blade thickness thicker than the male cutting blade 19 used in the embodiment of the manufacturing method described above can be used.

その後、リード41を所定のガルウィング形状に加工することにより、図19を参照して説明した、リード41の先端部41aが上方へ折り曲げられてリード41の下面41bに段差部41cが形成され、かつ、リード41の先端面においてダレ面41eが下面41b側に形成されたガルウィングタイプの半導体装置を製作することができる。   Thereafter, by processing the lead 41 into a predetermined gull wing shape, the tip 41a of the lead 41 described with reference to FIG. 19 is bent upward to form a step 41c on the lower surface 41b of the lead 41, and A gull wing type semiconductor device in which the sag surface 41e is formed on the lower surface 41b side at the tip surface of the lead 41 can be manufactured.

図19から図23を参照して説明した上記実施例は、ガルウィングタイプの半導体装置であって、リード41の先端部41aが図1から図5を参照して説明した実施例のリード3の先端部3aと同様の構成をもつもの、その半導体装置の製造方法及びそれに用いられるリードフレームを説明しているが、本発明はこれに限定されるものではない。ガルウィングタイプの半導体装置において、リードの先端部の構成について、図6から図9を参照して説明した実施例のリード23の先端部23aと同様の構成、図10から図14を参照して説明した実施例のリード31の先端部31aと同様の構成、図15から図18を参照して説明した実施例のリード39の先端部39aと同様の構成を適用することもでき、それらの実施例と同様の作用効果を得ることができる。半導体装置の製造方法及びリードフレームについても同様である。   The above-described embodiment described with reference to FIGS. 19 to 23 is a gull-wing type semiconductor device, and the tip 41a of the lead 41 has the tip of the lead 3 of the embodiment described with reference to FIGS. Although the semiconductor device manufacturing method and the lead frame used therefor having the same configuration as the portion 3a are described, the present invention is not limited to this. In the gull-wing type semiconductor device, the configuration of the leading end portion of the lead will be described with reference to the same configuration as the leading end portion 23a of the lead 23 of the embodiment described with reference to FIGS. The same configuration as the tip portion 31a of the lead 31 of the embodiment described above, and the same configuration as the tip portion 39a of the lead 39 of the embodiment described with reference to FIGS. 15 to 18 can also be applied. The same effect can be obtained. The same applies to the semiconductor device manufacturing method and the lead frame.

以上、本発明の実施例を説明したが、寸法、形状及び配置などは一例であり、本発明はこれに限定されるものではなく、特許請求の範囲に記載された本発明の範囲内で種々の変更が可能である。   As mentioned above, although the Example of this invention was described, a dimension, a shape, arrangement | positioning, etc. are examples, this invention is not limited to this, Various within the range of this invention described in the claim Can be changed.

半導体装置の一実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。BRIEF DESCRIPTION OF THE DRAWINGS It is a figure which shows one Example of a semiconductor device, (A) Top view, (B) The side view seen from the A direction, (C) The side view seen from the B direction, (D) is a bottom view, E) is an enlarged view of a portion surrounded by a broken-line circle in (B). 同実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。It is sectional drawing which shows the lead part of the state mounted in the mounting board | substrate in the Example, (A) is the case where the plating film is not formed in the shearing surface of a lead front end surface, (B) is the shearing surface of a lead front end surface Shows the case where a plating film is formed. リードフレームの一実施例を示す図であり、(A)平面図、(B)は(A)のA−A位置での断面図である。It is a figure which shows one Example of a lead frame, (A) Top view, (B) is sectional drawing in the AA position of (A). 製造方法の一実施例を説明するための概略工程断面図である。It is general | schematic process sectional drawing for demonstrating one Example of a manufacturing method. 同実施例におけるリード切断時のリード近傍及び切断刃を拡大して示す断面図である。It is sectional drawing which expands and shows the lead vicinity and cutting blade at the time of the lead cutting | disconnection in the Example. 半導体装置の他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。It is a figure which shows the other Example of a semiconductor device, (A) Top view, (B) The side view seen from the A direction, (C) The side view seen from the B direction, (D) is a bottom view, (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). 同実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード下面の段差部にはんだフィレットが形成されている場合、(B)はリード下面の段差部から先端部にわたってはんだフィレットが形成されている場合を示す。It is sectional drawing which shows the lead part of the state mounted in the mounting board | substrate in the same Example, (A) is a front-end | tip from the level | step-difference part of a lead lower surface, when (A) has a solder fillet formed in the level | step-difference part of a lower surface of a lead The case where the solder fillet is formed over the part is shown. 製造方法の他の実施例を説明するための概略工程断面図である。It is an outline process sectional view for explaining other examples of a manufacturing method. 同実施例におけるリード切断時のリード近傍及び切断刃を拡大して示す断面図である。It is sectional drawing which expands and shows the lead vicinity and cutting blade at the time of the lead cutting | disconnection in the Example. 半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。It is a figure which shows the further another Example of a semiconductor device, (A) Top view, (B) The side view seen from the A direction, (C) The side view seen from the B direction, (D) is a bottom view (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). 同実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。It is sectional drawing which shows the lead part of the state mounted in the mounting board | substrate in the Example, (A) is the case where the plating film is not formed in the shearing surface of a lead front end surface, (B) is the shearing surface of a lead front end surface Shows the case where a plating film is formed. リードフレームの他の実施例を示す図であり、(A)平面図、(B)は(A)のB−B位置での断面図である。It is a figure which shows the other Example of a lead frame, (A) Top view, (B) is sectional drawing in the BB position of (A). 製造方法のさらに他の実施例を説明するための概略工程断面図である。It is a schematic process sectional drawing for demonstrating the further another Example of a manufacturing method. 同実施例におけるリード切断時のリード近傍及び切断刃を拡大して示す断面図である。It is sectional drawing which expands and shows the lead vicinity and cutting blade at the time of the lead cutting | disconnection in the Example. 半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)はA方向から見た側面図、(C)はB方向から見た側面図、(D)は下面図、(E)は(B)の破線円で囲まれた部分の拡大図である。It is a figure which shows the further another Example of a semiconductor device, (A) Top view, (B) The side view seen from the A direction, (C) The side view seen from the B direction, (D) is a bottom view (E) is an enlarged view of a portion surrounded by a broken-line circle in (B). 同実施例を実装基板に実装した状態のリード部分を示す断面図である。It is sectional drawing which shows the lead part of the state mounted in the mounting board | substrate in the Example. 製造方法のさらに他の実施例を説明するための概略工程断面図である。It is a schematic process sectional drawing for demonstrating the further another Example of a manufacturing method. 同実施例におけるリード切断時のリード近傍及び切断刃を拡大して示す断面図である。It is sectional drawing which expands and shows the lead vicinity and cutting blade at the time of the lead cutting | disconnection in the Example. 半導体装置のさらに他の実施例を示す図であり、(A)平面図、(B)は側面図、(C)は(B)の破線円で囲まれた部分の拡大図である。It is a figure which shows other Example of a semiconductor device, (A) Top view, (B) is a side view, (C) is an enlarged view of the part enclosed with the broken-line circle of (B). 同実施例を実装基板に実装した状態のリード部分を示す断面図であり、(A)はリード先端面のせん断面にメッキ被膜が形成されていない場合、(B)はリード先端面のせん断面にメッキ被膜が形成されている場合を示す。It is sectional drawing which shows the lead part of the state mounted in the mounting board | substrate in the Example, (A) is the case where the plating film is not formed in the shearing surface of a lead front end surface, (B) is the shearing surface of a lead front end surface Shows the case where a plating film is formed. リードフレームのさらに他の実施例を示す図であり、(A)平面図、(B)は(A)のC−C位置での断面図である。It is a figure which shows other Example of a lead frame, (A) Top view, (B) is sectional drawing in CC position of (A). 製造方法の他の実施例を説明するための概略工程断面図である。It is an outline process sectional view for explaining other examples of a manufacturing method. 同実施例におけるリード切断時のリード近傍及び切断刃を拡大して示す断面図である。It is sectional drawing which expands and shows the lead vicinity and cutting blade at the time of the lead cutting | disconnection in the Example. 従来技術における切断前のアウターリードの側面図である。It is a side view of the outer lead before the cutting | disconnection in a prior art. 他の従来技術におけるリード先端部を示す図であり、(A)はプレス処理前の平面図、(B)はプレス処理後の平面図、(C)はプレス処理後の側面図である。It is a figure which shows the lead front-end | tip part in another prior art, (A) is a top view before press processing, (B) is a top view after press processing, (C) is a side view after press processing. さらに他の従来技術における切断前のリードの平面図である。It is a top view of the lead before cutting in still another prior art. さらに他の従来技術におけるリード先端部の側面図である。It is a side view of the lead tip part in still another prior art.

符号の説明Explanation of symbols

1 封止樹脂
3,23,31,39,41 リード
3a,23a,31a,39a,41a リードの先端部
3b,23b,31b,39b,41b リードの下面
3c,23c,31c,39c,41c リード下面の段差部
3d,23d,31d,39d,41d リードの上面3d
3e,23e,31e,39e,41e ダレ面
3f,23f,31f,39f,41f せん断面
3g,23g,31g,39g,41g 破断面
3h,23h,31h,39h,41h 切断バリ
5 実装基板
7 はんだフィレット
9 リードフレーム
11 ダイパッド
13 凹部
15 半導体チップ
17 ボンディングワイヤ
19 オス型切断刃
21 メス型切断刃
25 オス型切断刃
27 メス型切断刃
33 ゴミ
35 リードフレーム
37 凸部
43 リードフレーム
45 タイバー
47 凹部
49 オス型切断刃
50 メス型切断刃
1 Sealing resin 3, 23, 31, 39, 41 Lead 3a, 23a, 31a, 39a, 41a Lead tip 3b, 23b, 31b, 39b, 41b Lead lower surface 3c, 23c, 31c, 39c, 41c Lead lower surface Steps 3d, 23d, 31d, 39d, 41d of the upper surface 3d of the lead
3e, 23e, 31e, 39e, 41e Sag surface 3f, 23f, 31f, 39f, 41f Shear surface 3g, 23g, 31g, 39g, 41g Broken surface 3h, 23h, 31h, 39h, 41h Cutting burr 5 Mounting substrate 7 Solder fillet 9 Lead frame 11 Die pad 13 Recess 15 Semiconductor chip 17 Bonding wire 19 Male cutting blade 21 Female cutting blade 25 Male cutting blade 27 Female cutting blade 33 Garbage 35 Lead frame 37 Convex 43 Lead frame 45 Tie bar 47 Concave 49 Male Die cutting blade 50 Female cutting blade

Claims (8)

半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置において、
前記リードの先端部が半抜き工法により上方へ折り曲げられていることを特徴とする半導体装置。
In a semiconductor device provided with a plurality of leads on the outer edge of a sealing resin and a sealing resin for sealing a semiconductor chip,
2. A semiconductor device according to claim 1, wherein a tip end portion of the lead is bent upward by a half punching method.
半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置において、
前記リードの先端部が半抜き工法により下方へ折り曲げられていることを特徴とする半導体装置。
In a semiconductor device provided with a plurality of leads on the outer edge of a sealing resin and a sealing resin for sealing a semiconductor chip,
2. A semiconductor device according to claim 1, wherein a tip end portion of the lead is bent downward by a half punching method.
前記リードの先端面において上面側にダレ面が形成されている請求項1又は2に記載の半導体装置。   3. The semiconductor device according to claim 1, wherein a sag surface is formed on an upper surface side of a tip surface of the lead. 前記リードの先端面において下面側にダレ面が形成されている請求項1又は2に記載の半導体装置。   3. The semiconductor device according to claim 1, wherein a sag surface is formed on a lower surface side of the leading end surface of the lead. 前記半導体装置はリードレスタイプである請求項1から4のいずれかに記載の半導体装置。   The semiconductor device according to claim 1, wherein the semiconductor device is a leadless type. 半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置に用いられるリードフレームにおいて、
切断後のリードの先端に対応する部分が半抜き工法により上方又は下方へ凸状に形成されていることを特徴とするリードフレーム。
In a lead frame used in a semiconductor device provided with a plurality of leads on the outer edge of a sealing resin and a sealing resin for sealing a semiconductor chip,
A lead frame, wherein a portion corresponding to the tip of the lead after cutting is formed in a convex shape upward or downward by a half punching method.
半導体チップを封止するための封止樹脂と封止樹脂の外縁部に複数のリードを備えた半導体装置の製造方法において、
切断後のリードの先端に対応する部分が半抜き工法により上方又は下方へ凸状に形成されているリードフレームを用い、半導体チップを前記リードフレームに搭載して樹脂封止処理及びメッキ処理を施した後、前記リードフレームの凸状部分を切断して半導体装置をリードフレームから切り離す工程を含むことを特徴とする半導体装置の製造方法。
In a manufacturing method of a semiconductor device provided with a plurality of leads on an outer edge portion of a sealing resin and a sealing resin for sealing a semiconductor chip,
Using a lead frame in which a portion corresponding to the tip of the lead after cutting is formed in a convex shape upward or downward by a half-punch method, a semiconductor chip is mounted on the lead frame and subjected to resin sealing treatment and plating treatment. And a step of cutting the protruding portion of the lead frame to separate the semiconductor device from the lead frame.
前記凸状部分を切断する際に、切断位置に対して封止樹脂側に刃厚をもつ第1切断刃と前記切断位置に対して封止樹脂とは反対側に刃厚をもつ第2切断刃を用い、前記リードフレームに対して前記第1切断刃を裏面側から、前記第2切断刃を上面側から押し当てて前記凸状部分を切断する請求項7に記載の半導体装置の製造方法。   When cutting the convex portion, a first cutting blade having a blade thickness on the sealing resin side with respect to the cutting position and a second cutting having a blade thickness on the side opposite to the sealing resin with respect to the cutting position 8. The method of manufacturing a semiconductor device according to claim 7, wherein a blade is used to cut the convex portion by pressing the first cutting blade against the lead frame from the back surface side and the second cutting blade from the top surface side. .
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Cited By (11)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
JP2010010187A (en) * 2008-06-24 2010-01-14 Renesas Technology Corp Method of manufacturing semiconductor integrated circuit device
US20100052124A1 (en) * 2008-08-28 2010-03-04 Sanyo Electric Co., Ltd. Resin sealing type semiconductor device and method of manufacturing the same, and resin sealing type electronic device
US7757375B2 (en) 2006-03-31 2010-07-20 Nec Electronics Corporation Lead cutter and method of fabricating semiconductor device
CN104617156A (en) * 2015-01-19 2015-05-13 苏州固锝电子股份有限公司 Rectifying chip for microelectronic device
CN108109972A (en) * 2017-12-29 2018-06-01 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198797A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198804A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is stack package structure and its manufacturing process that pin side wall climbs tin
CN108198761A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198790A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is stack package structure and its manufacturing process that pin side wall climbs tin
CN108206170A (en) * 2017-12-29 2018-06-26 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
WO2023218959A1 (en) * 2022-05-13 2023-11-16 ローム株式会社 Semiconductor device and method for manufacturing semiconductor device

Cited By (13)

* Cited by examiner, † Cited by third party
Publication number Priority date Publication date Assignee Title
US7757375B2 (en) 2006-03-31 2010-07-20 Nec Electronics Corporation Lead cutter and method of fabricating semiconductor device
US7795060B2 (en) 2006-03-31 2010-09-14 Nec Electronics Corporation Lead cutter and method of fabricating semiconductor device
JP2010010187A (en) * 2008-06-24 2010-01-14 Renesas Technology Corp Method of manufacturing semiconductor integrated circuit device
US20100052124A1 (en) * 2008-08-28 2010-03-04 Sanyo Electric Co., Ltd. Resin sealing type semiconductor device and method of manufacturing the same, and resin sealing type electronic device
CN104617156A (en) * 2015-01-19 2015-05-13 苏州固锝电子股份有限公司 Rectifying chip for microelectronic device
CN104617156B (en) * 2015-01-19 2017-10-13 苏州固锝电子股份有限公司 Rectification chip for microelectronic component
CN108109972A (en) * 2017-12-29 2018-06-01 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198797A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198804A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is stack package structure and its manufacturing process that pin side wall climbs tin
CN108198761A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
CN108198790A (en) * 2017-12-29 2018-06-22 江苏长电科技股份有限公司 There is stack package structure and its manufacturing process that pin side wall climbs tin
CN108206170A (en) * 2017-12-29 2018-06-26 江苏长电科技股份有限公司 There is semiconductor package and its manufacturing process that pin side wall climbs tin
WO2023218959A1 (en) * 2022-05-13 2023-11-16 ローム株式会社 Semiconductor device and method for manufacturing semiconductor device

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