JP2004287301A - Matrix display device - Google Patents
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Abstract
Description
【0001】
【発明の属する技術分野】
本発明は、液晶表示装置などのように、画素をマトリックス状に配置してなるマトリックス表示装置に関する。
【0002】
近年、デスクトップ型のパーソナルコンピュータにおいては、省エネルギー、省スペースの要求から、CRT(陰極線管)に代わり、液晶表示装置を備える製品が市場を拡大しており、競合メーカでは、歩留まり向上によるコストダウンが求められている。
【0003】
【従来の技術】
図8は従来の液晶表示装置の一例の要部の概略的構成図である(例えば、特許文献1参照)。図8中、1はアクティブマトリックス型の液晶表示パネル、2は液晶表示パネル1に形成されているデータ線(表示信号線)にデータ信号をA/D(アナログ/デシタル)変換して出力するソースドライバ部(データ線駆動回路部)である。
【0004】
3は液晶表示パネル1に形成されているゲート線(走査信号線)に走査信号を出力するゲートドライバ部(ゲート線駆動回路部)、4は画像信号や同期信号等を入力して液晶表示パネル1に画像を表示するために必要な各種の信号を作成する信号制御部である。
【0005】
図9はソースドライバ部2の概略的構成図である。図9中、5−1〜5−4は液晶表示パネル1に形成されているデータ線にデータ信号をA/D変換して出力するソースドライバIC(integrated circuit)、6は信号制御部4が出力するデータ信号をソースドライバIC5−1〜5−4に伝送するデータ信号線、7は信号制御部4が出力するクロック信号をソースドライバIC5−1〜5−4に伝送するクロック信号線である。
【0006】
8−1は信号制御部4が出力するデータスタート信号(データ信号の取り込みタイミングを与える信号)を1段目のソースドライバIC5−1に伝送するデータスタート信号線、8−2は1段目のソースドライバIC5−1が出力するデータスタート信号を2段目のソースドライバIC5−2に伝送するデータスタート信号線である。
【0007】
8−3は2段目のソースドライバIC5−2が出力するデータスタート信号を3段目のソースドライバIC5−3に伝送するデータスタート信号線、8−4は3段目のソースドライバIC5−3が出力するデータスタート信号を4段目のソースドライバIC5−4に伝送するデータスタート信号線である。
【0008】
図10はソースドライバIC5−1〜5−4の動作を示すタイミングチャートであり、信号制御部4からソースドライバIC5−1〜5−4に与えられるクロック信号、データスタート信号、データ信号を示している。
【0009】
ソースドライバIC5−1〜5−4は、データスタート信号が与えられると、データ信号線6を介して与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、ソースドライバIC5−1〜5−3は、入力したデータスタート信号を出力する。
【0010】
図11はソースドライバ部2の動作を示すタイミングチャートであり、(A)は信号制御部4から出力されるデータ信号、(B)は1段目のソースドライバIC5−1に入力するデータスタート信号、(C)は2段目のソースドライバIC5−2に入力するデータスタート信号、(D)は3段目のソースドライバIC5−3に入力するデータスタート信号、(E)は4段目のソースドライバIC5−4に入力するデータスタート信号を示している。
【0011】
1段目のソースドライバIC5−1は、信号制御部4からデータスタート信号が与えられると、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−2に出力して2段目のソースドライバIC5−2に与える。
【0012】
2段目のソースドライバIC5−2は、1段目のソースドライバIC5−1からデータスタート信号が与えられると、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−3に出力して3段目のソースドライバIC5−3に与える。
【0013】
3段目のソースドライバIC5−3は、2段目のソースドライバIC5−2からデータスタート信号が与えられると、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−4に出力して4段目のソースドライバIC5−4に与える。
【0014】
4段目のソースドライバIC5−4は、3段目のソースドライバIC5−3からデータスタート信号が与えられると、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号を取り込む。以上の動作が各水平ラインのデータ信号を取り込む際に行われる。
【0015】
【特許文献1】特開2000−194312号公報
【0016】
【発明が解決しようとする課題】
図8に示す従来の液晶表示装置においては、1段目〜3段目のソースドライバIC5−1〜5−3のいずれかに異常があり、異常があるソースドライバICの内部においてデータスタート信号の転送が正常に行われず、異常があるソースドライバICからデータスタート信号が出力されないと、異常があるソースドライバICの次段以降のソースドライバICにデータスタート信号が与えられないことになる。
【0017】
この結果、異常のあるソースドライバICに割り当てられているデータ線のみならず、異常のあるソースドライバICの次段以降のソースドライバICに割り当てられているデータ線も駆動されず、異常があるソースドライバICに割り当てられている表示部分のみならず、異常があるソースドライバICの次段以降のソースドライバICに割り当てられている表示部分も表示がなされない状態となる。
【0018】
例えば、1段目のソースドライバIC5−1に異常があり、1段目のソースドライバIC5−1の内部においてデータスタート信号の転送が正常に行われず、1段目のソースドライバIC5−1からデータスタート信号が出力されないと、2段目以降のソースドライバIC5−2〜5−4にデータスタート信号が与えられないことになる。
【0019】
この結果、1段目のソースドライバIC5−1に割り当てられているデータ線のみならず、2段目以降のソースドライバIC5−2〜5−4に割り当てられているデータ線も駆動されず、1段目のソースドライバIC5−1に割り当てられている表示部分のみならず、2段目以降のソースドライバIC5−2〜5−4に割り当てられている表示部分も表示がなされない状態となる。
【0020】
このような場合、修理時の対応として、異常のあるソースドライバICは明確であるが、異常のあるソースドライバICの次段以降のソースドライバICに異常があるか否かを判断することができず、異常のあるソースドライバICの特定を1回の画面表示で行うことができない。
【0021】
そこで、このような場合には、異常が明確である表示異常初段のソースドライバICを交換した後、再び画面表示を行い、その他のソースドライバICについて異常の有無を確認する必要があり、この結果、異常があるソースドライバICが確認されると、再びソースドライバICの交換作業を行う必要があり、修理時の手間が増加してしまうという問題点があった。このような問題点は、ゲートドライバICについても存在する。
【0022】
本発明は、かかる点に鑑み、マトリックス表示パネルを駆動する駆動回路の中の異常がある駆動回路の特定を1回の画面表示で行うことができるようにし、修理時の手間の短縮化を図ることができるようにしたマトリックス表示装置を提供することを目的とする。
【0023】
【課題を解決するための手段】
本発明は、マトリックス表示パネルと、初段の駆動回路に与えられる所定の制御信号を順に次段以降の駆動回路に転送するようにカスケード接続されて前記マトリックス表示パネルを駆動する複数の駆動回路を有するマトリックス表示装置であって、各駆動回路間に介在し、前段の駆動回路が前記制御信号を出力する場合には、前記制御信号を後段の駆動回路に転送し、前段の駆動回路が前記制御信号を出力しない場合には、前記制御信号を擬似した擬似制御信号を後段の駆動回路に転送する補助回路を有するというものである。
【0024】
本発明によれば、複数の駆動回路のいずれかに異常があり、この異常がある駆動回路から所定の制御信号が出力されない場合、異常がある駆動回路に割り当てられている表示部分のみが表示不良となり、異常がある駆動回路の次段以降の正常な駆動回路に割り当てられている表示部分は表示不良とはならない。したがって、複数の駆動回路の中の異常がある駆動回路の特定を1回の画面表示で行うことができる。
【0025】
【発明の実施の形態】
以下、図1〜図7を参照して、本発明の第1実施形態〜第3実施形態について、本発明を液晶表示装置に適用した場合を例にして説明する。なお、図1、図4、図6において、図8、図9に対応する部分には同一符号を付し、その重複説明は省略する。
【0026】
(第1実施形態・・図1〜図3)
図1は本発明の第1実施形態の要部の概略的構成図である。本発明の第1実施形態は、図8に示す従来の液晶表示装置が備えるソースドライバ部2と回路構成の異なるソースドライバ部9を備え、その他については、図8に示す従来の液晶表示装置と同様に構成したものである。
【0027】
ソースドライバ部9は、データスタート信号線8−2〜8−4のそれぞれに補助回路10−1〜10−3を介在させ、その他については、図8及び図9に示すソースドライバ部2と同様に構成したものである。
【0028】
補助回路10−1は、1段目のソースドライバIC5−1からデータスタート信号が出力されるか否かを監視し、1段目のソースドライバIC5−1からデータスタート信号が出力される場合には、1段目のソースドライバIC5−1から出力されるデータスタート信号を2段目のソースドライバIC5−2に転送し、1段目のソースドライバIC5−1からデータスタート信号が出力されない場合には、自ら生成する擬似データスタート信号を2段目のソースドライバIC5−2に転送するものである。
【0029】
補助回路10−2は、2段目のソースドライバIC5−2からデータスタート信号が出力されるか否かを監視し、2段目のソースドライバIC5−2からデータスタート信号が出力される場合には、2段目のソースドライバIC5−2から出力されるデータスタート信号を3段目のソースドライバIC5−3に転送し、2段目のソースドライバIC5−2からデータスタート信号が出力されない場合には、自ら生成する擬似データスタート信号を3段目のソースドライバIC5−3に転送するものである。
【0030】
なお、本明細書では、信号制御部4から出力されて1段目〜4段目のソースドライバIC5−1〜5−4を順に転送されるデータスタート信号のみならず、擬似データスタート信号も、ソースドライバICから出力される場合には、データスタート信号と呼ぶことにする。
【0031】
補助回路10−3は、3段目のソースドライバIC5−3からデータスタート信号が出力されるか否かを監視し、3段目のソースドライバIC5−3からデータスタート信号が出力される場合には、3段目のソースドライバIC5−3から出力されるデータスタート信号を4段目のソースドライバIC5−4に転送し、3段目のソースドライバIC5−3からデータスタート信号が出力されない場合には、自ら生成する擬似データスタート信号を4段目のソースドライバIC5−4に転送するものである。
【0032】
図2は補助回路10−1〜10−3の概略的構成図であり、補助回路10−1〜10−3は同一の回路構成とされている。図2中、11はデータスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されるか否かを判定するためのカウンタであり、リセット信号入力端子RESをデータスタート信号が出力されるか否かを監視しているソースドライバICのデータスタート信号出力端子に接続され、被カウント信号入力端子INにクロック信号が与えられる。
【0033】
カウンタ11は、その出力Xを1ビット、初期状態をLレベルとし、信号制御部4から供給されるクロック信号の立ち上がり数をカウントし、データスタート信号が非活性である期間(ソースドライバICが正常である場合に、ソースドライバICからデータスタート信号が出力されてから次のデータスタート信号が出力されるまでの期間)に入力されるクロック信号の数よりも多い、予め設定された値になると、出力XがHレベルに立ち上がるようにされている。
【0034】
12はJKフリップフロップであり、J入力端子にカウンタ11の出力Xが与えられ、K入力端子にデータスタート信号が与えられ、クロック入力端子にクロック信号が与えられる。この結果、クロック信号の立ち上がり時に、J入力端子がHレベル、K入力端子がLレベルの場合には、出力QはHレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がHレベルの場合には、出力QはLレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がLレベルの場合には、出力Qを変化させない。
【0035】
13は擬似データスタート信号を出力するカウンタであり、被カウント信号入力端子INにクロック信号が与えられ、イネーブル信号入力端子ENにJKフリップフロップ12の出力Qが与えられ、JKフリップフロップ12の出力QがLレベルの場合には非活性状態とされ、JKフリップフロップ12の出力QがHレベルの場合には活性状態とされ、クロック信号の立ち上がり数をカウントし、出力Xとしてデータスタート信号を擬似した擬似データスタート信号を出力する。
【0036】
14はセレクタであり、JKフリップフロップ12の出力Qを選択制御信号とし、JKフリップフロップ12の出力QがLレベルの場合には、入力されるデータスタート信号を選択して出力し、JKフリップフロップ12の出力QがHレベルの場合には、カウンタ13から出力される擬似データスタート信号を選択して出力するものである。
【0037】
このように構成された補助回路10−1〜10−3においては、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が一定周期で出力される場合には、カウンタ11は、一定周期でリセットされるので、その出力XはLレベルを維持することになる。
【0038】
そして、データスタート信号が入力されると、JKフリップフロップ12は、K入力端子をHレベルとし、この状態で、クロック信号が立ち上がると、出力QはLレベルとなり、その後、K入力端子はLレベルとなり、出力QはLレベルが維持される。したがって、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力される場合には、セレクタ14は、入力されたデータスタート信号を選択して出力することになる。
【0039】
これに対して、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されない場合には、カウンタ11はリセットされることはなく、カウント値は予め設定されたカウント値を超えることになるので、カウンタ11の出力XはHレベルとなる。
【0040】
この結果、JKフリップフロップ12では、J入力端子はHレベルになり、出力QはHレベルを維持することになる。したがって、カウンタ13は、イネーブル信号入力端子ENがHレベルとなるので、クロック信号の立ち上がり数をカウントし、擬似データスタート信号を出力し、セレクタ14は、カウンタ13が出力する擬似データスタート信号を選択して出力することになる。
【0041】
図3はソースドライバ部9の動作を示すタイミングチャートである。(A)は信号制御部4から出力されるデータ信号、(B)は1段目のソースドライバIC5−1に入力するデータスタート信号、(C)は2段目のソースドライバIC5−2に入力するデータスタート信号、(D)は3段目のソースドライバIC5−3に入力するデータスタート信号、(E)は4段目のソースドライバIC5−4に入力するデータスタート信号を示している。
【0042】
本発明の第1実施形態においては、1段目のソースドライバIC5−1は、信号制御部4からデータスタート信号が与えられると、何ら異常がない場合には、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−2に出力し、補助回路10−1は、1段目のソースドライバIC5−1からデータスタート信号線8−2に出力されるデータスタート信号を入力して2段目のソースドライバIC5−2に転送する。
【0043】
2段目のソースドライバIC5−2は、補助回路10−1からデータスタート信号が与えられると、何ら異常がない場合、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−3に出力し、補助回路10−2は、2段目のソースドライバIC5−2からデータスタート信号線8−3に出力されるデータスタート信号を入力して3段目のソースドライバIC5−3に転送する。
【0044】
3段目のソースドライバIC5−3は、補助回路10−2からデータスタート信号が与えられると、何ら異常がない場合、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号の取り込みが完了すると、入力したデータスタート信号をデータスタート信号線8−4に出力し、補助回路10−3は、3段目のソースドライバIC5−3からデータスタート信号線8−4に出力されるデータスタート信号を入力して4段目のソースドライバIC5−4に転送する。
【0045】
4段目のソースドライバIC5−4は、補助回路10−3からデータスタート信号が与えられると、何ら異常がない場合、信号制御部4から与えられるデータ信号の取り込みをクロック信号に同期させて開始し、規定数のデータ信号を取り込む。以上の動作が各水平ラインのデータ信号を取り込む際に行われる。
【0046】
ここで、ソースドライバIC5−1〜5−3のいずれか1個又は2個又は3個に異常があり、異常があるソースドライバICからデータスタート信号が出力されない場合には、異常があるソースドライバICからデータスタート信号が出力されるか否かを監視している補助回路は、擬似データスタート信号を出力することになる。
【0047】
この結果、データスタート信号を出力しないソースドライバICに割り当てられている表示部分のみが表示不良となり、4個のソースドライバIC5−1〜5−4の中の異常のあるソースドライバの特定を1回の画面表示で行うことができる。したがって、本発明の第1実施形態によれば、修理時の手間の短縮化を図ることができる。
【0048】
(第2実施形態・・図4、図5)
図4は本発明の第2実施形態の要部の概略的構成図である。本発明の第2実施形態は、図8に示す従来の液晶表示装置が備えるソースドライバ部2と回路構成の異なるソースドライバ部15を備え、その他については、図8に示す従来の液晶表示装置と同様に構成したものである。
【0049】
ソースドライバ部15は、データスタート信号線8−2〜8−4のそれぞれに補助回路16−1〜16−3を介在させ、その他については、図8及び図9に示すソースドライバ部2と同様に構成したものである。
【0050】
補助回路16−1は、1段目のソースドライバIC5−1からデータスタート信号が出力されるか否かを監視し、1段目のソースドライバIC5−1からデータスタート信号が出力される場合には、1段目のソースドライバIC5−1から出力されるデータスタート信号を2段目のソースドライバIC5−2に転送し、1段目のソースドライバIC5−1からデータスタート信号が出力されない場合には、信号制御部4から出力されるデータスタート信号を擬似データスタート信号として2段目のソースドライバIC5−2に転送するものである。
【0051】
補助回路16−2は、2段目のソースドライバIC5−2からデータスタート信号が出力されるか否かを監視し、2段目のソースドライバIC5−2からデータスタート信号が出力される場合には、2段目のソースドライバIC5−2から出力されるデータスタート信号を3段目のソースドライバIC5−3に転送し、2段目のソースドライバIC5−2からデータスタート信号が出力されない場合には、1段目のソースドライバIC5−1から出力されるデータスタート信号を擬似データスタート信号として3段目のソースドライバIC5−3に転送するものである。
【0052】
補助回路16−3は、3段目のソースドライバIC5−3からデータスタート信号が出力されるか否かを監視し、3段目のソースドライバIC5−3からデータスタート信号が出力される場合には、3段目のソースドライバIC5−3から出力されるデータスタート信号を4段目のソースドライバIC5−4に転送し、3段目のソースドライバIC5−3からデータスタート信号が出力されない場合には、2段目のソースドライバIC5−2から出力されるデータスタート信号を擬似データスタート信号として4段目のソースドライバIC5−4に転送するものである。
【0053】
図5は補助回路16−1〜16−3の概略的構成図であり、補助回路16−1〜16−3は同一の回路構成とされている。図5中、17はデータスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されるか否かを判定するためのカウンタであり、リセット信号入力端子RESをデータスタート信号が出力されるか否かを監視しているソースドライバICのデータスタート信号出力端子に接続され、被カウント信号入力端子INにクロック信号が与えられる。
【0054】
カウンタ17は、その出力Xを1ビット、初期状態をLレベルとし、信号制御部4から供給されるクロック信号の立ち上がり数をカウントし、データスタート信号が非活性である期間(ソースドライバICが正常である場合に、ソースドライバICからデータスタート信号が出力されてから次のデータスタート信号が出力されるまでの期間)に入力されるクロック信号の数よりも多い、予め設定された値になると、出力XがHレベルに立ち上がるようにされている。
【0055】
18はJKフリップフロップであり、J入力端子にカウンタ17の出力Xが与えられ、K入力端子にデータスタート信号が与えられ、クロック入力端子にクロック信号が与えられる。この結果、クロック信号の立ち上がり時に、J入力端子がHレベル、K入力端子がLレベルの場合には、出力QはHレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がHレベルの場合には、出力QはLレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がLレベルの場合には、出力Qを変化させない。
【0056】
19はセレクタであり、JKフリップフロップ18の出力Qを選択制御信号とし、JKフリップフロップ18の出力QがLレベルの場合には、入力されるデータスタート信号を選択して出力し、JKフリップフロップ18の出力QがHレベルの場合には、入力される擬似データスタート信号を選択して出力するものである。
【0057】
このように構成された補助回路16−1〜16−3においては、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が一定周期で出力される場合には、カウンタ17は、一定周期でリセットされ、その出力Xは、Lレベルを維持することになる。
【0058】
そして、データスタート信号が入力されると、JKフリップフロップ18は、K入力端子をHレベルとし、この状態で、クロック信号が立ち上がると、出力QはLレベルとなり、その後、K入力端子はLレベルとなり、出力QはLレベルが維持され、セレクタ19は、入力されたデータスタート信号を選択して出力することになる。
【0059】
これに対して、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されない場合には、カウンタ17はリセットされることはなく、カウント値は予め設定されたカウント値を超えることになるので、カウンタ17の出力XはHレベルとなる。この結果、JKフリップフロップ18では、J入力端子はHレベルになり、出力QはHレベルが維持され、セレクタ19は、入力される擬似データスタート信号を選択して出力することになる。
【0060】
したがって、本発明の第2実施形態によれば、ソースドライバIC5−1〜5−3のいずれか1個又は2個又は3個に異常があり、異常があるソースドライバICからデータスタート信号が出力されない場合、異常があるソースドライバICからデータスタート信号が出力されるか否かを監視している補助回路は、擬似データスタート信号を出力することになる。
【0061】
この結果、データスタート信号を出力しないソースドライバICに割り当てられている表示部分のみが表示不良となり、4個のソースドライバIC5−1〜5−4の中の異常のあるソースドライバの特定を1回の画面表示で行うことができる。したがって、修理時の手間の短縮化を図ることができる。
【0062】
(第3実施形態・・図6、図7)
図6は本発明の第3実施形態の要部の概略的構成図であり、本発明の第3実施形態は、図8に示す従来の液晶表示装置が備えるソースドライバ部2と回路構成の異なるソースドライバ部20を備え、その他については、図8に示す従来の液晶表示装置と同様に構成したものである。
【0063】
ソースドライバ部20は、データスタート信号線8−2〜8−4のそれぞれに補助回路21−1〜21−3を介在させると共に、信号制御部4から出力されるデータスタート信号を3経路に分岐するデータスタート信号分岐回路22を設け、データスタート信号分岐回路22から出力される3個のデータスタート信号をそれぞれデータスタート信号線23−1〜23−3を介して補助回路21−1〜21−3に転送するようにし、その他については、図8及び図9に示すソースドライバ部2と同様に構成したものである。
【0064】
補助回路21−1は、1段目のソースドライバIC5−1からデータスタート信号が出力されるか否かを監視し、1段目のソースドライバIC5−1からデータスタート信号が出力される場合には、1段目のソースドライバIC5−1から出力されるデータスタート信号を2段目のソースドライバIC5−2に転送し、1段目のソースドライバIC5−1からデータスタート信号が出力されない場合には、データスタート信号分岐回路22からデータスタート信号線23−1に出力されるデータスタート信号を擬似データスタート信号として2段目のソースドライバIC5−2に転送するものである。
【0065】
補助回路21−2は、2段目のソースドライバIC5−2からデータスタート信号が出力されるか否かを監視し、2段目のソースドライバIC5−2からデータスタート信号が出力される場合には、2段目のソースドライバIC5−2から出力されるデータスタート信号を3段目のソースドライバIC5−3に転送し、2段目のソースドライバIC5−2からデータスタート信号が出力されない場合には、データスタート信号分岐回路22からデータスタート信号線23−2に出力されるデータスタート信号を擬似データスタート信号として3段目のソースドライバIC5−3に転送するものである。
【0066】
補助回路21−3は、3段目のソースドライバIC5−3からデータスタート信号が出力されるか否かを監視し、3段目のソースドライバIC5−3からデータスタート信号が出力される場合には、3段目のソースドライバIC5−3から出力されるデータスタート信号を4段目のソースドライバIC5−4に転送し、3段目のソースドライバIC5−3からデータスタート信号が出力されない場合には、データスタート信号分岐回路22からデータスタート信号線23−3に出力されるデータスタート信号を擬似データスタート信号として4段目のソースドライバIC5−4に転送するものである。
【0067】
図7は補助回路21−1〜21−3の概略的構成図であり、補助回路21−1〜21−3は同一の回路構成とされている。図7中、24はデータスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されるか否かを判定するためのカウンタであり、リセット信号入力端子RESをデータスタート信号が出力されるか否かを監視しているソースドライバICのデータスタート信号出力端子に接続され、被カウント信号入力端子INにクロック信号が与えられる。
【0068】
カウンタ24は、その出力Xを1ビット、初期状態をLレベルとし、信号制御部4から供給されるクロック信号の立ち上がり数をカウントし、データスタート信号が非活性である期間(ソースドライバICが正常である場合に、ソースドライバICからデータスタート信号が出力されてから次のデータスタート信号が出力されるまでの期間)に入力されるクロック信号の数よりも多い、予め設定された値になると、出力XがHレベルに立ち上がるようにされている。
【0069】
25はJKフリップフロップであり、J入力端子にカウンタ24の出力Xが与えられ、K入力端子にデータスタート信号が与えられ、クロック入力端子にクロック信号が与えられる。この結果、クロック信号の立ち上がり時に、J入力端子がHレベル、K入力端子がLレベルの場合には、出力QはHレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がHレベルの場合には、出力QはLレベルとなる。また、クロック信号の立ち上がり時に、J入力端子がLレベル、K入力端子がLレベルの場合には、出力Qを変化させない。
【0070】
26はセレクタであり、JKフリップフロップ25の出力Qを選択制御信号とし、JKフリップフロップ25の出力QがLレベルの場合には、入力されるデータスタート信号を選択して出力し、JKフリップフロップ25の出力QがHレベルの場合には、入力される擬似データスタート信号を選択して出力するものである。
【0071】
このように構成された補助回路21−1〜21−3においては、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が一定周期で出力される場合には、カウンタ24は、一定周期でリセットされ、その出力Xは、Lレベルを維持することになる。
【0072】
そして、データスタート信号が入力されると、JKフリップフロップ25は、K入力端子をHレベルとし、この状態で、クロック信号が立ち上がると、出力QはLレベルとなり、その後、K入力端子はLレベルとなり、出力QはLレベルが維持され、セレクタ26は、入力されたデータスタート信号を選択して出力することになる。
【0073】
これに対して、データスタート信号が出力されるか否かを監視しているソースドライバICからデータスタート信号が出力されない場合には、カウンタ24はリセットされることはなく、カウント値は予め設定されたカウント値を超えることになるので、カウンタ24の出力XはHレベルとなる。この結果、JKフリップフロップ25では、J入力端子はHレベルになり、出力QはHレベルが維持され、セレクタ26は、入力される擬似データスタート信号を選択して出力することになる。
【0074】
したがって、本発明の第3実施形態によれば、ソースドライバIC5−1〜5−3のいずれか1個又は2個又は3個に異常があり、異常があるソースドライバICからデータスタート信号が出力されない場合、異常があるソースドライバICからデータスタート信号が出力されるか否かを監視している補助回路は、擬似データスタート信号を出力することになる。
【0075】
この結果、データスタート信号を出力しないソースドライバICに割り当てられている表示部分のみが表示不良となり、4個のソースドライバIC5−1〜5−4の中の異常のあるソースドライバの特定を1回の画面表示で行うことができる。したがって、修理時の手間の短縮化を図ることができる。
【0076】
なお、本発明の第1実施形態〜第3実施形態においては、補助回路を別置きにした場合について説明したが、補助回路は、ソースドライバIC5−1〜5−4に搭載しても良いし、信号制御部4に含めるようにしても良い。更に、別置きの補助回路のほか、ソースドライバIC5−1〜5−4に搭載した補助回路や、信号制御部4に含める補助回路を設け、通常使用する補助回路に破壊が発生した場合に、別の補助回路を使用できるように構成しても良い。
【0077】
また、本発明の第1実施形態〜第3実施形態においては、ソースドライバIC5−1〜5−4を順に転送される所定の制御信号としてデータスタート信号を取り上げ、データスタート信号に対応して補助回路を設けるようにした場合について説明したが、ソースドライバICを順に転送される他の信号について補助回路を設けるようにしても良い。
【0078】
また、本発明の第1実施形態〜第3実施形態においては、ソースドライバIC5−1〜5−4に対応して補助回路を設けるようにした場合について説明したが、この代わりに、走査信号を出力してゲート線(走査信号線)を駆動するゲートドライバICに対応して補助回路を設けるようにしても良いし、ソースドライバIC5−1〜5−4及びゲートドライバICのそれぞれに対応して補助回路を設けるようにしても良い。
【0079】
なお、ゲートドライバICに対応して補助回路を設ける場合には、補助回路は、ゲートドライバICに走査信号の出力タイミングを与える走査スタート信号がゲートドライバICから出力されるか否かを監視し、走査スタート信号が出力されない場合には、走査スタート信号を擬似した擬似走査スタート信号を出力するように構成する。
【0080】
また、本発明の第1実施形態〜第3実施形態においては、本発明を液晶表示装置に適用した場合について説明したが、本発明は、プラズマ・ディスプレイ装置等のマトリックス表示装置にも適用することができる。
【0081】
【発明の効果】
以上のように、本発明によれば、複数の駆動回路のいずれかに異常があり、この異常がある駆動回路から所定の制御信号が出力されない場合、異常のある駆動回路に割り当てられている表示部分のみが表示不良となり、異常のある駆動回路の次段以降の正常な駆動回路に割り当てられている表示部分は表示不良とはならないので、複数の駆動回路の中の異常のある駆動回路の特定を1回の画面表示で行うことができる。したがって、修理時の手間短縮化を図ることができる。
【図面の簡単な説明】
【図1】本発明の第1実施形態の要部の概略的構成図である。
【図2】本発明の第1実施形態が備えるソースドライバ部内の補助回路の概略的構成図である。
【図3】本発明の第1実施形態が備えるソースドライバ部の動作を示すタイミングチャートである。
【図4】本発明の第2実施形態の要部の概略的構成図である。
【図5】本発明の第2実施形態が備えるソースドライバ部内の補助回路の概略的構成図である。
【図6】本発明の第3実施形態の要部の概略的構成図である。
【図7】本発明の第3実施形態が備えるソースドライバ部内の補助回路の概略的構成図である。
【図8】従来の液晶表示装置の一例の要部の概略的構成図である。
【図9】図8に示す従来の液晶表示装置が備えるソースドライバ部の概略的構成図である。
【図10】図8に示す従来の液晶表示装置が備えるソースドライバ部内のソースドライバICの動作を示すタイミングチャートである。
【図11】図8に示す従来の液晶表示装置が備えるソースドライバ部の動作を示すタイミングチャートである。
【符号の説明】
5−i・・・ソースドライバIC
10−i・・・補助回路
16−i・・・補助回路
21−i・・・補助回路[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention relates to a matrix display device in which pixels are arranged in a matrix, such as a liquid crystal display device.
[0002]
In recent years, desktop personal computers have been expanding their markets with liquid crystal display devices instead of CRTs (Cathode Ray Tubes) due to demands for energy saving and space saving. Competing manufacturers have reduced the cost by improving the yield. It has been demanded.
[0003]
[Prior art]
FIG. 8 is a schematic configuration diagram of a main part of an example of a conventional liquid crystal display device (for example, see Patent Document 1). In FIG. 8,
[0004]
Reference numeral 3 denotes a gate driver unit (gate line driving circuit unit) that outputs a scanning signal to a gate line (scanning signal line) formed on the liquid
[0005]
FIG. 9 is a schematic configuration diagram of the source driver unit 2. 9, reference numerals 5-1 to 5-4 denote source driver ICs (integrated circuits) for A / D-converting and outputting data signals to data lines formed on the liquid
[0006]
8-1 is a data start signal line for transmitting a data start signal (a signal for giving a data signal fetch timing) output from the
[0007]
8-3 is a data start signal line for transmitting a data start signal output from the second stage source driver IC5-2 to the third stage source driver IC5-3, and 8-4 is a third stage source driver IC5-3. Is a data start signal line for transmitting a data start signal output from the data driver to the fourth stage source driver IC 5-4.
[0008]
FIG. 10 is a timing chart showing the operation of the source driver ICs 5-1 to 5-4, showing a clock signal, a data start signal, and a data signal supplied from the
[0009]
When the data start signal is supplied, the source driver ICs 5-1 to 5-4 start capturing the data signal supplied via the
[0010]
11A and 11B are timing charts showing the operation of the source driver unit 2. FIG. 11A shows a data signal output from the
[0011]
Upon receiving the data start signal from the
[0012]
When a data start signal is supplied from the first-stage source driver IC 5-1, the second-stage source driver IC 5-2 starts capturing a data signal supplied from the
[0013]
When a data start signal is supplied from the second-stage source driver IC 5-2, the third-stage source driver IC 5-3 starts capturing the data signal supplied from the
[0014]
When the data start signal is supplied from the third-stage source driver IC 5-3, the fourth-stage source driver IC 5-4 starts capturing the data signal supplied from the
[0015]
[Patent Document 1] JP-A-2000-194312
[0016]
[Problems to be solved by the invention]
In the conventional liquid crystal display device shown in FIG. 8, one of the first to third stage source driver ICs 5-1 to 5-3 has an abnormality, and the data start signal of the data start signal is generated inside the abnormal source driver IC. If the transfer is not performed normally and the data start signal is not output from the abnormal source driver IC, the data start signal is not supplied to the source driver ICs subsequent to the abnormal source driver IC.
[0017]
As a result, not only the data lines assigned to the abnormal source driver ICs, but also the data lines assigned to the source driver ICs subsequent to the abnormal source driver IC are not driven, and the abnormal source driver ICs are not driven. In addition to the display portion assigned to the driver IC, the display portion assigned to the source driver IC subsequent to the abnormal source driver IC is not displayed.
[0018]
For example, the first-stage source driver IC 5-1 has an error, and the data start signal is not normally transferred inside the first-stage source driver IC 5-1. If the start signal is not output, the data start signal will not be given to the second and subsequent source driver ICs 5-2 to 5-4.
[0019]
As a result, not only the data lines assigned to the first-stage source driver IC 5-1 but also the data lines assigned to the second-stage and later source driver ICs 5-2 to 5-4 are not driven. Not only the display portion assigned to the source driver IC 5-1 in the second stage, but also the display portions assigned to the source driver ICs 5-2 to 5-4 in the second and subsequent stages are not displayed.
[0020]
In such a case, as a response at the time of repair, the abnormal source driver IC is clear, but it can be determined whether or not there is an abnormality in the source driver ICs subsequent to the abnormal source driver IC. Therefore, it is not possible to specify an abnormal source driver IC by one screen display.
[0021]
Therefore, in such a case, it is necessary to replace the source driver IC at the first stage of the display abnormality where the abnormality is clear, display the screen again, and confirm whether or not the other source driver ICs are abnormal. When an abnormal source driver IC is confirmed, it is necessary to replace the source driver IC again, and there is a problem that labor for repair increases. Such a problem also exists in the gate driver IC.
[0022]
In view of the above, the present invention enables a drive circuit having an abnormality in a drive circuit for driving a matrix display panel to be specified in a single screen display, thereby reducing the time and labor required for repair. It is an object of the present invention to provide a matrix display device capable of performing such operations.
[0023]
[Means for Solving the Problems]
The present invention includes a matrix display panel and a plurality of drive circuits cascaded so as to sequentially transfer a predetermined control signal given to a first-stage drive circuit to a next-stage drive circuit and to drive the matrix display panel. A matrix display device, wherein the control signal is interposed between respective drive circuits, and when the preceding drive circuit outputs the control signal, the control signal is transferred to a subsequent drive circuit, and the preceding drive circuit outputs the control signal. Is not output, there is provided an auxiliary circuit for transferring a pseudo control signal simulating the control signal to a subsequent drive circuit.
[0024]
According to the present invention, when any of the plurality of drive circuits has an abnormality, and a predetermined control signal is not output from the abnormal drive circuit, only a display portion assigned to the abnormal drive circuit has a display defect. Thus, the display portion assigned to the normal drive circuit subsequent to the abnormal drive circuit does not become a display failure. Therefore, it is possible to specify a drive circuit having an abnormality among a plurality of drive circuits by one screen display.
[0025]
BEST MODE FOR CARRYING OUT THE INVENTION
Hereinafter, a first embodiment to a third embodiment of the present invention will be described with reference to FIGS. 1 to 7 by taking an example in which the present invention is applied to a liquid crystal display device. In FIGS. 1, 4, and 6, parts corresponding to those in FIGS. 8 and 9 are denoted by the same reference numerals, and redundant description will be omitted.
[0026]
(1st Embodiment ... FIGS. 1-3)
FIG. 1 is a schematic configuration diagram of a main part of the first embodiment of the present invention. The first embodiment of the present invention includes a
[0027]
The
[0028]
The auxiliary circuit 10-1 monitors whether or not a data start signal is output from the first-stage source driver IC 5-1. Transfers the data start signal output from the first-stage source driver IC 5-1 to the second-stage source driver IC 5-2, and outputs the data start signal from the first-stage source driver IC 5-1 when the data start signal is not output from the first-stage source driver IC 5-1. Is for transferring the pseudo data start signal generated by itself to the second-stage source driver IC5-2.
[0029]
The auxiliary circuit 10-2 monitors whether or not a data start signal is output from the second-stage source driver IC5-2, and when the data start signal is output from the second-stage source driver IC5-2. Transfers the data start signal output from the second-stage source driver IC 5-2 to the third-stage source driver IC 5-3, and outputs the data start signal from the second-stage source driver IC 5-2 when the data start signal is not output. Is for transferring the pseudo data start signal generated by itself to the third-stage source driver IC5-3.
[0030]
In this specification, not only the data start signal output from the
[0031]
The auxiliary circuit 10-3 monitors whether or not a data start signal is output from the third-stage source driver IC 5-3, and when the data start signal is output from the third-stage source driver IC 5-3. Transfers the data start signal output from the third-stage source driver IC 5-3 to the fourth-stage source driver IC 5-4. When the data start signal is not output from the third-stage source driver IC 5-3, Is for transferring the pseudo data start signal generated by itself to the fourth stage source driver IC 5-4.
[0032]
FIG. 2 is a schematic configuration diagram of the auxiliary circuits 10-1 to 10-3, and the auxiliary circuits 10-1 to 10-3 have the same circuit configuration. In FIG. 2,
[0033]
The
[0034]
[0035]
Reference numeral 13 denotes a counter which outputs a pseudo data start signal. The counter 13 receives a clock signal at a counted signal input terminal IN, an output Q of the JK flip-
[0036]
[0037]
In the auxiliary circuits 10-1 to 10-3 configured as described above, when the data start signal is output at a constant cycle from the source driver IC monitoring whether or not the data start signal is output, ,
[0038]
When the data start signal is input, the JK flip-
[0039]
On the other hand, when the data start signal is not output from the source driver IC monitoring whether or not the data start signal is output, the
[0040]
As a result, in the JK flip-
[0041]
FIG. 3 is a timing chart showing the operation of the
[0042]
In the first embodiment of the present invention, the first-stage source driver IC 5-1 receives the data start signal from the
[0043]
When the data start signal is supplied from the auxiliary circuit 10-1, if there is no abnormality, the second-stage source driver IC5-2 starts capturing the data signal supplied from the
[0044]
When the data start signal is supplied from the auxiliary circuit 10-2, the source driver IC 5-3 in the third stage starts capturing the data signal supplied from the
[0045]
When the data start signal is supplied from the auxiliary circuit 10-3, the source driver IC 5-4 in the fourth stage starts taking in the data signal supplied from the
[0046]
Here, if any one, two, or three of the source driver ICs 5-1 to 5-3 have an abnormality and the data start signal is not output from the abnormal source driver IC, the abnormal source driver An auxiliary circuit monitoring whether or not a data start signal is output from the IC outputs a pseudo data start signal.
[0047]
As a result, only the display portion assigned to the source driver IC that does not output the data start signal has a display failure, and the abnormal source driver among the four source driver ICs 5-1 to 5-4 is identified once. Screen display. Therefore, according to the first embodiment of the present invention, it is possible to reduce labor for repair.
[0048]
(Second embodiment: FIGS. 4 and 5)
FIG. 4 is a schematic configuration diagram of a main part of the second embodiment of the present invention. The second embodiment of the present invention includes a source driver section 15 having a different circuit configuration from the source driver section 2 provided in the conventional liquid crystal display device shown in FIG. 8, and the other components are the same as those of the conventional liquid crystal display device shown in FIG. It has the same configuration.
[0049]
The source driver unit 15 has the auxiliary circuits 16-1 to 16-3 interposed in the data start signal lines 8-2 to 8-4, respectively, and the rest is the same as the source driver unit 2 shown in FIGS. It is what was constituted.
[0050]
The auxiliary circuit 16-1 monitors whether or not a data start signal is output from the first-stage source driver IC 5-1. Transfers the data start signal output from the first-stage source driver IC 5-1 to the second-stage source driver IC 5-2, and outputs the data start signal from the first-stage source driver IC 5-1 when the data start signal is not output from the first-stage source driver IC 5-1. Is for transferring the data start signal output from the
[0051]
The auxiliary circuit 16-2 monitors whether or not a data start signal is output from the second-stage source driver IC5-2, and when the data start signal is output from the second-stage source driver IC5-2. Transfers the data start signal output from the second-stage source driver IC 5-2 to the third-stage source driver IC 5-3, and outputs the data start signal from the second-stage source driver IC 5-2 when the data start signal is not output. Transfers the data start signal output from the first-stage source driver IC 5-1 to the third-stage source driver IC 5-3 as a pseudo data start signal.
[0052]
The auxiliary circuit 16-3 monitors whether or not a data start signal is output from the third-stage source driver IC 5-3, and when the data start signal is output from the third-stage source driver IC 5-3. Transfers the data start signal output from the third-stage source driver IC 5-3 to the fourth-stage source driver IC 5-4. When the data start signal is not output from the third-stage source driver IC 5-3, Transfers the data start signal output from the second-stage source driver IC 5-2 to the fourth-stage source driver IC 5-4 as a pseudo data start signal.
[0053]
FIG. 5 is a schematic configuration diagram of the auxiliary circuits 16-1 to 16-3, and the auxiliary circuits 16-1 to 16-3 have the same circuit configuration. In FIG. 5, reference numeral 17 denotes a counter for determining whether or not the data start signal is output from the source driver IC monitoring whether or not the data start signal is output. It is connected to a data start signal output terminal of a source driver IC that monitors whether or not a data start signal is output, and a clock signal is supplied to a counted signal input terminal IN.
[0054]
The counter 17 sets the output X to 1 bit, sets the initial state to L level, counts the number of rising edges of the clock signal supplied from the
[0055]
[0056]
[0057]
In the auxiliary circuits 16-1 to 16-3 configured as described above, when the data start signal is output at a constant cycle from the source driver IC monitoring whether or not the data start signal is output, , Counter 17 is reset at regular intervals, and its output X is maintained at the L level.
[0058]
When the data start signal is input, the JK flip-
[0059]
On the other hand, when the data start signal is not output from the source driver IC monitoring whether the data start signal is output, the counter 17 is not reset and the count value is set in advance. Therefore, the output X of the counter 17 becomes H level. As a result, in the JK flip-
[0060]
Therefore, according to the second embodiment of the present invention, any one, two, or three of the source driver ICs 5-1 to 5-3 have an abnormality, and the data start signal is output from the abnormal source driver IC. If not, the auxiliary circuit monitoring whether or not the data start signal is output from the abnormal source driver IC will output the pseudo data start signal.
[0061]
As a result, only the display portion assigned to the source driver IC that does not output the data start signal has a display failure, and the abnormal source driver among the four source driver ICs 5-1 to 5-4 is identified once. Screen display. Therefore, the time required for repair can be reduced.
[0062]
(Third embodiment: FIGS. 6, 7)
FIG. 6 is a schematic configuration diagram of a main part of a third embodiment of the present invention. The third embodiment of the present invention has a circuit configuration different from that of the source driver unit 2 provided in the conventional liquid crystal display device shown in FIG. A source driver unit 20 is provided, and the other components are configured similarly to the conventional liquid crystal display device shown in FIG.
[0063]
The source driver unit 20 has the auxiliary circuits 21-1 to 21-3 interposed in the data start signal lines 8-2 to 8-4, respectively, and branches the data start signal output from the
[0064]
The auxiliary circuit 21-1 monitors whether or not a data start signal is output from the first-stage source driver IC 5-1. Transfers the data start signal output from the first-stage source driver IC 5-1 to the second-stage source driver IC 5-2, and outputs the data start signal from the first-stage source driver IC 5-1 when the data start signal is not output from the first-stage source driver IC 5-1. Is for transferring the data start signal output from the data start signal branch circuit 22 to the data start signal line 23-1 as a pseudo data start signal to the second stage source driver IC5-2.
[0065]
The auxiliary circuit 21-2 monitors whether or not the data start signal is output from the second-stage source driver IC5-2, and when the data start signal is output from the second-stage source driver IC5-2. Transfers the data start signal output from the second-stage source driver IC 5-2 to the third-stage source driver IC 5-3, and outputs the data start signal from the second-stage source driver IC 5-2 when the data start signal is not output. Is for transferring the data start signal output from the data start signal branch circuit 22 to the data start signal line 23-2 as a pseudo data start signal to the source driver IC 5-3 at the third stage.
[0066]
The auxiliary circuit 21-3 monitors whether or not the data start signal is output from the third-stage source driver IC 5-3, and when the data start signal is output from the third-stage source driver IC 5-3. Transfers the data start signal output from the third-stage source driver IC 5-3 to the fourth-stage source driver IC 5-4. When the data start signal is not output from the third-stage source driver IC 5-3, Is for transferring the data start signal output from the data start signal branch circuit 22 to the data start signal line 23-3 as a pseudo data start signal to the fourth stage source driver IC 5-4.
[0067]
FIG. 7 is a schematic configuration diagram of the auxiliary circuits 21-1 to 21-3. The auxiliary circuits 21-1 to 21-3 have the same circuit configuration. In FIG. 7,
[0068]
The
[0069]
[0070]
[0071]
In the auxiliary circuits 21-1 to 21-3 configured as described above, when the data start signal is output at a constant cycle from the source driver IC monitoring whether or not the data start signal is output, ,
[0072]
When the data start signal is input, the JK flip-
[0073]
On the other hand, when the data start signal is not output from the source driver IC monitoring whether or not the data start signal is output, the
[0074]
Therefore, according to the third embodiment of the present invention, any one, two or three of the source driver ICs 5-1 to 5-3 have an abnormality, and the data start signal is output from the abnormal source driver IC. If not, the auxiliary circuit monitoring whether or not a data start signal is output from the abnormal source driver IC will output a pseudo data start signal.
[0075]
As a result, only the display portion assigned to the source driver IC that does not output the data start signal has a display failure, and the abnormal source driver among the four source driver ICs 5-1 to 5-4 is identified once. Screen display. Therefore, the time required for repair can be reduced.
[0076]
In the first to third embodiments of the present invention, the case where the auxiliary circuit is provided separately has been described. However, the auxiliary circuit may be mounted on the source driver ICs 5-1 to 5-4. , May be included in the
[0077]
Further, in the first to third embodiments of the present invention, a data start signal is taken as a predetermined control signal to be sequentially transferred to the source driver ICs 5-1 to 5-4, and an auxiliary signal corresponding to the data start signal is provided. Although the case where a circuit is provided has been described, an auxiliary circuit may be provided for other signals sequentially transferred to the source driver IC.
[0078]
Further, in the first to third embodiments of the present invention, a case has been described in which an auxiliary circuit is provided corresponding to the source driver ICs 5-1 to 5-4. An auxiliary circuit may be provided corresponding to a gate driver IC that outputs and drives a gate line (scanning signal line), or may correspond to each of the source driver ICs 5-1 to 5-4 and the gate driver IC. An auxiliary circuit may be provided.
[0079]
In the case where an auxiliary circuit is provided corresponding to the gate driver IC, the auxiliary circuit monitors whether or not a scan start signal for giving a scan signal output timing to the gate driver IC is output from the gate driver IC. When the scan start signal is not output, a pseudo scan start signal that simulates the scan start signal is output.
[0080]
In the first to third embodiments of the present invention, the case where the present invention is applied to a liquid crystal display device has been described. However, the present invention is also applicable to a matrix display device such as a plasma display device. Can be.
[0081]
【The invention's effect】
As described above, according to the present invention, if any of the plurality of drive circuits has an abnormality and a predetermined control signal is not output from the abnormal drive circuit, the display assigned to the abnormal drive circuit Only the display part is defective and the display part assigned to the normal drive circuit following the abnormal drive circuit is not a display defect, so the abnormal drive circuit among multiple drive circuits can be identified. Can be performed in one screen display. Therefore, it is possible to reduce the labor required for repair.
[Brief description of the drawings]
FIG. 1 is a schematic configuration diagram of a main part of a first embodiment of the present invention.
FIG. 2 is a schematic configuration diagram of an auxiliary circuit in a source driver unit included in the first embodiment of the present invention.
FIG. 3 is a timing chart illustrating an operation of a source driver unit included in the first embodiment of the present invention.
FIG. 4 is a schematic configuration diagram of a main part of a second embodiment of the present invention.
FIG. 5 is a schematic configuration diagram of an auxiliary circuit in a source driver unit included in a second embodiment of the present invention.
FIG. 6 is a schematic configuration diagram of a main part of a third embodiment of the present invention.
FIG. 7 is a schematic configuration diagram of an auxiliary circuit in a source driver unit included in a third embodiment of the present invention.
FIG. 8 is a schematic configuration diagram of a main part of an example of a conventional liquid crystal display device.
9 is a schematic configuration diagram of a source driver unit included in the conventional liquid crystal display device shown in FIG.
FIG. 10 is a timing chart showing an operation of a source driver IC in a source driver unit included in the conventional liquid crystal display device shown in FIG.
FIG. 11 is a timing chart showing an operation of a source driver unit included in the conventional liquid crystal display device shown in FIG.
[Explanation of symbols]
5-i: Source driver IC
10-i ... Auxiliary circuit
16-i: Auxiliary circuit
21-i ... Auxiliary circuit
Claims (5)
各駆動回路間に介在し、前段の駆動回路が前記制御信号を出力する場合には、前記制御信号を後段の駆動回路に転送し、前段の駆動回路が前記制御信号を出力しない場合には、前記制御信号を擬似した擬似制御信号を後段の駆動回路に転送する補助回路を有することを特徴とするマトリックス表示装置。A matrix display panel, and a matrix display device having a plurality of drive circuits that drive the matrix display panel in a cascade connection so as to sequentially transfer a predetermined control signal given to a first-stage drive circuit to a next-stage drive circuit and the like. So,
Interposed between each drive circuit, if the previous drive circuit outputs the control signal, transfer the control signal to the subsequent drive circuit, if the previous drive circuit does not output the control signal, A matrix display device comprising an auxiliary circuit for transferring a pseudo control signal simulating the control signal to a subsequent drive circuit.
前記制御信号は、前記ソースドライバICにデータ信号の取り込みタイミングを与えるデータスタート信号であることを特徴とする請求項1記載のマトリックス表示装置。The drive circuit includes a source driver IC that drives data lines of the matrix display panel,
2. The matrix display device according to claim 1, wherein the control signal is a data start signal that gives the source driver IC a timing to capture a data signal.
前記制御信号は、前記ゲートドライバICに走査信号の出力タイミングを与える走査スタート信号であることを特徴とする請求項1記載のマトリックス表示装置。The driving circuit includes a gate driver IC that drives a gate line of the matrix display panel,
2. The matrix display device according to claim 1, wherein the control signal is a scan start signal for giving an output timing of a scan signal to the gate driver IC.
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