JP2004096965A - Switching power supply - Google Patents
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Abstract
Description
【0001】
【発明の属する技術分野】
本発明は、MOS型FETからなる整流スイッチ素子と転流スイッチ素子とを備えた同期整流回路を、トランスの二次側に接続したスイッチング電源装置に関する。
【0002】
【従来の技術】
一般に、主スイッチング素子に同期して、MOS型FETからなる整流スイッチ素子と転流スイッチ素子を交互にオン,オフさせる同期整流方式のスイッチング電源装置が、例えば特許文献1や特許文献2などに開示されている。
【0003】
図4は、同期整流方式のフォワード型スイッチング電源装置の回路図である。同図において、1は所定の直流入力電圧Viを供給する入力電圧源、T1は一次側(入力側)と二次側(出力側)とを絶縁するトランスで、このトランスT1の一次巻線Tと主スイッチング素子Qmとによる直列回路が直流電源Viの両端間に接続される。主スイッチング素子Qmは例えばMOS型FETからなり、内蔵するボディダイオードDmおよび寄生キャパシタンスCmが、そのドレイン・ソース間に並列接続される。そして、発振器(OSC)20を備えた制御回路21の駆動パルス発生回路22から送り出されるパルス駆動信号によって、主スイッチング素子Qmをスイッチング動作させることにより、トランスT1の一次巻線に直流入力電圧Viが断続的に印加され、一次巻線の巻数n1と二次巻線の巻数n2に比例した電圧が、トランスT1の二次巻線に誘起されるようになっている。
【0004】
一方、2はトランスT1の二次巻線に接続される同期整流回路で、これはいずれもMOS型FETからなる整流スイッチ素子Qfoと転流スイッチ素子Qfrとにより構成される。より具体的には、主スイッチング素子Qmのオン時に正極性の電圧が発生するトランスT1の二次巻線のドット側端子に、整流スイッチ素子Qfoのゲートが接続され、この整流スイッチ素子Qfoのドレイン・ソースが、トランスT1の二次巻線の非ドット側端子から出力端子4に至るマイナス側出力電圧ライン6に挿入接続される。また、転流スイッチ素子Qfrのゲートは、後述する放電ドライバ回路7を介して、主スイッチング素子Qmのオフ時に正極性の電圧が発生するトランスT1の二次巻線の非ドット側端子に接続されると共に、転流スイッチ素子Qfrのドレイン・ソースが、トランスT1の二次巻線のドット側端子から出力端子3に至るプラス側出力電圧ライン5と、前記マイナス側出力電圧ライン6間に挿入接続される。
【0005】
なお、整流スイッチ素子Qfoのドレイン・ソース間には、内蔵するボディダイオードDfoおよび寄生キャパシタンスCfoが並列接続され、さらに転流スイッチ素子Qfrのドレイン・ソース間にも、内蔵するボディダイオードDfoおよび寄生キャパシタンスCfoが並列接続される。またCgsfrは、転流スイッチ素子Qfrのゲート・ソース間容量である。同期整流回路2の出力側には、周知の出力チョークコイルLfおよび出力コンデンサCfからなる平滑回路が接続され、この出力コンデンサCfの両端間に直流出力電圧Voを供給するための出力端子3,4が接続される。
【0006】
転流スイッチ素子Qfrの放電ドライバ回路7は、トランスT1の二次巻線の非ドット側端子にアノードを接続し、転流スイッチ素子Qfrのゲートにカソードを接続したダイオードDgと、前記転流スイッチ素子Qfrのゲート・ソース間容量Cgsfrを放電させるための放電抵抗Rgsと、前記主スイッチング素子Qmと同期してオン,オフ動作するスイッチ素子Q3とにより構成される。そして、制御回路21からのパルス駆動信号が立ち上がって主スイッチング素子Qmがオンし、トランスT1の二次巻線のドット側端子に正極性の電圧が誘起されると、整流スイッチ素子Qfoのゲート電圧が上昇して、整流スイッチ素子Qfoは主スイッチング素子Qmのオンタイミングに同期してターンオンする一方で、放電ドライバ回路7を構成するダイオードDgはオフ状態となり、転流スイッチ素子Qfrはオフする。これにより、トランスT1の二次巻線から出力チョークコイルLfを介して、出力端子3,4の両端間に接続される負荷(図示せず)に出力電流が流れ、この出力電流に見合うエネルギーが出力チョークコイルLfに蓄えられる。
【0007】
やがて、パルス駆動信号の立ち下がりに伴ない主スイッチング素子Qmがオフし、トランスT1の二次巻線の非ドット側端子に正極性の電圧が発生すると、整流スイッチ素子Qfoのゲート電圧が下降して、整流スイッチ素子Qfoはオフする一方で、放電ドライバ回路7を構成するダイオードDgはオン状態となり、転流スイッチ素子Qfrのゲート電圧が上昇して、転流スイッチ素子Qfrは主スイッチング素子Qmのオフタイミングに同期してターンオンする。これにより、出力チョークコイルLfに蓄えられたエネルギーが、転流スイッチ素子Qfrを介して負荷側に供給される。
【0008】
そして、再び主スイッチング素子Qmがオンし、トランスT1の二次巻線のドット側端子に正極性の電圧が誘起されると、ダイオードDgはオフ状態となり、転流スイッチ素子Qfrのゲート・ソース間容量Cgsfrに蓄積された電荷が、主スイッチング素子Qmと共にターンオンしたスイッチ素子Q3により速やかに放電されるようになっている。
【0009】
【特許文献1】
特開2000−262052号公報
【特許文献2】
特開2000−350446号公報
【0010】
【発明が解決しようとする課題】
このように、上記同期整流方式のスイッチング電源装置では、主スイッチング素子Qmのスイッチングに同期して、整流スイッチ素子Qfoおよび転流スイッチ素子Qfrを交互にオンさせることで、ダイオード整流方式よりも遥かに小さな導通損失で、直流出力電圧Voを負荷に供給することができる。しかし、複数の電源ユニット8A,8B…から負荷に電力を供給するいわゆる並列運転時には、出力電圧Voの高い電源ユニット8Bから出力電圧Voの低い電源ユニット8Aに、電流が流れ続けることによる弊害が発生する。その動作原理を、図5の等価回路と図6における各部の波形図に基づき説明する。
【0011】
図6において、最上段にある波形は、主スイッチング素子Qmのドレイン・ソース間電圧Vdsmで、以下、出力チョークコイルLfを流れるチョーク電流iLf(出力側に向かう方が正方向),トランスT1の励磁インダクタンスLpを流れる励磁電流iLp,転流スイッチ素子Qfrのゲート・ソース間電圧Vgsfr,整流スイッチ素子Qfoのドレイン・ソース間電圧Vdsfoを示している。また図6の各波形は、図5の等価回路で示す出力電圧Voの低い方の電源ユニット8Aに関してのものである。
【0012】
制御回路21は、発振器20から周期的に発生する発振出力を基準信号として、直流出力電圧Voに応じたパルス導通幅のパルス駆動信号を主スイッチング素子Qmに与えている。ここで、並列運転時において出力電圧Voの低い方の電源ユニット8Aは、必要以上の出力電力を出さないように、発振器20からの発振出力に対して毎回ではなく間欠的にパルス駆動信号を与えるような制御、すなわち間欠発振を行なう。なお、こうした間欠発振は、入力電圧Viや負荷の急激な変動によって、若しくは電源装置の動作開始時においても、同様に発生する。
【0013】
制御回路21が間欠発振動作を行なうと、図5の等価回路に示すように、電源装置すなわちコンバータとしては、次に主スイッチング素子Q1mやスイッチ素子Q3にパルス駆動信号が発生するまで一時的な動作停止状態となる。その場合、図6に示すように、主スイッチング素子Qmをオンにするパルス駆動信号が、期間t1において制御回路21から与えられた後、次の期間t2に移行しても、転流スイッチ素子Qfrのゲート・ソース間に蓄積された電荷は直ぐには放電されず、転流スイッチ素子Qfrはオンしたままの状態になる。これにより、出力チョークコイルLfは、初めに自身に蓄えられたエネルギーを出力側に放出するため、正方向のチョーク電流iLfが流れるが、やがて全てのエネルギーを放出すると、今度は他の電源ユニット8Bの出力電圧Voを電源としてエネルギーを蓄積し、負方向に励磁され続ける。その結果、チョーク電流iLfは負方向に増加し、転流スイッチ素子Qfrに大きな電流ストレスが加わる(図6のP1参照)。
【0014】
その後、転流スイッチ素子Qfrのゲート・ソース間に蓄積された電荷が、抵抗Rgsにより自然放電して、この転流スイッチ素子Qfrがターンオフすると、図6に示す期間t3に移行し、出力チョークコイルLfのリセット電圧により整流スイッチ素子Qfoのゲート・ソース間電圧が上昇して、この整流スイッチ素子Qfoがターンオンする。これにより、出力チョークコイルLfには、Vi・n2/n1−Voなる電圧が正方向に加わって励磁され、前記負方向のチョーク電流iLfは減少に転じる。なお、この期間t3は、iLf>0となるまで続く。またこの期間t3中は、トランスT1の励磁インダクタンスLpが励磁され続ける。励磁インダクタンスLpが励磁される時間Tは、T=Lf・ILf1/(Vi・n2/n1−Vo)となる(但し、ILf1はチョーク電流iLfの最小値)。
【0015】
ここでの最小値ILf1は負方向に大きな電流値であるので、結果的に励磁インダクタンスLpが励磁される時間Tも長くなって、励磁インダクタンスLpに蓄えられるエネルギーが増大する。そのため、出力チョークコイルLfに蓄えられていたエネルギーが一旦全て放出し、iLf>0に達した後の期間t4において、転流スイッチ素子Qfrのゲート・ソース間および整流スイッチ素子Qfoのドレイン・ソース間には、励磁インダクタンスLpのリセットエネルギーの放出に伴なう過大な電圧ストレスが発生する(図6に示すP2およびP3を参照)。
【0016】
このように、主スイッチング素子Qmへのパルス駆動信号の供給を一時的にせよ休止して間欠発振を行なうと、出力端子3,4に接続した外部電源(この場合は、他の電源ユニット8B)から出力回路である同期整流回路2や出力平滑回路(出力チョークコイルLfおよび出力コンデンサCf)に電流が流れ続けて、転流スイッチ素子Qfrに過大な電流・電圧ストレスが発生すると共に、整流スイッチ素子Qfoにも過大な電圧ストレスが発生する。
【0017】
本発明は、上記の課題に着目して成されたものであって、その目的は、主スイッチング素子への駆動信号の供給が間欠的になっても、転流スイッチ素子に過大な電流・電圧ストレスが加わらないスイッチング電源装置を提供することにある。
【0018】
【課題を解決するための手段】
本発明におけるスイッチング電源装置は、上記目的を達成するために、主スイッチング素子のスイッチングによりトランスの一次巻線に入力電圧を断続的に印加し、前記トランスの二次巻線に発生した電圧を出力回路により整流平滑して出力電圧を取り出すと共に、前記出力回路は、前記主スイッチング素子のオン時にエネルギーを蓄えるチョークコイルと、前記主スイッチング素子のオフ時にターンオンして前記チョークコイルのエネルギーを出力側に送り出すMOS型FETからなる転流スイッチ素子とを少なくとも備えたスイッチング電源装置において、前記転流スイッチ素子のゲート・ソース間に蓄積した電荷を放電させるスイッチ素子と、このスイッチ素子にオンパルス信号を供給する制御手段とを備え、前記制御手段は、前記主スイッチング素子をスイッチングさせる毎に出力するパルス駆動信号の間隔が拡がっても、前記スイッチ素子に供給するオンパルス信号の間隔を一定時間以上に拡げないようにするパルス信号間隔制限手段を備えて構成される。
【0019】
この場合、例えば複数の電源装置による並列運転を行なっているときに、出力電圧の低い電源装置は、主スイッチング素子に供給する駆動信号の間隔を拡げる間欠発振を行なうようになるが、パルス信号間隔制限手段はスイッチ素子に供給するオンパルス信号の間隔を一定時間以上に拡げないように制限するので、転流スイッチ素子のゲートに蓄積した電荷はパルス信号間隔制限手段により所定のタイミングで強制的に放電され、転流スイッチ素子がターンオフする。したがって、転流スイッチ素子が長時間オンし続けることによる弊害、すなわち転流スイッチ素子に過大な電流・電圧ストレスが発生することを防止できる。
【0020】
【発明の実施形態】
以下、本発明における好ましい各実施態様について、添付図面を参照して詳細に説明する。なお、上記従来例と同一部分には同一符号を付し、その共通する箇所の説明は重複するため省略する。
【0021】
図1は、本発明の一実施例を示す回路図である。同図において、本実施例における転流スイッチ素子Qfrの放電ドライバ回路31は、転流スイッチ素子Qfrのゲート・ソース間に蓄積した電荷を放電するために、転流スイッチ素子Qfrのゲート・ソース間を開閉する例えばMOS型FETからなるスイッチ素子Q3が設けられる。また制御手段に相当する制御回路21は、発振器20の基準信号が出力される毎に、一定の導通幅を有するオンパルス信号をスイッチ素子Q3のゲートに供給するオンパルス発生回路22と、発振器20からの基準信号より所定時間遅らせて、出力電圧Voに応じた導通幅のパルス駆動信号を主スイッチング素子Qmのゲートに供給すると共に、出力電圧Voの低下時には発振器20の基準信号に対し間欠的に前記パルス駆動信号を発生させる駆動パルス発生回路23とにより構成される。すなわち、本実施例における制御回路21は、主スイッチング素子Qmをスイッチングさせるパルス駆動信号が、発振器20の基準信号タイミングに合わせて発生しない間欠発振となっても、すなわち各パルス駆動信号間の間隔が拡がっても、スイッチ素子Q3に供給するオンパルス信号の間隔を一定時間以上に拡げないようにするパルス信号間隔制限手段を、前記オンパルス発生回路22に備えている。なお、Rcfは、出力コンデンサCfの等価直列抵抗(ESR)である。それ以外の構成は、前記従来例における図4と共通している。
【0022】
次に、図2における等価回路と図3における各部の波形図に基づいて、上記構成についてその作用を説明する。なお同図において、最上段にある波形は、スイッチ素子Q3のゲート・ソース間電圧Vp1で、以下、主スイッチング素子Qmのドレイン・ソース間電圧Vdsm,出力チョークコイルLfのチョーク電流iLf,励磁インダクタンスLpを流れる励磁電流iLp,転流スイッチ素子Qfrのゲート・ソース間電圧Vgsfr,転流スイッチ素子Qfrのドレイン・ソース間電圧Vdsfr,整流スイッチ素子Qfoのドレイン・ソース間電圧Vdsfoをそれぞれ示している。また図3の各波形は、出力電圧Voの低い方の電源ユニット8Aに関してのものである。
【0023】
発振器20の基準信号よりも所定時間遅れて、駆動パルス発生回路23からのパルス駆動信号が立ち上がって、主スイッチング素子Qmがターンオンすると、トランスT1の二次側では整流スイッチ素子Qfoのゲート電圧が上昇して、整流スイッチ素子Qfoは主スイッチング素子Qmのオンタイミングに同期してターンオンする一方で、放電ドライバ回路7を構成するダイオードDgはオフ状態となり、転流スイッチ素子Qfrはオフする。これにより、トランスT1の二次巻線から出力チョークコイルLfを介して負荷に出力電流が流れ、この出力電流に見合うエネルギーが出力チョークコイルLfに蓄えられる。
【0024】
やがて、パルス駆動信号の立ち下がりに伴ない主スイッチング素子Qmがオフすると、トランスT1の二次側では整流スイッチ素子Qfoのゲート電圧が下降して、この整流スイッチ素子Qfoはオフする一方で、放電ドライバ回路7を構成するダイオードDgはオン状態となり、転流スイッチ素子Qfrのゲート電圧が上昇して、転流スイッチ素子Qfrは主スイッチング素子Qmのオフタイミングに同期してターンオンする。これにより、出力チョークコイルLfに蓄えられたエネルギーが、転流スイッチ素子Qfrを介して負荷側に供給される。
【0025】
その後、発振器20にて次の基準信号が発生すると、制御回路21のオンパルス発生回路22は、基準信号の発生タイミングに合せてスイッチ素子Q3のゲートにオンパルス信号を供給し、主スイッチング素子Qmへのパルス駆動信号を立ち上げる前に、このスイッチ素子Q3をターンオンさせ、転流スイッチ素子Qfrのゲート・ソース間を短絡する。これにより、主スイッチング素子Qmがターンオンする直前に、転流スイッチ素子Qfrのゲート・ソース間に蓄積された電荷を速やかに放電し、かつ転流スイッチ素子Qfrをターンオフさせることができる。駆動パルス発生回路22により、主スイッチング素子Qmへのパルス駆動信号の供給を、転流スイッチ素子Qfrのターンオフタイミングよりも意図的に遅らせる理由は、主スイッチング素子Qmと転流スイッチ素子Qfrが同時にオンして、転流スイッチ素子Qfrに貫通電流が流れることを確実に防止するためである。
【0026】
ところで、他の電源ユニット8Bと並列運転を行なっている出力電圧Voの低い電源ユニット8Aが間欠発振を行なっている場合、駆動パルス発生回路22からのパルス駆動信号は、発振器20の基準信号タイミングに対し毎回ではなく、何回かに一度だけ発生するようになる。このときの等価回路は図2に示すようになり、図3の状態1に示すように、主スイッチング素子Qmがターンオフすると、放電ドライバ回路7を構成するダイオードDgを介して、トランスT1の二次巻線に発生するリセット電圧が転流スイッチ素子Qfrのゲートに印加され、この転流スイッチ素子Qfrがターンオンする。すると出力チョークコイルLfは、初めに自身に蓄えられたエネルギーを出力側に放出するため、正方向のチョーク電流iLfが流れるが、やがて全てのエネルギーを放出すると、今度は他の電源ユニット8Bの出力電圧Voを電源としてエネルギーを蓄積し、転流スイッチ素子Qfrがターンオフするまでは負方向に励磁され続ける。その結果、チョーク電流iLfは負方向に増加する。因みに、このときのチョーク電流iLfの値は、チョーク電流iLfの最大値をILf0とし、他の電源ユニット8Bの出力電圧をVoとし、時間をtとすると、iLf=ILf0−Vo/Lf・tとなる。
【0027】
しかし本実施例では、発振器20から次の基準信号が発生すると、駆動パルス発生回路23が主スイッチング素子Qmにパルス駆動信号を供給するか否かに拘らず、オンパルス発生回路22は転流スイッチ素子Qfrをターンオフさせるためのオンパルス信号をスイッチ素子Q3のゲートに供給する。すなわち状態2に移行して、転流スイッチ素子Qfrがターンオフすると、出力チョークコイルLfのリセット電圧により整流スイッチ素子Qfoがターンオンし、出力チョークコイルLfには、Vi・n2/n1−Voなる電圧が正方向に加わって励磁され、前記負方向のチョーク電流iLfは減少に転じる。それと共に、トランスT1の励磁インダクタンスLpも直流入力電圧Viにより励磁される。この状態は、iLf・n2/n1>>iLpであると仮定すると、iLf>0となるまで続く。また、チョーク電流iLfの値は、このチョーク電流iLfの最大値をILf1とすると、iLf=ILf1+(Vi・n2/n1−Vo)/Lf・tとなる。
【0028】
やがて、チョーク電流iLfがゼロに戻ると(Lf>0)に戻ると、励磁インダクタンスLpに蓄積されたエネルギーによりトランスT1の二次巻線に再びリセット電圧が発生し、図3の状態1に戻る。上述したように、状態2では出力チョークコイルLfを流れる負方向のチョーク電流iLfがゼロにリセットされ、かつ状態2の最終的なチョーク電流iLfの値が、状態1のチョーク電流iLfの初期値となるため、チョーク電流iLfの最大値ILf0はゼロを越えたものとなる(ILf0>0)。したがって、状態1から状態2に移行する際の、負方向に流れるチョーク電流iLfの最大値は、ILf0がゼロとして考えた場合でも、−Vo/Lf・tに制限され、転流スイッチ素子Qfrに過大な電流・電圧ストレスが発生しなくなると共に、整流スイッチ素子Qfoにも過大な電圧ストレスが発生しなくなる。
【0029】
以上のように本実施例では、主スイッチング素子QmのスイッチングによりトランスT1の一次巻線に入力電圧Viを断続的に印加し、トランスT1の二次巻線に発生した電圧を出力回路(同期整流回路2,出力チョークコイルLf,出力コンデンサCf)により整流平滑して出力電圧Voを取り出すと共に、出力回路は、主スイッチング素子Qmのオン時にエネルギーを蓄えるチョークコイルとしての出力チョークコイルLfと、主スイッチング素子Qmのオフ時にターンオンして、出力チョークコイルLfのエネルギーを出力側に送り出すMOS型FETからなる転流スイッチ素子Qfrとを少なくとも備えたスイッチング電源装置において、転流スイッチ素子Qfrのゲート・ソース間に蓄積した電荷を放電させるスイッチ素子Q3と、このスイッチ素子Q3にオンパルス信号を供給する制御手段としての制御回路21を備え、この制御回路21は、主スイッチング素子Qmをスイッチングさせる毎に出力するパルス駆動信号の間隔が拡がっても、スイッチ素子Q3に供給するオンパルス信号の間隔を一定時間以上に拡げないようにするパルス信号間隔制限手段に相当するオンパルス発生回路22を備えている。
【0030】
この場合、例えば複数の電源装置による並列運転を行なっているときに、出力電圧Voの低い電源装置は、主スイッチング素子Qmに供給するパルス駆動信号の間隔を拡げる間欠発振を行なうようになるが、オンパルス発生回路22はスイッチ素子Q3に供給するオンパルス信号の間隔を一定時間以上に拡げないように制限するので、転流スイッチ素子Qfrのゲートに蓄積した電荷はオンパルス発生回路22により所定のタイミングで強制的に放電され、転流スイッチ素子Qfrもターンオフする。したがって、転流スイッチ素子Qfrが長時間オンし続けることによる弊害、すなわち転流スイッチ素子Qfrに過大な電流・電圧ストレスが発生することを防止できると共に、整流スイッチ素子Qfoに過大な電圧ストレスが発生することも同時に防止できる。また本実施例における回路は、入力電圧Viや負荷の急激な変動によって、若しくは電源装置の動作開始時において生じる間欠発振に対しても、同様に過大な電圧ストレスの発生を防止できる。
【0031】
また本実施例におけるオンパルス発生回路22は、本来主スイッチング素子Qmのパルス駆動信号の基準信号となる発振器20を利用して、この発振器20からの基準信号が発生する毎に、オンパルス信号をスイッチ素子Q3に供給するようにしている。そのため、オンパルス信号を生成する専用の発振手段を設けずに、所望の動作をスイッチ素子Q3に対し行わせることが可能になる。
【0032】
さらに、こうした構成において本実施例では、発振器20からの基準信号より所定時間遅らせて、出力電圧Voに応じた導通幅のパルス駆動信号を主スイッチング素子Qmのゲートに供給する駆動パルス発生回路23を備えている。このように主スイッチング素子Qmに供給するパルス駆動信号の発生タイミングを、オンパルス信号の発生タイミングよりも意図的に遅らせることで、転流スイッチ素子Qfrに貫通電流が流れることを確実に防止できる。
【0033】
なお、本発明は上記実施例に限定されるものではなく、種々の変形が可能である。例えば主スイッチング素子6は、実施例におけるMOS型FETに限らず、それ以外の各種のスイッチング素子を利用することができる。また本実施例では、スイッチ素子Q3のみを転流スイッチ素子Qfrのゲート・ソース間に接続しているが、電流制限用の抵抗とスイッチ素子Q3の直列回路を、転流スイッチ素子Qfrのゲート・ソース間に接続してもよい。
【0034】
【発明の効果】
本発明におけるスイッチング電源装置によれば、主スイッチング素子への駆動信号の供給が間欠的になっても、転流スイッチ素子に過大な電流・電圧ストレスが加わらないスイッチング電源装置を提供できる。
【図面の簡単な説明】
【図1】本発明の一実施例を示すスイッチング電源装置の回路図である。
【図2】同上間欠発振時におけるパルス駆動信号が停止している時の等価回路を表わした回路図である。
【図3】同上各部の動作状態を示す波形図である。
【図4】従来例におけるスイッチング電源装置の回路図である。
【図5】従来の間欠発振時におけるパルス駆動信号が停止している時の等価回路を表わした回路図である。
【図6】従来例における各部の動作状態を示す波形図である。
【符号の説明】
2 同期整流回路(出力回路)
21 制御回路(制御手段)
22 オンパルス発生回路(パルス信号間隔制限手段)
T1 トランス
Lf 出力チョークコイル(出力回路,チョークコイル)
Qfr 転流スイッチ素子
Qm 主スイッチング素子
Q3 スイッチ素子[0001]
TECHNICAL FIELD OF THE INVENTION
The present invention relates to a switching power supply device in which a synchronous rectification circuit including a rectification switch element composed of a MOS FET and a commutation switch element is connected to a secondary side of a transformer.
[0002]
[Prior art]
In general, a synchronous rectification type switching power supply device that alternately turns on and off a rectifying switch element and a commutation switch element composed of a MOS FET in synchronization with a main switching element is disclosed in, for example,
[0003]
FIG. 4 is a circuit diagram of a synchronous rectification type forward switching power supply device. In FIG. 1,
[0004]
On the other hand,
[0005]
The built-in body diode Dfo and the parasitic capacitance Cfo are connected in parallel between the drain and source of the rectifying switch element Qfo, and the built-in body diode Dfo and the parasitic capacitance are also connected between the drain and source of the commutation switch element Qfr. Cfo are connected in parallel. Cgsfr is the gate-source capacitance of the commutation switch element Qfr. The output side of the
[0006]
The
[0007]
Eventually, when the main switching element Qm is turned off with the fall of the pulse drive signal and a positive voltage is generated at the non-dot side terminal of the secondary winding of the transformer T1, the gate voltage of the rectifying switch element Qfo decreases. Then, while the rectifying switch element Qfo is turned off, the diode Dg constituting the
[0008]
Then, when the main switching element Qm is turned on again and a positive voltage is induced at the dot side terminal of the secondary winding of the transformer T1, the diode Dg is turned off, and the gate-source of the commutation switch element Qfr is turned off. The charge accumulated in the capacitor Cgsfr is quickly discharged by the switching element Q3 turned on together with the main switching element Qm.
[0009]
[Patent Document 1]
JP 2000-262052 A [Patent Document 2]
Japanese Patent Application Laid-Open No. 2000-350446
[Problems to be solved by the invention]
As described above, in the switching power supply device of the synchronous rectification method, the rectification switch element Qfo and the commutation switch element Qfr are alternately turned on in synchronization with the switching of the main switching element Qm, thereby far more than the diode rectification method. The DC output voltage Vo can be supplied to the load with a small conduction loss. However, during so-called parallel operation in which power is supplied from a plurality of
[0011]
In FIG. 6, the waveform at the top is the drain-source voltage Vdsm of the main switching element Qm. Hereinafter, the choke current iLf flowing through the output choke coil Lf (the direction toward the output side is positive), and the excitation of the transformer T1. It shows the exciting current iLp flowing through the inductance Lp, the gate-source voltage Vgsfr of the commutation switch element Qfr, and the drain-source voltage Vdsfo of the rectifier switch element Qfo. The waveforms in FIG. 6 relate to the
[0012]
The
[0013]
When the
[0014]
Thereafter, the charge accumulated between the gate and the source of the commutation switch element Qfr is spontaneously discharged by the resistor Rgs, and when the commutation switch element Qfr is turned off, the process proceeds to a period t3 shown in FIG. The voltage between the gate and the source of the rectifying switch element Qfo increases due to the reset voltage of Lf, and the rectifying switch element Qfo is turned on. As a result, a voltage of Vi · n2 / n1-Vo is applied to the output choke coil Lf in the positive direction to be excited, and the choke current iLf in the negative direction starts to decrease. This period t3 continues until iLf> 0. Further, during this period t3, the excitation inductance Lp of the transformer T1 is continuously excited. The time T during which the exciting inductance Lp is excited becomes T = Lf · ILf1 / (Vi · n2 / n1−Vo) (where ILf1 is the minimum value of the choke current iLf).
[0015]
Since the minimum value ILf1 here is a large current value in the negative direction, the time T during which the exciting inductance Lp is excited becomes longer as a result, and the energy stored in the exciting inductance Lp increases. Therefore, during the period t4 after the energy stored in the output choke coil Lf is once released and iLf> 0 is reached, between the gate and source of the commutation switch element Qfr and between the drain and source of the rectification switch element Qfo Causes excessive voltage stress due to the release of the reset energy of the excitation inductance Lp (see P2 and P3 shown in FIG. 6).
[0016]
As described above, when the supply of the pulse drive signal to the main switching element Qm is temporarily stopped even if the intermittent oscillation is performed, the external power supply connected to the
[0017]
SUMMARY OF THE INVENTION The present invention has been made in view of the above-described problems, and has as its object to provide a commutation switch element with an excessive current / voltage even when a drive signal is supplied to a main switching element intermittently. An object of the present invention is to provide a switching power supply device to which no stress is applied.
[0018]
[Means for Solving the Problems]
In order to achieve the above object, a switching power supply device according to the present invention intermittently applies an input voltage to a primary winding of a transformer by switching a main switching element and outputs a voltage generated in a secondary winding of the transformer. A circuit rectifies and smoothes to take out an output voltage, and the output circuit has a choke coil that stores energy when the main switching element is turned on, and turns on when the main switching element is turned off to output energy of the choke coil to the output side. In a switching power supply device including at least a commutation switch element composed of a MOS type FET to send out, a switch element for discharging electric charges accumulated between a gate and a source of the commutation switch element, and an on-pulse signal is supplied to the switch element. Control means, wherein the control means is Even if the interval of the pulse drive signal output every time the switching of the switching element is expanded, the pulse signal interval limiting means is provided to prevent the interval of the on-pulse signal supplied to the switch element from being expanded beyond a certain time. .
[0019]
In this case, for example, when performing parallel operation by a plurality of power supply devices, the power supply device having a low output voltage performs intermittent oscillation to increase the interval between drive signals supplied to the main switching element. Since the limiter limits the interval of the ON pulse signal supplied to the switch element so as not to extend beyond a certain time, the charge accumulated in the gate of the commutation switch element is forcibly discharged at a predetermined timing by the pulse signal interval limiter. The commutation switch element is turned off. Therefore, it is possible to prevent an adverse effect caused by the commutation switch element being kept on for a long time, that is, generation of excessive current / voltage stress in the commutation switch element.
[0020]
DETAILED DESCRIPTION OF THE INVENTION
Hereinafter, preferred embodiments of the present invention will be described in detail with reference to the accompanying drawings. The same parts as those of the above-described conventional example are denoted by the same reference numerals, and the description of the common parts will be omitted because they are duplicated.
[0021]
FIG. 1 is a circuit diagram showing one embodiment of the present invention. In the figure, the
[0022]
Next, the operation of the above configuration will be described based on the equivalent circuit in FIG. 2 and the waveform diagrams of the respective parts in FIG. In the figure, the waveform at the top is the gate-source voltage Vp1 of the switching element Q3. Hereinafter, the drain-source voltage Vdsm of the main switching element Qm, the choke current iLf of the output choke coil Lf, and the excitation inductance Lp , The gate-source voltage Vgsfr of the commutation switch element Qfr, the drain-source voltage Vdsfr of the commutation switch element Qfr, and the drain-source voltage Vdsfo of the rectification switch element Qfo. Each waveform in FIG. 3 relates to the
[0023]
When a pulse drive signal from the drive
[0024]
Eventually, when the main switching element Qm is turned off in response to the fall of the pulse drive signal, the gate voltage of the rectifying switch element Qfo decreases on the secondary side of the transformer T1, and the rectifying switch element Qfo is turned off while discharging. The diode Dg constituting the
[0025]
Thereafter, when the next reference signal is generated by the
[0026]
By the way, when the power supply unit 8 </ b> A having a low output voltage Vo performing the parallel operation with the other power supply unit 8 </ b> B is performing intermittent oscillation, the pulse drive signal from the drive
[0027]
However, in the present embodiment, when the next reference signal is generated from the
[0028]
Eventually, when the choke current iLf returns to zero (Lf> 0), a reset voltage is again generated in the secondary winding of the transformer T1 by the energy stored in the exciting inductance Lp, and the state returns to the
[0029]
As described above, in the present embodiment, the input voltage Vi is intermittently applied to the primary winding of the transformer T1 by the switching of the main switching element Qm, and the voltage generated in the secondary winding of the transformer T1 is output to the output circuit (synchronous rectification).
[0030]
In this case, for example, when performing parallel operation by a plurality of power supply devices, the power supply device having a low output voltage Vo performs intermittent oscillation for increasing the interval of the pulse drive signal supplied to the main switching element Qm. Since the on-
[0031]
Further, the on-
[0032]
Furthermore, in this embodiment, in this embodiment, the drive
[0033]
It should be noted that the present invention is not limited to the above embodiment, and various modifications are possible. For example, the
[0034]
【The invention's effect】
ADVANTAGE OF THE INVENTION According to the switching power supply device in this invention, even if supply of a drive signal to a main switching element becomes intermittent, a switching power supply apparatus which does not apply an excessive current and voltage stress to a commutation switching element can be provided.
[Brief description of the drawings]
FIG. 1 is a circuit diagram of a switching power supply device showing one embodiment of the present invention.
FIG. 2 is a circuit diagram showing an equivalent circuit when a pulse drive signal is stopped during the same intermittent oscillation.
FIG. 3 is a waveform chart showing an operation state of each section of the above.
FIG. 4 is a circuit diagram of a conventional switching power supply device.
FIG. 5 is a circuit diagram showing an equivalent circuit when a pulse drive signal is stopped at the time of conventional intermittent oscillation.
FIG. 6 is a waveform diagram showing an operation state of each unit in a conventional example.
[Explanation of symbols]
2 Synchronous rectifier circuit (output circuit)
21 control circuit (control means)
22 On-pulse generation circuit (pulse signal interval limiting means)
T1 transformer Lf output choke coil (output circuit, choke coil)
Qfr Commutation switch element Qm Main switching element Q3 Switch element
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