JP2003264286A - 超接合半導体素子の製造方法 - Google Patents
超接合半導体素子の製造方法Info
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Abstract
層を有する超接合半導体素子を簡易に量産性よく製造す
ること。 【解決手段】 低抵抗層31の表面に、低抵抗層31よ
りも抵抗の大きい高比抵抗層32をエピタキシャル成長
させる工程と、エピタキシャル成長させた高比抵抗層3
2にボロンおよびリンのイオンビーム照射をおこなう工
程とを、同一チャンバー内で繰り返し交互におこなう。
その際、イオンビーム照射時のチャンバー内圧力をエピ
タキシャル成長時よりも低くし、イオンビームの散乱を
抑制する。
Description
容量化を両立させることのできる超接合半導体素子の製
造方法に関し、特に並列pn接合層を備えたMOSFE
T(絶縁ゲート型電界効果トランジスタ)、IGBT
(絶縁ゲート型バイポーラトランジスタ)、バイポーラ
トランジスタまたはダイオード等の超接合半導体素子の
製造方法に関する。
圧を得るために高比抵抗のドリフト領域を主電流経路に
設けるため、高耐圧のものほどこの部分の電圧降下が大
きくなってオン電圧が高くなるという問題があった。こ
の問題に対する解決法として、ドリフト層を、不純物濃
度を高めたn型の領域とp型の領域とを交互に積層した
並列pn層で構成し、オフ状態のときは空乏化して耐圧
を負担するようにした構造の半導体装置が、たとえば米
国特許第5216275号明細書などに開示されてい
る。
うに第1導電型(たとえば、n型)のドリフト領域と第
2導電型(たとえば、p型)の仕切り領域とを交互に繰
り返して接合した構造のことである。また、超接合半導
体素子とは、オン状態では電流を流し、一方、オフ状態
では空乏化する並列pn接合層からなるドリフト領域を
備えた半導体素子のことである。
として、エピタキシャル成長によってトレンチ構造を埋
め込む方法が公知である。しかし、この方法では、トレ
ンチのアスペクト比が高いため、トレンチ形成時に基板
に除去不能なダメージが生じるという問題点がある。ま
た、トレンチ内を高品質のエピタキシャル層で埋め込む
のは極めて困難であるなどの問題点もある。
板上に高抵抗の半導体層をエピタキシャル成長させなが
ら、そのエピタキシャル成長層にn型不純物とp型不純
物のイオンビームを照射して選択的にイオン注入するこ
とによって、並列pn接合層を形成する方法について、
先に出願している(特開2001−168036号)。
この方法によれば、並列pn接合層を容易に形成するこ
とができるという効果が得られる。
の発明者らの検討により、上記特開2001−1680
36号公報による並列pn接合層の形成方法では、ソー
スガスの供給によりエピタキシャル成長中のチャンバー
内圧力が100〜3000Paと比較的高い、すなわち
真空度が低いため、イオンビームが散乱されやすく、並
列pn接合層の不純物濃度にばらつきが生じるおそれの
あることが判明した。
ものであって、不純物濃度のばらつきが小さい並列pn
接合層を有する超接合半導体素子を簡易に量産性よく製
造することができる超接合半導体素子の製造方法を提供
することを目的とする。
め、本発明は、第1の主面と第2の主面との間に、低抵
抗層と、オン状態では電流が流れ、かつp型領域とn型
領域とが交互に配置された構成の並列pn接合層とを備
えた超接合半導体素子の製造方法において、前記低抵抗
層の表面に前記低抵抗層よりも抵抗の大きい高比抵抗層
をエピタキシャル成長させる工程と、前記エピタキシャ
ル成長工程につづいて同一チャンバー内で、チャンバー
内圧力がエピタキシャル成長時よりも低い状態で、前記
高比抵抗層に所定の不純物をイオンビーム照射により選
択的に注入する工程と、前記高比抵抗層に注入された不
純物を熱処理により拡散させて前記並列pn接合層を形
成する工程と、を含むことを特徴とする。この発明によ
れば、エピタキシャル成長時のチャンバー内圧力よりも
低い圧力でイオンビームが照射されるため、イオンビー
ムの散乱が抑制され、不純物濃度のばらつきの小さい並
列pn接合層が形成される。
長と前記イオンビーム照射とを繰り返しおこなった後、
前記熱処理をおこなう構成としてもよい。このようにす
れば、所望の厚さを有する並列pn接合層が形成され
る。
ム照射時のチャンバー内圧力を1×10-2Pa以下とし
てもよい。この場合には、イオンビームが散乱されにく
くなり、並列pn接合層の不純物濃度のばらつきが抑制
される。
ム照射時のイオン種をボロン、リン、またはボロンとリ
ンの組み合わせとしてもよい。この構成によれば、たと
えばボロンの注入によってp型領域が形成され、リンの
注入によってn型領域が形成される。
ム照射時にビーム径を変化させることにより異なる幅の
並列pn接合層を形成する構成としてもよい。このよう
にすれば、異なるピッチを有する並列pn接合層が形成
され、狭いピッチの並列pn接合層では熱処理時の相互
拡散によって不純物濃度が低くなり、電界が緩和されや
すくなるため、この領域での耐圧が向上する。
ムの平均自由工程を、イオンビーム銃と半導体素子間の
距離の10倍以上としてもよい。この場合には、イオン
ビームが散乱されにくくなり、並列pn接合層の不純物
濃度のばらつきが抑制される。
を用いて説明する。 実施の形態1.図1は実施の形態1において用いられる
枚葉式のエピタキシャル成長炉の断面模式図である。こ
のエピタキシャル成長炉では、ソースガス導入口1およ
びソースガス排気口2を備えたチャンバー3に、ボロン
照射用イオンビーム銃4およびリン照射用イオンビーム
銃5を複数備えている。また、サセプタ6を加熱するた
めに、RFコイル7がサセプタ6の直下に敷設され、エ
ピタキシャル基板8はサセプタ6の上に設置される。
キシャル基板8との間の距離dはイオンビームの平均自
由工程λの1/10以下である。すなわち、各イオンビ
ーム銃4,5は、λ≧10dとなる位置に設置されてい
る。その理由は、イオンビーム中のイオン種がエピタキ
シャル基板8に達するまでに残留ガス分子に衝突する回
数はd/λで表されるが、この衝突回数を1/10以下
に低減するためである。つまり、衝突回数が小さいほど
イオンビームが散乱されにくくなるため、エピタキシャ
ル基板8に導入される不純物量がより正確になり、並列
pn接合層の濃度のばらつきが抑制されるからである。
換言すれば、イオンビームの衝突は、並列pn接合層の
濃度ばらつきの原因となる。
00V、2300V、4500V)における耐圧と並列
pn接合層の濃度との関係を示す。図14において、縦
軸は最大耐圧BVmaxを1としたときの耐圧比であ
り、横軸は最大耐圧BVmaxが得られるときの濃度を
1としたときの濃度比である。図14より、最大耐圧が
大きくなる、すなわち高耐圧化するのに伴って、濃度の
ばらつきに対する耐圧低下の程度が急激になっているこ
とがわかる。
の耐圧を得るために許容される濃度ばらつきと最大耐圧
との関係を示す。図15において、縦軸は許容濃度ばら
つき[%]であり、横軸は最大耐圧[V]である。図1
5より、最大耐圧が大きくなるのに伴って、許容濃度ば
らつきが急激に小さくなっていることがわかる。
の濃度ばらつきがあると仮定すると、740Vクラスで
は最大耐圧の90%以上の耐圧が得られる。それに対し
て、2300Vクラスで耐圧を最大耐圧の95%以上に
するためには濃度のばらつきを2%程度にする必要であ
る。また、4500Vクラスでは、最大耐圧の95%以
上の耐圧を得るには濃度のばらつきを1%程度に抑える
必要がある。
濃度ばらつきの原因であり、衝突回数が1/10になれ
ば濃度のばらつきも1/10になるため、通常の濃度ば
らつき13%に対して、λ=10dにセッティングする
ことによって濃度ばらつきを1.3%に抑えることが可
能となる。さらに、λ=100dとすれば0.13%の
濃度ばらつきに抑えることが可能となる。したがって、
本実施の形態ではλ≧10dである。
はチャンバー内圧力の影響を受ける。チャンバー内に存
在する分子の密度をn[cm-3]、チャンバー内圧力を
p[Torr]、絶対温度をT[K]とすると、気体運
動論によればつぎの(1)式が成り立つ。
ースガス分子の分子半径をr2[cm]とすると、平均
自由工程λ[cm]はつぎの(2)式で表される。
すると、つぎの(3)式が得られる。
r2を1×10-8[cm]と仮定すると、つぎの(4)
式が得られる。圧力の単位がPaの場合は(5)式とな
る。
ー内圧力が10-2Paの場合には、平均自由工程λは4
000cmとなる。比較として、前記特開2001−1
68036号公報による従来技術において、チャンバー
内圧力を1mTorrとすると平均自由工程λは300
cmとなる。イオンビーム銃とエピタキシャル基板との
間の距離dを300cmとすれば、従来はエピタキシャ
ル基板にイオンビームが到達する以前に必ず衝突が起こ
ることになる。
ンバー内圧力を10-2Paとすれば、衝突回数は300
/4000回、すなわち0.075回である。したがっ
て、本実施の形態においてチャンバー内圧力を10-2P
aとすることによって、濃度のばらつきを1/0.07
5=13.3倍抑えることができる。換言すれば、前記
特開2001−168036号公報による従来技術によ
る13.3%の濃度ばらつきを1%に抑えることができ
る。
ャンバー内圧力は10-3Paであるとよく、さらに望ま
しくは10-4Paであるとよい。その場合には、濃度ば
らつきをそれぞれ0.1%および0.01%に抑えるこ
とが可能となり、事実上ばらつきがないものとすること
ができる。また、10-4Pa以下の圧力であれば、イオ
ン電荷の中性化も回避される。また、最大耐圧4500
V以上の高耐圧クラスにおいてもばらつきの低減が可能
となる。
ビーム銃を備えた枚葉式のエピタキシャル成長炉を用い
た場合の超接合基板の製造方法について説明する。図2
〜図5は、図1の枚葉式のエピタキシャル成長炉によ
る、超接合基板の製造工程を順に示す模式図である。
ス導入口1よりSiCl4などのソースガスを導入し
て、n型の低抵抗半導体基板よりなる低抵抗層31の上
に、低濃度(1×1013cm-3程度)のn-高比抵抗層
32を約8μmの厚さで成膜する(図2)。エピタキシ
ャル成長中のチャンバー内圧力はおおむね100〜30
00Paの範囲であり、特に限定しないが、たとえば本
実施の形態では400Paとする。たとえばMOSFE
Tの場合、低抵抗層31はn+ドレイン層となる。
ャンバー3内にエピタキシャル基板8を入れたまま、チ
ャンバー3内のソースガスを排気口2より排気して、イ
オンビームが散乱しにくい圧力まで真空度を高めた後、
選択的にボロンとリンのイオンビーム照射をおこない、
n-高比抵抗層32の表面にボロンビーム照射領域34
とリンビーム照射領域35を交互に設ける(図3)。イ
オンビーム照射時のチャンバー内圧力は上述したように
10-2Pa以下であるのが適当であるが、本実施の形態
では、イオン電荷の中性化を実質的になくすため、特に
限定しないが、たとえば10-6Paとする。
注入量は等しいことが望ましい。これは、最終的にリン
ビーム照射領域35がnドリフト領域となり、ボロンビ
ーム照射領域34がp仕切り領域となったときに、両者
の空乏層の広がりが同じになるからである。また、リン
ビーム照射領域35およびボロンビーム照射領域34の
幅は等しくすることが望ましい。本実施の形態ではリン
ビーム照射領域35およびボロンビーム照射領域34の
幅はたとえば3μmであり、リンおよびボロンの各注入
量はたとえば3.6×1013cm-2である。
びチャンバー3内にソースガスを導入し、再度上述した
要領でエピタキシャル成長をおこない、n-高抵抗層3
2を形成する。その後、再び上述した要領でチャンバー
3内を減圧し、リンおよびボロンのイオンビーム照射を
おこなう。このようにエピタキシャル基板8をチャンバ
ー3内に入れたまま、エピタキシャル成長とイオンビー
ム照射を複数回繰り返し、並列pn接合層を所定の厚さ
にする。特に限定しないが、本実施の形態では、エピタ
キシャル成長とイオンビーム照射の工程をたとえば6回
繰り返しおこなう。
抗層32をエピタキシャル法により約4μm成長させる
(図4)。これにより、エピタキシャル成長によって形
成された熱処理前の並列pn接合層の厚さは、たとえば
52μmとなる。この後、エピタキシャル基板8をチャ
ンバー3内から取り出し、熱処理をおこない、注入され
た不純物を拡散させて並列pn接合層のp仕切り領域3
6とnドリフト領域37を形成する(図5)。
の熱処理により、nドリフト領域37とp仕切り領域3
6とが接続し、各nドリフト領域37および各p仕切り
領域36の幅は6μmとなり、並列pn接合層としては
12μmとなる。なお、ビーム照射幅や不純物のドーズ
量や熱処理時間等を変えることによって、最終的な並列
pn接合層のnドリフト領域37とp仕切り領域36の
条件は変更可能である。
同一チャンバー3内でエピタキシャル成長と、エピタキ
シャル成長時よりも低い圧力でのイオンビーム照射とを
交互に繰り返しおこなうことによって、簡易に量産性よ
く並列pn接合層が製造される。したがって、ばらつき
の小さい超接合半導体素子を簡易に量産性よく製造する
ことができる。なお、多数のイオンビーム銃を並列に、
かつ等間隔で配置するようにしても、nドリフト領域3
7とp仕切り領域36の幅を等しくすることができる。
この場合には、イオン注入用のレジストマスクを形成す
る必要がない。つまり、フォトリソグラフィーをおこな
わずに並列pn接合層を形成することができる。
て用いられる枚葉式のエピタキシャル成長炉の断面模式
図である。このエピタキシャル成長炉では、ソースガス
導入口1およびソースガス排気口2を備えたチャンバー
3に、ボロン照射用イオンビーム銃4を複数備えてい
る。リン照射用イオンビーム銃は設けられていない。ま
た、サセプタ6を加熱するために、RFコイル7がサセ
プタ6の直下に敷設され、エピタキシャル基板8はサセ
プタ6の上に設置される。
ピタキシャル基板8との間の距離dと、イオンビームの
平均自由工程λとの関係や、イオンビーム照射時のチャ
ンバー内圧力などは実施の形態1と同じである。したが
って、説明を省略する。
みを備えた枚葉式のエピタキシャル成長炉を用いた場合
の超接合基板の製造方法について説明する。図7〜図9
は、図6の枚葉式のエピタキシャル成長炉による、超接
合基板の製造工程を順に示す模式図である。
抵抗半導体基板よりなる低抵抗層31の上に、不純物濃
度が3.6×1015cm-3程度のn型半導体層33を約
8μmの厚さで成膜する(図7)。エピタキシャル成長
中のチャンバー内圧力はおおむね100〜3000Pa
の範囲である。
ャル基板8を入れたまま、チャンバー3内を10-2Pa
以下、たとえば10-6Paまで排気して、ボロンのイオ
ンビーム照射によりn型半導体層33の表面にボロンビ
ーム照射領域34を選択的に設ける(図8)。本実施の
形態では、ボロンビーム照射領域34の幅はたとえば3
μmであり、ボロンの注入量はたとえば1.2×1013
cm-2である。
板8をチャンバー3内に入れたまま、エピタキシャル成
長とイオンビーム照射を複数回繰り返し、並列pn接合
層を所定の厚さにする。特に限定しないが、本実施の形
態では、エピタキシャル成長とイオンビーム照射の工程
をたとえば6回繰り返しおこなう。その後、基板表面
に、不純物濃度が3.6×1015cm-3程度の低濃度n
型半導体層33をエピタキシャル法により約4μm成長
させる(図9)。
ー3内から取り出し、熱処理をおこない、注入されたボ
ロンを拡散させて並列pn接合層のp仕切り領域36お
よびnドリフト領域37を形成する(図5)。nドリフ
ト領域37は、エピタキシャル成長したn型半導体層3
3である。本実施の形態では、1150℃で10時間の
熱処理により、6μm幅のnドリフト領域37と6μm
幅のp仕切り領域36とが接続し、並列pn接合層とし
ては12μmとなる。なお、ビーム照射幅や不純物のド
ーズ量や熱処理時間等を変えることによって、最終的な
並列pn接合層のnドリフト領域37とp仕切り領域3
6の条件は変更可能である。
実施の形態1と同様に、簡易に量産性よく並列pn接合
層が製造されるので、ばらつきの小さい超接合半導体素
子を簡易に量産性よく製造することができる。なお、実
施の形態2の方法は、p型低抵抗半導体基板上にp型半
導体層を形成し、選択的にリンを注入する場合にも適用
可能である。この場合には、複数のリン照射用イオンビ
ーム銃を備えた枚葉式のエピタキシャル成長炉を用いる
ことが有効である。
いて用いられる枚葉式のエピタキシャル成長炉の断面模
式図である。このエピタキシャル成長炉では、ソースガ
ス導入口1およびソースガス排気口2を備えたチャンバ
ー3に、ボロン照射用イオンビーム銃4とリン照射用イ
オンビーム銃5を各1台ずつ備えている。また、サセプ
タ6を加熱するために、RFコイル7がサセプタ6の直
下に敷設され、エピタキシャル基板8はサセプタ6の上
に設置される。
ャル基板8との間の距離dと、イオンビームの平均自由
工程λとの関係や、イオンビーム照射時のチャンバー内
圧力などは実施の形態1と同じである。したがって、説
明を省略する。
を用いた場合には、ボロン照射用イオンビーム銃4およ
びリン照射用イオンビーム銃5が各1台ずつしかない。
そのため、実施の形態3では、これら1台ずつのイオン
ビーム銃4,5を走査することにより、並列pn接合層
を形成する。製造方法のその他の点については実施の形
態1と同じである。実施の形態3によれば、ボロン照射
用とリン照射用のイオンビーム銃4,5が1台ずつであ
るため、エピタキシャル成長炉のコストを低く抑えるこ
とができる。
エピタキシャル成長炉は基本的に図10に示す構成と同
じである。また、イオンビーム銃4,5とエピタキシャ
ル基板8との間の距離dと、イオンビームの平均自由工
程λとの関係や、イオンビーム照射時のチャンバー内圧
力などは実施の形態1と同じである。したがって、重複
する説明を省略する。
る製造方法による超接合基板の製造工程を順に示す模式
図である。まず、チャンバー3内において、n型の低抵
抗半導体基板よりなる低抵抗層31の上に、低濃度(1
×1013cm-3程度)のn-高比抵抗層32を約8μm
の厚さで成膜する(図11)。エピタキシャル成長中の
チャンバー内圧力はおおむね100〜3000Paの範
囲である。
ャル基板8を入れたまま、チャンバー3内を10-2Pa
以下、たとえば10-6Paまで排気して、ボロンおよび
リンのイオンビーム照射をおこなう。このとき、ピッチ
が広い並列pn接合層を形成する領域に対しては、ビー
ム径を太くして走査し、一方、ピッチが狭い並列pn接
合層を形成する領域に対してはビーム径を細くして走査
する。
すように、ピッチが広いボロンビーム照射領域34およ
びリンビーム照射領域35と、ピッチが狭いボロンビー
ム照射領域38およびリンビーム照射領域39が形成さ
れる。本実施の形態では、特に限定しないが、たとえば
ピッチが広い領域でのビーム銃の走査をビーム径3μm
でおこない、狭いピッチの領域ではビーム径を1.5μ
mとして走査する。
板8をチャンバー3内に入れたまま、エピタキシャル成
長とイオンビーム照射を複数回、たとえば6回繰り返
し、並列pn接合層を所定の厚さにする。その後、基板
表面に高比抵抗層32をエピタキシャル法により約4μ
m成長させる(図12)。そして、エピタキシャル基板
8をチャンバー3内から取り出し、熱処理をおこない、
注入された不純物を拡散させて幅が広い並列pn接合層
のp仕切り領域36およびnドリフト領域37と、幅が
狭い並列pn接合層のp仕切り領域40およびnドリフ
ト領域41を形成する(図13)。
pn接合層では、最終的な熱処理による相互拡散によっ
て濃度が低くなり、電界が緩和されやすくなるため、耐
圧が向上する。したがって、狭いピッチの並列pn接合
層を耐圧構造部などに配置することが可能となる。な
お、エピタキシャル成長炉を、ボロンおよびリンのそれ
ぞれに対してビーム径が太いイオンビーム銃とビーム径
が細いイオンビーム銃とをそれぞれ1台以上ずつ備えた
構成としても同様の効果が得られる。
のチャンバー内圧力よりも低い圧力でイオンビームが照
射されるため、イオンビームの散乱が抑制され、不純物
濃度のばらつきの小さい並列pn接合層が形成される。
したがって、ばらつきの小さい超接合半導体素子を簡易
に量産性よく製造することができる。
ン照射用の複数のビーム銃を備えた枚葉式のエピタキシ
ャル成長炉の断面模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
射用のビーム銃を備えた枚葉式のエピタキシャル成長炉
の断面模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
造される超接合基板の製造段階における構成を示す断面
模式図である。
のビーム銃とリン照射用のビーム銃とを各1台備えた枚
葉式のエピタキシャル成長炉の断面模式図である。
り製造される超接合基板の製造段階における構成を示す
断面模式図である。
り製造される超接合基板の製造段階における構成を示す
断面模式図である。
り製造される超接合基板の製造段階における構成を示す
断面模式図である。
V、4500Vにおける耐圧と並列pn接合層の濃度と
の関係を規格化して示す特性図である。
濃度ばらつきと最大耐圧との関係を示す特性図である。
Claims (6)
- 【請求項1】 第1の主面と第2の主面との間に、低抵
抗層と、オン状態では電流が流れ、かつp型領域とn型
領域とが交互に配置された構成の並列pn接合層とを備
えた超接合半導体素子の製造方法において、 前記低抵抗層の表面に前記低抵抗層よりも抵抗の大きい
高比抵抗層をエピタキシャル成長させる工程と、 前記エピタキシャル成長工程につづいて同一チャンバー
内で、チャンバー内圧力がエピタキシャル成長時よりも
低い状態で、前記高比抵抗層に所定の不純物をイオンビ
ーム照射により選択的に注入する工程と、 前記高比抵抗層に注入された不純物を熱処理により拡散
させて前記並列pn接合層を形成する工程と、 を含むことを特徴とする超接合半導体素子の製造方法。 - 【請求項2】 前記エピタキシャル成長と前記イオンビ
ーム照射とを繰り返しおこなった後、前記熱処理をおこ
なうことを特徴とする請求項1に記載の超接合半導体素
子の製造方法。 - 【請求項3】 前記イオンビーム照射時のチャンバー内
圧力を1×10-2Pa以下とすることを特徴とする請求
項1または2に記載の超接合半導体素子の製造方法。 - 【請求項4】 前記イオンビーム照射時のイオン種をボ
ロン、リン、またはボロンとリンの組み合わせとするこ
とを特徴とする請求項1〜3のいずれか一つに記載の超
接合半導体素子の製造方法。 - 【請求項5】 前記イオンビーム照射時にビーム径を変
化させることにより異なる幅の並列pn接合層を形成す
ることを特徴とする請求項1〜4のいずれか一つに記載
の超接合半導体素子の製造方法。 - 【請求項6】 前記イオンビームの平均自由工程を、イ
オンビーム銃と半導体素子間の距離の10倍以上とする
ことを特徴とする請求項1〜5のいずれか一つに記載の
超接合半導体素子の製造方法。
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-
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